TimeQuest Timing Analyzer report for ds18b20_seg7
Fri May 04 14:48:49 2012
Quartus II Version 11.0 Build 157 04/27/2011 SJ Full Version


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; Table of Contents ;
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  1. Legal Notice
  2. TimeQuest Timing Analyzer Summary
  3. Parallel Compilation
  4. Clocks
  5. Slow 1200mV 85C Model Fmax Summary
  6. Slow 1200mV 85C Model Setup Summary
  7. Slow 1200mV 85C Model Hold Summary
  8. Slow 1200mV 85C Model Recovery Summary
  9. Slow 1200mV 85C Model Removal Summary
 10. Slow 1200mV 85C Model Minimum Pulse Width Summary
 11. Slow 1200mV 85C Model Setup: 'ds18b20_drive:ds18b20_u0|clk_1us'
 12. Slow 1200mV 85C Model Setup: 'CLOCK_50'
 13. Slow 1200mV 85C Model Hold: 'CLOCK_50'
 14. Slow 1200mV 85C Model Hold: 'ds18b20_drive:ds18b20_u0|clk_1us'
 15. Slow 1200mV 85C Model Minimum Pulse Width: 'CLOCK_50'
 16. Slow 1200mV 85C Model Minimum Pulse Width: 'ds18b20_drive:ds18b20_u0|clk_1us'
 17. Setup Times
 18. Hold Times
 19. Clock to Output Times
 20. Minimum Clock to Output Times
 21. Slow 1200mV 85C Model Metastability Report
 22. Slow 1200mV 0C Model Fmax Summary
 23. Slow 1200mV 0C Model Setup Summary
 24. Slow 1200mV 0C Model Hold Summary
 25. Slow 1200mV 0C Model Recovery Summary
 26. Slow 1200mV 0C Model Removal Summary
 27. Slow 1200mV 0C Model Minimum Pulse Width Summary
 28. Slow 1200mV 0C Model Setup: 'ds18b20_drive:ds18b20_u0|clk_1us'
 29. Slow 1200mV 0C Model Setup: 'CLOCK_50'
 30. Slow 1200mV 0C Model Hold: 'ds18b20_drive:ds18b20_u0|clk_1us'
 31. Slow 1200mV 0C Model Hold: 'CLOCK_50'
 32. Slow 1200mV 0C Model Minimum Pulse Width: 'CLOCK_50'
 33. Slow 1200mV 0C Model Minimum Pulse Width: 'ds18b20_drive:ds18b20_u0|clk_1us'
 34. Setup Times
 35. Hold Times
 36. Clock to Output Times
 37. Minimum Clock to Output Times
 38. Slow 1200mV 0C Model Metastability Report
 39. Fast 1200mV 0C Model Setup Summary
 40. Fast 1200mV 0C Model Hold Summary
 41. Fast 1200mV 0C Model Recovery Summary
 42. Fast 1200mV 0C Model Removal Summary
 43. Fast 1200mV 0C Model Minimum Pulse Width Summary
 44. Fast 1200mV 0C Model Setup: 'ds18b20_drive:ds18b20_u0|clk_1us'
 45. Fast 1200mV 0C Model Setup: 'CLOCK_50'
 46. Fast 1200mV 0C Model Hold: 'CLOCK_50'
 47. Fast 1200mV 0C Model Hold: 'ds18b20_drive:ds18b20_u0|clk_1us'
 48. Fast 1200mV 0C Model Minimum Pulse Width: 'CLOCK_50'
 49. Fast 1200mV 0C Model Minimum Pulse Width: 'ds18b20_drive:ds18b20_u0|clk_1us'
 50. Setup Times
 51. Hold Times
 52. Clock to Output Times
 53. Minimum Clock to Output Times
 54. Fast 1200mV 0C Model Metastability Report
 55. Multicorner Timing Analysis Summary
 56. Setup Times
 57. Hold Times
 58. Clock to Output Times
 59. Minimum Clock to Output Times
 60. Board Trace Model Assignments
 61. Input Transition Times
 62. Slow Corner Signal Integrity Metrics
 63. Fast Corner Signal Integrity Metrics
 64. Setup Transfers
 65. Hold Transfers
 66. Report TCCS
 67. Report RSKM
 68. Unconstrained Paths
 69. TimeQuest Timing Analyzer Messages



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; Legal Notice ;
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Copyright (C) 1991-2011 Altera Corporation
Your use of Altera Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
functions, and any output files from any of the foregoing 
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; TimeQuest Timing Analyzer Summary                                      ;
+--------------------+---------------------------------------------------+
; Quartus II Version ; Version 11.0 Build 157 04/27/2011 SJ Full Version ;
; Revision Name      ; ds18b20_seg7                                      ;
; Device Family      ; Cyclone III                                       ;
; Device Name        ; EP3C16Q240C8                                      ;
; Timing Models      ; Final                                             ;
; Delay Model        ; Combined                                          ;
; Rise/Fall Delays   ; Enabled                                           ;
+--------------------+---------------------------------------------------+


+------------------------------------------+
; Parallel Compilation                     ;
+----------------------------+-------------+
; Processors                 ; Number      ;
+----------------------------+-------------+
; Number detected on machine ; 2           ;
; Maximum allowed            ; 2           ;
;                            ;             ;
; Average used               ; 1.00        ;
; Maximum used               ; 2           ;
;                            ;             ;
; Usage by Processor         ; % Time Used ;
;     1 processor            ; 100.0%      ;
;     2 processors           ; < 0.1%      ;
+----------------------------+-------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clocks                                                                                                                                                                                                                             ;
+----------------------------------+------+--------+------------+-------+-------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+--------------------------------------+
; Clock Name                       ; Type ; Period ; Frequency  ; Rise  ; Fall  ; Duty Cycle ; Divide by ; Multiply by ; Phase ; Offset ; Edge List ; Edge Shift ; Inverted ; Master ; Source ; Targets                              ;
+----------------------------------+------+--------+------------+-------+-------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+--------------------------------------+
; CLOCK_50                         ; Base ; 1.000  ; 1000.0 MHz ; 0.000 ; 0.500 ;            ;           ;             ;       ;        ;           ;            ;          ;        ;        ; { CLOCK_50 }                         ;
; ds18b20_drive:ds18b20_u0|clk_1us ; Base ; 1.000  ; 1000.0 MHz ; 0.000 ; 0.500 ;            ;           ;             ;       ;        ;           ;            ;          ;        ;        ; { ds18b20_drive:ds18b20_u0|clk_1us } ;
+----------------------------------+------+--------+------------+-------+-------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+--------------------------------------+


+------------------------------------------------------------------------+
; Slow 1200mV 85C Model Fmax Summary                                     ;
+------------+-----------------+----------------------------------+------+
; Fmax       ; Restricted Fmax ; Clock Name                       ; Note ;
+------------+-----------------+----------------------------------+------+
; 164.45 MHz ; 164.45 MHz      ; ds18b20_drive:ds18b20_u0|clk_1us ;      ;
; 223.61 MHz ; 223.61 MHz      ; CLOCK_50                         ;      ;
+------------+-----------------+----------------------------------+------+
This panel reports FMAX for every clock in the design, regardless of the user-specified clock periods.  FMAX is only computed for paths where the source and destination registers or ports are driven by the same clock.  Paths of different clocks, including generated clocks, are ignored.  For paths between a clock and its inversion, FMAX is computed as if the rising and falling edges are scaled along with FMAX, such that the duty cycle (in terms of a percentage) is maintained. Altera recommends that you always use clock constraints and other slack reports for sign-off analysis.


+-----------------------------------------------------------+
; Slow 1200mV 85C Model Setup Summary                       ;
+----------------------------------+--------+---------------+
; Clock                            ; Slack  ; End Point TNS ;
+----------------------------------+--------+---------------+
; ds18b20_drive:ds18b20_u0|clk_1us ; -5.081 ; -178.535      ;
; CLOCK_50                         ; -3.472 ; -72.993       ;
+----------------------------------+--------+---------------+


+----------------------------------------------------------+
; Slow 1200mV 85C Model Hold Summary                       ;
+----------------------------------+-------+---------------+
; Clock                            ; Slack ; End Point TNS ;
+----------------------------------+-------+---------------+
; CLOCK_50                         ; 0.449 ; 0.000         ;
; ds18b20_drive:ds18b20_u0|clk_1us ; 0.455 ; 0.000         ;
+----------------------------------+-------+---------------+


------------------------------------------
; Slow 1200mV 85C Model Recovery Summary ;
------------------------------------------
No paths to report.


-----------------------------------------
; Slow 1200mV 85C Model Removal Summary ;
-----------------------------------------
No paths to report.


+-----------------------------------------------------------+
; Slow 1200mV 85C Model Minimum Pulse Width Summary         ;
+----------------------------------+--------+---------------+
; Clock                            ; Slack  ; End Point TNS ;
+----------------------------------+--------+---------------+
; CLOCK_50                         ; -3.000 ; -52.071       ;
; ds18b20_drive:ds18b20_u0|clk_1us ; -1.487 ; -89.220       ;
+----------------------------------+--------+---------------+


+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Setup: 'ds18b20_drive:ds18b20_u0|clk_1us'                                                                                                                                         ;
+--------+--------------------------------------+------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+
; Slack  ; From Node                            ; To Node                                  ; Launch Clock                     ; Latch Clock                      ; Relationship ; Clock Skew ; Data Delay ;
+--------+--------------------------------------+------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+
; -5.081 ; ds18b20_drive:ds18b20_u0|step[3]     ; ds18b20_drive:ds18b20_u0|one_wire_buf~en ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 6.016      ;
; -4.957 ; ds18b20_drive:ds18b20_u0|cnt_1us[4]  ; ds18b20_drive:ds18b20_u0|state.WRITE0    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.892      ;
; -4.957 ; ds18b20_drive:ds18b20_u0|cnt_1us[4]  ; ds18b20_drive:ds18b20_u0|state.S6        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.892      ;
; -4.941 ; ds18b20_drive:ds18b20_u0|cnt_1us[1]  ; ds18b20_drive:ds18b20_u0|state.WRITE0    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.876      ;
; -4.941 ; ds18b20_drive:ds18b20_u0|cnt_1us[1]  ; ds18b20_drive:ds18b20_u0|state.S6        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.876      ;
; -4.931 ; ds18b20_drive:ds18b20_u0|cnt_1us[8]  ; ds18b20_drive:ds18b20_u0|state.WRITE0    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.866      ;
; -4.931 ; ds18b20_drive:ds18b20_u0|cnt_1us[8]  ; ds18b20_drive:ds18b20_u0|state.S6        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.866      ;
; -4.907 ; ds18b20_drive:ds18b20_u0|step[2]     ; ds18b20_drive:ds18b20_u0|one_wire_buf~en ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.084     ; 5.824      ;
; -4.904 ; ds18b20_drive:ds18b20_u0|cnt_1us[8]  ; ds18b20_drive:ds18b20_u0|state.S2        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.065     ; 5.840      ;
; -4.897 ; ds18b20_drive:ds18b20_u0|cnt_1us[4]  ; ds18b20_drive:ds18b20_u0|state.S2        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.065     ; 5.833      ;
; -4.881 ; ds18b20_drive:ds18b20_u0|cnt_1us[1]  ; ds18b20_drive:ds18b20_u0|state.S2        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.065     ; 5.817      ;
; -4.753 ; ds18b20_drive:ds18b20_u0|cnt_1us[5]  ; ds18b20_drive:ds18b20_u0|state.WRITE0    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.688      ;
; -4.753 ; ds18b20_drive:ds18b20_u0|cnt_1us[5]  ; ds18b20_drive:ds18b20_u0|state.S6        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.688      ;
; -4.729 ; ds18b20_drive:ds18b20_u0|cnt_1us[7]  ; ds18b20_drive:ds18b20_u0|state.WRITE0    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.664      ;
; -4.729 ; ds18b20_drive:ds18b20_u0|cnt_1us[7]  ; ds18b20_drive:ds18b20_u0|state.S6        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.664      ;
; -4.726 ; ds18b20_drive:ds18b20_u0|cnt_1us[6]  ; ds18b20_drive:ds18b20_u0|state.WRITE0    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.661      ;
; -4.726 ; ds18b20_drive:ds18b20_u0|cnt_1us[6]  ; ds18b20_drive:ds18b20_u0|state.S6        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.661      ;
; -4.726 ; ds18b20_drive:ds18b20_u0|cnt_1us[5]  ; ds18b20_drive:ds18b20_u0|state.S2        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.065     ; 5.662      ;
; -4.722 ; ds18b20_drive:ds18b20_u0|step[1]     ; ds18b20_drive:ds18b20_u0|state.S7        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.095     ; 5.628      ;
; -4.720 ; ds18b20_drive:ds18b20_u0|cnt_1us[0]  ; ds18b20_drive:ds18b20_u0|state.WRITE0    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.655      ;
; -4.720 ; ds18b20_drive:ds18b20_u0|cnt_1us[0]  ; ds18b20_drive:ds18b20_u0|state.S6        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.066     ; 5.655      ;
; -4.715 ; ds18b20_drive:ds18b20_u0|step[2]     ; ds18b20_drive:ds18b20_u0|state.WRITE0    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.095     ; 5.621      ;
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; -4.444 ; ds18b20_drive:ds18b20_u0|step[1]     ; ds18b20_drive:ds18b20_u0|state.WRITE0    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.093     ; 5.352      ;
; -4.444 ; ds18b20_drive:ds18b20_u0|step[1]     ; ds18b20_drive:ds18b20_u0|state.S6        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.093     ; 5.352      ;
; -4.441 ; ds18b20_drive:ds18b20_u0|cnt_1us[13] ; ds18b20_drive:ds18b20_u0|state.S2        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.078     ; 5.364      ;
; -4.410 ; ds18b20_drive:ds18b20_u0|step[1]     ; ds18b20_drive:ds18b20_u0|state.WRITE01   ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.081     ; 5.330      ;
; -4.390 ; ds18b20_drive:ds18b20_u0|cnt_1us[14] ; ds18b20_drive:ds18b20_u0|cnt_1us_clear   ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.067     ; 5.324      ;
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; -4.375 ; ds18b20_drive:ds18b20_u0|cnt_1us[2]  ; ds18b20_drive:ds18b20_u0|cnt_1us_clear   ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.054     ; 5.322      ;
; -4.347 ; ds18b20_drive:ds18b20_u0|step[0]     ; ds18b20_drive:ds18b20_u0|step[3]         ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.079     ; 5.269      ;
; -4.325 ; ds18b20_drive:ds18b20_u0|cnt_1us[14] ; ds18b20_drive:ds18b20_u0|state.S3        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.078     ; 5.248      ;
; -4.322 ; ds18b20_drive:ds18b20_u0|step[4]     ; ds18b20_drive:ds18b20_u0|one_wire_buf~en ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.082     ; 5.241      ;
; -4.321 ; ds18b20_drive:ds18b20_u0|cnt_1us[16] ; ds18b20_drive:ds18b20_u0|state.S3        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.078     ; 5.244      ;
; -4.318 ; ds18b20_drive:ds18b20_u0|step[1]     ; ds18b20_drive:ds18b20_u0|bit_valid[3]    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.095     ; 5.224      ;
; -4.318 ; ds18b20_drive:ds18b20_u0|step[1]     ; ds18b20_drive:ds18b20_u0|bit_valid[0]    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.095     ; 5.224      ;
; -4.318 ; ds18b20_drive:ds18b20_u0|step[1]     ; ds18b20_drive:ds18b20_u0|bit_valid[1]    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.095     ; 5.224      ;
; -4.318 ; ds18b20_drive:ds18b20_u0|step[1]     ; ds18b20_drive:ds18b20_u0|bit_valid[2]    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.095     ; 5.224      ;
; -4.316 ; ds18b20_drive:ds18b20_u0|cnt_1us[3]  ; ds18b20_drive:ds18b20_u0|cnt_1us_clear   ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.054     ; 5.263      ;
; -4.301 ; ds18b20_drive:ds18b20_u0|cnt_1us[17] ; ds18b20_drive:ds18b20_u0|cnt_1us_clear   ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.067     ; 5.235      ;
; -4.274 ; ds18b20_drive:ds18b20_u0|step[3]     ; ds18b20_drive:ds18b20_u0|step[0]         ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.079     ; 5.196      ;
; -4.269 ; ds18b20_drive:ds18b20_u0|step[0]     ; ds18b20_drive:ds18b20_u0|state.WRITE01   ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.065     ; 5.205      ;
; -4.266 ; ds18b20_drive:ds18b20_u0|step[1]     ; ds18b20_drive:ds18b20_u0|state.S3        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.092     ; 5.175      ;
; -4.265 ; ds18b20_drive:ds18b20_u0|step[1]     ; ds18b20_drive:ds18b20_u0|state.S2        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.092     ; 5.174      ;
; -4.262 ; ds18b20_drive:ds18b20_u0|state.S00   ; ds18b20_drive:ds18b20_u0|state.WRITE0    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.057     ; 5.206      ;
; -4.262 ; ds18b20_drive:ds18b20_u0|state.S00   ; ds18b20_drive:ds18b20_u0|state.S6        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.057     ; 5.206      ;
; -4.253 ; ds18b20_drive:ds18b20_u0|step[2]     ; ds18b20_drive:ds18b20_u0|step[0]         ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.097     ; 5.157      ;
; -4.252 ; ds18b20_drive:ds18b20_u0|cnt_1us[18] ; ds18b20_drive:ds18b20_u0|state.S2        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.078     ; 5.175      ;
; -4.241 ; ds18b20_drive:ds18b20_u0|cnt_1us[18] ; ds18b20_drive:ds18b20_u0|state.WRITE0    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.079     ; 5.163      ;
; -4.241 ; ds18b20_drive:ds18b20_u0|cnt_1us[18] ; ds18b20_drive:ds18b20_u0|state.S6        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.079     ; 5.163      ;
+--------+--------------------------------------+------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Setup: 'CLOCK_50'                                                                                                                                              ;
+--------+----------------------------------------------+------------------------------------+----------------------------------+-------------+--------------+------------+------------+
; Slack  ; From Node                                    ; To Node                            ; Launch Clock                     ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+--------+----------------------------------------------+------------------------------------+----------------------------------+-------------+--------------+------------+------------+
; -3.472 ; seg_dynamic_drive:seg7_u0|cnt[16]            ; seg_dynamic_drive:seg7_u0|HEX[3]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.114     ; 4.359      ;
; -3.390 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[16]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.105     ; 4.286      ;
; -3.266 ; seg_dynamic_drive:seg7_u0|cnt[15]            ; seg_dynamic_drive:seg7_u0|HEX[0]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.114     ; 4.153      ;
; -3.244 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[14]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.105     ; 4.140      ;
; -3.214 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[15]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.105     ; 4.110      ;
; -3.190 ; seg_dynamic_drive:seg7_u0|cnt[15]            ; seg_dynamic_drive:seg7_u0|HEX[3]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.114     ; 4.077      ;
; -3.173 ; seg_dynamic_drive:seg7_u0|cnt[15]            ; seg_dynamic_drive:seg7_u0|HEX[1]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.114     ; 4.060      ;
; -3.098 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[12]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.105     ; 3.994      ;
; -3.068 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[13]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.105     ; 3.964      ;
; -2.952 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[10]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.105     ; 3.848      ;
; -2.931 ; ds18b20_drive:ds18b20_u0|temperature_buf[9]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.344     ; 2.578      ;
; -2.922 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[11]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.105     ; 3.818      ;
; -2.910 ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.343     ; 2.558      ;
; -2.873 ; ds18b20_drive:ds18b20_u0|temperature_buf[4]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.343     ; 2.521      ;
; -2.872 ; ds18b20_drive:ds18b20_u0|temperature_buf[3]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.340     ; 2.523      ;
; -2.858 ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.343     ; 2.506      ;
; -2.845 ; ds18b20_drive:ds18b20_u0|temperature_buf[8]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.344     ; 2.492      ;
; -2.817 ; ds18b20_drive:ds18b20_u0|temperature_buf[5]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.343     ; 2.465      ;
; -2.808 ; ds18b20_drive:ds18b20_u0|temperature_buf[0]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.340     ; 2.459      ;
; -2.807 ; ds18b20_drive:ds18b20_u0|temperature_buf[0]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.340     ; 2.458      ;
; -2.806 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[8]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.105     ; 3.702      ;
; -2.802 ; ds18b20_drive:ds18b20_u0|temperature_buf[1]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.340     ; 2.453      ;
; -2.776 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[9]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.105     ; 3.672      ;
; -2.776 ; ds18b20_drive:ds18b20_u0|temperature_buf[10] ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.344     ; 2.423      ;
; -2.767 ; seg_dynamic_drive:seg7_u0|cnt[16]            ; seg_dynamic_drive:seg7_u0|HEX[1]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.114     ; 3.654      ;
; -2.760 ; seg_dynamic_drive:seg7_u0|cnt[16]            ; seg_dynamic_drive:seg7_u0|HEX[0]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.114     ; 3.647      ;
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; -2.630 ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.343     ; 2.278      ;
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; -2.513 ; ds18b20_drive:ds18b20_u0|temperature_buf[1]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.340     ; 2.164      ;
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; -2.484 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[5]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.105     ; 3.380      ;
; -2.477 ; ds18b20_drive:ds18b20_u0|temperature_buf[5]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.343     ; 2.125      ;
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; -1.865 ; seg_dynamic_drive:seg7_u0|cnt[2]             ; seg_dynamic_drive:seg7_u0|cnt[16]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.786      ;
; -1.796 ; seg_dynamic_drive:seg7_u0|cnt[1]             ; seg_dynamic_drive:seg7_u0|cnt[15]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.717      ;
; -1.781 ; seg_dynamic_drive:seg7_u0|cnt[3]             ; seg_dynamic_drive:seg7_u0|cnt[16]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.702      ;
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; -1.749 ; seg_dynamic_drive:seg7_u0|cnt[2]             ; seg_dynamic_drive:seg7_u0|cnt[13]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.670      ;
; -1.747 ; seg_dynamic_drive:seg7_u0|cnt[4]             ; seg_dynamic_drive:seg7_u0|cnt[15]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.668      ;
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; -1.709 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[1]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.105     ; 2.605      ;
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; -1.650 ; seg_dynamic_drive:seg7_u0|cnt[1]             ; seg_dynamic_drive:seg7_u0|cnt[13]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.571      ;
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; -1.635 ; seg_dynamic_drive:seg7_u0|cnt[3]             ; seg_dynamic_drive:seg7_u0|cnt[14]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.556      ;
; -1.634 ; seg_dynamic_drive:seg7_u0|cnt[1]             ; seg_dynamic_drive:seg7_u0|cnt[12]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.555      ;
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; -1.603 ; seg_dynamic_drive:seg7_u0|cnt[6]             ; seg_dynamic_drive:seg7_u0|cnt[15]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.524      ;
; -1.601 ; seg_dynamic_drive:seg7_u0|cnt[4]             ; seg_dynamic_drive:seg7_u0|cnt[13]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.522      ;
; -1.573 ; seg_dynamic_drive:seg7_u0|cnt[6]             ; seg_dynamic_drive:seg7_u0|cnt[16]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.494      ;
; -1.573 ; seg_dynamic_drive:seg7_u0|cnt[2]             ; seg_dynamic_drive:seg7_u0|cnt[12]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.494      ;
; -1.571 ; seg_dynamic_drive:seg7_u0|cnt[4]             ; seg_dynamic_drive:seg7_u0|cnt[14]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.492      ;
; -1.568 ; seg_dynamic_drive:seg7_u0|cnt[15]            ; seg_dynamic_drive:seg7_u0|SEG_S[0] ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.089     ; 2.480      ;
; -1.557 ; ds18b20_drive:ds18b20_u0|cnt[1]              ; ds18b20_drive:ds18b20_u0|cnt[5]    ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.079     ; 2.479      ;
; -1.519 ; seg_dynamic_drive:seg7_u0|cnt[16]            ; seg_dynamic_drive:seg7_u0|SEG_S[1] ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.089     ; 2.431      ;
; -1.515 ; ds18b20_drive:ds18b20_u0|cnt[2]              ; ds18b20_drive:ds18b20_u0|cnt[4]    ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.079     ; 2.437      ;
; -1.507 ; seg_dynamic_drive:seg7_u0|cnt[5]             ; seg_dynamic_drive:seg7_u0|cnt[15]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.428      ;
; -1.505 ; seg_dynamic_drive:seg7_u0|cnt[3]             ; seg_dynamic_drive:seg7_u0|cnt[13]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.426      ;
; -1.504 ; seg_dynamic_drive:seg7_u0|cnt[1]             ; seg_dynamic_drive:seg7_u0|cnt[11]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.425      ;
; -1.494 ; ds18b20_drive:ds18b20_u0|cnt[2]              ; ds18b20_drive:ds18b20_u0|cnt[5]    ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.079     ; 2.416      ;
; -1.490 ; seg_dynamic_drive:seg7_u0|cnt[5]             ; seg_dynamic_drive:seg7_u0|cnt[14]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.411      ;
; -1.489 ; seg_dynamic_drive:seg7_u0|cnt[3]             ; seg_dynamic_drive:seg7_u0|cnt[12]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.080     ; 2.410      ;
+--------+----------------------------------------------+------------------------------------+----------------------------------+-------------+--------------+------------+------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Hold: 'CLOCK_50'                                                                                                              ;
+-------+-----------------------------------+-----------------------------------+--------------+-------------+--------------+------------+------------+
; Slack ; From Node                         ; To Node                           ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+-------+-----------------------------------+-----------------------------------+--------------+-------------+--------------+------------+------------+
; 0.449 ; seg_dynamic_drive:seg7_u0|cnt[0]  ; seg_dynamic_drive:seg7_u0|cnt[0]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.097      ; 0.758      ;
; 0.518 ; ds18b20_drive:ds18b20_u0|cnt[5]   ; ds18b20_drive:ds18b20_u0|clk_1us  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 0.809      ;
; 0.736 ; seg_dynamic_drive:seg7_u0|cnt[4]  ; seg_dynamic_drive:seg7_u0|cnt[4]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.028      ;
; 0.737 ; seg_dynamic_drive:seg7_u0|cnt[14] ; seg_dynamic_drive:seg7_u0|cnt[14] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.029      ;
; 0.737 ; seg_dynamic_drive:seg7_u0|cnt[12] ; seg_dynamic_drive:seg7_u0|cnt[12] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.029      ;
; 0.737 ; seg_dynamic_drive:seg7_u0|cnt[6]  ; seg_dynamic_drive:seg7_u0|cnt[6]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.029      ;
; 0.737 ; seg_dynamic_drive:seg7_u0|cnt[2]  ; seg_dynamic_drive:seg7_u0|cnt[2]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.029      ;
; 0.737 ; ds18b20_drive:ds18b20_u0|cnt[0]   ; ds18b20_drive:ds18b20_u0|cnt[4]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.028      ;
; 0.740 ; seg_dynamic_drive:seg7_u0|cnt[10] ; seg_dynamic_drive:seg7_u0|cnt[10] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.032      ;
; 0.740 ; seg_dynamic_drive:seg7_u0|cnt[8]  ; seg_dynamic_drive:seg7_u0|cnt[8]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.032      ;
; 0.740 ; seg_dynamic_drive:seg7_u0|cnt[7]  ; seg_dynamic_drive:seg7_u0|cnt[7]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.032      ;
; 0.740 ; seg_dynamic_drive:seg7_u0|cnt[3]  ; seg_dynamic_drive:seg7_u0|cnt[3]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.032      ;
; 0.741 ; seg_dynamic_drive:seg7_u0|cnt[13] ; seg_dynamic_drive:seg7_u0|cnt[13] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.033      ;
; 0.741 ; seg_dynamic_drive:seg7_u0|cnt[11] ; seg_dynamic_drive:seg7_u0|cnt[11] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.033      ;
; 0.741 ; seg_dynamic_drive:seg7_u0|cnt[5]  ; seg_dynamic_drive:seg7_u0|cnt[5]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.033      ;
; 0.742 ; seg_dynamic_drive:seg7_u0|cnt[9]  ; seg_dynamic_drive:seg7_u0|cnt[9]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.034      ;
; 0.757 ; seg_dynamic_drive:seg7_u0|cnt[1]  ; seg_dynamic_drive:seg7_u0|cnt[1]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.049      ;
; 0.765 ; ds18b20_drive:ds18b20_u0|cnt[3]   ; ds18b20_drive:ds18b20_u0|cnt[3]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.056      ;
; 0.767 ; ds18b20_drive:ds18b20_u0|cnt[2]   ; ds18b20_drive:ds18b20_u0|cnt[2]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.058      ;
; 0.788 ; seg_dynamic_drive:seg7_u0|cnt[16] ; seg_dynamic_drive:seg7_u0|cnt[16] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.080      ;
; 0.789 ; seg_dynamic_drive:seg7_u0|cnt[15] ; seg_dynamic_drive:seg7_u0|cnt[15] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.081      ;
; 0.790 ; ds18b20_drive:ds18b20_u0|cnt[0]   ; ds18b20_drive:ds18b20_u0|cnt[0]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.081      ;
; 0.887 ; ds18b20_drive:ds18b20_u0|cnt[5]   ; ds18b20_drive:ds18b20_u0|cnt[5]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.178      ;
; 0.906 ; ds18b20_drive:ds18b20_u0|cnt[3]   ; ds18b20_drive:ds18b20_u0|clk_1us  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.197      ;
; 1.001 ; ds18b20_drive:ds18b20_u0|cnt[3]   ; ds18b20_drive:ds18b20_u0|cnt[1]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.292      ;
; 1.003 ; ds18b20_drive:ds18b20_u0|cnt[3]   ; ds18b20_drive:ds18b20_u0|cnt[4]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.294      ;
; 1.005 ; ds18b20_drive:ds18b20_u0|cnt[3]   ; ds18b20_drive:ds18b20_u0|cnt[5]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.296      ;
; 1.091 ; seg_dynamic_drive:seg7_u0|cnt[2]  ; seg_dynamic_drive:seg7_u0|cnt[3]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.383      ;
; 1.091 ; seg_dynamic_drive:seg7_u0|cnt[4]  ; seg_dynamic_drive:seg7_u0|cnt[5]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.383      ;
; 1.092 ; seg_dynamic_drive:seg7_u0|cnt[6]  ; seg_dynamic_drive:seg7_u0|cnt[7]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.384      ;
; 1.092 ; seg_dynamic_drive:seg7_u0|cnt[12] ; seg_dynamic_drive:seg7_u0|cnt[13] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.384      ;
; 1.092 ; seg_dynamic_drive:seg7_u0|cnt[14] ; seg_dynamic_drive:seg7_u0|cnt[15] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.384      ;
; 1.094 ; seg_dynamic_drive:seg7_u0|cnt[10] ; seg_dynamic_drive:seg7_u0|cnt[11] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.386      ;
; 1.094 ; seg_dynamic_drive:seg7_u0|cnt[8]  ; seg_dynamic_drive:seg7_u0|cnt[9]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.386      ;
; 1.100 ; seg_dynamic_drive:seg7_u0|cnt[1]  ; seg_dynamic_drive:seg7_u0|cnt[2]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.392      ;
; 1.101 ; seg_dynamic_drive:seg7_u0|cnt[3]  ; seg_dynamic_drive:seg7_u0|cnt[4]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.393      ;
; 1.101 ; seg_dynamic_drive:seg7_u0|cnt[7]  ; seg_dynamic_drive:seg7_u0|cnt[8]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.393      ;
; 1.102 ; seg_dynamic_drive:seg7_u0|cnt[13] ; seg_dynamic_drive:seg7_u0|cnt[14] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.394      ;
; 1.102 ; seg_dynamic_drive:seg7_u0|cnt[11] ; seg_dynamic_drive:seg7_u0|cnt[12] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.394      ;
; 1.102 ; seg_dynamic_drive:seg7_u0|cnt[5]  ; seg_dynamic_drive:seg7_u0|cnt[6]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.394      ;
; 1.103 ; seg_dynamic_drive:seg7_u0|cnt[9]  ; seg_dynamic_drive:seg7_u0|cnt[10] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.395      ;
; 1.109 ; seg_dynamic_drive:seg7_u0|cnt[1]  ; seg_dynamic_drive:seg7_u0|cnt[3]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.401      ;
; 1.110 ; seg_dynamic_drive:seg7_u0|cnt[3]  ; seg_dynamic_drive:seg7_u0|cnt[5]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.402      ;
; 1.110 ; seg_dynamic_drive:seg7_u0|cnt[7]  ; seg_dynamic_drive:seg7_u0|cnt[9]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.402      ;
; 1.111 ; seg_dynamic_drive:seg7_u0|cnt[5]  ; seg_dynamic_drive:seg7_u0|cnt[7]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.403      ;
; 1.111 ; seg_dynamic_drive:seg7_u0|cnt[11] ; seg_dynamic_drive:seg7_u0|cnt[13] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.403      ;
; 1.111 ; seg_dynamic_drive:seg7_u0|cnt[13] ; seg_dynamic_drive:seg7_u0|cnt[15] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.403      ;
; 1.112 ; seg_dynamic_drive:seg7_u0|cnt[9]  ; seg_dynamic_drive:seg7_u0|cnt[11] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.404      ;
; 1.118 ; ds18b20_drive:ds18b20_u0|cnt[1]   ; ds18b20_drive:ds18b20_u0|cnt[2]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.409      ;
; 1.128 ; ds18b20_drive:ds18b20_u0|cnt[2]   ; ds18b20_drive:ds18b20_u0|cnt[3]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.419      ;
; 1.137 ; ds18b20_drive:ds18b20_u0|cnt[0]   ; ds18b20_drive:ds18b20_u0|cnt[2]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.428      ;
; 1.150 ; seg_dynamic_drive:seg7_u0|cnt[15] ; seg_dynamic_drive:seg7_u0|cnt[16] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.442      ;
; 1.162 ; ds18b20_drive:ds18b20_u0|cnt[1]   ; ds18b20_drive:ds18b20_u0|cnt[1]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.453      ;
; 1.222 ; seg_dynamic_drive:seg7_u0|cnt[2]  ; seg_dynamic_drive:seg7_u0|cnt[4]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.514      ;
; 1.222 ; seg_dynamic_drive:seg7_u0|cnt[4]  ; seg_dynamic_drive:seg7_u0|cnt[6]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.514      ;
; 1.223 ; seg_dynamic_drive:seg7_u0|cnt[6]  ; seg_dynamic_drive:seg7_u0|cnt[8]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.515      ;
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; 1.225 ; seg_dynamic_drive:seg7_u0|cnt[10] ; seg_dynamic_drive:seg7_u0|cnt[12] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.517      ;
; 1.225 ; seg_dynamic_drive:seg7_u0|cnt[8]  ; seg_dynamic_drive:seg7_u0|cnt[10] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.080      ; 1.517      ;
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; 1.368 ; ds18b20_drive:ds18b20_u0|cnt[5]   ; ds18b20_drive:ds18b20_u0|cnt[1]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.079      ; 1.659      ;
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+-------+-----------------------------------+-----------------------------------+--------------+-------------+--------------+------------+------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Hold: 'ds18b20_drive:ds18b20_u0|clk_1us'                                                                                                                                                     ;
+-------+----------------------------------------------+----------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+
; Slack ; From Node                                    ; To Node                                      ; Launch Clock                     ; Latch Clock                      ; Relationship ; Clock Skew ; Data Delay ;
+-------+----------------------------------------------+----------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+
; 0.455 ; ds18b20_drive:ds18b20_u0|step[3]             ; ds18b20_drive:ds18b20_u0|step[3]             ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.079      ; 0.746      ;
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; 1.233 ; ds18b20_drive:ds18b20_u0|cnt_1us[11]         ; ds18b20_drive:ds18b20_u0|cnt_1us[13]         ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.079      ; 1.524      ;
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; 1.244 ; ds18b20_drive:ds18b20_u0|cnt_1us[17]         ; ds18b20_drive:ds18b20_u0|cnt_1us[19]         ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.079      ; 1.535      ;
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; 1.259 ; ds18b20_drive:ds18b20_u0|cnt_1us[1]          ; ds18b20_drive:ds18b20_u0|cnt_1us[3]          ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.078      ; 1.549      ;
; 1.259 ; ds18b20_drive:ds18b20_u0|cnt_1us[10]         ; ds18b20_drive:ds18b20_u0|cnt_1us[14]         ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.079      ; 1.550      ;
+-------+----------------------------------------------+----------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+


+------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Minimum Pulse Width: 'CLOCK_50'                                                                  ;
+--------+--------------+----------------+------------------+----------+------------+------------------------------------+
; Slack  ; Actual Width ; Required Width ; Type             ; Clock    ; Clock Edge ; Target                             ;
+--------+--------------+----------------+------------------+----------+------------+------------------------------------+
; -3.000 ; 1.000        ; 4.000          ; Port Rate        ; CLOCK_50 ; Rise       ; CLOCK_50                           ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[0]    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[1]    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[2]    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[3]    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[4]    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[5]    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[0]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[1]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[2]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[3]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG[7]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[0] ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[1] ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[2] ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[3] ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[0]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[10]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[11]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[12]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[13]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[14]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[15]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[16]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[1]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[2]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[3]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[4]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[5]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[6]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[7]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[8]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[9]   ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us   ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[0]    ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[1]    ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[2]    ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[3]    ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[4]    ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[5]    ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[0]   ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[1]   ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[2]   ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[3]   ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG[7]   ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[0] ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[1] ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[2] ;
; 0.262  ; 0.450        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[3] ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[10]  ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[11]  ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[12]  ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[13]  ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[14]  ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[15]  ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[16]  ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[1]   ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[2]   ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[3]   ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[4]   ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[5]   ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[6]   ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[7]   ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[8]   ;
; 0.263  ; 0.451        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[9]   ;
; 0.264  ; 0.452        ; 0.188          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[0]   ;
; 0.327  ; 0.547        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[0]   ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[10]  ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[11]  ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[12]  ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[13]  ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[14]  ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[15]  ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[16]  ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[1]   ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[2]   ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[3]   ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[4]   ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[5]   ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[6]   ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[7]   ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[8]   ;
; 0.328  ; 0.548        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[9]   ;
; 0.329  ; 0.549        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us   ;
; 0.329  ; 0.549        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[0]    ;
; 0.329  ; 0.549        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[1]    ;
; 0.329  ; 0.549        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[2]    ;
; 0.329  ; 0.549        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[3]    ;
; 0.329  ; 0.549        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[4]    ;
; 0.329  ; 0.549        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[5]    ;
; 0.329  ; 0.549        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[0]   ;
; 0.329  ; 0.549        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[1]   ;
; 0.329  ; 0.549        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[2]   ;
; 0.329  ; 0.549        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[3]   ;
; 0.330  ; 0.550        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG[7]   ;
; 0.330  ; 0.550        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[0] ;
; 0.330  ; 0.550        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[1] ;
; 0.330  ; 0.550        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[2] ;
; 0.330  ; 0.550        ; 0.220          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[3] ;
+--------+--------------+----------------+------------------+----------+------------+------------------------------------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Minimum Pulse Width: 'ds18b20_drive:ds18b20_u0|clk_1us'                                                                            ;
+--------+--------------+----------------+------------------+----------------------------------+------------+----------------------------------------------+
; Slack  ; Actual Width ; Required Width ; Type             ; Clock                            ; Clock Edge ; Target                                       ;
+--------+--------------+----------------+------------------+----------------------------------+------------+----------------------------------------------+
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[0]        ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[1]        ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[2]        ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[3]        ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[0]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[10]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[11]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[12]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[13]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[14]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[15]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[16]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[17]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[18]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[19]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[1]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[2]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[3]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[4]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[5]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[6]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[7]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[8]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[9]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us_clear       ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|one_wire_buf~en     ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ0         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ1         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ2         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ3         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S0            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S00           ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S1            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S2            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S3            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S4            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S5            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S6            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S7            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.WRITE0        ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.WRITE00       ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.WRITE01       ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.WRITE1        ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[0]             ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[1]             ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[2]             ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[3]             ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[4]             ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[5]             ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[0]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[10] ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[1]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[2]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[3]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[4]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[5]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[6]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[8]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[9]  ;
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; 0.235  ; 0.455        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S7            ;
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; 0.238  ; 0.458        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[3]  ;
; 0.238  ; 0.458        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[4]  ;
; 0.238  ; 0.458        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[5]  ;
; 0.238  ; 0.458        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[6]  ;
; 0.238  ; 0.458        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ;
; 0.239  ; 0.459        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[0]          ;
; 0.239  ; 0.459        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[1]          ;
; 0.239  ; 0.459        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[2]          ;
; 0.239  ; 0.459        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[3]          ;
; 0.239  ; 0.459        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[4]          ;
; 0.239  ; 0.459        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[5]          ;
; 0.239  ; 0.459        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[6]          ;
; 0.239  ; 0.459        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[7]          ;
; 0.239  ; 0.459        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[8]          ;
; 0.239  ; 0.459        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[9]          ;
; 0.239  ; 0.459        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[10] ;
; 0.239  ; 0.459        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[8]  ;
; 0.239  ; 0.459        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[9]  ;
; 0.240  ; 0.460        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us_clear       ;
; 0.240  ; 0.460        ; 0.220          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S5            ;
+--------+--------------+----------------+------------------+----------------------------------+------------+----------------------------------------------+


+--------------------------------------------------------------------------------------------------------------+
; Setup Times                                                                                                  ;
+-----------+----------------------------------+-------+-------+------------+----------------------------------+
; Data Port ; Clock Port                       ; Rise  ; Fall  ; Clock Edge ; Clock Reference                  ;
+-----------+----------------------------------+-------+-------+------------+----------------------------------+
; DS18B20   ; ds18b20_drive:ds18b20_u0|clk_1us ; 4.326 ; 4.592 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
; Q_KEY     ; ds18b20_drive:ds18b20_u0|clk_1us ; 3.532 ; 3.696 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+-----------+----------------------------------+-------+-------+------------+----------------------------------+


+----------------------------------------------------------------------------------------------------------------+
; Hold Times                                                                                                     ;
+-----------+----------------------------------+--------+--------+------------+----------------------------------+
; Data Port ; Clock Port                       ; Rise   ; Fall   ; Clock Edge ; Clock Reference                  ;
+-----------+----------------------------------+--------+--------+------------+----------------------------------+
; DS18B20   ; ds18b20_drive:ds18b20_u0|clk_1us ; -0.753 ; -0.942 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
; Q_KEY     ; ds18b20_drive:ds18b20_u0|clk_1us ; -1.887 ; -2.115 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+-----------+----------------------------------+--------+--------+------------+----------------------------------+


+-------------------------------------------------------------------------------------------------------------------+
; Clock to Output Times                                                                                             ;
+--------------+----------------------------------+--------+--------+------------+----------------------------------+
; Data Port    ; Clock Port                       ; Rise   ; Fall   ; Clock Edge ; Clock Reference                  ;
+--------------+----------------------------------+--------+--------+------------+----------------------------------+
; SEG7_SEG[*]  ; CLOCK_50                         ; 11.340 ; 10.705 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[0] ; CLOCK_50                         ; 8.874  ; 8.488  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[1] ; CLOCK_50                         ; 10.832 ; 10.264 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[2] ; CLOCK_50                         ; 8.899  ; 8.530  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[3] ; CLOCK_50                         ; 8.801  ; 8.484  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[4] ; CLOCK_50                         ; 8.800  ; 8.458  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[5] ; CLOCK_50                         ; 11.340 ; 10.705 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[6] ; CLOCK_50                         ; 8.762  ; 9.181  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[7] ; CLOCK_50                         ; 7.371  ; 7.059  ; Rise       ; CLOCK_50                         ;
; SEG7_SEL[*]  ; CLOCK_50                         ; 8.156  ; 7.820  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[0] ; CLOCK_50                         ; 7.848  ; 7.513  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[1] ; CLOCK_50                         ; 7.770  ; 7.445  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[2] ; CLOCK_50                         ; 8.156  ; 7.820  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[3] ; CLOCK_50                         ; 8.063  ; 7.719  ; Rise       ; CLOCK_50                         ;
; DS18B20      ; ds18b20_drive:ds18b20_u0|clk_1us ; 8.603  ; 8.938  ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+--------------+----------------------------------+--------+--------+------------+----------------------------------+


+-------------------------------------------------------------------------------------------------------------------+
; Minimum Clock to Output Times                                                                                     ;
+--------------+----------------------------------+--------+--------+------------+----------------------------------+
; Data Port    ; Clock Port                       ; Rise   ; Fall   ; Clock Edge ; Clock Reference                  ;
+--------------+----------------------------------+--------+--------+------------+----------------------------------+
; SEG7_SEG[*]  ; CLOCK_50                         ; 7.212  ; 6.905  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[0] ; CLOCK_50                         ; 8.307  ; 7.920  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[1] ; CLOCK_50                         ; 10.301 ; 9.687  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[2] ; CLOCK_50                         ; 8.305  ; 7.933  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[3] ; CLOCK_50                         ; 8.240  ; 7.894  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[4] ; CLOCK_50                         ; 8.239  ; 7.886  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[5] ; CLOCK_50                         ; 10.734 ; 10.092 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[6] ; CLOCK_50                         ; 8.188  ; 8.613  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[7] ; CLOCK_50                         ; 7.212  ; 6.905  ; Rise       ; CLOCK_50                         ;
; SEG7_SEL[*]  ; CLOCK_50                         ; 7.594  ; 7.274  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[0] ; CLOCK_50                         ; 7.669  ; 7.340  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[1] ; CLOCK_50                         ; 7.594  ; 7.274  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[2] ; CLOCK_50                         ; 7.965  ; 7.634  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[3] ; CLOCK_50                         ; 7.875  ; 7.538  ; Rise       ; CLOCK_50                         ;
; DS18B20      ; ds18b20_drive:ds18b20_u0|clk_1us ; 8.347  ; 8.677  ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+--------------+----------------------------------+--------+--------+------------+----------------------------------+


----------------------------------------------
; Slow 1200mV 85C Model Metastability Report ;
----------------------------------------------
No synchronizer chains to report.


+------------------------------------------------------------------------+
; Slow 1200mV 0C Model Fmax Summary                                      ;
+------------+-----------------+----------------------------------+------+
; Fmax       ; Restricted Fmax ; Clock Name                       ; Note ;
+------------+-----------------+----------------------------------+------+
; 175.01 MHz ; 175.01 MHz      ; ds18b20_drive:ds18b20_u0|clk_1us ;      ;
; 233.48 MHz ; 233.48 MHz      ; CLOCK_50                         ;      ;
+------------+-----------------+----------------------------------+------+
This panel reports FMAX for every clock in the design, regardless of the user-specified clock periods.  FMAX is only computed for paths where the source and destination registers or ports are driven by the same clock.  Paths of different clocks, including generated clocks, are ignored.  For paths between a clock and its inversion, FMAX is computed as if the rising and falling edges are scaled along with FMAX, such that the duty cycle (in terms of a percentage) is maintained. Altera recommends that you always use clock constraints and other slack reports for sign-off analysis.


+-----------------------------------------------------------+
; Slow 1200mV 0C Model Setup Summary                        ;
+----------------------------------+--------+---------------+
; Clock                            ; Slack  ; End Point TNS ;
+----------------------------------+--------+---------------+
; ds18b20_drive:ds18b20_u0|clk_1us ; -4.714 ; -163.448      ;
; CLOCK_50                         ; -3.283 ; -65.760       ;
+----------------------------------+--------+---------------+


+----------------------------------------------------------+
; Slow 1200mV 0C Model Hold Summary                        ;
+----------------------------------+-------+---------------+
; Clock                            ; Slack ; End Point TNS ;
+----------------------------------+-------+---------------+
; ds18b20_drive:ds18b20_u0|clk_1us ; 0.402 ; 0.000         ;
; CLOCK_50                         ; 0.403 ; 0.000         ;
+----------------------------------+-------+---------------+


-----------------------------------------
; Slow 1200mV 0C Model Recovery Summary ;
-----------------------------------------
No paths to report.


----------------------------------------
; Slow 1200mV 0C Model Removal Summary ;
----------------------------------------
No paths to report.


+-----------------------------------------------------------+
; Slow 1200mV 0C Model Minimum Pulse Width Summary          ;
+----------------------------------+--------+---------------+
; Clock                            ; Slack  ; End Point TNS ;
+----------------------------------+--------+---------------+
; CLOCK_50                         ; -3.000 ; -52.071       ;
; ds18b20_drive:ds18b20_u0|clk_1us ; -1.487 ; -89.220       ;
+----------------------------------+--------+---------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Setup: 'ds18b20_drive:ds18b20_u0|clk_1us'                                                                                                                                              ;
+--------+---------------------------------------+---------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+
; Slack  ; From Node                             ; To Node                                     ; Launch Clock                     ; Latch Clock                      ; Relationship ; Clock Skew ; Data Delay ;
+--------+---------------------------------------+---------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+
; -4.714 ; ds18b20_drive:ds18b20_u0|step[3]      ; ds18b20_drive:ds18b20_u0|one_wire_buf~en    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.058     ; 5.658      ;
; -4.656 ; ds18b20_drive:ds18b20_u0|cnt_1us[4]   ; ds18b20_drive:ds18b20_u0|state.WRITE0       ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.059     ; 5.599      ;
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; -4.155 ; ds18b20_drive:ds18b20_u0|cnt_1us[5]   ; ds18b20_drive:ds18b20_u0|cnt_1us_clear      ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.048     ; 5.109      ;
; -4.153 ; ds18b20_drive:ds18b20_u0|cnt_1us[2]   ; ds18b20_drive:ds18b20_u0|state.S2           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.058     ; 5.097      ;
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+--------+---------------------------------------+---------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Setup: 'CLOCK_50'                                                                                                                                               ;
+--------+----------------------------------------------+------------------------------------+----------------------------------+-------------+--------------+------------+------------+
; Slack  ; From Node                                    ; To Node                            ; Launch Clock                     ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+--------+----------------------------------------------+------------------------------------+----------------------------------+-------------+--------------+------------+------------+
; -3.283 ; seg_dynamic_drive:seg7_u0|cnt[16]            ; seg_dynamic_drive:seg7_u0|HEX[3]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.102     ; 4.183      ;
; -3.087 ; seg_dynamic_drive:seg7_u0|cnt[15]            ; seg_dynamic_drive:seg7_u0|HEX[0]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.102     ; 3.987      ;
; -3.036 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[16]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.945      ;
; -2.998 ; seg_dynamic_drive:seg7_u0|cnt[15]            ; seg_dynamic_drive:seg7_u0|HEX[1]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.102     ; 3.898      ;
; -2.989 ; seg_dynamic_drive:seg7_u0|cnt[15]            ; seg_dynamic_drive:seg7_u0|HEX[3]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.102     ; 3.889      ;
; -2.910 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[14]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.819      ;
; -2.871 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[15]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.780      ;
; -2.784 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[12]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.693      ;
; -2.745 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[13]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.654      ;
; -2.677 ; ds18b20_drive:ds18b20_u0|temperature_buf[9]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.252     ; 2.417      ;
; -2.658 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[10]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.567      ;
; -2.628 ; seg_dynamic_drive:seg7_u0|cnt[16]            ; seg_dynamic_drive:seg7_u0|HEX[1]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.102     ; 3.528      ;
; -2.628 ; ds18b20_drive:ds18b20_u0|temperature_buf[8]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.252     ; 2.368      ;
; -2.619 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[11]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.528      ;
; -2.614 ; seg_dynamic_drive:seg7_u0|cnt[16]            ; seg_dynamic_drive:seg7_u0|HEX[0]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.102     ; 3.514      ;
; -2.600 ; ds18b20_drive:ds18b20_u0|temperature_buf[3]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.345      ;
; -2.595 ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 2.337      ;
; -2.580 ; seg_dynamic_drive:seg7_u0|cnt[15]            ; seg_dynamic_drive:seg7_u0|HEX[2]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.102     ; 3.480      ;
; -2.576 ; ds18b20_drive:ds18b20_u0|temperature_buf[4]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 2.318      ;
; -2.548 ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 2.290      ;
; -2.546 ; ds18b20_drive:ds18b20_u0|temperature_buf[10] ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.252     ; 2.286      ;
; -2.544 ; ds18b20_drive:ds18b20_u0|temperature_buf[0]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.289      ;
; -2.544 ; ds18b20_drive:ds18b20_u0|temperature_buf[0]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.289      ;
; -2.533 ; ds18b20_drive:ds18b20_u0|temperature_buf[1]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.278      ;
; -2.532 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[8]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.441      ;
; -2.520 ; ds18b20_drive:ds18b20_u0|temperature_buf[5]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 2.262      ;
; -2.497 ; ds18b20_drive:ds18b20_u0|temperature_buf[0]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.242      ;
; -2.493 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[9]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.402      ;
; -2.479 ; ds18b20_drive:ds18b20_u0|temperature_buf[1]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.224      ;
; -2.455 ; ds18b20_drive:ds18b20_u0|temperature_buf[5]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 2.197      ;
; -2.449 ; ds18b20_drive:ds18b20_u0|temperature_buf[10] ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.252     ; 2.189      ;
; -2.428 ; ds18b20_drive:ds18b20_u0|temperature_buf[2]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.173      ;
; -2.425 ; ds18b20_drive:ds18b20_u0|temperature_buf[8]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.252     ; 2.165      ;
; -2.425 ; ds18b20_drive:ds18b20_u0|temperature_buf[3]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.170      ;
; -2.406 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[6]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.315      ;
; -2.406 ; ds18b20_drive:ds18b20_u0|temperature_buf[0]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.151      ;
; -2.389 ; ds18b20_drive:ds18b20_u0|temperature_buf[1]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.134      ;
; -2.380 ; ds18b20_drive:ds18b20_u0|temperature_buf[9]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.252     ; 2.120      ;
; -2.371 ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 2.113      ;
; -2.367 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[7]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.276      ;
; -2.363 ; ds18b20_drive:ds18b20_u0|temperature_buf[2]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.108      ;
; -2.350 ; ds18b20_drive:ds18b20_u0|temperature_buf[2]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.095      ;
; -2.348 ; ds18b20_drive:ds18b20_u0|temperature_buf[10] ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.252     ; 2.088      ;
; -2.336 ; ds18b20_drive:ds18b20_u0|temperature_buf[5]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 2.078      ;
; -2.333 ; ds18b20_drive:ds18b20_u0|temperature_buf[2]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.078      ;
; -2.323 ; ds18b20_drive:ds18b20_u0|temperature_buf[4]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 2.065      ;
; -2.320 ; ds18b20_drive:ds18b20_u0|temperature_buf[6]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 2.062      ;
; -2.320 ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 2.062      ;
; -2.285 ; ds18b20_drive:ds18b20_u0|temperature_buf[4]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 2.027      ;
; -2.280 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[4]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.189      ;
; -2.280 ; ds18b20_drive:ds18b20_u0|temperature_buf[1]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.025      ;
; -2.264 ; seg_dynamic_drive:seg7_u0|cnt[16]            ; seg_dynamic_drive:seg7_u0|HEX[2]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.102     ; 3.164      ;
; -2.264 ; ds18b20_drive:ds18b20_u0|temperature_buf[3]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 2.009      ;
; -2.243 ; ds18b20_drive:ds18b20_u0|temperature_buf[3]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.247     ; 1.988      ;
; -2.241 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[5]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.150      ;
; -2.194 ; ds18b20_drive:ds18b20_u0|temperature_buf[6]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 1.936      ;
; -2.187 ; ds18b20_drive:ds18b20_u0|temperature_buf[5]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 1.929      ;
; -2.174 ; ds18b20_drive:ds18b20_u0|temperature_buf[4]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 1.916      ;
; -2.154 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[2]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.063      ;
; -2.115 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[3]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 3.024      ;
; -2.051 ; ds18b20_drive:ds18b20_u0|temperature_buf[6]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 1.793      ;
; -2.020 ; ds18b20_drive:ds18b20_u0|temperature_buf[6]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -1.250     ; 1.762      ;
; -1.618 ; seg_dynamic_drive:seg7_u0|cnt[1]             ; seg_dynamic_drive:seg7_u0|cnt[16]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.549      ;
; -1.611 ; seg_dynamic_drive:seg7_u0|cnt[16]            ; seg_dynamic_drive:seg7_u0|SEG[7]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.079     ; 2.534      ;
; -1.570 ; seg_dynamic_drive:seg7_u0|cnt[2]             ; seg_dynamic_drive:seg7_u0|cnt[15]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.501      ;
; -1.547 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[1]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.093     ; 2.456      ;
; -1.531 ; seg_dynamic_drive:seg7_u0|cnt[2]             ; seg_dynamic_drive:seg7_u0|cnt[16]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.462      ;
; -1.494 ; ds18b20_drive:ds18b20_u0|cnt[1]              ; ds18b20_drive:ds18b20_u0|cnt[4]    ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.425      ;
; -1.493 ; seg_dynamic_drive:seg7_u0|cnt[3]             ; seg_dynamic_drive:seg7_u0|cnt[16]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.424      ;
; -1.492 ; seg_dynamic_drive:seg7_u0|cnt[1]             ; seg_dynamic_drive:seg7_u0|cnt[14]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.423      ;
; -1.480 ; seg_dynamic_drive:seg7_u0|cnt[1]             ; seg_dynamic_drive:seg7_u0|cnt[15]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.411      ;
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; -1.442 ; seg_dynamic_drive:seg7_u0|cnt[4]             ; seg_dynamic_drive:seg7_u0|cnt[15]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.373      ;
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; -1.407 ; ds18b20_drive:ds18b20_u0|cnt[0]              ; ds18b20_drive:ds18b20_u0|cnt[4]    ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.338      ;
; -1.405 ; seg_dynamic_drive:seg7_u0|cnt[2]             ; seg_dynamic_drive:seg7_u0|cnt[14]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.336      ;
; -1.403 ; seg_dynamic_drive:seg7_u0|cnt[4]             ; seg_dynamic_drive:seg7_u0|cnt[16]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.334      ;
; -1.383 ; seg_dynamic_drive:seg7_u0|cnt[16]            ; seg_dynamic_drive:seg7_u0|SEG_S[1] ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.079     ; 2.306      ;
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; -1.368 ; seg_dynamic_drive:seg7_u0|cnt[5]             ; seg_dynamic_drive:seg7_u0|cnt[16]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.299      ;
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; -1.285 ; ds18b20_drive:ds18b20_u0|cnt[1]              ; ds18b20_drive:ds18b20_u0|cnt[5]    ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.216      ;
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; -1.279 ; seg_dynamic_drive:seg7_u0|cnt[6]             ; seg_dynamic_drive:seg7_u0|cnt[16]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.210      ;
; -1.279 ; seg_dynamic_drive:seg7_u0|cnt[2]             ; seg_dynamic_drive:seg7_u0|cnt[12]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.210      ;
; -1.277 ; seg_dynamic_drive:seg7_u0|cnt[4]             ; seg_dynamic_drive:seg7_u0|cnt[14]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.208      ;
; -1.242 ; seg_dynamic_drive:seg7_u0|cnt[5]             ; seg_dynamic_drive:seg7_u0|cnt[14]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.173      ;
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; -1.240 ; seg_dynamic_drive:seg7_u0|cnt[1]             ; seg_dynamic_drive:seg7_u0|cnt[10]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.171      ;
; -1.238 ; seg_dynamic_drive:seg7_u0|cnt[7]             ; seg_dynamic_drive:seg7_u0|cnt[16]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.071     ; 2.169      ;
+--------+----------------------------------------------+------------------------------------+----------------------------------+-------------+--------------+------------+------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Hold: 'ds18b20_drive:ds18b20_u0|clk_1us'                                                                                                                                                      ;
+-------+----------------------------------------------+----------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+
; Slack ; From Node                                    ; To Node                                      ; Launch Clock                     ; Latch Clock                      ; Relationship ; Clock Skew ; Data Delay ;
+-------+----------------------------------------------+----------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+
; 0.402 ; ds18b20_drive:ds18b20_u0|step[2]             ; ds18b20_drive:ds18b20_u0|step[2]             ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.072      ; 0.669      ;
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; 1.054 ; ds18b20_drive:ds18b20_u0|cnt_1us[0]          ; ds18b20_drive:ds18b20_u0|cnt_1us[2]          ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.070      ; 1.319      ;
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; 1.099 ; ds18b20_drive:ds18b20_u0|state.S5            ; ds18b20_drive:ds18b20_u0|state.WRITE0        ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.059      ; 1.353      ;
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; 1.115 ; ds18b20_drive:ds18b20_u0|cnt_1us[15]         ; ds18b20_drive:ds18b20_u0|cnt_1us[17]         ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.071      ; 1.381      ;
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; 1.138 ; ds18b20_drive:ds18b20_u0|state.READ2         ; ds18b20_drive:ds18b20_u0|state.READ3         ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.072      ; 1.405      ;
; 1.139 ; ds18b20_drive:ds18b20_u0|cnt_1us[9]          ; ds18b20_drive:ds18b20_u0|cnt_1us[12]         ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.082      ; 1.416      ;
; 1.139 ; ds18b20_drive:ds18b20_u0|cnt_1us[10]         ; ds18b20_drive:ds18b20_u0|cnt_1us[13]         ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.071      ; 1.405      ;
; 1.140 ; ds18b20_drive:ds18b20_u0|cnt_1us[15]         ; ds18b20_drive:ds18b20_u0|cnt_1us[18]         ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.071      ; 1.406      ;
+-------+----------------------------------------------+----------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Hold: 'CLOCK_50'                                                                                                               ;
+-------+-----------------------------------+-----------------------------------+--------------+-------------+--------------+------------+------------+
; Slack ; From Node                         ; To Node                           ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+-------+-----------------------------------+-----------------------------------+--------------+-------------+--------------+------------+------------+
; 0.403 ; seg_dynamic_drive:seg7_u0|cnt[0]  ; seg_dynamic_drive:seg7_u0|cnt[0]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.086      ; 0.684      ;
; 0.485 ; ds18b20_drive:ds18b20_u0|cnt[5]   ; ds18b20_drive:ds18b20_u0|clk_1us  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 0.751      ;
; 0.679 ; ds18b20_drive:ds18b20_u0|cnt[0]   ; ds18b20_drive:ds18b20_u0|cnt[4]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 0.945      ;
; 0.685 ; seg_dynamic_drive:seg7_u0|cnt[14] ; seg_dynamic_drive:seg7_u0|cnt[14] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 0.951      ;
; 0.685 ; seg_dynamic_drive:seg7_u0|cnt[4]  ; seg_dynamic_drive:seg7_u0|cnt[4]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 0.951      ;
; 0.686 ; seg_dynamic_drive:seg7_u0|cnt[12] ; seg_dynamic_drive:seg7_u0|cnt[12] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 0.952      ;
; 0.686 ; seg_dynamic_drive:seg7_u0|cnt[6]  ; seg_dynamic_drive:seg7_u0|cnt[6]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 0.952      ;
; 0.687 ; seg_dynamic_drive:seg7_u0|cnt[2]  ; seg_dynamic_drive:seg7_u0|cnt[2]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 0.953      ;
; 0.688 ; seg_dynamic_drive:seg7_u0|cnt[7]  ; seg_dynamic_drive:seg7_u0|cnt[7]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 0.954      ;
; 0.689 ; seg_dynamic_drive:seg7_u0|cnt[10] ; seg_dynamic_drive:seg7_u0|cnt[10] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 0.955      ;
; 0.689 ; seg_dynamic_drive:seg7_u0|cnt[8]  ; seg_dynamic_drive:seg7_u0|cnt[8]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 0.955      ;
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; 1.224 ; seg_dynamic_drive:seg7_u0|cnt[6]  ; seg_dynamic_drive:seg7_u0|cnt[10] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 1.490      ;
; 1.227 ; seg_dynamic_drive:seg7_u0|cnt[2]  ; seg_dynamic_drive:seg7_u0|cnt[6]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 1.493      ;
; 1.229 ; seg_dynamic_drive:seg7_u0|cnt[8]  ; seg_dynamic_drive:seg7_u0|cnt[12] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 1.495      ;
; 1.230 ; seg_dynamic_drive:seg7_u0|cnt[10] ; seg_dynamic_drive:seg7_u0|cnt[14] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 1.496      ;
; 1.250 ; seg_dynamic_drive:seg7_u0|cnt[1]  ; seg_dynamic_drive:seg7_u0|cnt[6]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 1.516      ;
; 1.251 ; seg_dynamic_drive:seg7_u0|cnt[4]  ; seg_dynamic_drive:seg7_u0|cnt[9]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 1.517      ;
; 1.251 ; seg_dynamic_drive:seg7_u0|cnt[3]  ; seg_dynamic_drive:seg7_u0|cnt[8]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 1.517      ;
; 1.251 ; seg_dynamic_drive:seg7_u0|cnt[7]  ; seg_dynamic_drive:seg7_u0|cnt[12] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 1.517      ;
; 1.252 ; seg_dynamic_drive:seg7_u0|cnt[6]  ; seg_dynamic_drive:seg7_u0|cnt[11] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 1.518      ;
; 1.253 ; seg_dynamic_drive:seg7_u0|cnt[5]  ; seg_dynamic_drive:seg7_u0|cnt[10] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 1.519      ;
; 1.253 ; seg_dynamic_drive:seg7_u0|cnt[9]  ; seg_dynamic_drive:seg7_u0|cnt[14] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 1.519      ;
; 1.254 ; seg_dynamic_drive:seg7_u0|cnt[11] ; seg_dynamic_drive:seg7_u0|cnt[16] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 1.520      ;
; 1.255 ; seg_dynamic_drive:seg7_u0|cnt[2]  ; seg_dynamic_drive:seg7_u0|cnt[7]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.071      ; 1.521      ;
+-------+-----------------------------------+-----------------------------------+--------------+-------------+--------------+------------+------------+


+------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Minimum Pulse Width: 'CLOCK_50'                                                                   ;
+--------+--------------+----------------+------------------+----------+------------+------------------------------------+
; Slack  ; Actual Width ; Required Width ; Type             ; Clock    ; Clock Edge ; Target                             ;
+--------+--------------+----------------+------------------+----------+------------+------------------------------------+
; -3.000 ; 1.000        ; 4.000          ; Port Rate        ; CLOCK_50 ; Rise       ; CLOCK_50                           ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[0]    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[1]    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[2]    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[3]    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[4]    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[5]    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[0]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[1]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[2]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[3]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG[7]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[0] ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[1] ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[2] ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[3] ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[0]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[10]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[11]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[12]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[13]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[14]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[15]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[16]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[1]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[2]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[3]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[4]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[5]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[6]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[7]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[8]   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[9]   ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us   ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[0]    ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[1]    ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[2]    ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[3]    ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[4]    ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[5]    ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[0]   ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[1]   ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[2]   ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[3]   ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG[7]   ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[0] ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[1] ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[2] ;
; 0.257  ; 0.441        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[3] ;
; 0.258  ; 0.442        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[0]   ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[10]  ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[11]  ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[12]  ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[13]  ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[14]  ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[15]  ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[16]  ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[1]   ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[2]   ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[3]   ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[4]   ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[5]   ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[6]   ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[7]   ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[8]   ;
; 0.259  ; 0.443        ; 0.184          ; Low Pulse Width  ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[9]   ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[10]  ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[11]  ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[12]  ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[13]  ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[14]  ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[15]  ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[16]  ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[1]   ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[2]   ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[3]   ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[4]   ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[5]   ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[6]   ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[7]   ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[8]   ;
; 0.338  ; 0.554        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[9]   ;
; 0.339  ; 0.555        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG[7]   ;
; 0.339  ; 0.555        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[0] ;
; 0.339  ; 0.555        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[1] ;
; 0.339  ; 0.555        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[2] ;
; 0.339  ; 0.555        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[3] ;
; 0.339  ; 0.555        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[0]   ;
; 0.340  ; 0.556        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us   ;
; 0.340  ; 0.556        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[0]    ;
; 0.340  ; 0.556        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[1]    ;
; 0.340  ; 0.556        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[2]    ;
; 0.340  ; 0.556        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[3]    ;
; 0.340  ; 0.556        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[4]    ;
; 0.340  ; 0.556        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[5]    ;
; 0.340  ; 0.556        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[0]   ;
; 0.340  ; 0.556        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[1]   ;
; 0.340  ; 0.556        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[2]   ;
; 0.340  ; 0.556        ; 0.216          ; High Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[3]   ;
+--------+--------------+----------------+------------------+----------+------------+------------------------------------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Minimum Pulse Width: 'ds18b20_drive:ds18b20_u0|clk_1us'                                                                             ;
+--------+--------------+----------------+------------------+----------------------------------+------------+----------------------------------------------+
; Slack  ; Actual Width ; Required Width ; Type             ; Clock                            ; Clock Edge ; Target                                       ;
+--------+--------------+----------------+------------------+----------------------------------+------------+----------------------------------------------+
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[0]        ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[1]        ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[2]        ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[3]        ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[0]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[10]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[11]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[12]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[13]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[14]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[15]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[16]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[17]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[18]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[19]         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[1]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[2]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[3]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[4]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[5]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[6]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[7]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[8]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[9]          ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us_clear       ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|one_wire_buf~en     ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ0         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ1         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ2         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ3         ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S0            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S00           ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S1            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S2            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S3            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S4            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S5            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S6            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S7            ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.WRITE0        ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.WRITE00       ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.WRITE01       ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.WRITE1        ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[0]             ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[1]             ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[2]             ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[3]             ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[4]             ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[5]             ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[0]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[10] ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[1]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[2]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[3]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[4]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[5]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[6]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[8]  ;
; -1.487 ; 1.000        ; 2.487          ; Min Period       ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[9]  ;
; 0.106  ; 0.322        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[0]        ;
; 0.106  ; 0.322        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[1]        ;
; 0.106  ; 0.322        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[2]        ;
; 0.106  ; 0.322        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[3]        ;
; 0.106  ; 0.322        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ0         ;
; 0.106  ; 0.322        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ1         ;
; 0.106  ; 0.322        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ2         ;
; 0.106  ; 0.322        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ3         ;
; 0.106  ; 0.322        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S0            ;
; 0.106  ; 0.322        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S7            ;
; 0.106  ; 0.322        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[0]             ;
; 0.106  ; 0.322        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[3]             ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us_clear       ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|one_wire_buf~en     ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S00           ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S1            ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S4            ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.S5            ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.WRITE00       ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.WRITE01       ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.WRITE1        ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[1]             ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[2]             ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[4]             ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|step[5]             ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[0]  ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[10] ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[1]  ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[2]  ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[3]  ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[8]  ;
; 0.107  ; 0.323        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|temperature_buf[9]  ;
; 0.108  ; 0.324        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[0]          ;
; 0.108  ; 0.324        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[10]         ;
; 0.108  ; 0.324        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[11]         ;
; 0.108  ; 0.324        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[12]         ;
; 0.108  ; 0.324        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[13]         ;
; 0.108  ; 0.324        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[14]         ;
; 0.108  ; 0.324        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[15]         ;
; 0.108  ; 0.324        ; 0.216          ; High Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[16]         ;
+--------+--------------+----------------+------------------+----------------------------------+------------+----------------------------------------------+


+--------------------------------------------------------------------------------------------------------------+
; Setup Times                                                                                                  ;
+-----------+----------------------------------+-------+-------+------------+----------------------------------+
; Data Port ; Clock Port                       ; Rise  ; Fall  ; Clock Edge ; Clock Reference                  ;
+-----------+----------------------------------+-------+-------+------------+----------------------------------+
; DS18B20   ; ds18b20_drive:ds18b20_u0|clk_1us ; 3.980 ; 3.970 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
; Q_KEY     ; ds18b20_drive:ds18b20_u0|clk_1us ; 3.269 ; 3.206 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+-----------+----------------------------------+-------+-------+------------+----------------------------------+


+----------------------------------------------------------------------------------------------------------------+
; Hold Times                                                                                                     ;
+-----------+----------------------------------+--------+--------+------------+----------------------------------+
; Data Port ; Clock Port                       ; Rise   ; Fall   ; Clock Edge ; Clock Reference                  ;
+-----------+----------------------------------+--------+--------+------------+----------------------------------+
; DS18B20   ; ds18b20_drive:ds18b20_u0|clk_1us ; -0.640 ; -0.706 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
; Q_KEY     ; ds18b20_drive:ds18b20_u0|clk_1us ; -1.695 ; -1.792 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+-----------+----------------------------------+--------+--------+------------+----------------------------------+


+-------------------------------------------------------------------------------------------------------------------+
; Clock to Output Times                                                                                             ;
+--------------+----------------------------------+--------+--------+------------+----------------------------------+
; Data Port    ; Clock Port                       ; Rise   ; Fall   ; Clock Edge ; Clock Reference                  ;
+--------------+----------------------------------+--------+--------+------------+----------------------------------+
; SEG7_SEG[*]  ; CLOCK_50                         ; 10.896 ; 10.235 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[0] ; CLOCK_50                         ; 8.507  ; 8.037  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[1] ; CLOCK_50                         ; 10.486 ; 9.745  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[2] ; CLOCK_50                         ; 8.495  ; 8.078  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[3] ; CLOCK_50                         ; 8.437  ; 8.048  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[4] ; CLOCK_50                         ; 8.435  ; 8.009  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[5] ; CLOCK_50                         ; 10.896 ; 10.235 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[6] ; CLOCK_50                         ; 8.295  ; 8.810  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[7] ; CLOCK_50                         ; 7.087  ; 6.686  ; Rise       ; CLOCK_50                         ;
; SEG7_SEL[*]  ; CLOCK_50                         ; 7.821  ; 7.390  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[0] ; CLOCK_50                         ; 7.529  ; 7.110  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[1] ; CLOCK_50                         ; 7.454  ; 7.051  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[2] ; CLOCK_50                         ; 7.821  ; 7.390  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[3] ; CLOCK_50                         ; 7.761  ; 7.256  ; Rise       ; CLOCK_50                         ;
; DS18B20      ; ds18b20_drive:ds18b20_u0|clk_1us ; 8.118  ; 8.560  ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+--------------+----------------------------------+--------+--------+------------+----------------------------------+


+------------------------------------------------------------------------------------------------------------------+
; Minimum Clock to Output Times                                                                                    ;
+--------------+----------------------------------+--------+-------+------------+----------------------------------+
; Data Port    ; Clock Port                       ; Rise   ; Fall  ; Clock Edge ; Clock Reference                  ;
+--------------+----------------------------------+--------+-------+------------+----------------------------------+
; SEG7_SEG[*]  ; CLOCK_50                         ; 6.940  ; 6.548 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[0] ; CLOCK_50                         ; 7.926  ; 7.459 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[1] ; CLOCK_50                         ; 9.926  ; 9.224 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[2] ; CLOCK_50                         ; 7.922  ; 7.519 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[3] ; CLOCK_50                         ; 7.858  ; 7.434 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[4] ; CLOCK_50                         ; 7.911  ; 7.428 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[5] ; CLOCK_50                         ; 10.392 ; 9.606 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[6] ; CLOCK_50                         ; 7.695  ; 8.220 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[7] ; CLOCK_50                         ; 6.940  ; 6.548 ; Rise       ; CLOCK_50                         ;
; SEG7_SEL[*]  ; CLOCK_50                         ; 7.292  ; 6.897 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[0] ; CLOCK_50                         ; 7.364  ; 6.954 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[1] ; CLOCK_50                         ; 7.292  ; 6.897 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[2] ; CLOCK_50                         ; 7.644  ; 7.223 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[3] ; CLOCK_50                         ; 7.587  ; 7.095 ; Rise       ; CLOCK_50                         ;
; DS18B20      ; ds18b20_drive:ds18b20_u0|clk_1us ; 7.885  ; 8.316 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+--------------+----------------------------------+--------+-------+------------+----------------------------------+


---------------------------------------------
; Slow 1200mV 0C Model Metastability Report ;
---------------------------------------------
No synchronizer chains to report.


+-----------------------------------------------------------+
; Fast 1200mV 0C Model Setup Summary                        ;
+----------------------------------+--------+---------------+
; Clock                            ; Slack  ; End Point TNS ;
+----------------------------------+--------+---------------+
; ds18b20_drive:ds18b20_u0|clk_1us ; -1.618 ; -46.813       ;
; CLOCK_50                         ; -0.948 ; -15.358       ;
+----------------------------------+--------+---------------+


+----------------------------------------------------------+
; Fast 1200mV 0C Model Hold Summary                        ;
+----------------------------------+-------+---------------+
; Clock                            ; Slack ; End Point TNS ;
+----------------------------------+-------+---------------+
; CLOCK_50                         ; 0.184 ; 0.000         ;
; ds18b20_drive:ds18b20_u0|clk_1us ; 0.186 ; 0.000         ;
+----------------------------------+-------+---------------+


-----------------------------------------
; Fast 1200mV 0C Model Recovery Summary ;
-----------------------------------------
No paths to report.


----------------------------------------
; Fast 1200mV 0C Model Removal Summary ;
----------------------------------------
No paths to report.


+-----------------------------------------------------------+
; Fast 1200mV 0C Model Minimum Pulse Width Summary          ;
+----------------------------------+--------+---------------+
; Clock                            ; Slack  ; End Point TNS ;
+----------------------------------+--------+---------------+
; CLOCK_50                         ; -3.000 ; -45.637       ;
; ds18b20_drive:ds18b20_u0|clk_1us ; -1.000 ; -60.000       ;
+----------------------------------+--------+---------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Setup: 'ds18b20_drive:ds18b20_u0|clk_1us'                                                                                                                                              ;
+--------+---------------------------------------+---------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+
; Slack  ; From Node                             ; To Node                                     ; Launch Clock                     ; Latch Clock                      ; Relationship ; Clock Skew ; Data Delay ;
+--------+---------------------------------------+---------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+
; -1.618 ; ds18b20_drive:ds18b20_u0|step[2]      ; ds18b20_drive:ds18b20_u0|state.S7           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.047     ; 2.558      ;
; -1.609 ; ds18b20_drive:ds18b20_u0|step[0]      ; ds18b20_drive:ds18b20_u0|one_wire_buf~en    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.030     ; 2.566      ;
; -1.602 ; ds18b20_drive:ds18b20_u0|step[3]      ; ds18b20_drive:ds18b20_u0|one_wire_buf~en    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.030     ; 2.559      ;
; -1.582 ; ds18b20_drive:ds18b20_u0|cnt_1us[8]   ; ds18b20_drive:ds18b20_u0|state.S2           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.031     ; 2.538      ;
; -1.579 ; ds18b20_drive:ds18b20_u0|cnt_1us[4]   ; ds18b20_drive:ds18b20_u0|state.WRITE0       ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.032     ; 2.534      ;
; -1.579 ; ds18b20_drive:ds18b20_u0|cnt_1us[4]   ; ds18b20_drive:ds18b20_u0|state.S6           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.032     ; 2.534      ;
; -1.575 ; ds18b20_drive:ds18b20_u0|cnt_1us[8]   ; ds18b20_drive:ds18b20_u0|state.WRITE0       ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.032     ; 2.530      ;
; -1.575 ; ds18b20_drive:ds18b20_u0|cnt_1us[8]   ; ds18b20_drive:ds18b20_u0|state.S6           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.032     ; 2.530      ;
; -1.567 ; ds18b20_drive:ds18b20_u0|cnt_1us[4]   ; ds18b20_drive:ds18b20_u0|state.S2           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.031     ; 2.523      ;
; -1.558 ; ds18b20_drive:ds18b20_u0|step[3]      ; ds18b20_drive:ds18b20_u0|state.S7           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.036     ; 2.509      ;
; -1.531 ; ds18b20_drive:ds18b20_u0|step[2]      ; ds18b20_drive:ds18b20_u0|one_wire_buf~en    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.041     ; 2.477      ;
; -1.505 ; ds18b20_drive:ds18b20_u0|cnt_1us[1]   ; ds18b20_drive:ds18b20_u0|state.WRITE0       ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.032     ; 2.460      ;
; -1.505 ; ds18b20_drive:ds18b20_u0|cnt_1us[1]   ; ds18b20_drive:ds18b20_u0|state.S6           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.032     ; 2.460      ;
; -1.495 ; ds18b20_drive:ds18b20_u0|cnt_1us[6]   ; ds18b20_drive:ds18b20_u0|cnt_1us_clear      ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.026     ; 2.456      ;
; -1.493 ; ds18b20_drive:ds18b20_u0|cnt_1us[1]   ; ds18b20_drive:ds18b20_u0|state.S2           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.031     ; 2.449      ;
; -1.490 ; ds18b20_drive:ds18b20_u0|cnt_1us[5]   ; ds18b20_drive:ds18b20_u0|state.S2           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.031     ; 2.446      ;
; -1.478 ; ds18b20_drive:ds18b20_u0|cnt_1us[7]   ; ds18b20_drive:ds18b20_u0|state.S2           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.031     ; 2.434      ;
; -1.477 ; ds18b20_drive:ds18b20_u0|step[1]      ; ds18b20_drive:ds18b20_u0|one_wire_buf~en    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.039     ; 2.425      ;
; -1.475 ; ds18b20_drive:ds18b20_u0|cnt_1us[6]   ; ds18b20_drive:ds18b20_u0|state.WRITE0       ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.032     ; 2.430      ;
; -1.475 ; ds18b20_drive:ds18b20_u0|cnt_1us[6]   ; ds18b20_drive:ds18b20_u0|state.S6           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.032     ; 2.430      ;
; -1.471 ; ds18b20_drive:ds18b20_u0|cnt_1us[7]   ; ds18b20_drive:ds18b20_u0|state.WRITE0       ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.032     ; 2.426      ;
; -1.471 ; ds18b20_drive:ds18b20_u0|cnt_1us[7]   ; ds18b20_drive:ds18b20_u0|state.S6           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.032     ; 2.426      ;
; -1.464 ; ds18b20_drive:ds18b20_u0|cnt_1us[5]   ; ds18b20_drive:ds18b20_u0|state.WRITE0       ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.032     ; 2.419      ;
; -1.464 ; ds18b20_drive:ds18b20_u0|cnt_1us[5]   ; ds18b20_drive:ds18b20_u0|state.S6           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.032     ; 2.419      ;
; -1.461 ; ds18b20_drive:ds18b20_u0|step[1]      ; ds18b20_drive:ds18b20_u0|state.S7           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.045     ; 2.403      ;
; -1.459 ; ds18b20_drive:ds18b20_u0|step[2]      ; ds18b20_drive:ds18b20_u0|state.WRITE0       ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.046     ; 2.400      ;
; -1.459 ; ds18b20_drive:ds18b20_u0|step[2]      ; ds18b20_drive:ds18b20_u0|state.S6           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.046     ; 2.400      ;
; -1.456 ; ds18b20_drive:ds18b20_u0|step[1]      ; ds18b20_drive:ds18b20_u0|state.WRITE01      ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.038     ; 2.405      ;
; -1.453 ; ds18b20_drive:ds18b20_u0|step[1]      ; ds18b20_drive:ds18b20_u0|step[3]            ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.045     ; 2.395      ;
; -1.444 ; ds18b20_drive:ds18b20_u0|step[3]      ; ds18b20_drive:ds18b20_u0|step[3]            ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.036     ; 2.395      ;
; -1.435 ; ds18b20_drive:ds18b20_u0|step[3]      ; ds18b20_drive:ds18b20_u0|step[0]            ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.036     ; 2.386      ;
; -1.429 ; ds18b20_drive:ds18b20_u0|step[1]      ; ds18b20_drive:ds18b20_u0|state.WRITE0       ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.044     ; 2.372      ;
; -1.429 ; ds18b20_drive:ds18b20_u0|step[1]      ; ds18b20_drive:ds18b20_u0|state.S6           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.044     ; 2.372      ;
; -1.428 ; ds18b20_drive:ds18b20_u0|state.S00    ; ds18b20_drive:ds18b20_u0|cnt_1us_clear      ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.016     ; 2.399      ;
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; -1.307 ; ds18b20_drive:ds18b20_u0|cnt_1us[9]   ; ds18b20_drive:ds18b20_u0|state.S6           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.032     ; 2.262      ;
; -1.306 ; ds18b20_drive:ds18b20_u0|cnt_1us[15]  ; ds18b20_drive:ds18b20_u0|state.WRITE0       ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.037     ; 2.256      ;
; -1.306 ; ds18b20_drive:ds18b20_u0|cnt_1us[15]  ; ds18b20_drive:ds18b20_u0|state.S6           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.037     ; 2.256      ;
; -1.300 ; ds18b20_drive:ds18b20_u0|cnt_1us[12]  ; ds18b20_drive:ds18b20_u0|state.WRITE0       ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.037     ; 2.250      ;
; -1.300 ; ds18b20_drive:ds18b20_u0|cnt_1us[12]  ; ds18b20_drive:ds18b20_u0|state.S6           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.037     ; 2.250      ;
; -1.299 ; ds18b20_drive:ds18b20_u0|cnt_1us[14]  ; ds18b20_drive:ds18b20_u0|cnt_1us_clear      ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.031     ; 2.255      ;
; -1.299 ; ds18b20_drive:ds18b20_u0|state.S00    ; ds18b20_drive:ds18b20_u0|state.WRITE0       ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.022     ; 2.264      ;
; -1.299 ; ds18b20_drive:ds18b20_u0|state.S00    ; ds18b20_drive:ds18b20_u0|state.S6           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.022     ; 2.264      ;
; -1.298 ; ds18b20_drive:ds18b20_u0|cnt_1us[10]  ; ds18b20_drive:ds18b20_u0|state.S2           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.036     ; 2.249      ;
; -1.297 ; ds18b20_drive:ds18b20_u0|state.S5     ; ds18b20_drive:ds18b20_u0|step[3]            ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.043     ; 2.241      ;
; -1.297 ; ds18b20_drive:ds18b20_u0|cnt_1us[9]   ; ds18b20_drive:ds18b20_u0|state.S2           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.031     ; 2.253      ;
; -1.296 ; ds18b20_drive:ds18b20_u0|step[4]      ; ds18b20_drive:ds18b20_u0|one_wire_buf~en    ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.039     ; 2.244      ;
; -1.296 ; ds18b20_drive:ds18b20_u0|cnt_1us[15]  ; ds18b20_drive:ds18b20_u0|state.S2           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.036     ; 2.247      ;
; -1.290 ; ds18b20_drive:ds18b20_u0|cnt_1us[12]  ; ds18b20_drive:ds18b20_u0|state.S2           ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.000        ; -0.036     ; 2.241      ;
+--------+---------------------------------------+---------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Setup: 'CLOCK_50'                                                                                                                                               ;
+--------+----------------------------------------------+------------------------------------+----------------------------------+-------------+--------------+------------+------------+
; Slack  ; From Node                                    ; To Node                            ; Launch Clock                     ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+--------+----------------------------------------------+------------------------------------+----------------------------------+-------------+--------------+------------+------------+
; -0.948 ; seg_dynamic_drive:seg7_u0|cnt[16]            ; seg_dynamic_drive:seg7_u0|HEX[3]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.050     ; 1.885      ;
; -0.944 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[16]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.055     ; 1.876      ;
; -0.940 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[15]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.055     ; 1.872      ;
; -0.911 ; seg_dynamic_drive:seg7_u0|cnt[15]            ; seg_dynamic_drive:seg7_u0|HEX[0]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.050     ; 1.848      ;
; -0.876 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[14]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.055     ; 1.808      ;
; -0.872 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[13]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.055     ; 1.804      ;
; -0.871 ; seg_dynamic_drive:seg7_u0|cnt[15]            ; seg_dynamic_drive:seg7_u0|HEX[1]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.050     ; 1.808      ;
; -0.857 ; seg_dynamic_drive:seg7_u0|cnt[15]            ; seg_dynamic_drive:seg7_u0|HEX[3]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.050     ; 1.794      ;
; -0.808 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[12]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.055     ; 1.740      ;
; -0.804 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[11]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.055     ; 1.736      ;
; -0.788 ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.641     ; 1.124      ;
; -0.774 ; ds18b20_drive:ds18b20_u0|temperature_buf[4]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.641     ; 1.110      ;
; -0.772 ; ds18b20_drive:ds18b20_u0|temperature_buf[9]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.642     ; 1.107      ;
; -0.758 ; ds18b20_drive:ds18b20_u0|temperature_buf[3]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.638     ; 1.097      ;
; -0.743 ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.641     ; 1.079      ;
; -0.740 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[10]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.055     ; 1.672      ;
; -0.740 ; ds18b20_drive:ds18b20_u0|temperature_buf[8]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.642     ; 1.075      ;
; -0.736 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[9]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.055     ; 1.668      ;
; -0.725 ; ds18b20_drive:ds18b20_u0|temperature_buf[5]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.641     ; 1.061      ;
; -0.718 ; ds18b20_drive:ds18b20_u0|temperature_buf[0]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.638     ; 1.057      ;
; -0.714 ; seg_dynamic_drive:seg7_u0|cnt[16]            ; seg_dynamic_drive:seg7_u0|HEX[0]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.050     ; 1.651      ;
; -0.713 ; ds18b20_drive:ds18b20_u0|temperature_buf[0]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.638     ; 1.052      ;
; -0.711 ; ds18b20_drive:ds18b20_u0|temperature_buf[1]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.638     ; 1.050      ;
; -0.710 ; ds18b20_drive:ds18b20_u0|temperature_buf[5]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.641     ; 1.046      ;
; -0.705 ; seg_dynamic_drive:seg7_u0|cnt[15]            ; seg_dynamic_drive:seg7_u0|HEX[2]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.050     ; 1.642      ;
; -0.697 ; ds18b20_drive:ds18b20_u0|temperature_buf[1]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.638     ; 1.036      ;
; -0.694 ; ds18b20_drive:ds18b20_u0|temperature_buf[3]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.638     ; 1.033      ;
; -0.693 ; seg_dynamic_drive:seg7_u0|cnt[16]            ; seg_dynamic_drive:seg7_u0|HEX[1]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.050     ; 1.630      ;
; -0.684 ; ds18b20_drive:ds18b20_u0|temperature_buf[10] ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.642     ; 1.019      ;
; -0.683 ; ds18b20_drive:ds18b20_u0|temperature_buf[0]  ; seg_dynamic_drive:seg7_u0|HEX[3]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.638     ; 1.022      ;
; -0.672 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[8]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.055     ; 1.604      ;
; -0.672 ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.641     ; 1.008      ;
; -0.669 ; ds18b20_drive:ds18b20_u0|temperature_buf[0]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.638     ; 1.008      ;
; -0.668 ; seg_dynamic_drive:seg7_u0|cnt[0]             ; seg_dynamic_drive:seg7_u0|cnt[7]   ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.055     ; 1.600      ;
; -0.658 ; ds18b20_drive:ds18b20_u0|temperature_buf[5]  ; seg_dynamic_drive:seg7_u0|HEX[1]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.641     ; 0.994      ;
; -0.648 ; ds18b20_drive:ds18b20_u0|temperature_buf[7]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.641     ; 0.984      ;
; -0.647 ; ds18b20_drive:ds18b20_u0|temperature_buf[2]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.638     ; 0.986      ;
; -0.646 ; ds18b20_drive:ds18b20_u0|temperature_buf[1]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.638     ; 0.985      ;
; -0.642 ; ds18b20_drive:ds18b20_u0|temperature_buf[4]  ; seg_dynamic_drive:seg7_u0|HEX[0]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.641     ; 0.978      ;
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; -0.634 ; ds18b20_drive:ds18b20_u0|temperature_buf[4]  ; seg_dynamic_drive:seg7_u0|HEX[2]   ; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50    ; 1.000        ; -0.641     ; 0.970      ;
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; -0.230 ; seg_dynamic_drive:seg7_u0|cnt[1]             ; seg_dynamic_drive:seg7_u0|cnt[15]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.035     ; 1.182      ;
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; -0.163 ; seg_dynamic_drive:seg7_u0|cnt[3]             ; seg_dynamic_drive:seg7_u0|cnt[15]  ; CLOCK_50                         ; CLOCK_50    ; 1.000        ; -0.035     ; 1.115      ;
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+--------+----------------------------------------------+------------------------------------+----------------------------------+-------------+--------------+------------+------------+


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; Fast 1200mV 0C Model Hold: 'CLOCK_50'                                                                                                               ;
+-------+-----------------------------------+-----------------------------------+--------------+-------------+--------------+------------+------------+
; Slack ; From Node                         ; To Node                           ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+-------+-----------------------------------+-----------------------------------+--------------+-------------+--------------+------------+------------+
; 0.184 ; seg_dynamic_drive:seg7_u0|cnt[0]  ; seg_dynamic_drive:seg7_u0|cnt[0]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.046      ; 0.314      ;
; 0.202 ; ds18b20_drive:ds18b20_u0|cnt[5]   ; ds18b20_drive:ds18b20_u0|clk_1us  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.321      ;
; 0.286 ; ds18b20_drive:ds18b20_u0|cnt[0]   ; ds18b20_drive:ds18b20_u0|cnt[4]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.405      ;
; 0.294 ; seg_dynamic_drive:seg7_u0|cnt[14] ; seg_dynamic_drive:seg7_u0|cnt[14] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.413      ;
; 0.294 ; seg_dynamic_drive:seg7_u0|cnt[4]  ; seg_dynamic_drive:seg7_u0|cnt[4]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.413      ;
; 0.294 ; seg_dynamic_drive:seg7_u0|cnt[2]  ; seg_dynamic_drive:seg7_u0|cnt[2]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.413      ;
; 0.295 ; seg_dynamic_drive:seg7_u0|cnt[12] ; seg_dynamic_drive:seg7_u0|cnt[12] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.414      ;
; 0.295 ; seg_dynamic_drive:seg7_u0|cnt[8]  ; seg_dynamic_drive:seg7_u0|cnt[8]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.414      ;
; 0.295 ; seg_dynamic_drive:seg7_u0|cnt[7]  ; seg_dynamic_drive:seg7_u0|cnt[7]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.414      ;
; 0.295 ; seg_dynamic_drive:seg7_u0|cnt[6]  ; seg_dynamic_drive:seg7_u0|cnt[6]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.414      ;
; 0.296 ; seg_dynamic_drive:seg7_u0|cnt[10] ; seg_dynamic_drive:seg7_u0|cnt[10] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.415      ;
; 0.296 ; seg_dynamic_drive:seg7_u0|cnt[3]  ; seg_dynamic_drive:seg7_u0|cnt[3]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.415      ;
; 0.297 ; seg_dynamic_drive:seg7_u0|cnt[13] ; seg_dynamic_drive:seg7_u0|cnt[13] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.416      ;
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; 0.308 ; ds18b20_drive:ds18b20_u0|cnt[2]   ; ds18b20_drive:ds18b20_u0|cnt[2]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.427      ;
; 0.317 ; seg_dynamic_drive:seg7_u0|cnt[16] ; seg_dynamic_drive:seg7_u0|cnt[16] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.436      ;
; 0.319 ; seg_dynamic_drive:seg7_u0|cnt[15] ; seg_dynamic_drive:seg7_u0|cnt[15] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.438      ;
; 0.319 ; ds18b20_drive:ds18b20_u0|cnt[0]   ; ds18b20_drive:ds18b20_u0|cnt[0]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.438      ;
; 0.351 ; ds18b20_drive:ds18b20_u0|cnt[3]   ; ds18b20_drive:ds18b20_u0|clk_1us  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.470      ;
; 0.360 ; ds18b20_drive:ds18b20_u0|cnt[5]   ; ds18b20_drive:ds18b20_u0|cnt[5]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.479      ;
; 0.390 ; ds18b20_drive:ds18b20_u0|cnt[3]   ; ds18b20_drive:ds18b20_u0|cnt[1]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.509      ;
; 0.392 ; ds18b20_drive:ds18b20_u0|cnt[3]   ; ds18b20_drive:ds18b20_u0|cnt[4]   ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.511      ;
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; 0.443 ; seg_dynamic_drive:seg7_u0|cnt[4]  ; seg_dynamic_drive:seg7_u0|cnt[5]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.562      ;
; 0.443 ; seg_dynamic_drive:seg7_u0|cnt[14] ; seg_dynamic_drive:seg7_u0|cnt[15] ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.562      ;
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; 0.444 ; seg_dynamic_drive:seg7_u0|cnt[8]  ; seg_dynamic_drive:seg7_u0|cnt[9]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.563      ;
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; 0.457 ; seg_dynamic_drive:seg7_u0|cnt[3]  ; seg_dynamic_drive:seg7_u0|cnt[5]  ; CLOCK_50     ; CLOCK_50    ; 0.000        ; 0.035      ; 0.576      ;
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+-------+-----------------------------------+-----------------------------------+--------------+-------------+--------------+------------+------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Hold: 'ds18b20_drive:ds18b20_u0|clk_1us'                                                                                                                                                      ;
+-------+----------------------------------------------+----------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+
; Slack ; From Node                                    ; To Node                                      ; Launch Clock                     ; Latch Clock                      ; Relationship ; Clock Skew ; Data Delay ;
+-------+----------------------------------------------+----------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+
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; 0.515 ; ds18b20_drive:ds18b20_u0|cnt_1us[17]         ; ds18b20_drive:ds18b20_u0|cnt_1us[19]         ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.037      ; 0.636      ;
; 0.516 ; ds18b20_drive:ds18b20_u0|state.READ2         ; ds18b20_drive:ds18b20_u0|state.READ3         ; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 0.000        ; 0.037      ; 0.637      ;
+-------+----------------------------------------------+----------------------------------------------+----------------------------------+----------------------------------+--------------+------------+------------+


+-----------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Minimum Pulse Width: 'CLOCK_50'                                                                  ;
+--------+--------------+----------------+-----------------+----------+------------+------------------------------------+
; Slack  ; Actual Width ; Required Width ; Type            ; Clock    ; Clock Edge ; Target                             ;
+--------+--------------+----------------+-----------------+----------+------------+------------------------------------+
; -3.000 ; 1.000        ; 4.000          ; Port Rate       ; CLOCK_50 ; Rise       ; CLOCK_50                           ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[0]    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[1]    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[2]    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[3]    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[4]    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[5]    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[0]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[1]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[2]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[3]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG[7]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[0] ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[1] ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[2] ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[3] ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[0]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[10]  ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[11]  ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[12]  ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[13]  ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[14]  ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[15]  ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[16]  ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[1]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[2]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[3]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[4]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[5]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[6]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[7]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[8]   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[9]   ;
; -0.234 ; -0.050       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us   ;
; -0.234 ; -0.050       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[0]    ;
; -0.234 ; -0.050       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[1]    ;
; -0.234 ; -0.050       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[2]    ;
; -0.234 ; -0.050       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[3]    ;
; -0.234 ; -0.050       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[4]    ;
; -0.234 ; -0.050       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_drive:ds18b20_u0|cnt[5]    ;
; -0.234 ; -0.050       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[0]   ;
; -0.234 ; -0.050       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[1]   ;
; -0.234 ; -0.050       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[2]   ;
; -0.234 ; -0.050       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|HEX[3]   ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG[7]   ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[0] ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[1] ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[2] ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|SEG_S[3] ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[0]   ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[10]  ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[11]  ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[12]  ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[13]  ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[14]  ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[15]  ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[16]  ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[1]   ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[2]   ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[3]   ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[4]   ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[5]   ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[6]   ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[7]   ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[8]   ;
; -0.233 ; -0.049       ; 0.184          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg_dynamic_drive:seg7_u0|cnt[9]   ;
; -0.059 ; -0.059       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; CLOCK_50~input|o                   ;
; -0.055 ; -0.055       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_u0|clk_1us|clk             ;
; -0.055 ; -0.055       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_u0|cnt[0]|clk              ;
; -0.055 ; -0.055       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_u0|cnt[1]|clk              ;
; -0.055 ; -0.055       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_u0|cnt[2]|clk              ;
; -0.055 ; -0.055       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_u0|cnt[3]|clk              ;
; -0.055 ; -0.055       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_u0|cnt[4]|clk              ;
; -0.055 ; -0.055       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; ds18b20_u0|cnt[5]|clk              ;
; -0.055 ; -0.055       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|HEX[0]|clk                 ;
; -0.055 ; -0.055       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|HEX[1]|clk                 ;
; -0.055 ; -0.055       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|HEX[2]|clk                 ;
; -0.055 ; -0.055       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|HEX[3]|clk                 ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[0]|clk                 ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[10]|clk                ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[11]|clk                ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[12]|clk                ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[13]|clk                ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[14]|clk                ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[15]|clk                ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[16]|clk                ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[1]|clk                 ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[2]|clk                 ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[3]|clk                 ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[4]|clk                 ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[5]|clk                 ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[6]|clk                 ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[7]|clk                 ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[8]|clk                 ;
; -0.054 ; -0.054       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|cnt[9]|clk                 ;
; -0.053 ; -0.053       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|SEG[7]|clk                 ;
; -0.053 ; -0.053       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|SEG_S[0]|clk               ;
; -0.053 ; -0.053       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|SEG_S[1]|clk               ;
; -0.053 ; -0.053       ; 0.000          ; Low Pulse Width ; CLOCK_50 ; Rise       ; seg7_u0|SEG_S[2]|clk               ;
+--------+--------------+----------------+-----------------+----------+------------+------------------------------------+


+---------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Minimum Pulse Width: 'ds18b20_drive:ds18b20_u0|clk_1us'                                                                            ;
+--------+--------------+----------------+-----------------+----------------------------------+------------+----------------------------------------------+
; Slack  ; Actual Width ; Required Width ; Type            ; Clock                            ; Clock Edge ; Target                                       ;
+--------+--------------+----------------+-----------------+----------------------------------+------------+----------------------------------------------+
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[0]        ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[1]        ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[2]        ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|bit_valid[3]        ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[0]          ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[10]         ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[11]         ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[12]         ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[13]         ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[14]         ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[15]         ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[16]         ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[17]         ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[18]         ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[19]         ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[1]          ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[2]          ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[3]          ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[4]          ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[5]          ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[6]          ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[7]          ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[8]          ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us[9]          ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|cnt_1us_clear       ;
; -1.000 ; 1.000        ; 2.000          ; Min Period      ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|one_wire_buf~en     ;
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; 0.160  ; 0.344        ; 0.184          ; Low Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ1         ;
; 0.160  ; 0.344        ; 0.184          ; Low Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ2         ;
; 0.160  ; 0.344        ; 0.184          ; Low Pulse Width ; ds18b20_drive:ds18b20_u0|clk_1us ; Rise       ; ds18b20_drive:ds18b20_u0|state.READ3         ;
+--------+--------------+----------------+-----------------+----------------------------------+------------+----------------------------------------------+


+--------------------------------------------------------------------------------------------------------------+
; Setup Times                                                                                                  ;
+-----------+----------------------------------+-------+-------+------------+----------------------------------+
; Data Port ; Clock Port                       ; Rise  ; Fall  ; Clock Edge ; Clock Reference                  ;
+-----------+----------------------------------+-------+-------+------------+----------------------------------+
; DS18B20   ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.796 ; 2.700 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
; Q_KEY     ; ds18b20_drive:ds18b20_u0|clk_1us ; 1.554 ; 2.431 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+-----------+----------------------------------+-------+-------+------------+----------------------------------+


+----------------------------------------------------------------------------------------------------------------+
; Hold Times                                                                                                     ;
+-----------+----------------------------------+--------+--------+------------+----------------------------------+
; Data Port ; Clock Port                       ; Rise   ; Fall   ; Clock Edge ; Clock Reference                  ;
+-----------+----------------------------------+--------+--------+------------+----------------------------------+
; DS18B20   ; ds18b20_drive:ds18b20_u0|clk_1us ; -0.329 ; -1.101 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
; Q_KEY     ; ds18b20_drive:ds18b20_u0|clk_1us ; -0.848 ; -1.656 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+-----------+----------------------------------+--------+--------+------------+----------------------------------+


+-----------------------------------------------------------------------------------------------------------------+
; Clock to Output Times                                                                                           ;
+--------------+----------------------------------+-------+-------+------------+----------------------------------+
; Data Port    ; Clock Port                       ; Rise  ; Fall  ; Clock Edge ; Clock Reference                  ;
+--------------+----------------------------------+-------+-------+------------+----------------------------------+
; SEG7_SEG[*]  ; CLOCK_50                         ; 5.883 ; 5.658 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[0] ; CLOCK_50                         ; 4.221 ; 4.193 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[1] ; CLOCK_50                         ; 5.627 ; 5.441 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[2] ; CLOCK_50                         ; 4.239 ; 4.199 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[3] ; CLOCK_50                         ; 4.217 ; 4.173 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[4] ; CLOCK_50                         ; 4.202 ; 4.182 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[5] ; CLOCK_50                         ; 5.883 ; 5.658 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[6] ; CLOCK_50                         ; 4.363 ; 4.361 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[7] ; CLOCK_50                         ; 3.542 ; 3.528 ; Rise       ; CLOCK_50                         ;
; SEG7_SEL[*]  ; CLOCK_50                         ; 3.875 ; 3.923 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[0] ; CLOCK_50                         ; 3.735 ; 3.760 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[1] ; CLOCK_50                         ; 3.703 ; 3.730 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[2] ; CLOCK_50                         ; 3.875 ; 3.923 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[3] ; CLOCK_50                         ; 3.814 ; 3.853 ; Rise       ; CLOCK_50                         ;
; DS18B20      ; ds18b20_drive:ds18b20_u0|clk_1us ; 4.293 ; 4.283 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+--------------+----------------------------------+-------+-------+------------+----------------------------------+


+-----------------------------------------------------------------------------------------------------------------+
; Minimum Clock to Output Times                                                                                   ;
+--------------+----------------------------------+-------+-------+------------+----------------------------------+
; Data Port    ; Clock Port                       ; Rise  ; Fall  ; Clock Edge ; Clock Reference                  ;
+--------------+----------------------------------+-------+-------+------------+----------------------------------+
; SEG7_SEG[*]  ; CLOCK_50                         ; 3.471 ; 3.455 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[0] ; CLOCK_50                         ; 3.890 ; 3.865 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[1] ; CLOCK_50                         ; 5.327 ; 5.110 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[2] ; CLOCK_50                         ; 3.957 ; 3.867 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[3] ; CLOCK_50                         ; 3.879 ; 3.851 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[4] ; CLOCK_50                         ; 3.866 ; 3.916 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[5] ; CLOCK_50                         ; 5.523 ; 5.394 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[6] ; CLOCK_50                         ; 4.033 ; 4.035 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[7] ; CLOCK_50                         ; 3.471 ; 3.455 ; Rise       ; CLOCK_50                         ;
; SEG7_SEL[*]  ; CLOCK_50                         ; 3.625 ; 3.648 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[0] ; CLOCK_50                         ; 3.655 ; 3.677 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[1] ; CLOCK_50                         ; 3.625 ; 3.648 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[2] ; CLOCK_50                         ; 3.790 ; 3.833 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[3] ; CLOCK_50                         ; 3.732 ; 3.766 ; Rise       ; CLOCK_50                         ;
; DS18B20      ; ds18b20_drive:ds18b20_u0|clk_1us ; 4.176 ; 4.170 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+--------------+----------------------------------+-------+-------+------------+----------------------------------+


---------------------------------------------
; Fast 1200mV 0C Model Metastability Report ;
---------------------------------------------
No synchronizer chains to report.


+-------------------------------------------------------------------------------------------------+
; Multicorner Timing Analysis Summary                                                             ;
+-----------------------------------+----------+-------+----------+---------+---------------------+
; Clock                             ; Setup    ; Hold  ; Recovery ; Removal ; Minimum Pulse Width ;
+-----------------------------------+----------+-------+----------+---------+---------------------+
; Worst-case Slack                  ; -5.081   ; 0.184 ; N/A      ; N/A     ; -3.000              ;
;  CLOCK_50                         ; -3.472   ; 0.184 ; N/A      ; N/A     ; -3.000              ;
;  ds18b20_drive:ds18b20_u0|clk_1us ; -5.081   ; 0.186 ; N/A      ; N/A     ; -1.487              ;
; Design-wide TNS                   ; -251.528 ; 0.0   ; 0.0      ; 0.0     ; -141.291            ;
;  CLOCK_50                         ; -72.993  ; 0.000 ; N/A      ; N/A     ; -52.071             ;
;  ds18b20_drive:ds18b20_u0|clk_1us ; -178.535 ; 0.000 ; N/A      ; N/A     ; -89.220             ;
+-----------------------------------+----------+-------+----------+---------+---------------------+


+--------------------------------------------------------------------------------------------------------------+
; Setup Times                                                                                                  ;
+-----------+----------------------------------+-------+-------+------------+----------------------------------+
; Data Port ; Clock Port                       ; Rise  ; Fall  ; Clock Edge ; Clock Reference                  ;
+-----------+----------------------------------+-------+-------+------------+----------------------------------+
; DS18B20   ; ds18b20_drive:ds18b20_u0|clk_1us ; 4.326 ; 4.592 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
; Q_KEY     ; ds18b20_drive:ds18b20_u0|clk_1us ; 3.532 ; 3.696 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+-----------+----------------------------------+-------+-------+------------+----------------------------------+


+----------------------------------------------------------------------------------------------------------------+
; Hold Times                                                                                                     ;
+-----------+----------------------------------+--------+--------+------------+----------------------------------+
; Data Port ; Clock Port                       ; Rise   ; Fall   ; Clock Edge ; Clock Reference                  ;
+-----------+----------------------------------+--------+--------+------------+----------------------------------+
; DS18B20   ; ds18b20_drive:ds18b20_u0|clk_1us ; -0.329 ; -0.706 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
; Q_KEY     ; ds18b20_drive:ds18b20_u0|clk_1us ; -0.848 ; -1.656 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+-----------+----------------------------------+--------+--------+------------+----------------------------------+


+-------------------------------------------------------------------------------------------------------------------+
; Clock to Output Times                                                                                             ;
+--------------+----------------------------------+--------+--------+------------+----------------------------------+
; Data Port    ; Clock Port                       ; Rise   ; Fall   ; Clock Edge ; Clock Reference                  ;
+--------------+----------------------------------+--------+--------+------------+----------------------------------+
; SEG7_SEG[*]  ; CLOCK_50                         ; 11.340 ; 10.705 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[0] ; CLOCK_50                         ; 8.874  ; 8.488  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[1] ; CLOCK_50                         ; 10.832 ; 10.264 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[2] ; CLOCK_50                         ; 8.899  ; 8.530  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[3] ; CLOCK_50                         ; 8.801  ; 8.484  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[4] ; CLOCK_50                         ; 8.800  ; 8.458  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[5] ; CLOCK_50                         ; 11.340 ; 10.705 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[6] ; CLOCK_50                         ; 8.762  ; 9.181  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[7] ; CLOCK_50                         ; 7.371  ; 7.059  ; Rise       ; CLOCK_50                         ;
; SEG7_SEL[*]  ; CLOCK_50                         ; 8.156  ; 7.820  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[0] ; CLOCK_50                         ; 7.848  ; 7.513  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[1] ; CLOCK_50                         ; 7.770  ; 7.445  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[2] ; CLOCK_50                         ; 8.156  ; 7.820  ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[3] ; CLOCK_50                         ; 8.063  ; 7.719  ; Rise       ; CLOCK_50                         ;
; DS18B20      ; ds18b20_drive:ds18b20_u0|clk_1us ; 8.603  ; 8.938  ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+--------------+----------------------------------+--------+--------+------------+----------------------------------+


+-----------------------------------------------------------------------------------------------------------------+
; Minimum Clock to Output Times                                                                                   ;
+--------------+----------------------------------+-------+-------+------------+----------------------------------+
; Data Port    ; Clock Port                       ; Rise  ; Fall  ; Clock Edge ; Clock Reference                  ;
+--------------+----------------------------------+-------+-------+------------+----------------------------------+
; SEG7_SEG[*]  ; CLOCK_50                         ; 3.471 ; 3.455 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[0] ; CLOCK_50                         ; 3.890 ; 3.865 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[1] ; CLOCK_50                         ; 5.327 ; 5.110 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[2] ; CLOCK_50                         ; 3.957 ; 3.867 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[3] ; CLOCK_50                         ; 3.879 ; 3.851 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[4] ; CLOCK_50                         ; 3.866 ; 3.916 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[5] ; CLOCK_50                         ; 5.523 ; 5.394 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[6] ; CLOCK_50                         ; 4.033 ; 4.035 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEG[7] ; CLOCK_50                         ; 3.471 ; 3.455 ; Rise       ; CLOCK_50                         ;
; SEG7_SEL[*]  ; CLOCK_50                         ; 3.625 ; 3.648 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[0] ; CLOCK_50                         ; 3.655 ; 3.677 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[1] ; CLOCK_50                         ; 3.625 ; 3.648 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[2] ; CLOCK_50                         ; 3.790 ; 3.833 ; Rise       ; CLOCK_50                         ;
;  SEG7_SEL[3] ; CLOCK_50                         ; 3.732 ; 3.766 ; Rise       ; CLOCK_50                         ;
; DS18B20      ; ds18b20_drive:ds18b20_u0|clk_1us ; 4.176 ; 4.170 ; Rise       ; ds18b20_drive:ds18b20_u0|clk_1us ;
+--------------+----------------------------------+-------+-------+------------+----------------------------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Board Trace Model Assignments                                                                                                                                                                                                                                                                                                                                                                                    ;
+---------------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+---------------+-----------------+-------------+
; Pin           ; I/O Standard ; Near Tline Length ; Near Tline L per Length ; Near Tline C per Length ; Near Series R ; Near Differential R ; Near Pull-up R ; Near Pull-down R ; Near C ; Far Tline Length ; Far Tline L per Length ; Far Tline C per Length ; Far Series R ; Far Pull-up R ; Far Pull-down R ; Far C ; Termination Voltage ; Far Differential R ; EBD File Name ; EBD Signal Name ; EBD Far-end ;
+---------------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+---------------+-----------------+-------------+
; SEG7_SEG[0]   ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; SEG7_SEG[1]   ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; SEG7_SEG[2]   ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; SEG7_SEG[3]   ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; SEG7_SEG[4]   ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; SEG7_SEG[5]   ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; SEG7_SEG[6]   ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; SEG7_SEG[7]   ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; SEG7_SEL[0]   ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; SEG7_SEL[1]   ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; SEG7_SEL[2]   ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; SEG7_SEL[3]   ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; DS18B20       ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; ~ALTERA_DCLK~ ; 3.3-V LVTTL  ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
+---------------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+---------------+-----------------+-------------+


+----------------------------------------------------------------------------+
; Input Transition Times                                                     ;
+-------------------------+--------------+-----------------+-----------------+
; Pin                     ; I/O Standard ; 10-90 Rise Time ; 90-10 Fall Time ;
+-------------------------+--------------+-----------------+-----------------+
; DS18B20                 ; 3.3-V LVTTL  ; 2640 ps         ; 2640 ps         ;
; CLOCK_50                ; 3.3-V LVTTL  ; 2640 ps         ; 2640 ps         ;
; Q_KEY                   ; 3.3-V LVTTL  ; 2640 ps         ; 2640 ps         ;
; ~ALTERA_ASDO_DATA1~     ; 3.3-V LVTTL  ; 2640 ps         ; 2640 ps         ;
; ~ALTERA_FLASH_nCE_nCSO~ ; 3.3-V LVTTL  ; 2640 ps         ; 2640 ps         ;
; ~ALTERA_DATA0~          ; 3.3-V LVTTL  ; 2640 ps         ; 2640 ps         ;
+-------------------------+--------------+-----------------+-----------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow Corner Signal Integrity Metrics                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                       ;
+---------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; Pin           ; I/O Standard ; Board Delay on Rise ; Board Delay on Fall ; Steady State Voh at FPGA Pin ; Steady State Vol at FPGA Pin ; Voh Max at FPGA Pin ; Vol Min at FPGA Pin ; Ringback Voltage on Rise at FPGA Pin ; Ringback Voltage on Fall at FPGA Pin ; 10-90 Rise Time at FPGA Pin ; 90-10 Fall Time at FPGA Pin ; Monotonic Rise at FPGA Pin ; Monotonic Fall at FPGA Pin ; Steady State Voh at Far-end ; Steady State Vol at Far-end ; Voh Max at Far-end ; Vol Min at Far-end ; Ringback Voltage on Rise at Far-end ; Ringback Voltage on Fall at Far-end ; 10-90 Rise Time at Far-end ; 90-10 Fall Time at Far-end ; Monotonic Rise at Far-end ; Monotonic Fall at Far-end ;
+---------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; SEG7_SEG[0]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 5.19e-07 V                   ; 3.11 V              ; -0.0313 V           ; 0.287 V                              ; 0.284 V                              ; 1.36e-09 s                  ; 1.1e-09 s                   ; No                         ; Yes                        ; 3.08 V                      ; 5.19e-07 V                  ; 3.11 V             ; -0.0313 V          ; 0.287 V                             ; 0.284 V                             ; 1.36e-09 s                 ; 1.1e-09 s                  ; No                        ; Yes                       ;
; SEG7_SEG[1]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 5.19e-07 V                   ; 3.08 V              ; -0.00384 V          ; 0.283 V                              ; 0.244 V                              ; 6.17e-09 s                  ; 4.9e-09 s                   ; No                         ; Yes                        ; 3.08 V                      ; 5.19e-07 V                  ; 3.08 V             ; -0.00384 V         ; 0.283 V                             ; 0.244 V                             ; 6.17e-09 s                 ; 4.9e-09 s                  ; No                        ; Yes                       ;
; SEG7_SEG[2]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 5.19e-07 V                   ; 3.11 V              ; -0.0313 V           ; 0.287 V                              ; 0.284 V                              ; 1.36e-09 s                  ; 1.1e-09 s                   ; No                         ; Yes                        ; 3.08 V                      ; 5.19e-07 V                  ; 3.11 V             ; -0.0313 V          ; 0.287 V                             ; 0.284 V                             ; 1.36e-09 s                 ; 1.1e-09 s                  ; No                        ; Yes                       ;
; SEG7_SEG[3]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 5.19e-07 V                   ; 3.11 V              ; -0.0313 V           ; 0.287 V                              ; 0.284 V                              ; 1.36e-09 s                  ; 1.1e-09 s                   ; No                         ; Yes                        ; 3.08 V                      ; 5.19e-07 V                  ; 3.11 V             ; -0.0313 V          ; 0.287 V                             ; 0.284 V                             ; 1.36e-09 s                 ; 1.1e-09 s                  ; No                        ; Yes                       ;
; SEG7_SEG[4]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 5.19e-07 V                   ; 3.11 V              ; -0.0313 V           ; 0.287 V                              ; 0.284 V                              ; 1.36e-09 s                  ; 1.1e-09 s                   ; No                         ; Yes                        ; 3.08 V                      ; 5.19e-07 V                  ; 3.11 V             ; -0.0313 V          ; 0.287 V                             ; 0.284 V                             ; 1.36e-09 s                 ; 1.1e-09 s                  ; No                        ; Yes                       ;
; SEG7_SEG[5]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 5.19e-07 V                   ; 3.08 V              ; -0.00384 V          ; 0.283 V                              ; 0.244 V                              ; 6.17e-09 s                  ; 4.9e-09 s                   ; No                         ; Yes                        ; 3.08 V                      ; 5.19e-07 V                  ; 3.08 V             ; -0.00384 V         ; 0.283 V                             ; 0.244 V                             ; 6.17e-09 s                 ; 4.9e-09 s                  ; No                        ; Yes                       ;
; SEG7_SEG[6]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 5.19e-07 V                   ; 3.11 V              ; -0.0313 V           ; 0.287 V                              ; 0.284 V                              ; 1.36e-09 s                  ; 1.1e-09 s                   ; No                         ; Yes                        ; 3.08 V                      ; 5.19e-07 V                  ; 3.11 V             ; -0.0313 V          ; 0.287 V                             ; 0.284 V                             ; 1.36e-09 s                 ; 1.1e-09 s                  ; No                        ; Yes                       ;
; SEG7_SEG[7]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 5.19e-07 V                   ; 3.11 V              ; -0.0313 V           ; 0.287 V                              ; 0.284 V                              ; 1.36e-09 s                  ; 1.1e-09 s                   ; No                         ; Yes                        ; 3.08 V                      ; 5.19e-07 V                  ; 3.11 V             ; -0.0313 V          ; 0.287 V                             ; 0.284 V                             ; 1.36e-09 s                 ; 1.1e-09 s                  ; No                        ; Yes                       ;
; SEG7_SEL[0]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 5.19e-07 V                   ; 3.11 V              ; -0.0313 V           ; 0.287 V                              ; 0.284 V                              ; 1.36e-09 s                  ; 1.1e-09 s                   ; No                         ; Yes                        ; 3.08 V                      ; 5.19e-07 V                  ; 3.11 V             ; -0.0313 V          ; 0.287 V                             ; 0.284 V                             ; 1.36e-09 s                 ; 1.1e-09 s                  ; No                        ; Yes                       ;
; SEG7_SEL[1]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 5.19e-07 V                   ; 3.11 V              ; -0.0313 V           ; 0.287 V                              ; 0.284 V                              ; 1.36e-09 s                  ; 1.1e-09 s                   ; No                         ; Yes                        ; 3.08 V                      ; 5.19e-07 V                  ; 3.11 V             ; -0.0313 V          ; 0.287 V                             ; 0.284 V                             ; 1.36e-09 s                 ; 1.1e-09 s                  ; No                        ; Yes                       ;
; SEG7_SEL[2]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 5.19e-07 V                   ; 3.11 V              ; -0.0313 V           ; 0.287 V                              ; 0.284 V                              ; 1.36e-09 s                  ; 1.1e-09 s                   ; No                         ; Yes                        ; 3.08 V                      ; 5.19e-07 V                  ; 3.11 V             ; -0.0313 V          ; 0.287 V                             ; 0.284 V                             ; 1.36e-09 s                 ; 1.1e-09 s                  ; No                        ; Yes                       ;
; SEG7_SEL[3]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 5.19e-07 V                   ; 3.11 V              ; -0.0313 V           ; 0.287 V                              ; 0.284 V                              ; 1.36e-09 s                  ; 1.1e-09 s                   ; No                         ; Yes                        ; 3.08 V                      ; 5.19e-07 V                  ; 3.11 V             ; -0.0313 V          ; 0.287 V                             ; 0.284 V                             ; 1.36e-09 s                 ; 1.1e-09 s                  ; No                        ; Yes                       ;
; DS18B20       ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 5.19e-07 V                   ; 3.11 V              ; -0.0313 V           ; 0.287 V                              ; 0.284 V                              ; 1.36e-09 s                  ; 1.1e-09 s                   ; No                         ; Yes                        ; 3.08 V                      ; 5.19e-07 V                  ; 3.11 V             ; -0.0313 V          ; 0.287 V                             ; 0.284 V                             ; 1.36e-09 s                 ; 1.1e-09 s                  ; No                        ; Yes                       ;
; ~ALTERA_DCLK~ ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.08 V                       ; 2.58e-07 V                   ; 3.13 V              ; -0.0396 V           ; 0.18 V                               ; 0.073 V                              ; 4.81e-10 s                  ; 4.67e-10 s                  ; Yes                        ; Yes                        ; 3.08 V                      ; 2.58e-07 V                  ; 3.13 V             ; -0.0396 V          ; 0.18 V                              ; 0.073 V                             ; 4.81e-10 s                 ; 4.67e-10 s                 ; Yes                       ; Yes                       ;
+---------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast Corner Signal Integrity Metrics                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                       ;
+---------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; Pin           ; I/O Standard ; Board Delay on Rise ; Board Delay on Fall ; Steady State Voh at FPGA Pin ; Steady State Vol at FPGA Pin ; Voh Max at FPGA Pin ; Vol Min at FPGA Pin ; Ringback Voltage on Rise at FPGA Pin ; Ringback Voltage on Fall at FPGA Pin ; 10-90 Rise Time at FPGA Pin ; 90-10 Fall Time at FPGA Pin ; Monotonic Rise at FPGA Pin ; Monotonic Fall at FPGA Pin ; Steady State Voh at Far-end ; Steady State Vol at Far-end ; Voh Max at Far-end ; Vol Min at Far-end ; Ringback Voltage on Rise at Far-end ; Ringback Voltage on Fall at Far-end ; 10-90 Rise Time at Far-end ; 90-10 Fall Time at Far-end ; Monotonic Rise at Far-end ; Monotonic Fall at Far-end ;
+---------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; SEG7_SEG[0]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 1.29e-07 V                   ; 3.55 V              ; -0.053 V            ; 0.341 V                              ; 0.35 V                               ; 9.04e-10 s                  ; 7.28e-10 s                  ; No                         ; No                         ; 3.46 V                      ; 1.29e-07 V                  ; 3.55 V             ; -0.053 V           ; 0.341 V                             ; 0.35 V                              ; 9.04e-10 s                 ; 7.28e-10 s                 ; No                        ; No                        ;
; SEG7_SEG[1]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 1.29e-07 V                   ; 3.48 V              ; -0.0136 V           ; 0.352 V                              ; 0.346 V                              ; 4.12e-09 s                  ; 3.34e-09 s                  ; No                         ; Yes                        ; 3.46 V                      ; 1.29e-07 V                  ; 3.48 V             ; -0.0136 V          ; 0.352 V                             ; 0.346 V                             ; 4.12e-09 s                 ; 3.34e-09 s                 ; No                        ; Yes                       ;
; SEG7_SEG[2]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 1.29e-07 V                   ; 3.55 V              ; -0.053 V            ; 0.341 V                              ; 0.35 V                               ; 9.04e-10 s                  ; 7.28e-10 s                  ; No                         ; No                         ; 3.46 V                      ; 1.29e-07 V                  ; 3.55 V             ; -0.053 V           ; 0.341 V                             ; 0.35 V                              ; 9.04e-10 s                 ; 7.28e-10 s                 ; No                        ; No                        ;
; SEG7_SEG[3]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 1.29e-07 V                   ; 3.55 V              ; -0.053 V            ; 0.341 V                              ; 0.35 V                               ; 9.04e-10 s                  ; 7.28e-10 s                  ; No                         ; No                         ; 3.46 V                      ; 1.29e-07 V                  ; 3.55 V             ; -0.053 V           ; 0.341 V                             ; 0.35 V                              ; 9.04e-10 s                 ; 7.28e-10 s                 ; No                        ; No                        ;
; SEG7_SEG[4]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 1.29e-07 V                   ; 3.55 V              ; -0.053 V            ; 0.341 V                              ; 0.35 V                               ; 9.04e-10 s                  ; 7.28e-10 s                  ; No                         ; No                         ; 3.46 V                      ; 1.29e-07 V                  ; 3.55 V             ; -0.053 V           ; 0.341 V                             ; 0.35 V                              ; 9.04e-10 s                 ; 7.28e-10 s                 ; No                        ; No                        ;
; SEG7_SEG[5]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 1.29e-07 V                   ; 3.48 V              ; -0.0136 V           ; 0.352 V                              ; 0.346 V                              ; 4.12e-09 s                  ; 3.34e-09 s                  ; No                         ; Yes                        ; 3.46 V                      ; 1.29e-07 V                  ; 3.48 V             ; -0.0136 V          ; 0.352 V                             ; 0.346 V                             ; 4.12e-09 s                 ; 3.34e-09 s                 ; No                        ; Yes                       ;
; SEG7_SEG[6]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 1.29e-07 V                   ; 3.55 V              ; -0.053 V            ; 0.341 V                              ; 0.35 V                               ; 9.04e-10 s                  ; 7.28e-10 s                  ; No                         ; No                         ; 3.46 V                      ; 1.29e-07 V                  ; 3.55 V             ; -0.053 V           ; 0.341 V                             ; 0.35 V                              ; 9.04e-10 s                 ; 7.28e-10 s                 ; No                        ; No                        ;
; SEG7_SEG[7]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 1.29e-07 V                   ; 3.55 V              ; -0.053 V            ; 0.341 V                              ; 0.35 V                               ; 9.04e-10 s                  ; 7.28e-10 s                  ; No                         ; No                         ; 3.46 V                      ; 1.29e-07 V                  ; 3.55 V             ; -0.053 V           ; 0.341 V                             ; 0.35 V                              ; 9.04e-10 s                 ; 7.28e-10 s                 ; No                        ; No                        ;
; SEG7_SEL[0]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 1.29e-07 V                   ; 3.55 V              ; -0.053 V            ; 0.341 V                              ; 0.35 V                               ; 9.04e-10 s                  ; 7.28e-10 s                  ; No                         ; No                         ; 3.46 V                      ; 1.29e-07 V                  ; 3.55 V             ; -0.053 V           ; 0.341 V                             ; 0.35 V                              ; 9.04e-10 s                 ; 7.28e-10 s                 ; No                        ; No                        ;
; SEG7_SEL[1]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 1.29e-07 V                   ; 3.55 V              ; -0.053 V            ; 0.341 V                              ; 0.35 V                               ; 9.04e-10 s                  ; 7.28e-10 s                  ; No                         ; No                         ; 3.46 V                      ; 1.29e-07 V                  ; 3.55 V             ; -0.053 V           ; 0.341 V                             ; 0.35 V                              ; 9.04e-10 s                 ; 7.28e-10 s                 ; No                        ; No                        ;
; SEG7_SEL[2]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 1.29e-07 V                   ; 3.55 V              ; -0.053 V            ; 0.341 V                              ; 0.35 V                               ; 9.04e-10 s                  ; 7.28e-10 s                  ; No                         ; No                         ; 3.46 V                      ; 1.29e-07 V                  ; 3.55 V             ; -0.053 V           ; 0.341 V                             ; 0.35 V                              ; 9.04e-10 s                 ; 7.28e-10 s                 ; No                        ; No                        ;
; SEG7_SEL[3]   ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 1.29e-07 V                   ; 3.55 V              ; -0.053 V            ; 0.341 V                              ; 0.35 V                               ; 9.04e-10 s                  ; 7.28e-10 s                  ; No                         ; No                         ; 3.46 V                      ; 1.29e-07 V                  ; 3.55 V             ; -0.053 V           ; 0.341 V                             ; 0.35 V                              ; 9.04e-10 s                 ; 7.28e-10 s                 ; No                        ; No                        ;
; DS18B20       ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 1.29e-07 V                   ; 3.55 V              ; -0.053 V            ; 0.341 V                              ; 0.35 V                               ; 9.04e-10 s                  ; 7.28e-10 s                  ; No                         ; No                         ; 3.46 V                      ; 1.29e-07 V                  ; 3.55 V             ; -0.053 V           ; 0.341 V                             ; 0.35 V                              ; 9.04e-10 s                 ; 7.28e-10 s                 ; No                        ; No                        ;
; ~ALTERA_DCLK~ ; 3.3-V LVTTL  ; 0 s                 ; 0 s                 ; 3.46 V                       ; 6.52e-08 V                   ; 3.58 V              ; -0.0651 V           ; 0.234 V                              ; 0.087 V                              ; 2.93e-10 s                  ; 3.07e-10 s                  ; Yes                        ; Yes                        ; 3.46 V                      ; 6.52e-08 V                  ; 3.58 V             ; -0.0651 V          ; 0.234 V                             ; 0.087 V                             ; 2.93e-10 s                 ; 3.07e-10 s                 ; Yes                       ; Yes                       ;
+---------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+


+-----------------------------------------------------------------------------------------------------------------+
; Setup Transfers                                                                                                 ;
+----------------------------------+----------------------------------+----------+----------+----------+----------+
; From Clock                       ; To Clock                         ; RR Paths ; FR Paths ; RF Paths ; FF Paths ;
+----------------------------------+----------------------------------+----------+----------+----------+----------+
; CLOCK_50                         ; CLOCK_50                         ; 225      ; 0        ; 0        ; 0        ;
; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50                         ; 46       ; 0        ; 0        ; 0        ;
; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1591     ; 0        ; 0        ; 0        ;
+----------------------------------+----------------------------------+----------+----------+----------+----------+
Entries labeled "false path" only account for clock-to-clock false paths and not path-based false paths. As a result, actual path counts may be lower than reported.


+-----------------------------------------------------------------------------------------------------------------+
; Hold Transfers                                                                                                  ;
+----------------------------------+----------------------------------+----------+----------+----------+----------+
; From Clock                       ; To Clock                         ; RR Paths ; FR Paths ; RF Paths ; FF Paths ;
+----------------------------------+----------------------------------+----------+----------+----------+----------+
; CLOCK_50                         ; CLOCK_50                         ; 225      ; 0        ; 0        ; 0        ;
; ds18b20_drive:ds18b20_u0|clk_1us ; CLOCK_50                         ; 46       ; 0        ; 0        ; 0        ;
; ds18b20_drive:ds18b20_u0|clk_1us ; ds18b20_drive:ds18b20_u0|clk_1us ; 1591     ; 0        ; 0        ; 0        ;
+----------------------------------+----------------------------------+----------+----------+----------+----------+
Entries labeled "false path" only account for clock-to-clock false paths and not path-based false paths. As a result, actual path counts may be lower than reported.


---------------
; Report TCCS ;
---------------
No dedicated SERDES Transmitter circuitry present in device or used in design


---------------
; Report RSKM ;
---------------
No dedicated SERDES Receiver circuitry present in device or used in design


+------------------------------------------------+
; Unconstrained Paths                            ;
+---------------------------------+-------+------+
; Property                        ; Setup ; Hold ;
+---------------------------------+-------+------+
; Illegal Clocks                  ; 0     ; 0    ;
; Unconstrained Clocks            ; 0     ; 0    ;
; Unconstrained Input Ports       ; 2     ; 2    ;
; Unconstrained Input Port Paths  ; 64    ; 64   ;
; Unconstrained Output Ports      ; 13    ; 13   ;
; Unconstrained Output Port Paths ; 34    ; 34   ;
+---------------------------------+-------+------+


+------------------------------------+
; TimeQuest Timing Analyzer Messages ;
+------------------------------------+
Info: *******************************************************************
Info: Running Quartus II TimeQuest Timing Analyzer
    Info: Version 11.0 Build 157 04/27/2011 SJ Full Version
    Info: Processing started: Fri May 04 14:48:44 2012
Info: Command: quartus_sta ds18b20_seg7 -c ds18b20_seg7
Info: qsta_default_script.tcl version: #1
Info: Parallel compilation is enabled and will use 2 of the 2 processors detected
Info: Low junction temperature is 0 degrees C
Info: High junction temperature is 85 degrees C
Critical Warning: Synopsys Design Constraints File file not found: 'ds18b20_seg7.sdc'. A Synopsys Design Constraints File is required by the TimeQuest Timing Analyzer to get proper timing constraints. Without it, the Compiler will not properly optimize the design.
Info: No user constrained base clocks found in the design. Calling "derive_clocks -period 1.0"
Info: Deriving Clocks
    Info: create_clock -period 1.000 -name CLOCK_50 CLOCK_50
    Info: create_clock -period 1.000 -name ds18b20_drive:ds18b20_u0|clk_1us ds18b20_drive:ds18b20_u0|clk_1us
Info: No user constrained clock uncertainty found in the design. Calling "derive_clock_uncertainty"
Info: Deriving Clock Uncertainty
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {CLOCK_50}] -setup 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {CLOCK_50}] -setup 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {CLOCK_50}] -setup 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {CLOCK_50}] -setup 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {CLOCK_50}] -hold 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {CLOCK_50}] -hold 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {CLOCK_50}] -hold 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {CLOCK_50}] -hold 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.030
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    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {CLOCK_50}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {CLOCK_50}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {CLOCK_50}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {CLOCK_50}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {CLOCK_50}] -hold 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {CLOCK_50}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {CLOCK_50}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {CLOCK_50}] -hold 0.020
Info: Analyzing Slow 1200mV 85C Model
Critical Warning: Timing requirements not met
Info: Worst-case setup slack is -5.081
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:    -5.081      -178.535 ds18b20_drive:ds18b20_u0|clk_1us 
    Info:    -3.472       -72.993 CLOCK_50 
Info: Worst-case hold slack is 0.449
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:     0.449         0.000 CLOCK_50 
    Info:     0.455         0.000 ds18b20_drive:ds18b20_u0|clk_1us 
Info: No Recovery paths to report
Info: No Removal paths to report
Info: Worst-case minimum pulse width slack is -3.000
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:    -3.000       -52.071 CLOCK_50 
    Info:    -1.487       -89.220 ds18b20_drive:ds18b20_u0|clk_1us 
Info: Analyzing Slow 1200mV 0C Model
Info: Started post-fitting delay annotation
Info: Delay annotation completed successfully
Info: Deriving Clock Uncertainty
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {CLOCK_50}] -setup 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {CLOCK_50}] -setup 0.030
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    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {CLOCK_50}] -setup 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {CLOCK_50}] -hold 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {CLOCK_50}] -hold 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {CLOCK_50}] -hold 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {CLOCK_50}] -hold 0.030
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    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {CLOCK_50}] -setup 0.020
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    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {CLOCK_50}] -hold 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {CLOCK_50}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {CLOCK_50}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {CLOCK_50}] -hold 0.020
Critical Warning: Timing requirements not met
Info: Worst-case setup slack is -4.714
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:    -4.714      -163.448 ds18b20_drive:ds18b20_u0|clk_1us 
    Info:    -3.283       -65.760 CLOCK_50 
Info: Worst-case hold slack is 0.402
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:     0.402         0.000 ds18b20_drive:ds18b20_u0|clk_1us 
    Info:     0.403         0.000 CLOCK_50 
Info: No Recovery paths to report
Info: No Removal paths to report
Info: Worst-case minimum pulse width slack is -3.000
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:    -3.000       -52.071 CLOCK_50 
    Info:    -1.487       -89.220 ds18b20_drive:ds18b20_u0|clk_1us 
Info: Analyzing Fast 1200mV 0C Model
Info: Started post-fitting delay annotation
Info: Delay annotation completed successfully
Info: Deriving Clock Uncertainty
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {CLOCK_50}] -setup 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {CLOCK_50}] -setup 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {CLOCK_50}] -setup 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {CLOCK_50}] -setup 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {CLOCK_50}] -hold 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {CLOCK_50}] -hold 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -rise_to [get_clocks {CLOCK_50}] -hold 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -fall_to [get_clocks {CLOCK_50}] -hold 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -setup 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.030
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {ds18b20_drive:ds18b20_u0|clk_1us}] -hold 0.030
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {CLOCK_50}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {CLOCK_50}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {CLOCK_50}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {CLOCK_50}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {CLOCK_50}] -hold 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {CLOCK_50}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -rise_to [get_clocks {CLOCK_50}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK_50}] -fall_to [get_clocks {CLOCK_50}] -hold 0.020
Critical Warning: Timing requirements not met
Info: Worst-case setup slack is -1.618
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:    -1.618       -46.813 ds18b20_drive:ds18b20_u0|clk_1us 
    Info:    -0.948       -15.358 CLOCK_50 
Info: Worst-case hold slack is 0.184
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:     0.184         0.000 CLOCK_50 
    Info:     0.186         0.000 ds18b20_drive:ds18b20_u0|clk_1us 
Info: No Recovery paths to report
Info: No Removal paths to report
Info: Worst-case minimum pulse width slack is -3.000
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:    -3.000       -45.637 CLOCK_50 
    Info:    -1.000       -60.000 ds18b20_drive:ds18b20_u0|clk_1us 
Info: Design is not fully constrained for setup requirements
Info: Design is not fully constrained for hold requirements
Info: Quartus II TimeQuest Timing Analyzer was successful. 0 errors, 4 warnings
    Info: Peak virtual memory: 273 megabytes
    Info: Processing ended: Fri May 04 14:48:49 2012
    Info: Elapsed time: 00:00:05
    Info: Total CPU time (on all processors): 00:00:03


