Analysis & Synthesis report for 12864
Fri May 04 11:04:19 2012
Quartus II Version 11.0 Build 157 04/27/2011 SJ Full Version


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; Table of Contents ;
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  1. Legal Notice
  2. Analysis & Synthesis Summary
  3. Analysis & Synthesis Settings
  4. Parallel Compilation
  5. Analysis & Synthesis Source Files Read
  6. Analysis & Synthesis Resource Usage Summary
  7. Analysis & Synthesis Resource Utilization by Entity
  8. State Machine - |lcd12864|next
  9. State Machine - |lcd12864|current
 10. Registers Removed During Synthesis
 11. Removed Registers Triggering Further Register Optimizations
 12. General Register Statistics
 13. Parameter Settings for User Entity Instance: Top-level Entity: |lcd12864
 14. Elapsed Time Per Partition
 15. Analysis & Synthesis Messages
 16. Analysis & Synthesis Suppressed Messages



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; Legal Notice ;
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Copyright (C) 1991-2011 Altera Corporation
Your use of Altera Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
functions, and any output files from any of the foregoing 
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; Analysis & Synthesis Summary                                                   ;
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; Analysis & Synthesis Status        ; Successful - Fri May 04 11:04:19 2012     ;
; Quartus II Version                 ; 11.0 Build 157 04/27/2011 SJ Full Version ;
; Revision Name                      ; 12864                                     ;
; Top-level Entity Name              ; lcd12864                                  ;
; Family                             ; Cyclone III                               ;
; Total logic elements               ; 130                                       ;
;     Total combinational functions  ; 105                                       ;
;     Dedicated logic registers      ; 86                                        ;
; Total registers                    ; 86                                        ;
; Total pins                         ; 16                                        ;
; Total virtual pins                 ; 0                                         ;
; Total memory bits                  ; 0                                         ;
; Embedded Multiplier 9-bit elements ; 0                                         ;
; Total PLLs                         ; 0                                         ;
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; Analysis & Synthesis Settings                                                                                        ;
+----------------------------------------------------------------------------+--------------------+--------------------+
; Option                                                                     ; Setting            ; Default Value      ;
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; Device                                                                     ; EP3C16Q240C8       ;                    ;
; Top-level entity name                                                      ; lcd12864           ; 12864              ;
; Family name                                                                ; Cyclone III        ; Cyclone IV GX      ;
; Use smart compilation                                                      ; Off                ; Off                ;
; Enable parallel Assembler and TimeQuest Timing Analyzer during compilation ; On                 ; On                 ;
; Enable compact report table                                                ; Off                ; Off                ;
; Restructure Multiplexers                                                   ; Auto               ; Auto               ;
; Create Debugging Nodes for IP Cores                                        ; Off                ; Off                ;
; Preserve fewer node names                                                  ; On                 ; On                 ;
; Disable OpenCore Plus hardware evaluation                                  ; Off                ; Off                ;
; Verilog Version                                                            ; Verilog_2001       ; Verilog_2001       ;
; VHDL Version                                                               ; VHDL_1993          ; VHDL_1993          ;
; State Machine Processing                                                   ; Auto               ; Auto               ;
; Safe State Machine                                                         ; Off                ; Off                ;
; Extract Verilog State Machines                                             ; On                 ; On                 ;
; Extract VHDL State Machines                                                ; On                 ; On                 ;
; Ignore Verilog initial constructs                                          ; Off                ; Off                ;
; Iteration limit for constant Verilog loops                                 ; 5000               ; 5000               ;
; Iteration limit for non-constant Verilog loops                             ; 250                ; 250                ;
; Add Pass-Through Logic to Inferred RAMs                                    ; On                 ; On                 ;
; Parallel Synthesis                                                         ; On                 ; On                 ;
; DSP Block Balancing                                                        ; Auto               ; Auto               ;
; NOT Gate Push-Back                                                         ; On                 ; On                 ;
; Power-Up Don't Care                                                        ; On                 ; On                 ;
; Remove Redundant Logic Cells                                               ; Off                ; Off                ;
; Remove Duplicate Registers                                                 ; On                 ; On                 ;
; Ignore CARRY Buffers                                                       ; Off                ; Off                ;
; Ignore CASCADE Buffers                                                     ; Off                ; Off                ;
; Ignore GLOBAL Buffers                                                      ; Off                ; Off                ;
; Ignore ROW GLOBAL Buffers                                                  ; Off                ; Off                ;
; Ignore LCELL Buffers                                                       ; Off                ; Off                ;
; Ignore SOFT Buffers                                                        ; On                 ; On                 ;
; Limit AHDL Integers to 32 Bits                                             ; Off                ; Off                ;
; Optimization Technique                                                     ; Balanced           ; Balanced           ;
; Carry Chain Length                                                         ; 70                 ; 70                 ;
; Auto Carry Chains                                                          ; On                 ; On                 ;
; Auto Open-Drain Pins                                                       ; On                 ; On                 ;
; Perform WYSIWYG Primitive Resynthesis                                      ; Off                ; Off                ;
; Auto ROM Replacement                                                       ; On                 ; On                 ;
; Auto RAM Replacement                                                       ; On                 ; On                 ;
; Auto DSP Block Replacement                                                 ; On                 ; On                 ;
; Auto Shift Register Replacement                                            ; Auto               ; Auto               ;
; Allow Shift Register Merging across Hierarchies                            ; Auto               ; Auto               ;
; Auto Clock Enable Replacement                                              ; On                 ; On                 ;
; Strict RAM Replacement                                                     ; Off                ; Off                ;
; Allow Synchronous Control Signals                                          ; On                 ; On                 ;
; Force Use of Synchronous Clear Signals                                     ; Off                ; Off                ;
; Auto RAM Block Balancing                                                   ; On                 ; On                 ;
; Auto RAM to Logic Cell Conversion                                          ; Off                ; Off                ;
; Auto Resource Sharing                                                      ; Off                ; Off                ;
; Allow Any RAM Size For Recognition                                         ; Off                ; Off                ;
; Allow Any ROM Size For Recognition                                         ; Off                ; Off                ;
; Allow Any Shift Register Size For Recognition                              ; Off                ; Off                ;
; Use LogicLock Constraints during Resource Balancing                        ; On                 ; On                 ;
; Ignore translate_off and synthesis_off directives                          ; Off                ; Off                ;
; Timing-Driven Synthesis                                                    ; On                 ; On                 ;
; Report Parameter Settings                                                  ; On                 ; On                 ;
; Report Source Assignments                                                  ; On                 ; On                 ;
; Report Connectivity Checks                                                 ; On                 ; On                 ;
; Ignore Maximum Fan-Out Assignments                                         ; Off                ; Off                ;
; Synchronization Register Chain Length                                      ; 2                  ; 2                  ;
; PowerPlay Power Optimization                                               ; Normal compilation ; Normal compilation ;
; HDL message level                                                          ; Level2             ; Level2             ;
; Suppress Register Optimization Related Messages                            ; Off                ; Off                ;
; Number of Removed Registers Reported in Synthesis Report                   ; 5000               ; 5000               ;
; Number of Inverted Registers Reported in Synthesis Report                  ; 100                ; 100                ;
; Clock MUX Protection                                                       ; On                 ; On                 ;
; Auto Gated Clock Conversion                                                ; Off                ; Off                ;
; Block Design Naming                                                        ; Auto               ; Auto               ;
; SDC constraint protection                                                  ; Off                ; Off                ;
; Synthesis Effort                                                           ; Auto               ; Auto               ;
; Shift Register Replacement - Allow Asynchronous Clear Signal               ; On                 ; On                 ;
; Analysis & Synthesis Message Level                                         ; Medium             ; Medium             ;
; Disable Register Merging Across Hierarchies                                ; Auto               ; Auto               ;
; Resource Aware Inference For Block RAM                                     ; On                 ; On                 ;
; Synthesis Seed                                                             ; 1                  ; 1                  ;
+----------------------------------------------------------------------------+--------------------+--------------------+


+------------------------------------------+
; Parallel Compilation                     ;
+----------------------------+-------------+
; Processors                 ; Number      ;
+----------------------------+-------------+
; Number detected on machine ; 2           ;
; Maximum allowed            ; 2           ;
;                            ;             ;
; Average used               ; 1.00        ;
; Maximum used               ; 1           ;
;                            ;             ;
; Usage by Processor         ; % Time Used ;
;     1 processor            ; 100.0%      ;
;     2 processors           ;   0.0%      ;
+----------------------------+-------------+


+--------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Source Files Read                                                                                   ;
+----------------------------------+-----------------+------------------------+--------------------------------------------+
; File Name with User-Entered Path ; Used in Netlist ; File Type              ; File Name with Absolute Path               ;
+----------------------------------+-----------------+------------------------+--------------------------------------------+
; lcd12864.v                       ; yes             ; User Verilog HDL File  ; E:/Program/EP3C16/verilog/12864/lcd12864.v ;
+----------------------------------+-----------------+------------------------+--------------------------------------------+


+-----------------------------------------------------+
; Analysis & Synthesis Resource Usage Summary         ;
+---------------------------------------------+-------+
; Resource                                    ; Usage ;
+---------------------------------------------+-------+
; Estimated Total logic elements              ; 130   ;
;                                             ;       ;
; Total combinational functions               ; 105   ;
; Logic element usage by number of LUT inputs ;       ;
;     -- 4 input functions                    ; 43    ;
;     -- 3 input functions                    ; 6     ;
;     -- <=2 input functions                  ; 56    ;
;                                             ;       ;
; Logic elements by mode                      ;       ;
;     -- normal mode                          ; 59    ;
;     -- arithmetic mode                      ; 46    ;
;                                             ;       ;
; Total registers                             ; 86    ;
;     -- Dedicated logic registers            ; 86    ;
;     -- I/O registers                        ; 0     ;
;                                             ;       ;
; I/O pins                                    ; 16    ;
; Maximum fan-out node                        ; clkr  ;
; Maximum fan-out                             ; 71    ;
; Total fan-out                               ; 530   ;
; Average fan-out                             ; 2.38  ;
+---------------------------------------------+-------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Resource Utilization by Entity                                                                                                                         ;
+----------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+---------------------+--------------+
; Compilation Hierarchy Node ; LC Combinationals ; LC Registers ; Memory Bits ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; Pins ; Virtual Pins ; Full Hierarchy Name ; Library Name ;
+----------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+---------------------+--------------+
; |lcd12864                  ; 105 (105)         ; 86 (86)      ; 0           ; 0            ; 0       ; 0         ; 16   ; 0            ; |lcd12864           ;              ;
+----------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+---------------------+--------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.


Encoding Type:  One-Hot
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; State Machine - |lcd12864|next                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                            ;
+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+----------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+
; Name         ; next.1010111 ; next.1010110 ; next.1010101 ; next.1010100 ; next.1010011 ; next.1010010 ; next.1010001 ; next.1010000 ; next.nul ; next.dat43 ; next.dat42 ; next.dat41 ; next.dat40 ; next.dat39 ; next.dat38 ; next.dat37 ; next.dat36 ; next.dat35 ; next.dat34 ; next.dat33 ; next.dat32 ; next.dat31 ; next.dat30 ; next.dat29 ; next.dat28 ; next.dat27 ; next.dat26 ; next.dat25 ; next.dat24 ; next.dat23 ; next.dat22 ; next.dat21 ; next.dat20 ; next.dat19 ; next.dat18 ; next.dat17 ; next.dat16 ; next.dat15 ; next.dat14 ; next.dat13 ; next.dat12 ; next.dat11 ; next.dat10 ; next.dat9 ; next.dat8 ; next.dat7 ; next.dat6 ; next.dat5 ; next.dat4 ; next.dat3 ; next.dat2 ; next.dat1 ; next.dat0 ; next.set6 ; next.set5 ; next.set3 ; next.set2 ; next.set1 ; next.set0 ;
+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+----------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+------------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+-----------+
; next.set0    ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0        ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ;
; next.set1    ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0        ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 1         ; 1         ;
; next.set2    ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0        ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 1         ; 0         ; 1         ;
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; next.set5    ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0        ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0          ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 0         ; 1         ; 0         ; 0         ; 0         ; 1         ;
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Encoding Type:  One-Hot
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; current.1010100 ; 0               ; 0               ; 0               ; 1               ; 0               ; 0               ; 0               ; 0               ; 0           ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 1            ;
; current.1010101 ; 0               ; 0               ; 1               ; 0               ; 0               ; 0               ; 0               ; 0               ; 0           ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 1            ;
; current.1010110 ; 0               ; 1               ; 0               ; 0               ; 0               ; 0               ; 0               ; 0               ; 0           ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 1            ;
; current.1010111 ; 1               ; 0               ; 0               ; 0               ; 0               ; 0               ; 0               ; 0               ; 0           ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0             ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 1            ;
+-----------------+-----------------+-----------------+-----------------+-----------------+-----------------+-----------------+-----------------+-----------------+-------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+---------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+


+----------------------------------------------------------------------------------+
; Registers Removed During Synthesis                                               ;
+-----------------------------------------+----------------------------------------+
; Register name                           ; Reason for Removal                     ;
+-----------------------------------------+----------------------------------------+
; current.set0                            ; Lost fanout                            ;
; current.set1                            ; Lost fanout                            ;
; current.set2                            ; Lost fanout                            ;
; current.set3                            ; Lost fanout                            ;
; current.set4                            ; Lost fanout                            ;
; current.set5                            ; Lost fanout                            ;
; current.set6                            ; Lost fanout                            ;
; current.dat0                            ; Lost fanout                            ;
; current.dat1                            ; Lost fanout                            ;
; current.dat2                            ; Lost fanout                            ;
; current.dat3                            ; Lost fanout                            ;
; current.dat4                            ; Lost fanout                            ;
; current.dat5                            ; Lost fanout                            ;
; current.dat6                            ; Lost fanout                            ;
; current.dat7                            ; Lost fanout                            ;
; current.dat8                            ; Lost fanout                            ;
; current.dat9                            ; Lost fanout                            ;
; current.dat10                           ; Lost fanout                            ;
; current.dat11                           ; Lost fanout                            ;
; current.dat12                           ; Lost fanout                            ;
; current.dat13                           ; Lost fanout                            ;
; current.dat14                           ; Lost fanout                            ;
; current.dat15                           ; Lost fanout                            ;
; current.dat16                           ; Lost fanout                            ;
; current.dat17                           ; Lost fanout                            ;
; current.dat18                           ; Lost fanout                            ;
; current.dat19                           ; Lost fanout                            ;
; current.dat20                           ; Lost fanout                            ;
; current.dat21                           ; Lost fanout                            ;
; current.dat22                           ; Lost fanout                            ;
; current.dat23                           ; Lost fanout                            ;
; current.dat24                           ; Lost fanout                            ;
; current.dat25                           ; Lost fanout                            ;
; current.dat26                           ; Lost fanout                            ;
; current.dat27                           ; Lost fanout                            ;
; current.dat28                           ; Lost fanout                            ;
; current.dat29                           ; Lost fanout                            ;
; current.dat30                           ; Lost fanout                            ;
; current.dat31                           ; Lost fanout                            ;
; current.dat32                           ; Lost fanout                            ;
; current.dat33                           ; Lost fanout                            ;
; current.dat34                           ; Lost fanout                            ;
; current.dat35                           ; Lost fanout                            ;
; current.dat36                           ; Lost fanout                            ;
; current.dat37                           ; Lost fanout                            ;
; current.dat38                           ; Lost fanout                            ;
; current.dat39                           ; Lost fanout                            ;
; current.dat40                           ; Lost fanout                            ;
; current.dat41                           ; Lost fanout                            ;
; current.dat42                           ; Lost fanout                            ;
; current.dat43                           ; Lost fanout                            ;
; current.nul                             ; Lost fanout                            ;
; current.1010000                         ; Lost fanout                            ;
; current.1010001                         ; Lost fanout                            ;
; current.1010010                         ; Lost fanout                            ;
; current.1010011                         ; Lost fanout                            ;
; current.1010100                         ; Lost fanout                            ;
; current.1010101                         ; Lost fanout                            ;
; current.1010110                         ; Lost fanout                            ;
; current.1010111                         ; Lost fanout                            ;
; next~61                                 ; Lost fanout                            ;
; next~62                                 ; Lost fanout                            ;
; next~63                                 ; Lost fanout                            ;
; next~64                                 ; Lost fanout                            ;
; next~65                                 ; Lost fanout                            ;
; next~66                                 ; Lost fanout                            ;
; next~67                                 ; Lost fanout                            ;
; current~2                               ; Lost fanout                            ;
; current~3                               ; Lost fanout                            ;
; current~4                               ; Lost fanout                            ;
; current~5                               ; Lost fanout                            ;
; current~6                               ; Lost fanout                            ;
; current~7                               ; Lost fanout                            ;
; current~8                               ; Lost fanout                            ;
; next.dat14                              ; Stuck at GND due to stuck port data_in ;
; next.dat15                              ; Stuck at GND due to stuck port data_in ;
; next.dat16                              ; Stuck at GND due to stuck port data_in ;
; next.dat17                              ; Stuck at GND due to stuck port data_in ;
; next.dat18                              ; Stuck at GND due to stuck port data_in ;
; next.dat19                              ; Stuck at GND due to stuck port data_in ;
; next.dat20                              ; Stuck at GND due to stuck port data_in ;
; next.dat21                              ; Stuck at GND due to stuck port data_in ;
; next.dat22                              ; Stuck at GND due to stuck port data_in ;
; next.dat23                              ; Stuck at GND due to stuck port data_in ;
; next.dat24                              ; Stuck at GND due to stuck port data_in ;
; next.dat25                              ; Stuck at GND due to stuck port data_in ;
; next.dat26                              ; Stuck at GND due to stuck port data_in ;
; next.dat27                              ; Stuck at GND due to stuck port data_in ;
; next.dat28                              ; Stuck at GND due to stuck port data_in ;
; next.dat29                              ; Stuck at GND due to stuck port data_in ;
; next.1010110                            ; Merged with next.1010101               ;
; next.1010111                            ; Merged with next.1010101               ;
; next.dat10                              ; Merged with next.1010101               ;
; next.dat11                              ; Merged with next.1010101               ;
; next.dat12                              ; Merged with next.1010101               ;
; next.dat13                              ; Merged with next.1010101               ;
; next.dat38                              ; Merged with next.1010101               ;
; next.dat39                              ; Merged with next.1010101               ;
; next.dat40                              ; Merged with next.1010101               ;
; next.dat41                              ; Merged with next.1010101               ;
; next.dat42                              ; Merged with next.1010101               ;
; next.dat43                              ; Merged with next.1010101               ;
; next.dat9                               ; Merged with next.1010101               ;
; next.set3                               ; Merged with next.1010101               ;
; next.set6                               ; Merged with next.1010101               ;
; next.1010101                            ; Stuck at GND due to stuck port data_in ;
; Total Number of Removed Registers = 106 ;                                        ;
+-----------------------------------------+----------------------------------------+


+---------------------------------------------------------------------------------------------------------------------------------------------+
; Removed Registers Triggering Further Register Optimizations                                                                                 ;
+---------------+---------------------------+-------------------------------------------------------------------------------------------------+
; Register name ; Reason for Removal        ; Registers Removed due to This Register                                                          ;
+---------------+---------------------------+-------------------------------------------------------------------------------------------------+
; next.dat15    ; Stuck at GND              ; next.dat16, next.dat17, next.dat18, next.dat19, next.dat20, next.dat21, next.dat22, next.dat23, ;
;               ; due to stuck port data_in ; next.dat24, next.dat25, next.dat26, next.dat27                                                  ;
; next.dat28    ; Stuck at GND              ; next.dat29                                                                                      ;
;               ; due to stuck port data_in ;                                                                                                 ;
+---------------+---------------------------+-------------------------------------------------------------------------------------------------+


+------------------------------------------------------+
; General Register Statistics                          ;
+----------------------------------------------+-------+
; Statistic                                    ; Value ;
+----------------------------------------------+-------+
; Total registers                              ; 86    ;
; Number of registers using Synchronous Clear  ; 0     ;
; Number of registers using Synchronous Load   ; 0     ;
; Number of registers using Asynchronous Clear ; 0     ;
; Number of registers using Asynchronous Load  ; 0     ;
; Number of registers using Clock Enable       ; 33    ;
; Number of registers using Preset             ; 0     ;
+----------------------------------------------+-------+


+--------------------------------------------------------------------------+
; Parameter Settings for User Entity Instance: Top-level Entity: |lcd12864 ;
+----------------+--------+------------------------------------------------+
; Parameter Name ; Value  ; Type                                           ;
+----------------+--------+------------------------------------------------+
; set0           ; 000000 ; Unsigned Binary                                ;
; set1           ; 000001 ; Unsigned Binary                                ;
; set2           ; 000010 ; Unsigned Binary                                ;
; set3           ; 000011 ; Unsigned Binary                                ;
; set4           ; 000100 ; Unsigned Binary                                ;
; set5           ; 000101 ; Unsigned Binary                                ;
; set6           ; 000110 ; Unsigned Binary                                ;
; dat0           ; 000111 ; Unsigned Binary                                ;
; dat1           ; 001000 ; Unsigned Binary                                ;
; dat2           ; 001001 ; Unsigned Binary                                ;
; dat3           ; 001010 ; Unsigned Binary                                ;
; dat4           ; 001011 ; Unsigned Binary                                ;
; dat5           ; 001100 ; Unsigned Binary                                ;
; dat6           ; 001101 ; Unsigned Binary                                ;
; dat7           ; 001110 ; Unsigned Binary                                ;
; dat8           ; 001111 ; Unsigned Binary                                ;
; dat9           ; 010000 ; Unsigned Binary                                ;
; dat10          ; 010010 ; Unsigned Binary                                ;
; dat11          ; 010011 ; Unsigned Binary                                ;
; dat12          ; 010100 ; Unsigned Binary                                ;
; dat13          ; 010101 ; Unsigned Binary                                ;
; dat14          ; 010110 ; Unsigned Binary                                ;
; dat15          ; 010111 ; Unsigned Binary                                ;
; dat16          ; 011000 ; Unsigned Binary                                ;
; dat17          ; 011001 ; Unsigned Binary                                ;
; dat18          ; 011010 ; Unsigned Binary                                ;
; dat19          ; 011011 ; Unsigned Binary                                ;
; dat20          ; 011100 ; Unsigned Binary                                ;
; dat21          ; 011101 ; Unsigned Binary                                ;
; dat22          ; 011110 ; Unsigned Binary                                ;
; dat23          ; 011111 ; Unsigned Binary                                ;
; dat24          ; 100000 ; Unsigned Binary                                ;
; dat25          ; 100001 ; Unsigned Binary                                ;
; dat26          ; 100010 ; Unsigned Binary                                ;
; dat27          ; 100011 ; Unsigned Binary                                ;
; dat28          ; 100100 ; Unsigned Binary                                ;
; dat29          ; 100101 ; Unsigned Binary                                ;
; dat30          ; 100110 ; Unsigned Binary                                ;
; dat31          ; 100111 ; Unsigned Binary                                ;
; dat32          ; 101000 ; Unsigned Binary                                ;
; dat33          ; 101001 ; Unsigned Binary                                ;
; dat34          ; 101010 ; Unsigned Binary                                ;
; dat35          ; 101011 ; Unsigned Binary                                ;
; dat36          ; 101100 ; Unsigned Binary                                ;
; dat37          ; 101110 ; Unsigned Binary                                ;
; dat38          ; 101111 ; Unsigned Binary                                ;
; dat39          ; 110000 ; Unsigned Binary                                ;
; dat40          ; 110001 ; Unsigned Binary                                ;
; dat41          ; 110010 ; Unsigned Binary                                ;
; dat42          ; 110011 ; Unsigned Binary                                ;
; dat43          ; 110100 ; Unsigned Binary                                ;
; nul            ; 110101 ; Unsigned Binary                                ;
+----------------+--------+------------------------------------------------+
Note: In order to hide this table in the UI and the text report file, please set the "Show Parameter Settings in Synthesis Report" option in "Analysis and Synthesis Settings -> More Settings" to "Off".


+-------------------------------+
; Elapsed Time Per Partition    ;
+----------------+--------------+
; Partition Name ; Elapsed Time ;
+----------------+--------------+
; Top            ; 00:00:00     ;
+----------------+--------------+


+-------------------------------+
; Analysis & Synthesis Messages ;
+-------------------------------+
Info: *******************************************************************
Info: Running Quartus II Analysis & Synthesis
    Info: Version 11.0 Build 157 04/27/2011 SJ Full Version
    Info: Processing started: Fri May 04 11:04:17 2012
Info: Command: quartus_map --read_settings_files=on --write_settings_files=off lcd12864 -c 12864
Info: Parallel compilation is enabled and will use 2 of the 2 processors detected
Info: Found 1 design units, including 1 entities, in source file lcd12864.v
    Info: Found entity 1: lcd12864
Info: Elaborating entity "lcd12864" for the top level hierarchy
Warning (10230): Verilog HDL assignment warning at lcd12864.v(75): truncated value with size 32 to match size of target (16)
Warning (10199): Verilog HDL Case Statement warning at lcd12864.v(109): case item expression never matches the case expression
Info (10264): Verilog HDL Case Statement information at lcd12864.v(84): all case item expressions in this case statement are onehot
Warning: Output pins are stuck at VCC or GND
    Warning (13410): Pin "LCD_N" is stuck at GND
    Warning (13410): Pin "LCD_P" is stuck at VCC
    Warning (13410): Pin "LCD_RST" is stuck at VCC
    Warning (13410): Pin "PSB" is stuck at VCC
    Warning (13410): Pin "rw" is stuck at GND
Info: Timing-Driven Synthesis is running
Info: 74 registers lost all their fanouts during netlist optimizations. The first 74 are displayed below.
    Info: Register "current.set0" lost all its fanouts during netlist optimizations.
    Info: Register "current.set1" lost all its fanouts during netlist optimizations.
    Info: Register "current.set2" lost all its fanouts during netlist optimizations.
    Info: Register "current.set3" lost all its fanouts during netlist optimizations.
    Info: Register "current.set4" lost all its fanouts during netlist optimizations.
    Info: Register "current.set5" lost all its fanouts during netlist optimizations.
    Info: Register "current.set6" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat0" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat1" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat2" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat3" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat4" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat5" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat6" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat7" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat8" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat9" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat10" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat11" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat12" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat13" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat14" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat15" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat16" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat17" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat18" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat19" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat20" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat21" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat22" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat23" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat24" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat25" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat26" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat27" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat28" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat29" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat30" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat31" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat32" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat33" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat34" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat35" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat36" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat37" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat38" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat39" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat40" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat41" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat42" lost all its fanouts during netlist optimizations.
    Info: Register "current.dat43" lost all its fanouts during netlist optimizations.
    Info: Register "current.nul" lost all its fanouts during netlist optimizations.
    Info: Register "current.1010000" lost all its fanouts during netlist optimizations.
    Info: Register "current.1010001" lost all its fanouts during netlist optimizations.
    Info: Register "current.1010010" lost all its fanouts during netlist optimizations.
    Info: Register "current.1010011" lost all its fanouts during netlist optimizations.
    Info: Register "current.1010100" lost all its fanouts during netlist optimizations.
    Info: Register "current.1010101" lost all its fanouts during netlist optimizations.
    Info: Register "current.1010110" lost all its fanouts during netlist optimizations.
    Info: Register "current.1010111" lost all its fanouts during netlist optimizations.
    Info: Register "next~61" lost all its fanouts during netlist optimizations.
    Info: Register "next~62" lost all its fanouts during netlist optimizations.
    Info: Register "next~63" lost all its fanouts during netlist optimizations.
    Info: Register "next~64" lost all its fanouts during netlist optimizations.
    Info: Register "next~65" lost all its fanouts during netlist optimizations.
    Info: Register "next~66" lost all its fanouts during netlist optimizations.
    Info: Register "next~67" lost all its fanouts during netlist optimizations.
    Info: Register "current~2" lost all its fanouts during netlist optimizations.
    Info: Register "current~3" lost all its fanouts during netlist optimizations.
    Info: Register "current~4" lost all its fanouts during netlist optimizations.
    Info: Register "current~5" lost all its fanouts during netlist optimizations.
    Info: Register "current~6" lost all its fanouts during netlist optimizations.
    Info: Register "current~7" lost all its fanouts during netlist optimizations.
    Info: Register "current~8" lost all its fanouts during netlist optimizations.
Info: Generated suppressed messages file E:/Program/EP3C16/verilog/12864/12864.map.smsg
Info: Generating hard_block partition "hard_block:auto_generated_inst"
Info: Implemented 150 device resources after synthesis - the final resource count might be different
    Info: Implemented 1 input pins
    Info: Implemented 15 output pins
    Info: Implemented 134 logic cells
Info: Quartus II Analysis & Synthesis was successful. 0 errors, 8 warnings
    Info: Peak virtual memory: 253 megabytes
    Info: Processing ended: Fri May 04 11:04:19 2012
    Info: Elapsed time: 00:00:02
    Info: Total CPU time (on all processors): 00:00:02


+------------------------------------------+
; Analysis & Synthesis Suppressed Messages ;
+------------------------------------------+
The suppressed messages can be found in E:/Program/EP3C16/verilog/12864/12864.map.smsg.


