Fitter report for MIDIKBD
Sun Dec 30 21:11:11 2012
Quartus II 32-bit Version 12.0 Build 178 05/31/2012 SJ Web Edition


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; Table of Contents ;
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  1. Legal Notice
  2. Fitter Summary
  3. Fitter Settings
  4. Parallel Compilation
  5. I/O Assignment Warnings
  6. Incremental Compilation Preservation Summary
  7. Incremental Compilation Partition Settings
  8. Incremental Compilation Placement Preservation
  9. Pin-Out File
 10. Fitter Resource Usage Summary
 11. Fitter Partition Statistics
 12. Input Pins
 13. Output Pins
 14. Bidir Pins
 15. Dual Purpose and Dedicated Pins
 16. I/O Bank Usage
 17. All Package Pins
 18. Fitter Resource Utilization by Entity
 19. Delay Chain Summary
 20. Pad To Core Delay Chain Fanout
 21. Control Signals
 22. Global & Other Fast Signals
 23. Non-Global High Fan-Out Signals
 24. Fitter RAM Summary
 25. |MIDIKBD|Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u1:Memory_CPU_u1_component|altsyncram:altsyncram_component|altsyncram_10j2:auto_generated|ALTSYNCRAM
 26. |MIDIKBD|Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u4:Memory_CPU_u4_component|altsyncram:altsyncram_component|altsyncram_40j2:auto_generated|ALTSYNCRAM
 27. |MIDIKBD|Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u3:Memory_CPU_u3_component|altsyncram:altsyncram_component|altsyncram_30j2:auto_generated|ALTSYNCRAM
 28. |MIDIKBD|Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u2:Memory_CPU_u2_component|altsyncram:altsyncram_component|altsyncram_20j2:auto_generated|ALTSYNCRAM
 29. Fitter DSP Block Usage Summary
 30. DSP Block Details
 31. Interconnect Usage Summary
 32. LAB Logic Elements
 33. LAB-wide Signals
 34. LAB Signals Sourced
 35. LAB Signals Sourced Out
 36. LAB Distinct Inputs
 37. I/O Rules Summary
 38. I/O Rules Details
 39. I/O Rules Matrix
 40. Fitter Device Options
 41. Operating Settings and Conditions
 42. Estimated Delay Added for Hold Timing Summary
 43. Estimated Delay Added for Hold Timing Details
 44. Fitter Messages



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; Legal Notice ;
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Copyright (C) 1991-2012 Altera Corporation
Your use of Altera Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
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; Fitter Summary                                                                ;
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; Fitter Status                      ; Successful - Sun Dec 30 21:11:11 2012    ;
; Quartus II 32-bit Version          ; 12.0 Build 178 05/31/2012 SJ Web Edition ;
; Revision Name                      ; MIDIKBD                                  ;
; Top-level Entity Name              ; MIDIKBD                                  ;
; Family                             ; Cyclone III                              ;
; Device                             ; EP3C40F780C8                             ;
; Timing Models                      ; Final                                    ;
; Total logic elements               ; 6,056 / 39,600 ( 15 % )                  ;
;     Total combinational functions  ; 5,231 / 39,600 ( 13 % )                  ;
;     Dedicated logic registers      ; 2,693 / 39,600 ( 7 % )                   ;
; Total registers                    ; 2693                                     ;
; Total pins                         ; 151 / 536 ( 28 % )                       ;
; Total virtual pins                 ; 0                                        ;
; Total memory bits                  ; 67,584 / 1,161,216 ( 6 % )               ;
; Embedded Multiplier 9-bit elements ; 4 / 252 ( 2 % )                          ;
; Total PLLs                         ; 0 / 4 ( 0 % )                            ;
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; Fitter Settings                                                                                                                                            ;
+----------------------------------------------------------------------------+---------------------------------------+---------------------------------------+
; Option                                                                     ; Setting                               ; Default Value                         ;
+----------------------------------------------------------------------------+---------------------------------------+---------------------------------------+
; Device                                                                     ; EP3C40F780C8                          ;                                       ;
; Fit Attempts to Skip                                                       ; 0                                     ; 0.0                                   ;
; Use smart compilation                                                      ; Off                                   ; Off                                   ;
; Enable parallel Assembler and TimeQuest Timing Analyzer during compilation ; On                                    ; On                                    ;
; Enable compact report table                                                ; Off                                   ; Off                                   ;
; Auto Merge PLLs                                                            ; On                                    ; On                                    ;
; Router Timing Optimization Level                                           ; Normal                                ; Normal                                ;
; Perform Clocking Topology Analysis During Routing                          ; Off                                   ; Off                                   ;
; Placement Effort Multiplier                                                ; 1.0                                   ; 1.0                                   ;
; Router Effort Multiplier                                                   ; 1.0                                   ; 1.0                                   ;
; Optimize Hold Timing                                                       ; All Paths                             ; All Paths                             ;
; Optimize Multi-Corner Timing                                               ; On                                    ; On                                    ;
; PowerPlay Power Optimization                                               ; Normal compilation                    ; Normal compilation                    ;
; SSN Optimization                                                           ; Off                                   ; Off                                   ;
; Optimize Timing                                                            ; Normal compilation                    ; Normal compilation                    ;
; Optimize Timing for ECOs                                                   ; Off                                   ; Off                                   ;
; Regenerate full fit report during ECO compiles                             ; Off                                   ; Off                                   ;
; Optimize IOC Register Placement for Timing                                 ; Normal                                ; Normal                                ;
; Limit to One Fitting Attempt                                               ; Off                                   ; Off                                   ;
; Final Placement Optimizations                                              ; Automatically                         ; Automatically                         ;
; Fitter Aggressive Routability Optimizations                                ; Automatically                         ; Automatically                         ;
; Fitter Initial Placement Seed                                              ; 1                                     ; 1                                     ;
; PCI I/O                                                                    ; Off                                   ; Off                                   ;
; Weak Pull-Up Resistor                                                      ; Off                                   ; Off                                   ;
; Enable Bus-Hold Circuitry                                                  ; Off                                   ; Off                                   ;
; Auto Packed Registers                                                      ; Auto                                  ; Auto                                  ;
; Auto Delay Chains                                                          ; On                                    ; On                                    ;
; Allow Single-ended Buffer for Differential-XSTL Input                      ; Off                                   ; Off                                   ;
; Treat Bidirectional Pin as Output Pin                                      ; Off                                   ; Off                                   ;
; Perform Physical Synthesis for Combinational Logic for Fitting             ; Off                                   ; Off                                   ;
; Perform Physical Synthesis for Combinational Logic for Performance         ; Off                                   ; Off                                   ;
; Perform Register Duplication for Performance                               ; Off                                   ; Off                                   ;
; Perform Logic to Memory Mapping for Fitting                                ; Off                                   ; Off                                   ;
; Perform Register Retiming for Performance                                  ; Off                                   ; Off                                   ;
; Perform Asynchronous Signal Pipelining                                     ; Off                                   ; Off                                   ;
; Fitter Effort                                                              ; Auto Fit                              ; Auto Fit                              ;
; Physical Synthesis Effort Level                                            ; Normal                                ; Normal                                ;
; Logic Cell Insertion - Logic Duplication                                   ; Auto                                  ; Auto                                  ;
; Auto Register Duplication                                                  ; Auto                                  ; Auto                                  ;
; Auto Global Clock                                                          ; On                                    ; On                                    ;
; Auto Global Register Control Signals                                       ; On                                    ; On                                    ;
; Reserve all unused pins                                                    ; As input tri-stated with weak pull-up ; As input tri-stated with weak pull-up ;
; Synchronizer Identification                                                ; Off                                   ; Off                                   ;
; Enable Beneficial Skew Optimization                                        ; On                                    ; On                                    ;
; Optimize Design for Metastability                                          ; On                                    ; On                                    ;
; Force Fitter to Avoid Periphery Placement Warnings                         ; Off                                   ; Off                                   ;
; RAM Bit Reservation (Cyclone III)                                          ; Off                                   ; Off                                   ;
; Enable input tri-state on active configuration pins in user mode           ; Off                                   ; Off                                   ;
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Parallel compilation was disabled, but you have multiple processors available. Enable parallel compilation to reduce compilation time.
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; Parallel Compilation                ;
+----------------------------+--------+
; Processors                 ; Number ;
+----------------------------+--------+
; Number detected on machine ; 4      ;
; Maximum allowed            ; 1      ;
+----------------------------+--------+


+------------------------------------------------+
; I/O Assignment Warnings                        ;
+----------------+-------------------------------+
; Pin Name       ; Reason                        ;
+----------------+-------------------------------+
; JTAG_NEXUS_TDO ; Incomplete set of assignments ;
; LED_B[0]       ; Incomplete set of assignments ;
; LED_B[1]       ; Incomplete set of assignments ;
; LED_B[2]       ; Incomplete set of assignments ;
; LED_B[3]       ; Incomplete set of assignments ;
; LED_B[4]       ; Incomplete set of assignments ;
; LED_B[5]       ; Incomplete set of assignments ;
; LED_B[6]       ; Incomplete set of assignments ;
; LED_B[7]       ; Incomplete set of assignments ;
; LED_G[0]       ; Incomplete set of assignments ;
; LED_G[1]       ; Incomplete set of assignments ;
; LED_G[2]       ; Incomplete set of assignments ;
; LED_G[3]       ; Incomplete set of assignments ;
; LED_G[4]       ; Incomplete set of assignments ;
; LED_G[5]       ; Incomplete set of assignments ;
; LED_G[6]       ; Incomplete set of assignments ;
; LED_G[7]       ; Incomplete set of assignments ;
; LED_R[0]       ; Incomplete set of assignments ;
; LED_R[1]       ; Incomplete set of assignments ;
; LED_R[2]       ; Incomplete set of assignments ;
; LED_R[3]       ; Incomplete set of assignments ;
; LED_R[4]       ; Incomplete set of assignments ;
; LED_R[5]       ; Incomplete set of assignments ;
; LED_R[6]       ; Incomplete set of assignments ;
; LED_R[7]       ; Incomplete set of assignments ;
; MIDI_TX        ; Incomplete set of assignments ;
; SRAM0_A[0]     ; Incomplete set of assignments ;
; SRAM0_A[1]     ; Incomplete set of assignments ;
; SRAM0_A[2]     ; Incomplete set of assignments ;
; SRAM0_A[3]     ; Incomplete set of assignments ;
; SRAM0_A[4]     ; Incomplete set of assignments ;
; SRAM0_A[5]     ; Incomplete set of assignments ;
; SRAM0_A[6]     ; Incomplete set of assignments ;
; SRAM0_A[7]     ; Incomplete set of assignments ;
; SRAM0_A[8]     ; Incomplete set of assignments ;
; SRAM0_A[9]     ; Incomplete set of assignments ;
; SRAM0_A[10]    ; Incomplete set of assignments ;
; SRAM0_A[11]    ; Incomplete set of assignments ;
; SRAM0_A[12]    ; Incomplete set of assignments ;
; SRAM0_A[13]    ; Incomplete set of assignments ;
; SRAM0_A[14]    ; Incomplete set of assignments ;
; SRAM0_A[15]    ; Incomplete set of assignments ;
; SRAM0_A[16]    ; Incomplete set of assignments ;
; SRAM0_A[17]    ; Incomplete set of assignments ;
; SRAM0_E        ; Incomplete set of assignments ;
; SRAM0_LB       ; Incomplete set of assignments ;
; SRAM0_OE       ; Incomplete set of assignments ;
; SRAM0_UB       ; Incomplete set of assignments ;
; SRAM0_W        ; Incomplete set of assignments ;
; SRAM1_A[0]     ; Incomplete set of assignments ;
; SRAM1_A[1]     ; Incomplete set of assignments ;
; SRAM1_A[2]     ; Incomplete set of assignments ;
; SRAM1_A[3]     ; Incomplete set of assignments ;
; SRAM1_A[4]     ; Incomplete set of assignments ;
; SRAM1_A[5]     ; Incomplete set of assignments ;
; SRAM1_A[6]     ; Incomplete set of assignments ;
; SRAM1_A[7]     ; Incomplete set of assignments ;
; SRAM1_A[8]     ; Incomplete set of assignments ;
; SRAM1_A[9]     ; Incomplete set of assignments ;
; SRAM1_A[10]    ; Incomplete set of assignments ;
; SRAM1_A[11]    ; Incomplete set of assignments ;
; SRAM1_A[12]    ; Incomplete set of assignments ;
; SRAM1_A[13]    ; Incomplete set of assignments ;
; SRAM1_A[14]    ; Incomplete set of assignments ;
; SRAM1_A[15]    ; Incomplete set of assignments ;
; SRAM1_A[16]    ; Incomplete set of assignments ;
; SRAM1_A[17]    ; Incomplete set of assignments ;
; SRAM1_E        ; Incomplete set of assignments ;
; SRAM1_LB       ; Incomplete set of assignments ;
; SRAM1_OE       ; Incomplete set of assignments ;
; SRAM1_UB       ; Incomplete set of assignments ;
; SRAM1_W        ; Incomplete set of assignments ;
; HA[2]          ; Incomplete set of assignments ;
; HA[3]          ; Incomplete set of assignments ;
; HA[4]          ; Incomplete set of assignments ;
; HA[5]          ; Incomplete set of assignments ;
; HA[6]          ; Incomplete set of assignments ;
; HA[7]          ; Incomplete set of assignments ;
; HA[8]          ; Incomplete set of assignments ;
; HA[9]          ; Incomplete set of assignments ;
; HA[10]         ; Incomplete set of assignments ;
; HA[11]         ; Incomplete set of assignments ;
; HA[12]         ; Incomplete set of assignments ;
; HA[13]         ; Incomplete set of assignments ;
; HA[14]         ; Incomplete set of assignments ;
; HA[15]         ; Incomplete set of assignments ;
; HA[16]         ; Incomplete set of assignments ;
; HA[17]         ; Incomplete set of assignments ;
; HA[18]         ; Incomplete set of assignments ;
; HA[19]         ; Incomplete set of assignments ;
; HB[2]          ; Incomplete set of assignments ;
; HB[3]          ; Incomplete set of assignments ;
; HB[4]          ; Incomplete set of assignments ;
; HB[5]          ; Incomplete set of assignments ;
; HB[6]          ; Incomplete set of assignments ;
; HB[7]          ; Incomplete set of assignments ;
; HB[8]          ; Incomplete set of assignments ;
; HB[9]          ; Incomplete set of assignments ;
; HB[10]         ; Incomplete set of assignments ;
; HB[11]         ; Incomplete set of assignments ;
; HB[12]         ; Incomplete set of assignments ;
; HB[13]         ; Incomplete set of assignments ;
; HB[14]         ; Incomplete set of assignments ;
; HB[15]         ; Incomplete set of assignments ;
; HB[16]         ; Incomplete set of assignments ;
; HB[17]         ; Incomplete set of assignments ;
; HB[18]         ; Incomplete set of assignments ;
; HB[19]         ; Incomplete set of assignments ;
; SRAM0_D[0]     ; Incomplete set of assignments ;
; SRAM0_D[1]     ; Incomplete set of assignments ;
; SRAM0_D[2]     ; Incomplete set of assignments ;
; SRAM0_D[3]     ; Incomplete set of assignments ;
; SRAM0_D[4]     ; Incomplete set of assignments ;
; SRAM0_D[5]     ; Incomplete set of assignments ;
; SRAM0_D[6]     ; Incomplete set of assignments ;
; SRAM0_D[7]     ; Incomplete set of assignments ;
; SRAM0_D[8]     ; Incomplete set of assignments ;
; SRAM0_D[9]     ; Incomplete set of assignments ;
; SRAM0_D[10]    ; Incomplete set of assignments ;
; SRAM0_D[11]    ; Incomplete set of assignments ;
; SRAM0_D[12]    ; Incomplete set of assignments ;
; SRAM0_D[13]    ; Incomplete set of assignments ;
; SRAM0_D[14]    ; Incomplete set of assignments ;
; SRAM0_D[15]    ; Incomplete set of assignments ;
; SRAM1_D[0]     ; Incomplete set of assignments ;
; SRAM1_D[1]     ; Incomplete set of assignments ;
; SRAM1_D[2]     ; Incomplete set of assignments ;
; SRAM1_D[3]     ; Incomplete set of assignments ;
; SRAM1_D[4]     ; Incomplete set of assignments ;
; SRAM1_D[5]     ; Incomplete set of assignments ;
; SRAM1_D[6]     ; Incomplete set of assignments ;
; SRAM1_D[7]     ; Incomplete set of assignments ;
; SRAM1_D[8]     ; Incomplete set of assignments ;
; SRAM1_D[9]     ; Incomplete set of assignments ;
; SRAM1_D[10]    ; Incomplete set of assignments ;
; SRAM1_D[11]    ; Incomplete set of assignments ;
; SRAM1_D[12]    ; Incomplete set of assignments ;
; SRAM1_D[13]    ; Incomplete set of assignments ;
; SRAM1_D[14]    ; Incomplete set of assignments ;
; SRAM1_D[15]    ; Incomplete set of assignments ;
; JTAG_NEXUS_TCK ; Incomplete set of assignments ;
; JTAG_NEXUS_TMS ; Incomplete set of assignments ;
; CLK_BRD        ; Incomplete set of assignments ;
; TEST_BUTTON    ; Incomplete set of assignments ;
; JTAG_NEXUS_TDI ; Incomplete set of assignments ;
; SW_USER2       ; Incomplete set of assignments ;
; SW_USER4       ; Incomplete set of assignments ;
; SW_USER3       ; Incomplete set of assignments ;
; SW_USER0       ; Incomplete set of assignments ;
; SW_USER1       ; Incomplete set of assignments ;
; MIDI_RX        ; Incomplete set of assignments ;
+----------------+-------------------------------+


+----------------------------------------------+
; Incremental Compilation Preservation Summary ;
+---------------------+------------------------+
; Type                ; Value                  ;
+---------------------+------------------------+
; Placement (by node) ;                        ;
;     -- Requested    ; 0 / 8417 ( 0.00 % )    ;
;     -- Achieved     ; 0 / 8417 ( 0.00 % )    ;
;                     ;                        ;
; Routing (by net)    ;                        ;
;     -- Requested    ; 0 / 0 ( 0.00 % )       ;
;     -- Achieved     ; 0 / 0 ( 0.00 % )       ;
+---------------------+------------------------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Incremental Compilation Partition Settings                                                                                                                                             ;
+--------------------------------+----------------+-------------------+-------------------------+------------------------+------------------------------+--------------------------------+
; Partition Name                 ; Partition Type ; Netlist Type Used ; Preservation Level Used ; Netlist Type Requested ; Preservation Level Requested ; Contents                       ;
+--------------------------------+----------------+-------------------+-------------------------+------------------------+------------------------------+--------------------------------+
; Top                            ; User-created   ; Source File       ; N/A                     ; Source File            ; N/A                          ;                                ;
; hard_block:auto_generated_inst ; Auto-generated ; Source File       ; N/A                     ; Source File            ; N/A                          ; hard_block:auto_generated_inst ;
+--------------------------------+----------------+-------------------+-------------------------+------------------------+------------------------------+--------------------------------+


+------------------------------------------------------------------------------------------------------------+
; Incremental Compilation Placement Preservation                                                             ;
+--------------------------------+---------+-------------------+-------------------------+-------------------+
; Partition Name                 ; # Nodes ; # Preserved Nodes ; Preservation Level Used ; Netlist Type Used ;
+--------------------------------+---------+-------------------+-------------------------+-------------------+
; Top                            ; 8409    ; 0                 ; N/A                     ; Source File       ;
; hard_block:auto_generated_inst ; 8       ; 0                 ; N/A                     ; Source File       ;
+--------------------------------+---------+-------------------+-------------------------+-------------------+


+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in P:/Hardware/Elektronik-Module_und_Bausätze/Altium Nanoboard 3000/NB3000_MIDI_Keyboard/ProjectOutputs/Default - All Constraints/MIDIKBD.pin.


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Usage Summary                                                                                                                                      ;
+---------------------------------------------+----------------------------------------------------------------------------------------------------------------------+
; Resource                                    ; Usage                                                                                                                ;
+---------------------------------------------+----------------------------------------------------------------------------------------------------------------------+
; Total logic elements                        ; 6,056 / 39,600 ( 15 % )                                                                                              ;
;     -- Combinational with no register       ; 3363                                                                                                                 ;
;     -- Register only                        ; 825                                                                                                                  ;
;     -- Combinational with a register        ; 1868                                                                                                                 ;
;                                             ;                                                                                                                      ;
; Logic element usage by number of LUT inputs ;                                                                                                                      ;
;     -- 4 input functions                    ; 2410                                                                                                                 ;
;     -- 3 input functions                    ; 2107                                                                                                                 ;
;     -- <=2 input functions                  ; 714                                                                                                                  ;
;     -- Register only                        ; 825                                                                                                                  ;
;                                             ;                                                                                                                      ;
; Logic elements by mode                      ;                                                                                                                      ;
;     -- normal mode                          ; 4289                                                                                                                 ;
;     -- arithmetic mode                      ; 942                                                                                                                  ;
;                                             ;                                                                                                                      ;
; Total registers*                            ; 2,693 / 42,205 ( 6 % )                                                                                               ;
;     -- Dedicated logic registers            ; 2,693 / 39,600 ( 7 % )                                                                                               ;
;     -- I/O registers                        ; 0 / 2,605 ( 0 % )                                                                                                    ;
;                                             ;                                                                                                                      ;
; Total LABs:  partially or completely used   ; 433 / 2,475 ( 17 % )                                                                                                 ;
; User inserted logic elements                ; 0                                                                                                                    ;
; Virtual pins                                ; 0                                                                                                                    ;
; I/O pins                                    ; 151 / 536 ( 28 % )                                                                                                   ;
;     -- Clock pins                           ; 2 / 8 ( 25 % )                                                                                                       ;
;     -- Dedicated input pins                 ; 0 / 9 ( 0 % )                                                                                                        ;
;                                             ;                                                                                                                      ;
; Global signals                              ; 2                                                                                                                    ;
; M9Ks                                        ; 10 / 126 ( 8 % )                                                                                                     ;
; Total block memory bits                     ; 67,584 / 1,161,216 ( 6 % )                                                                                           ;
; Total block memory implementation bits      ; 92,160 / 1,161,216 ( 8 % )                                                                                           ;
; Embedded Multiplier 9-bit elements          ; 4 / 252 ( 2 % )                                                                                                      ;
; PLLs                                        ; 0 / 4 ( 0 % )                                                                                                        ;
; Global clocks                               ; 2 / 20 ( 10 % )                                                                                                      ;
; JTAGs                                       ; 0 / 1 ( 0 % )                                                                                                        ;
; CRC blocks                                  ; 0 / 1 ( 0 % )                                                                                                        ;
; ASMI blocks                                 ; 0 / 1 ( 0 % )                                                                                                        ;
; Impedance control blocks                    ; 0 / 4 ( 0 % )                                                                                                        ;
; Average interconnect usage (total/H/V)      ; 7% / 7% / 7%                                                                                                         ;
; Peak interconnect usage (total/H/V)         ; 56% / 54% / 59%                                                                                                      ;
; Maximum fan-out node                        ; CLK_BRD~inputclkctrl                                                                                                 ;
; Maximum fan-out                             ; 2365                                                                                                                 ;
; Highest non-global fan-out signal           ; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_TakeBranch_1_0_0_g2_0_828_a2_1 ;
; Highest non-global fan-out                  ; 784                                                                                                                  ;
; Total fan-out                               ; 29105                                                                                                                ;
; Average fan-out                             ; 3.27                                                                                                                 ;
+---------------------------------------------+----------------------------------------------------------------------------------------------------------------------+
*  Register count does not include registers inside RAM blocks or DSP blocks.



+------------------------------------------------------------------------------------------------------+
; Fitter Partition Statistics                                                                          ;
+---------------------------------------------+-----------------------+--------------------------------+
; Statistic                                   ; Top                   ; hard_block:auto_generated_inst ;
+---------------------------------------------+-----------------------+--------------------------------+
; Difficulty Clustering Region                ; Low                   ; Low                            ;
;                                             ;                       ;                                ;
; Total logic elements                        ; 6056 / 39600 ( 15 % ) ; 0 / 39600 ( 0 % )              ;
;     -- Combinational with no register       ; 3363                  ; 0                              ;
;     -- Register only                        ; 825                   ; 0                              ;
;     -- Combinational with a register        ; 1868                  ; 0                              ;
;                                             ;                       ;                                ;
; Logic element usage by number of LUT inputs ;                       ;                                ;
;     -- 4 input functions                    ; 2410                  ; 0                              ;
;     -- 3 input functions                    ; 2107                  ; 0                              ;
;     -- <=2 input functions                  ; 714                   ; 0                              ;
;     -- Register only                        ; 825                   ; 0                              ;
;                                             ;                       ;                                ;
; Logic elements by mode                      ;                       ;                                ;
;     -- normal mode                          ; 4289                  ; 0                              ;
;     -- arithmetic mode                      ; 942                   ; 0                              ;
;                                             ;                       ;                                ;
; Total registers                             ; 2693                  ; 0                              ;
;     -- Dedicated logic registers            ; 2693 / 39600 ( 7 % )  ; 0 / 39600 ( 0 % )              ;
;     -- I/O registers                        ; 0                     ; 0                              ;
;                                             ;                       ;                                ;
; Total LABs:  partially or completely used   ; 433 / 2475 ( 17 % )   ; 0 / 2475 ( 0 % )               ;
;                                             ;                       ;                                ;
; Virtual pins                                ; 0                     ; 0                              ;
; I/O pins                                    ; 151                   ; 0                              ;
; Embedded Multiplier 9-bit elements          ; 4 / 252 ( 2 % )       ; 0 / 252 ( 0 % )                ;
; Total memory bits                           ; 67584                 ; 0                              ;
; Total RAM block bits                        ; 92160                 ; 0                              ;
; M9K                                         ; 10 / 126 ( 7 % )      ; 0 / 126 ( 0 % )                ;
; Clock control block                         ; 2 / 24 ( 8 % )        ; 0 / 24 ( 0 % )                 ;
;                                             ;                       ;                                ;
; Connections                                 ;                       ;                                ;
;     -- Input Connections                    ; 68                    ; 0                              ;
;     -- Registered Input Connections         ; 0                     ; 0                              ;
;     -- Output Connections                   ; 68                    ; 0                              ;
;     -- Registered Output Connections        ; 0                     ; 0                              ;
;                                             ;                       ;                                ;
; Internal Connections                        ;                       ;                                ;
;     -- Total Connections                    ; 29207                 ; 4                              ;
;     -- Registered Connections               ; 9209                  ; 0                              ;
;                                             ;                       ;                                ;
; External Connections                        ;                       ;                                ;
;     -- Top                                  ; 136                   ; 0                              ;
;     -- hard_block:auto_generated_inst       ; 0                     ; 0                              ;
;                                             ;                       ;                                ;
; Partition Interface                         ;                       ;                                ;
;     -- Input Ports                          ; 11                    ; 0                              ;
;     -- Output Ports                         ; 72                    ; 0                              ;
;     -- Bidir Ports                          ; 68                    ; 0                              ;
;                                             ;                       ;                                ;
; Registered Ports                            ;                       ;                                ;
;     -- Registered Input Ports               ; 0                     ; 0                              ;
;     -- Registered Output Ports              ; 0                     ; 0                              ;
;                                             ;                       ;                                ;
; Port Connectivity                           ;                       ;                                ;
;     -- Input Ports driven by GND            ; 0                     ; 0                              ;
;     -- Output Ports driven by GND           ; 0                     ; 0                              ;
;     -- Input Ports driven by VCC            ; 0                     ; 0                              ;
;     -- Output Ports driven by VCC           ; 0                     ; 0                              ;
;     -- Input Ports with no Source           ; 0                     ; 0                              ;
;     -- Output Ports with no Source          ; 0                     ; 0                              ;
;     -- Input Ports with no Fanout           ; 0                     ; 0                              ;
;     -- Output Ports with no Fanout          ; 0                     ; 0                              ;
+---------------------------------------------+-----------------------+--------------------------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins                                                                                                                                                                                                                                                                          ;
+----------------+-------+----------+--------------+--------------+--------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+---------------------------+----------------------+
; Name           ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Z coordinate ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination Control Block ; Location assigned by ;
+----------------+-------+----------+--------------+--------------+--------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+---------------------------+----------------------+
; CLK_BRD        ; A14   ; 8        ; 34           ; 43           ; 14           ; 2365                  ; 0                  ; yes    ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; JTAG_NEXUS_TCK ; Y27   ; 5        ; 67           ; 22           ; 14           ; 350                   ; 0                  ; yes    ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; JTAG_NEXUS_TDI ; AD21  ; 4        ; 59           ; 0            ; 21           ; 5                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; JTAG_NEXUS_TMS ; AE22  ; 4        ; 65           ; 0            ; 21           ; 8                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; MIDI_RX        ; C4    ; 8        ; 3            ; 43           ; 28           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW_USER0       ; M3    ; 1        ; 0            ; 30           ; 7            ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW_USER1       ; W1    ; 2        ; 0            ; 15           ; 21           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW_USER2       ; AB1   ; 2        ; 0            ; 15           ; 0            ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW_USER3       ; AB6   ; 2        ; 0            ; 6            ; 7            ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW_USER4       ; AA3   ; 2        ; 0            ; 6            ; 21           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; TEST_BUTTON    ; AG12  ; 3        ; 34           ; 0            ; 21           ; 327                   ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
+----------------+-------+----------+--------------+--------------+--------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+---------------------------+----------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins                                                                                                                                                                                                                                                                                                                                                                                                                                                     ;
+----------------+-------+----------+--------------+--------------+--------------+-----------------+------------------------+---------------+-----------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-----------------------------------+---------------------------+----------------------------+-----------------------------+----------------------+----------------------+---------------------+
; Name           ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Z coordinate ; Output Register ; Output Enable Register ; Power Up High ; Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination                       ; Termination Control Block ; Output Buffer Pre-emphasis ; Voltage Output Differential ; Location assigned by ; Output Enable Source ; Output Enable Group ;
+----------------+-------+----------+--------------+--------------+--------------+-----------------+------------------------+---------------+-----------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-----------------------------------+---------------------------+----------------------------+-----------------------------+----------------------+----------------------+---------------------+
; JTAG_NEXUS_TDO ; AC21  ; 4        ; 59           ; 0            ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[0]       ; AD27  ; 5        ; 67           ; 7            ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[1]       ; AA25  ; 5        ; 67           ; 13           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[2]       ; AB20  ; 4        ; 61           ; 0            ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[3]       ; AB23  ; 5        ; 67           ; 3            ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[4]       ; AD11  ; 3        ; 1            ; 0            ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[5]       ; AD10  ; 3        ; 14           ; 0            ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[6]       ; V4    ; 2        ; 0            ; 17           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[7]       ; R3    ; 2        ; 0            ; 19           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[0]       ; AC28  ; 5        ; 67           ; 8            ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[1]       ; AA23  ; 5        ; 67           ; 7            ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[2]       ; AA24  ; 5        ; 67           ; 5            ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[3]       ; AD26  ; 5        ; 67           ; 6            ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[4]       ; AC12  ; 3        ; 9            ; 0            ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[5]       ; AG11  ; 3        ; 29           ; 0            ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[6]       ; T3    ; 2        ; 0            ; 18           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[7]       ; U1    ; 2        ; 0            ; 17           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[0]       ; Y22   ; 5        ; 67           ; 5            ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[1]       ; W26   ; 5        ; 67           ; 12           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[2]       ; AB25  ; 5        ; 67           ; 13           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[3]       ; AB24  ; 5        ; 67           ; 2            ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[4]       ; Y13   ; 3        ; 16           ; 0            ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[5]       ; AC10  ; 3        ; 11           ; 0            ; 28           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[6]       ; W9    ; 2        ; 0            ; 8            ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[7]       ; R2    ; 2        ; 0            ; 20           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; MIDI_TX        ; D6    ; 8        ; 5            ; 43           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[0]     ; G13   ; 8        ; 25           ; 43           ; 28           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[10]    ; R22   ; 5        ; 67           ; 14           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[11]    ; L20   ; 6        ; 67           ; 29           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[12]    ; H22   ; 6        ; 67           ; 35           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[13]    ; J25   ; 6        ; 67           ; 34           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[14]    ; J22   ; 6        ; 67           ; 40           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[15]    ; C16   ; 7        ; 41           ; 43           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[16]    ; H14   ; 7        ; 38           ; 43           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[17]    ; E12   ; 8        ; 20           ; 43           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[1]     ; F15   ; 7        ; 41           ; 43           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[2]     ; D17   ; 7        ; 45           ; 43           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[3]     ; G19   ; 7        ; 63           ; 43           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[4]     ; A21   ; 7        ; 52           ; 43           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[5]     ; K25   ; 6        ; 67           ; 24           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[6]     ; L25   ; 6        ; 67           ; 25           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[7]     ; H7    ; 1        ; 0            ; 40           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[8]     ; M26   ; 6        ; 67           ; 29           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_A[9]     ; V1    ; 2        ; 0            ; 15           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_E        ; G20   ; 7        ; 63           ; 43           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_LB       ; D18   ; 7        ; 50           ; 43           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_OE       ; E15   ; 7        ; 36           ; 43           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_UB       ; G16   ; 7        ; 43           ; 43           ; 28           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM0_W        ; K22   ; 6        ; 67           ; 29           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[0]     ; E17   ; 7        ; 43           ; 43           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[10]    ; M28   ; 6        ; 67           ; 28           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[11]    ; N25   ; 6        ; 67           ; 26           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[12]    ; M24   ; 6        ; 67           ; 24           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[13]    ; N21   ; 6        ; 67           ; 26           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[14]    ; L23   ; 6        ; 67           ; 30           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[15]    ; E18   ; 7        ; 52           ; 43           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[16]    ; H16   ; 7        ; 43           ; 43           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[17]    ; D16   ; 7        ; 38           ; 43           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[1]     ; F18   ; 7        ; 54           ; 43           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[2]     ; B21   ; 7        ; 52           ; 43           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[3]     ; E19   ; 7        ; 56           ; 43           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[4]     ; F19   ; 7        ; 56           ; 43           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[5]     ; J23   ; 6        ; 67           ; 31           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[6]     ; M25   ; 6        ; 67           ; 31           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[7]     ; R21   ; 5        ; 67           ; 20           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[8]     ; L27   ; 6        ; 67           ; 32           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_A[9]     ; U20   ; 5        ; 67           ; 12           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_E        ; J10   ; 8        ; 14           ; 43           ; 28           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_LB       ; B23   ; 7        ; 59           ; 43           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_OE       ; C20   ; 7        ; 50           ; 43           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_UB       ; C21   ; 7        ; 54           ; 43           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; SRAM1_W        ; M21   ; 6        ; 67           ; 35           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
+----------------+-------+----------+--------------+--------------+--------------+-----------------+------------------------+---------------+-----------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-----------------------------------+---------------------------+----------------------------+-----------------------------+----------------------+----------------------+---------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Bidir Pins                                                                                                                                                                                                                                                                                                                                                                                                                                                                                          ;
+-------------+-------+----------+--------------+--------------+--------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------+-----------------+------------+----------+--------------+--------------+------------------+-----------------------------------+---------------------------+----------------------+------+----------------------------------------------------------+---------------------+
; Name        ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Z coordinate ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Output Register ; Output Enable Register ; Power Up High ; Slew Rate ; PCI I/O Enabled ; Open Drain ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Output Termination                ; Termination Control Block ; Location assigned by ; Load ; Output Enable Source                                     ; Output Enable Group ;
+-------------+-------+----------+--------------+--------------+--------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------+-----------------+------------+----------+--------------+--------------+------------------+-----------------------------------+---------------------------+----------------------+------+----------------------------------------------------------+---------------------+
; HA[10]      ; M5    ; 1        ; 0            ; 28           ; 7            ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[11]      ; T9    ; 2        ; 0            ; 11           ; 21           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[12]      ; L8    ; 1        ; 0            ; 34           ; 21           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[13]      ; M7    ; 1        ; 0            ; 33           ; 14           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[14]      ; L1    ; 1        ; 0            ; 28           ; 0            ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[15]      ; M1    ; 1        ; 0            ; 28           ; 21           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[16]      ; L4    ; 1        ; 0            ; 33           ; 21           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[17]      ; M9    ; 1        ; 0            ; 41           ; 14           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[18]      ; L5    ; 1        ; 0            ; 37           ; 14           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[19]      ; M2    ; 1        ; 0            ; 28           ; 14           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[2]       ; N4    ; 1        ; 0            ; 30           ; 21           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; On           ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[3]       ; R6    ; 2        ; 0            ; 19           ; 7            ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; On           ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[4]       ; M8    ; 1        ; 0            ; 33           ; 7            ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; On           ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[5]       ; R4    ; 2        ; 0            ; 19           ; 14           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; On           ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HA[6]       ; M4    ; 1        ; 0            ; 29           ; 7            ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; On           ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
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; HB[2]       ; J4    ; 1        ; 0            ; 32           ; 21           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HB[3]       ; L2    ; 1        ; 0            ; 29           ; 21           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HB[4]       ; J7    ; 1        ; 0            ; 35           ; 0            ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HB[5]       ; K7    ; 1        ; 0            ; 34           ; 7            ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HB[6]       ; J6    ; 1        ; 0            ; 36           ; 14           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HB[7]       ; L6    ; 1        ; 0            ; 34           ; 14           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HB[8]       ; H4    ; 1        ; 0            ; 39           ; 14           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; HB[9]       ; K4    ; 1        ; 0            ; 35           ; 21           ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; yes        ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; -                                                        ; -                   ;
; SRAM0_D[0]  ; D20   ; 7        ; 50           ; 43           ; 28           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[10] ; D26   ; 6        ; 67           ; 41           ; 7            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[11] ; D28   ; 6        ; 67           ; 39           ; 21           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[12] ; G10   ; 8        ; 16           ; 43           ; 14           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[13] ; B19   ; 7        ; 45           ; 43           ; 14           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[14] ; D21   ; 7        ; 54           ; 43           ; 0            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[15] ; D19   ; 7        ; 54           ; 43           ; 28           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[1]  ; E22   ; 7        ; 65           ; 43           ; 21           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[2]  ; C23   ; 7        ; 59           ; 43           ; 7            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[3]  ; F17   ; 7        ; 48           ; 43           ; 28           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[4]  ; C26   ; 6        ; 67           ; 41           ; 0            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[5]  ; G22   ; 6        ; 67           ; 38           ; 21           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[6]  ; G24   ; 6        ; 67           ; 26           ; 0            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[7]  ; H23   ; 6        ; 67           ; 34           ; 21           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[8]  ; G25   ; 6        ; 67           ; 36           ; 21           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM0_D[9]  ; E28   ; 6        ; 67           ; 37           ; 0            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[0]  ; J17   ; 7        ; 43           ; 43           ; 14           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[10] ; D27   ; 6        ; 67           ; 39           ; 14           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[11] ; E25   ; 6        ; 67           ; 32           ; 7            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[12] ; A19   ; 7        ; 45           ; 43           ; 7            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[13] ; B25   ; 7        ; 63           ; 43           ; 14           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[14] ; A26   ; 7        ; 63           ; 43           ; 0            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[15] ; E21   ; 7        ; 56           ; 43           ; 7            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[1]  ; G21   ; 7        ; 65           ; 43           ; 0            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[2]  ; C25   ; 7        ; 61           ; 43           ; 7            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[3]  ; H19   ; 7        ; 61           ; 43           ; 28           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[4]  ; J19   ; 7        ; 65           ; 43           ; 28           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[5]  ; E26   ; 6        ; 67           ; 40           ; 7            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[6]  ; E27   ; 6        ; 67           ; 38           ; 14           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[7]  ; E1    ; 1        ; 0            ; 36           ; 21           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[8]  ; F27   ; 6        ; 67           ; 37           ; 14           ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
; SRAM1_D[9]  ; F26   ; 6        ; 67           ; 38           ; 0            ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; 2         ; yes             ; no         ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; User                 ; 0 pF ; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s (inverted) ; -                   ;
+-------------+-------+----------+--------------+--------------+--------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------+-----------------+------------+----------+--------------+--------------+------------------+-----------------------------------+---------------------------+----------------------+------+----------------------------------------------------------+---------------------+


+---------------------------------------------------------------------------------------------------------------------------------+
; Dual Purpose and Dedicated Pins                                                                                                 ;
+----------+------------------------------------------+---------------------+-------------------------+---------------------------+
; Location ; Pin Name                                 ; Reserved As         ; User Signal Name        ; Pin Type                  ;
+----------+------------------------------------------+---------------------+-------------------------+---------------------------+
; F4       ; DIFFIO_L8n, DATA1, ASDO                  ; As input tri-stated ; ~ALTERA_ASDO_DATA1~     ; Dual Purpose Pin          ;
; E2       ; DIFFIO_L10p, FLASH_nCE, nCSO             ; As input tri-stated ; ~ALTERA_FLASH_nCE_nCSO~ ; Dual Purpose Pin          ;
; M6       ; nSTATUS                                  ; -                   ; -                       ; Dedicated Programming Pin ;
; P3       ; DCLK                                     ; As input tri-stated ; ~ALTERA_DCLK~           ; Dual Purpose Pin          ;
; N7       ; DATA0                                    ; As input tri-stated ; ~ALTERA_DATA0~          ; Dual Purpose Pin          ;
; P4       ; nCONFIG                                  ; -                   ; -                       ; Dedicated Programming Pin ;
; R8       ; nCE                                      ; -                   ; -                       ; Dedicated Programming Pin ;
; P24      ; CONF_DONE                                ; -                   ; -                       ; Dedicated Programming Pin ;
; N22      ; MSEL0                                    ; -                   ; -                       ; Dedicated Programming Pin ;
; P23      ; MSEL1                                    ; -                   ; -                       ; Dedicated Programming Pin ;
; M22      ; MSEL2                                    ; -                   ; -                       ; Dedicated Programming Pin ;
; P22      ; MSEL3                                    ; -                   ; -                       ; Dedicated Programming Pin ;
; F27      ; DIFFIO_R8p                               ; Use as regular IO   ; SRAM1_D[8]              ; Dual Purpose Pin          ;
; E28      ; DIFFIO_R7n, PADD23                       ; Use as regular IO   ; SRAM0_D[9]              ; Dual Purpose Pin          ;
; D28      ; DIFFIO_R5n, PADD22                       ; Use as regular IO   ; SRAM0_D[11]             ; Dual Purpose Pin          ;
; D27      ; DIFFIO_R5p, PADD21                       ; Use as regular IO   ; SRAM1_D[10]             ; Dual Purpose Pin          ;
; D18      ; DIFFIO_T41p, PADD2                       ; Use as regular IO   ; SRAM0_LB                ; Dual Purpose Pin          ;
; D17      ; DIFFIO_T37p, PADD4, DQS2T/CQ3T,DPCLK8    ; Use as regular IO   ; SRAM0_A[2]              ; Dual Purpose Pin          ;
; A19      ; DIFFIO_T36n, PADD5                       ; Use as regular IO   ; SRAM1_D[12]             ; Dual Purpose Pin          ;
; B19      ; DIFFIO_T36p, PADD6                       ; Use as regular IO   ; SRAM0_D[13]             ; Dual Purpose Pin          ;
; C16      ; DIFFIO_T31n, PADD9                       ; Use as regular IO   ; SRAM0_A[15]             ; Dual Purpose Pin          ;
; D16      ; DIFFIO_T31p, PADD10                      ; Use as regular IO   ; SRAM1_A[17]             ; Dual Purpose Pin          ;
; G13      ; DIFFIO_T18n, PADD19                      ; Use as regular IO   ; SRAM0_A[0]              ; Dual Purpose Pin          ;
; E12      ; DIFFIO_T16n, DATA14, DQS3T/CQ3T#,DPCLK11 ; Use as regular IO   ; SRAM0_A[17]             ; Dual Purpose Pin          ;
+----------+------------------------------------------+---------------------+-------------------------+---------------------------+


+------------------------------------------------------------+
; I/O Bank Usage                                             ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage            ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1        ; 31 / 61 ( 51 % ) ; 2.5V          ; --           ;
; 2        ; 23 / 73 ( 32 % ) ; 2.5V          ; --           ;
; 3        ; 7 / 65 ( 11 % )  ; 2.5V          ; --           ;
; 4        ; 4 / 67 ( 6 % )   ; 2.5V          ; --           ;
; 5        ; 15 / 71 ( 21 % ) ; 2.5V          ; --           ;
; 6        ; 31 / 65 ( 48 % ) ; 2.5V          ; --           ;
; 7        ; 37 / 67 ( 55 % ) ; 2.5V          ; --           ;
; 8        ; 7 / 67 ( 10 % )  ; 2.5V          ; --           ;
+----------+------------------+---------------+--------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins                                                                                                                                                       ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage                           ; Dir.   ; I/O Standard ; Voltage ; I/O Type   ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; A2       ;            ; 8        ; VCCIO8                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; A3       ; 540        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A4       ; 538        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A5       ;            ; 8        ; VCCIO8                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; A6       ; 524        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A7       ; 515        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A8       ; 531        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A9       ;            ; 8        ; VCCIO8                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; A10      ; 499        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A11      ; 497        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A12      ; 489        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A13      ;            ; 8        ; VCCIO8                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; A14      ; 481        ; 8        ; CLK_BRD                                  ; input  ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
; A15      ; 479        ; 7        ; GND+                                     ;        ;              ;         ; Column I/O ;                 ; --       ; --           ;
; A16      ;            ; 7        ; VCCIO7                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; A17      ; 473        ; 7        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A18      ; 460        ; 7        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A19      ; 458        ; 7        ; SRAM1_D[12]                              ; bidir  ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
; A20      ;            ; 7        ; VCCIO7                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; A21      ; 443        ; 7        ; SRAM0_A[4]                               ; output ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
; A22      ; 442        ; 7        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A23      ; 427        ; 7        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A24      ;            ; 7        ; VCCIO7                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; A25      ; 423        ; 7        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A26      ; 419        ; 7        ; SRAM1_D[14]                              ; bidir  ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
; A27      ;            ; 7        ; VCCIO7                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; AA1      ;            ; 2        ; VCCIO2                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; AA2      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; AA3      ; 128        ; 2        ; SW_USER4                                 ; input  ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
; AA4      ; 117        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AA5      ; 124        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AA6      ; 102        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AA7      ; 101        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AA8      ; 104        ; 2        ; HB[19]                                   ; bidir  ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
; AA9      ;            ;          ; GNDA1                                    ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; AA10     ; 174        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AA11     ;            ; 3        ; VCCIO3                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; AA12     ; 159        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; AG25     ; 259        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; AG28     ;            ; 5        ; VCCIO5                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; AH2      ;            ; 3        ; VCCIO3                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; AH3      ; 156        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; AH6      ; 166        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; AH15     ; 207        ; 4        ; GND+                                     ;        ;              ;         ; Column I/O ;                 ; --       ; --           ;
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; B17      ; 474        ; 7        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; B21      ; 444        ; 7        ; SRAM1_A[2]                               ; output ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
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; B25      ; 421        ; 7        ; SRAM1_D[13]                              ; bidir  ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
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; R5       ; 82         ; 2        ; HA[9]                                    ; bidir  ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; On           ;
; R6       ; 75         ; 2        ; HA[3]                                    ; bidir  ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; On           ;
; R7       ; 77         ; 2        ; HB[10]                                   ; bidir  ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
; R8       ; 65         ; 1        ; ^nCE                                     ;        ;              ;         ; --         ;                 ; --       ; --           ;
; R9       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; R10      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; R11      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; R12      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; R13      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; R14      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; R15      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
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; T3       ; 79         ; 2        ; LED_G[6]                                 ; output ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
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; T5       ;            ; 2        ; VCCIO2                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
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; T7       ; 103        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
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; W6       ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; W7       ;            ; 2        ; VCCIO2                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; W8       ; 110        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; W9       ; 118        ; 2        ; LED_R[6]                                 ; output ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
; W10      ; 157        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; W11      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; W12      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; W13      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; W14      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; W15      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; W16      ; 217        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; W17      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; W18      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; W19      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; W20      ; 327        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; W21      ; 297        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; W22      ; 295        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; W23      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; W24      ;            ; 5        ; VCCIO5                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; W25      ; 318        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; W26      ; 310        ; 5        ; LED_R[1]                                 ; output ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
; W27      ; 311        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; W28      ; 312        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y1       ; 69         ; 2        ; GND+                                     ;        ;              ;         ; Row I/O    ;                 ; --       ; --           ;
; Y2       ; 68         ; 2        ; GND+                                     ;        ;              ;         ; Row I/O    ;                 ; --       ; --           ;
; Y3       ; 107        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y4       ; 106        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y5       ; 97         ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y6       ; 98         ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y7       ; 105        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y8       ;            ; --       ; VCCA1                                    ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; Y9       ;            ;          ; VCCD_PLL1                                ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; Y10      ; 147        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; Y11      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; Y12      ; 153        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; Y13      ; 171        ; 3        ; LED_R[4]                                 ; output ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
; Y14      ; 175        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; Y15      ; 177        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; Y16      ;            ; 4        ; VCCIO4                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; Y17      ; 229        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; Y18      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; Y19      ; 243        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; Y20      ;            ;          ; VCCD_PLL4                                ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; Y21      ;            ; --       ; VCCA4                                    ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; Y22      ; 283        ; 5        ; LED_R[0]                                 ; output ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
; Y23      ; 291        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y24      ; 294        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y25      ; 325        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y26      ; 308        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y27      ; 343        ; 5        ; JTAG_NEXUS_TCK                           ; input  ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
; Y28      ; 342        ; 5        ; GND+                                     ;        ;              ;         ; Row I/O    ;                 ; --       ; --           ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
Note: Pin directions (input, output or bidir) are based on device operating in user mode.


+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity                                                                                                                                                                                                                                                                                                                                                                                                                                                 ;
+--------------------------------------------------------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+--------------+
; Compilation Hierarchy Node                                               ; Logic Cells ; Dedicated Logic Registers ; I/O Registers ; Memory Bits ; M9Ks ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Full Hierarchy Name                                                                                                                                                                         ; Library Name ;
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;       |MIDI:U_midi|                                                      ; 867 (0)     ; 514 (0)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 353 (0)      ; 177 (0)           ; 337 (0)          ; |MIDIKBD|WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi                                                                                                                                            ;              ;
;          |WB_UART8_V2:SUB_MIDI|                                          ; 867 (0)     ; 514 (0)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 353 (0)      ; 177 (0)           ; 337 (0)          ; |MIDIKBD|WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI                                                                                                                       ;              ;
;             |wb_uart:U_WB_UART|                                          ; 867 (867)   ; 514 (514)                 ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 353 (353)    ; 177 (177)         ; 337 (337)        ; |MIDIKBD|WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART                                                                                                     ;              ;
+--------------------------------------------------------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+--------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.


+------------------------------------------------------------------------------------------------+
; Delay Chain Summary                                                                            ;
+----------------+----------+---------------+---------------+-----------------------+-----+------+
; Name           ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ; TCOE ;
+----------------+----------+---------------+---------------+-----------------------+-----+------+
; JTAG_NEXUS_TDO ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[0]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[1]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[2]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[3]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[4]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[5]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[6]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[7]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[0]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[1]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[2]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[3]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[4]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[5]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[6]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[7]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[0]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[1]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[2]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[3]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[4]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[5]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[6]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[7]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; MIDI_TX        ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[0]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[1]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[2]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[3]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[4]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[5]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[6]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[7]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[8]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[9]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[10]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[11]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[12]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[13]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[14]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[15]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[16]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_A[17]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_E        ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_LB       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_OE       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_UB       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_W        ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[0]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[1]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[2]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[3]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[4]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[5]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[6]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[7]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[8]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[9]     ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[10]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[11]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[12]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[13]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[14]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[15]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[16]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_A[17]    ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_E        ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_LB       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_OE       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_UB       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SRAM1_W        ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HA[2]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[3]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[4]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[5]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[6]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[7]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[8]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[9]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[10]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[11]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[12]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[13]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[14]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[15]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[16]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[17]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[18]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HA[19]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[2]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[3]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[4]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[5]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[6]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[7]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[8]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[9]          ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[10]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[11]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[12]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[13]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[14]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[15]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[16]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[17]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[18]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; HB[19]         ; Bidir    ; --            ; --            ; --                    ; --  ; --   ;
; SRAM0_D[0]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM0_D[1]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM0_D[2]     ; Bidir    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SRAM0_D[3]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM0_D[4]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM0_D[5]     ; Bidir    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SRAM0_D[6]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM0_D[7]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM0_D[8]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM0_D[9]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM0_D[10]    ; Bidir    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SRAM0_D[11]    ; Bidir    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SRAM0_D[12]    ; Bidir    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SRAM0_D[13]    ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM0_D[14]    ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM0_D[15]    ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM1_D[0]     ; Bidir    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SRAM1_D[1]     ; Bidir    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SRAM1_D[2]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM1_D[3]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM1_D[4]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM1_D[5]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM1_D[6]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM1_D[7]     ; Bidir    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SRAM1_D[8]     ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM1_D[9]     ; Bidir    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SRAM1_D[10]    ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM1_D[11]    ; Bidir    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SRAM1_D[12]    ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM1_D[13]    ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SRAM1_D[14]    ; Bidir    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SRAM1_D[15]    ; Bidir    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; JTAG_NEXUS_TCK ; Input    ; (0) 0 ps      ; --            ; --                    ; --  ; --   ;
; JTAG_NEXUS_TMS ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; CLK_BRD        ; Input    ; (0) 0 ps      ; --            ; --                    ; --  ; --   ;
; TEST_BUTTON    ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; JTAG_NEXUS_TDI ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SW_USER2       ; Input    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SW_USER4       ; Input    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SW_USER3       ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SW_USER0       ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SW_USER1       ; Input    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; MIDI_RX        ; Input    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
+----------------+----------+---------------+---------------+-----------------------+-----+------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Pad To Core Delay Chain Fanout                                                                                                                                                                                       ;
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+-------------------+---------+
; Source Pin / Fanout                                                                                                                                                                    ; Pad To Core Index ; Setting ;
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+-------------------+---------+
; HA[2]                                                                                                                                                                                  ;                   ;         ;
; HA[3]                                                                                                                                                                                  ;                   ;         ;
; HA[4]                                                                                                                                                                                  ;                   ;         ;
; HA[5]                                                                                                                                                                                  ;                   ;         ;
; HA[6]                                                                                                                                                                                  ;                   ;         ;
; HA[7]                                                                                                                                                                                  ;                   ;         ;
; HA[8]                                                                                                                                                                                  ;                   ;         ;
; HA[9]                                                                                                                                                                                  ;                   ;         ;
; HA[10]                                                                                                                                                                                 ;                   ;         ;
; HA[11]                                                                                                                                                                                 ;                   ;         ;
; HA[12]                                                                                                                                                                                 ;                   ;         ;
; HA[13]                                                                                                                                                                                 ;                   ;         ;
; HA[14]                                                                                                                                                                                 ;                   ;         ;
; HA[15]                                                                                                                                                                                 ;                   ;         ;
; HA[16]                                                                                                                                                                                 ;                   ;         ;
; HA[17]                                                                                                                                                                                 ;                   ;         ;
; HA[18]                                                                                                                                                                                 ;                   ;         ;
; HA[19]                                                                                                                                                                                 ;                   ;         ;
; HB[2]                                                                                                                                                                                  ;                   ;         ;
; HB[3]                                                                                                                                                                                  ;                   ;         ;
; HB[4]                                                                                                                                                                                  ;                   ;         ;
; HB[5]                                                                                                                                                                                  ;                   ;         ;
; HB[6]                                                                                                                                                                                  ;                   ;         ;
; HB[7]                                                                                                                                                                                  ;                   ;         ;
; HB[8]                                                                                                                                                                                  ;                   ;         ;
; HB[9]                                                                                                                                                                                  ;                   ;         ;
; HB[10]                                                                                                                                                                                 ;                   ;         ;
; HB[11]                                                                                                                                                                                 ;                   ;         ;
; HB[12]                                                                                                                                                                                 ;                   ;         ;
; HB[13]                                                                                                                                                                                 ;                   ;         ;
; HB[14]                                                                                                                                                                                 ;                   ;         ;
; HB[15]                                                                                                                                                                                 ;                   ;         ;
; HB[16]                                                                                                                                                                                 ;                   ;         ;
; HB[17]                                                                                                                                                                                 ;                   ;         ;
; HB[18]                                                                                                                                                                                 ;                   ;         ;
; HB[19]                                                                                                                                                                                 ;                   ;         ;
; SRAM0_D[0]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_0                                                                                                       ; 0                 ; 6       ;
; SRAM0_D[1]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_1                                                                                                       ; 0                 ; 6       ;
; SRAM0_D[2]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_2                                                                                                       ; 1                 ; 6       ;
; SRAM0_D[3]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_3                                                                                                       ; 0                 ; 6       ;
; SRAM0_D[4]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_4                                                                                                       ; 0                 ; 6       ;
; SRAM0_D[5]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_5                                                                                                       ; 1                 ; 6       ;
; SRAM0_D[6]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_6                                                                                                       ; 0                 ; 6       ;
; SRAM0_D[7]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_7                                                                                                       ; 0                 ; 6       ;
; SRAM0_D[8]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_8                                                                                                       ; 0                 ; 6       ;
; SRAM0_D[9]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_9                                                                                                       ; 0                 ; 6       ;
; SRAM0_D[10]                                                                                                                                                                            ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_10                                                                                                      ; 1                 ; 6       ;
; SRAM0_D[11]                                                                                                                                                                            ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_11                                                                                                      ; 1                 ; 6       ;
; SRAM0_D[12]                                                                                                                                                                            ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_12                                                                                                      ; 1                 ; 6       ;
; SRAM0_D[13]                                                                                                                                                                            ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_13                                                                                                      ; 0                 ; 6       ;
; SRAM0_D[14]                                                                                                                                                                            ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_14                                                                                                      ; 0                 ; 6       ;
; SRAM0_D[15]                                                                                                                                                                            ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_15                                                                                                      ; 0                 ; 6       ;
; SRAM1_D[0]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_16                                                                                                      ; 1                 ; 6       ;
; SRAM1_D[1]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_17                                                                                                      ; 1                 ; 6       ;
; SRAM1_D[2]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_18                                                                                                      ; 0                 ; 6       ;
; SRAM1_D[3]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_19                                                                                                      ; 0                 ; 6       ;
; SRAM1_D[4]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_20                                                                                                      ; 0                 ; 6       ;
; SRAM1_D[5]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_21                                                                                                      ; 0                 ; 6       ;
; SRAM1_D[6]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_22                                                                                                      ; 0                 ; 6       ;
; SRAM1_D[7]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_23                                                                                                      ; 1                 ; 6       ;
; SRAM1_D[8]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_24                                                                                                      ; 0                 ; 6       ;
; SRAM1_D[9]                                                                                                                                                                             ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_25                                                                                                      ; 1                 ; 6       ;
; SRAM1_D[10]                                                                                                                                                                            ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_26                                                                                                      ; 0                 ; 6       ;
; SRAM1_D[11]                                                                                                                                                                            ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_27                                                                                                      ; 1                 ; 6       ;
; SRAM1_D[12]                                                                                                                                                                            ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_28                                                                                                      ; 0                 ; 6       ;
; SRAM1_D[13]                                                                                                                                                                            ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_29                                                                                                      ; 0                 ; 6       ;
; SRAM1_D[14]                                                                                                                                                                            ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_30                                                                                                      ; 1                 ; 6       ;
; SRAM1_D[15]                                                                                                                                                                            ;                   ;         ;
;      - Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_DAT_O_31                                                                                                      ; 0                 ; 6       ;
; JTAG_NEXUS_TCK                                                                                                                                                                         ;                   ;         ;
; JTAG_NEXUS_TMS                                                                                                                                                                         ;                   ;         ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|tapstate_nxt_x_0_                                                                      ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|tapstate_nxt_x_1_                                                                      ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|tapstate_nxt_x_2_                                                                      ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|tapstate_nxt_x_3_                                                                      ; 0                 ; 6       ;
;      - TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|tapstate_r_i_0_3__Z                   ; 0                 ; 6       ;
;      - TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|tapstate_r_i_0_2__Z                   ; 0                 ; 6       ;
;      - TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|tapstate_r_i_0_1__Z                   ; 0                 ; 6       ;
;      - TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|tapstate_r_i_0_0__Z                   ; 0                 ; 6       ;
; CLK_BRD                                                                                                                                                                                ;                   ;         ;
; TEST_BUTTON                                                                                                                                                                            ;                   ;         ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|un3_dat_o_RNIH4MF                                                                                                      ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_STATUS_RNO_0_                                                                                                       ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|un1_istimeout_27_RNIHAQG                                                                                               ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|un1_rst_i_1_cZ                                                                                                         ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_STATUS_RNO_1_                                                                                                       ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|IsOffline_RNO                                                                                                          ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_STATUS_RNO_3_                                                                                                       ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|un2_wishbone_write_RNISRV6                                                                                             ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|un5_rst_i_x                                                                                                            ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|INTENABLE_2_0_7__g2_x_cZ                                                                                               ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|INTENABLE_2_0_6__g2_x_cZ                                                                                               ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|INTENABLE_2_0_4__g2_x_cZ                                                                                               ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|INTENABLE_2_0_3__g2_x_cZ                                                                                               ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|INTENABLE_2_0_2__g2_x_cZ                                                                                               ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|INTENABLE_2_0_1__g2_x_cZ                                                                                               ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|INTENABLE_2_0_0__g2_x_cZ                                                                                               ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|RxSetFF0_RNO                                                                                                           ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TxAcknowledgeFF0_RNO                                                                                                   ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|RxSetFF1_RNO                                                                                                           ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TxAcknowledgeFF1_RNO                                                                                                   ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|INTENABLE_2_0_5__g2_x_cZ                                                                                               ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|GoOfflineFF0_Z                                                                                                         ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|GoOfflineFF1_Z                                                                                                         ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|GoOnlineFF0_Z                                                                                                          ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|GoOnlineFF1_Z                                                                                                          ; 0                 ; 6       ;
;      - TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|IsInstrumentOnline_Z                                                                                                   ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|WB_INTERFACE_un2_ack_x_RNICU1J                                                                   ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|DAT_O_RNO_2_6_                                                                                   ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|DAT_O_RNO_1_5_                                                                                   ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|DAT_O_RNO_4_3_                                                                                   ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txhead_1_sqmuxa_1_0_a2_cZ                                                                        ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|icd_en_0_a2_0_x_RNIL5CE_0_                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un1_reset_5_i_a2_0_0_x_RNIG0RA                                                                   ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txlowmark_en_0_o2_x_RNIQ8VJ_0_                                                                   ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txlowmark_en_0_o2_x_RNIQ8VJ_0_0_                                                                 ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un1_reset_12_i_o3_RNIPTP5                                                                        ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|alivebit_RNO_0                                                                                   ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|reset_RNIBL1C1                                                                                   ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un1_reset_6_i_a2_2_RNI9U7H                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|WB_INTERFACE_un2_ack_x_RNIDGG12                                                                  ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|DAT_O_RNO_0_2_                                                                                   ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|DAT_O_RNO_0_4_                                                                                   ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhighmark_en_0_a2_0_x_RNIQDNH_0_                                                                ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_en_0_a2_0_RNI9MLT_3_                                                                     ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|WB_INTERFACE_DAT_O_23_12_7_                                                                      ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txhead_RNO_1_                                                                                    ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtail_0_RNO_1_                                                                                  ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtail_0_RNO_3_                                                                                  ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|intmask_en_0_a2_RNIP098_0_                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un6_ack_1_a2_x_RNITKM61                                                                          ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un6_ack_1_a2_x_cZ                                                                                ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhighmark_0_i_a2_x_5_                                                                           ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_3__g2_x_cZ                                                                           ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_5__g2_x_cZ                                                                           ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_6__g2_x_cZ                                                                           ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_7__g2_x_cZ                                                                           ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_8__g2_x_cZ                                                                           ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_9__g2_x_cZ                                                                           ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_10__g2_x_cZ                                                                          ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|WB_INTERFACE_ack_RNO                                                                             ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un1_rst_i_2_i_o2_x_cZ                                                                            ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_4__g2_x_cZ                                                                           ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_23_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_22_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_21_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_20_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_19_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_18_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_17_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_16_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_15_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_14_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_13_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_12_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_11_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_10_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_9_                                                                                        ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_8_                                                                                        ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_7_                                                                                        ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_6_                                                                                        ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_5_                                                                                        ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_4_                                                                                        ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_3_                                                                                        ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_2_                                                                                        ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_1_                                                                                        ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_0_                                                                                        ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|intmask_7_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|intmask_6_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|intmask_5_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|intmask_4_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|intmask_3_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|intmask_2_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|intmask_1_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|intmask_0_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|alivebit_Z                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|parm_2_                                                                                          ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|parm_3_                                                                                          ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|parm_4_                                                                                          ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|parm_5_                                                                                          ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|control_0_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|control_1_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|WB_INTERFACE_ack                                                                                 ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|parm_0_                                                                                          ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|parm_1_                                                                                          ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|control_2_                                                                                       ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhighmark_7_                                                                                    ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhighmark_6_                                                                                    ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhighmark_4_                                                                                    ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhighmark_3_                                                                                    ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhighmark_2_                                                                                    ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhighmark_1_                                                                                    ; 0                 ; 6       ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhighmark_0_                                                                                    ; 0                 ; 6       ;
;      - TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|un1_resetcounter_RNITCK2_0                                                                      ; 0                 ; 6       ;
;      - TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|ResetCounter_0_                                                                                 ; 0                 ; 6       ;
;      - TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|ResetCounter_1_                                                                                 ; 0                 ; 6       ;
;      - TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|ResetCounter_2_                                                                                 ; 0                 ; 6       ;
;      - TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|ResetCounter_3_                                                                                 ; 0                 ; 6       ;
;      - TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|ResetCounter_4_                                                                                 ; 0                 ; 6       ;
;      - TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|ResetCounter_5_                                                                                 ; 0                 ; 6       ;
;      - TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|ResetCounter_6_                                                                                 ; 0                 ; 6       ;
;      - TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|ResetCounter_7_                                                                                 ; 0                 ; 6       ;
;      - Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|MIDIKBD__AltSyn_AltiumAlteraDffAsync:State_state_write_ack|lpm_ff:ff1|dffs[0]                                                         ; 0                 ; 6       ;
;      - Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|MIDIKBD__AltSyn_AltiumAlteraDffAsync:State_state_write_pulse|lpm_ff:ff1|dffs[0]                                                       ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_B_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_B_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_B_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_B_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_B_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_B_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_B_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_B_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_B_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_B_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_B_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_B_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_B_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_B_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_B_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_B_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_B_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_B_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_B_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_B_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_B_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_B_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_B_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_B_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_B_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_B_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_B_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_B_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_B_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_B_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_B_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_B_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_B_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_B_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_B_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_B_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_B_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_B_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_B_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_B_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_B_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_B_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_B_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_B_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_B_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_B_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_B_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_B_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_B_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_B_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_B_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_B_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_B_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_B_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_B_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_B_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_B_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_B_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_B_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_B_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_B_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_B_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_B_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_B_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_G_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_G_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_G_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_G_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_G_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_G_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_G_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_G_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_G_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_G_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_G_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_G_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_G_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_G_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_G_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_G_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_G_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_G_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_G_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_G_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_G_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_G_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_G_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_G_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_G_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_G_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_G_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_G_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_G_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_G_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_G_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_G_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_G_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_G_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_G_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_G_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_G_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_G_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_G_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_G_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_G_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_G_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_G_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_G_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_G_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_G_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_G_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_G_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_G_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_G_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_G_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_G_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_G_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_G_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_G_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_G_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_G_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_G_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_G_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_G_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_G_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_G_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_G_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_G_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_R_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_R_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_R_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_R_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_R_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_R_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_R_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LA_R_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_R_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_R_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_R_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_R_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_R_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_R_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_R_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LB_R_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_R_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_R_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_R_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_R_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_R_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_R_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_R_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LC_R_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_R_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_R_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_R_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_R_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_R_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_R_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_R_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LD_R_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_R_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_R_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_R_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_R_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_R_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_R_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_R_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LE_R_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_R_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_R_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_R_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_R_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_R_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_R_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_R_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LF_R_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_R_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_R_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_R_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_R_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_R_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_R_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_R_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LG_R_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_R_7|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_R_6|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_R_5|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_R_4|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_R_3|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_R_2|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_R_1|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsync:LH_R_0|lpm_ff:ff1|dffs[0]                                                                              ; 0                 ; 6       ;
;      - Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|MIDIKBD__AltSyn_AltiumAlteraDffAsync:State_state_read_ack|lpm_ff:ff1|dffs[0]                                                          ; 0                 ; 6       ;
;      - Configurable_KEY_MATRIX:U_MIDIKBD_OB_KEY_MATRIX|MIDIKBD__AltSyn_AltiumAlteraDffAsync:INST_scan_0|lpm_ff:ff1|dffs[0]                                                             ; 0                 ; 6       ;
;      - Configurable_KEY_MATRIX:U_MIDIKBD_OB_KEY_MATRIX|MIDIKBD__AltSyn_AltiumAlteraDffAsync:INST_scan_1|lpm_ff:ff1|dffs[0]                                                             ; 0                 ; 6       ;
;      - Configurable_KEY_MATRIX:U_MIDIKBD_OB_KEY_MATRIX|MIDIKBD__AltSyn_AltiumAlteraDffAsync:INST_scan_2|lpm_ff:ff1|dffs[0]                                                             ; 0                 ; 6       ;
;      - Configurable_KEY_MATRIX:U_MIDIKBD_OB_KEY_MATRIX|MIDIKBD__AltSyn_AltiumAlteraDffAsync:INST_scan_3|lpm_ff:ff1|dffs[0]                                                             ; 0                 ; 6       ;
;      - Configurable_KEY_MATRIX:U_MIDIKBD_OB_KEY_MATRIX|MIDIKBD__AltSyn_AltiumAlteraDffAsync:INST_scan_4|lpm_ff:ff1|dffs[0]                                                             ; 0                 ; 6       ;
;      - Configurable_KEY_MATRIX:U_MIDIKBD_OB_KEY_MATRIX|MIDIKBD__AltSyn_AltiumAlteraDffAsync:INST_scan_5|lpm_ff:ff1|dffs[0]                                                             ; 0                 ; 6       ;
;      - Configurable_KEY_MATRIX:U_MIDIKBD_OB_KEY_MATRIX|MIDIKBD__AltSyn_AltiumAlteraDffAsync:INST_scan_6|lpm_ff:ff1|dffs[0]                                                             ; 0                 ; 6       ;
;      - Configurable_KEY_MATRIX:U_MIDIKBD_OB_KEY_MATRIX|MIDIKBD__AltSyn_AltiumAlteraDffAsync:INST_scan_7|lpm_ff:ff1|dffs[0]                                                             ; 0                 ; 6       ;
;      - Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|State_state_addresssetup_in                                                                                                           ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38b                                                                                                                                        ; 0                 ; 6       ;
;      - Configurable_LEDS:U_MIDIKBD_OB_LEDS|CNT_0_in~0                                                                                                                                  ; 0                 ; 6       ;
; JTAG_NEXUS_TDI                                                                                                                                                                         ;                   ;         ;
;      - TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|ir_shift_process_sh_ireg_4_0_a2_x_3_  ; 0                 ; 6       ;
;      - TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|sh_reg_31__Z                          ; 0                 ; 6       ;
;      - TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|SubstituteRegister:tsk3000_SubstituteRegister|NexusReg_Shift_31__Z~feeder ; 0                 ; 6       ;
;      - TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|ControlRegister:tsk3000_ControlRegister|NexusReg_Shift_7__Z~feeder        ; 0                 ; 6       ;
;      - TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|DataRegister:tsk3000_DebugDataRegister|NexusReg_Shift_31__Z~feeder        ; 0                 ; 6       ;
; SW_USER2                                                                                                                                                                               ;                   ;         ;
;      - Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n2e~0                                                                                                                   ; 1                 ; 6       ;
; SW_USER4                                                                                                                                                                               ;                   ;         ;
;      - Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n2c~0                                                                                                                   ; 1                 ; 6       ;
; SW_USER3                                                                                                                                                                               ;                   ;         ;
;      - Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n2d~0                                                                                                                   ; 0                 ; 6       ;
; SW_USER0                                                                                                                                                                               ;                   ;         ;
;      - Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n2g~0                                                                                                                   ; 0                 ; 6       ;
; SW_USER1                                                                                                                                                                               ;                   ;         ;
;      - Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n2f~0                                                                                                                   ; 1                 ; 6       ;
; MIDI_RX                                                                                                                                                                                ;                   ;         ;
;      - WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|SYNC_INPUTS_rxdbuf_0_x                                                                           ; 1                 ; 6       ;
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+-------------------+---------+


+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Control Signals                                                                                                                                                                                                                                                                                                                 ;
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------+--------------------+---------+---------------------------------------+--------+----------------------+------------------+---------------------------+
; Name                                                                                                                                                                      ; Location           ; Fan-Out ; Usage                                 ; Global ; Global Resource Used ; Global Line Name ; Enable Signal Source Name ;
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------+--------------------+---------+---------------------------------------+--------+----------------------+------------------+---------------------------+
; CLK_BRD                                                                                                                                                                   ; PIN_A14            ; 2355    ; Clock                                 ; yes    ; Global Clock         ; GCLK14           ; --                        ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n1422~1                                                                                                                               ; LCCOMB_X41_Y16_N0  ; 12      ; Clock enable, Sync. clear             ; no     ; --                   ; --               ; --                        ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38b                                                                                                                                  ; LCCOMB_X44_Y17_N22 ; 7       ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s                                                                                                                             ; LCCOMB_X41_Y24_N24 ; 40      ; Output enable                         ; no     ; --                   ; --               ; --                        ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n479~0                                                                                                            ; LCCOMB_X46_Y32_N14 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|s_or8:n190|OUT                                                                                                  ; LCCOMB_X41_Y26_N26 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; JTAG_NEXUS_TCK                                                                                                                                                            ; PIN_Y27            ; 350     ; Clock                                 ; yes    ; Global Clock         ; GCLK9            ; --                        ;
; JTAG_NEXUS_TMS                                                                                                                                                            ; PIN_AE22           ; 8       ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_AND2:AND2_componentB1|lpm_and:lpm_and_component|and_node[0][1]                                                  ; LCCOMB_X46_Y31_N10 ; 2       ; Write enable                          ; no     ; --                   ; --               ; --                        ;
; Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_AND2:AND2_componentB2|lpm_and:lpm_and_component|and_node[0][1]                                                  ; LCCOMB_X46_Y31_N18 ; 2       ; Write enable                          ; no     ; --                   ; --               ; --                        ;
; Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_AND2:AND2_componentB3|lpm_and:lpm_and_component|and_node[0][1]                                                  ; LCCOMB_X46_Y31_N24 ; 2       ; Write enable                          ; no     ; --                   ; --               ; --                        ;
; Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_AND2:AND2_componentB4|lpm_and:lpm_and_component|and_node[0][1]                                                  ; LCCOMB_X42_Y31_N26 ; 2       ; Write enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|INTENABLE_2_0_7__g0_i_o4                                                                                         ; LCCOMB_X36_Y19_N0  ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_2:RegisterAcknowledge|sh_reg_0_0_0__g0_i_o4_i                                      ; LCCOMB_X37_Y19_N20 ; 2       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_2:RegisterAcknowledge|up_reg_0_0_0__g2_i                                           ; LCCOMB_X37_Y16_N0  ; 2       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_32:RegisterConfiguration|sh_reg_1_0_0__g0_i_o4_i                                   ; LCCOMB_X39_Y16_N24 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_32:RegisterConfiguration|up_reg_1_0_4__g2_i                                        ; LCCOMB_X39_Y16_N14 ; 28      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8:control_register|sh_reg_1_0_0__g0_i_o4_i                                         ; LCCOMB_X39_Y16_N16 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8:control_register|up_reg_1_0_0__g2_i                                              ; LCCOMB_X39_Y16_N26 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_1:RegisterReadFromInstrument|sh_reg_1_0_0__g0_i_o4_i                             ; LCCOMB_X39_Y19_N12 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_2:RegisterWriteFromInstrument|sh_reg_1_0_0__g0_i_o4_i                            ; LCCOMB_X38_Y17_N16 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_2:RegisterWriteFromInstrument|up_reg_1_0_0__g2_i                                 ; LCCOMB_X39_Y16_N2  ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_3:RegisterStatus|sh_reg_1_0_0__g0_i_o4_i                                         ; LCCOMB_X39_Y16_N18 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|reset_r                                                                          ; FF_X37_Y16_N3      ; 4       ; Async. clear                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|sh_ireg_1_0_0__g0_i_o4_i                                                         ; LCCOMB_X37_Y16_N22 ; 4       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|shiftdr_r                                                                        ; FF_X38_Y16_N15     ; 99      ; Sync. clear, Sync. load               ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|un19_tapstate_r                                                                  ; LCCOMB_X38_Y16_N4  ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|un5_ins                                                                          ; LCCOMB_X37_Y16_N12 ; 33      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|up_ireg_1_0_0__g2_i                                                              ; LCCOMB_X37_Y16_N20 ; 4       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TimeoutCounterlde                                                                                                ; LCCOMB_X38_Y17_N28 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_TXBUFFER_2_0_7__g0_i_o4_x                                                                                     ; LCCOMB_X37_Y19_N14 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|un5_rst_i_x_i                                                                                                    ; LCCOMB_X38_Y17_N10 ; 32      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TEST_BUTTON                                                                                                                                                               ; PIN_AG12           ; 327     ; Clock enable, Sync. clear, Sync. load ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|ResetCounterlde_x                                                                         ; LCCOMB_X37_Y22_N22 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|un1_resetcounter                                                                          ; LCCOMB_X36_Y21_N28 ; 85      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_2_0_0_31__g0_0                                     ; LCCOMB_X29_Y28_N22 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptModes_Reg_2_0_0_31__g0_0                                       ; LCCOMB_X34_Y29_N0  ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|CaptureFrom_IO_0                                                                    ; LCCOMB_X34_Y27_N20 ; 33      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|CaptureRegister_DMain_2_0_0_1_31__g0_i_o4                                           ; LCCOMB_X34_Y27_N22 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|CaptureRegister_IMain_2_0_0_31__g0_0                                                ; LCCOMB_X38_Y26_N10 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|DBoot_STB_O                                                                         ; LCCOMB_X39_Y26_N0  ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IBoot_STB_O                                                                         ; LCCOMB_X39_Y26_N22 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|PipelineRegister_IMain_2_0_0_1_31__g0_i_o4                                          ; LCCOMB_X37_Y26_N4  ; 68      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|un4_reset_i_a2                                                                      ; LCCOMB_X37_Y26_N18 ; 13      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|un5_enableflushcount_i_0_0_i                                              ; LCCOMB_X38_Y23_N14 ; 4       ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Destination_WB_2_0_0_5__g2_0_5881_a2_5                                                ; LCCOMB_X34_Y27_N18 ; 51      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Rs_Data_2_0_0_31__g2_0_6970_i_a7_i                                                    ; LCCOMB_X39_Y32_N16 ; 32      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Rt_Data_2_0_0_1_31__g0_i_o4                                                           ; LCCOMB_X37_Y26_N8  ; 272     ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Rt_Data_2_0_0_26__g2_0_7485_i_1                                                       ; LCCOMB_X34_Y31_N16 ; 32      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Rt_Index_Local_0_0_0_1_Z[5]                                                           ; LCCOMB_X34_Y31_N22 ; 33      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_GP:U_Registers_GP|ram_1_reg_41                                                                          ; FF_X36_Y27_N29     ; 3       ; Clock enable, Write enable            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|CompareRegister_Enable_1_0_0_0_g0_i_o4                                                ; LCCOMB_X26_Y31_N20 ; 3       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|DebugData_Value_2_0_0_1_31__g0_i_o4                                                   ; LCCOMB_X29_Y24_N22 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|ExceptionReturnRegister_2_0_0_1_31__g0_i_o4                                           ; LCCOMB_X34_Y29_N10 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|G_9246                                                                                ; LCCOMB_X34_Y29_N24 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|G_9248                                                                                ; LCCOMB_X34_Y29_N18 ; 14      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|IE_Current_1_0_0_0_g0_i_o4                                                            ; LCCOMB_X33_Y32_N10 ; 6       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|WishboneTimeOutRegister_1_0_0_0_g0_i_o4                                               ; LCCOMB_X33_Y29_N22 ; 1       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|un5_reset_i                                                                           ; LCCOMB_X27_Y27_N4  ; 32      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_IsTrap_1_0_0_g2_0_860_a2_4                                                          ; LCCOMB_X37_Y28_N0  ; 16      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_0                                                                        ; FF_X45_Y31_N1      ; 86      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_1                                                                        ; FF_X45_Y31_N3      ; 77      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_2_0_0_0__g2_0_3775_a2_1                                                  ; LCCOMB_X42_Y31_N22 ; 32      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_0__g2_0_4318_i_2                                                   ; LCCOMB_X46_Y31_N4  ; 34      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_2_0_0_0__g2_0_5148_i_o4                                                      ; LCCOMB_X48_Y32_N18 ; 16      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_2_0_0_1__g2_0_5168_i_1                                                       ; LCCOMB_X51_Y28_N14 ; 16      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_TakeBranch_1_0_0_g2_0_828_a2_1                                                      ; LCCOMB_X44_Y30_N18 ; 784     ; Sync. clear, Sync. load               ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_PC_2_0_0_0__g2_0_2543_a2_4                                                            ; LCCOMB_X37_Y28_N12 ; 37      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_PC_PreCalc_2_0_0_1__g2_0_3000_o2                                                      ; LCCOMB_X39_Y33_N30 ; 29      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_2_0_0_13__g2_0_8676_i_0_0                                                      ; LCCOMB_X37_Y28_N16 ; 36      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_2_0_0_26__g2_0_8847_a2_4_0                                                     ; LCCOMB_X39_Y33_N18 ; 55      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_38                                                                             ; FF_X38_Y33_N1      ; 32      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_2_0_0_1_31__g0_i_o4                                                                ; LCCOMB_X39_Y26_N20 ; 163     ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Result_2_0_0_0__g2_0_1249_a2_7                                                      ; LCCOMB_X42_Y26_N22 ; 32      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_2_0_0_1_31__g0_i_o4                                                                 ; LCCOMB_X39_Y26_N14 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_2_0_0_5__g2_0_7741_i_0                                                              ; LCCOMB_X36_Y32_N28 ; 99      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|G_70_x                                                                                                        ; LCCOMB_X38_Y23_N8  ; 31      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|G_85_x                                                                                                        ; LCCOMB_X33_Y24_N10 ; 27      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|HI_Reg_0                                                                                                      ; LCCOMB_X36_Y24_N6  ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|InRegA_0                                                                                                      ; LCCOMB_X36_Y25_N6  ; 64      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|LO_REG_0                                                                                                      ; LCCOMB_X36_Y24_N16 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|LoopCounterlde_i_a2                                                                                           ; LCCOMB_X36_Y25_N20 ; 7       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|PartialProduct_i_a2                                                                                           ; LCCOMB_X36_Y25_N18 ; 36      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|PartialProduct_i_a2_0_x                                                                                       ; LCCOMB_X36_Y25_N10 ; 38      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_0_x[0]                                                                                            ; LCCOMB_X33_Y23_N6  ; 33      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_i_a2                                                                                              ; LCCOMB_X33_Y23_N14 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RegA_Abs_i_a2                                                                                                 ; LCCOMB_X36_Y25_N16 ; 34      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RegB_Abs_i_a2_x                                                                                               ; LCCOMB_X36_Y25_N0  ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|Reg_DoDivide_1_i_a2_0_a2_x                                                                                    ; LCCOMB_X36_Y24_N30 ; 5       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_sqmuxa_1                                                                                       ; LCCOMB_X33_Y23_N24 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|State_1__Z                                                                                                    ; FF_X36_Y25_N31     ; 66      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|State_2__Z                                                                                                    ; FF_X36_Y25_N5      ; 72      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|State_5__Z                                                                                                    ; FF_X36_Y25_N29     ; 40      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|UnsignedMultResult_0_o2_x                                                                                     ; LCCOMB_X36_Y25_N2  ; 65      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_11_sn_m2                                                                                           ; LCCOMB_X33_Y24_N16 ; 32      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_i                                                                                                  ; LCCOMB_X36_Y25_N22 ; 64      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|un1_reg_signb                                                                                                 ; LCCOMB_X37_Y23_N16 ; 31      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|ControlRegister:tsk3000_ControlRegister|RegOut_6_0_o2[7]            ; LCCOMB_X35_Y21_N22 ; 7       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|ControlRegister:tsk3000_ControlRegister|un1_enable_i                ; LCCOMB_X35_Y21_N12 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|ControlReset_i_x                                                    ; LCCOMB_X36_Y21_N22 ; 14      ; Async. clear                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|ControlReset_x                                                      ; LCCOMB_X38_Y21_N24 ; 1       ; Async. clear                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|DataRegister:tsk3000_DebugDataRegister|NexusReg_Shift_scalar        ; LCCOMB_X29_Y21_N16 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|DataRegister:tsk3000_DebugDataRegister|RegOut                       ; LCCOMB_X33_Y21_N10 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|SubstituteRegister:tsk3000_SubstituteRegister|NexusReg_Shift_scalar ; LCCOMB_X41_Y26_N0  ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|SubstituteRegister:tsk3000_SubstituteRegister|RegOut                ; LCCOMB_X37_Y21_N10 ; 32      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|G_9_0_a2                        ; LCCOMB_X33_Y21_N24 ; 4       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|tapstate_r_i_0_2__Z             ; FF_X33_Y21_N23     ; 87      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|un12_tdo_0_a2                   ; LCCOMB_X37_Y21_N20 ; 33      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|un13_tapstate_r_0_a2            ; LCCOMB_X33_Y21_N4  ; 4       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|un2_clockdr_0_a2                ; LCCOMB_X33_Y21_N18 ; 3       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|un3_tdoenable_0_a2              ; LCCOMB_X33_Y21_N28 ; 32      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|up_ireg_1__Z                    ; FF_X36_Y21_N3      ; 70      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|up_ireg_i_0_0__Z                ; FF_X36_Y21_N1      ; 75      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugSignalController:TSK3000_DebugSignalController|DebugDataReg_Write_Z                        ; FF_X38_Y21_N21     ; 33      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|DAT_O_1_0_7__g0_i_o4                                                                       ; LCCOMB_X53_Y20_N6  ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|G_492                                                                                      ; LCCOMB_X53_Y20_N30 ; 6       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|G_494                                                                                      ; LCCOMB_X53_Y20_N2  ; 3       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|G_508                                                                                      ; LCCOMB_X51_Y21_N14 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|G_510_x                                                                                    ; LCCOMB_X56_Y21_N26 ; 24      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|ack_1_0_g0_0_x                                                                             ; LCCOMB_X53_Y20_N8  ; 1       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|alivebit_1_0_g0_i_o4                                                                       ; LCCOMB_X53_Y20_N22 ; 1       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_2_0_23__g0_i_o4                                                                     ; LCCOMB_X54_Y20_N0  ; 25      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|delaylde_0                                                                                 ; LCCOMB_X56_Y22_N6  ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|delaylde_0_o2                                                                              ; LCCOMB_X56_Y20_N12 ; 13      ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|dt_elapsed_1_0_g0_i_o4                                                                     ; LCCOMB_X56_Y20_N14 ; 1       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|icd_2_0_7__g0_i_o4                                                                         ; LCCOMB_X53_Y20_N10 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|icd_en_0_a2_1_x[0]                                                                         ; LCCOMB_X54_Y23_N28 ; 10      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|icdcountlde                                                                                ; LCCOMB_X59_Y20_N2  ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|intmask_2_0_7__g0_i_o4_x                                                                   ; LCCOMB_X54_Y20_N2  ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe0__0_0__g0_i_o4_i                                                                      ; LCCOMB_X56_Y19_N22 ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe0__0_0__g2_i                                                                           ; LCCOMB_X60_Y19_N20 ; 10      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe10__0_0__g0_i_o4_i                                                                     ; LCCOMB_X56_Y17_N20 ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe11__0_0__g0_i_o4_i                                                                     ; LCCOMB_X56_Y17_N14 ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe12__0_0__g0_i_o4_i                                                                     ; LCCOMB_X56_Y17_N22 ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe13__0_0__g0_i_o4_i                                                                     ; LCCOMB_X56_Y17_N16 ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe14__0_0__g0_i_o4_i                                                                     ; LCCOMB_X56_Y17_N28 ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe15__0_0__g0_i_o4_i                                                                     ; LCCOMB_X56_Y17_N26 ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe1__0_0__g0_i_o4_i                                                                      ; LCCOMB_X56_Y19_N8  ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe1__0_0__g2_i                                                                           ; LCCOMB_X62_Y19_N16 ; 10      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe2__0_0__g0_i_o4_i                                                                      ; LCCOMB_X56_Y19_N12 ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe2__0_0__g2_i                                                                           ; LCCOMB_X62_Y19_N26 ; 10      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe3__0_0__g0_i_o4_i                                                                      ; LCCOMB_X56_Y19_N14 ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe3__0_0__g2_i                                                                           ; LCCOMB_X60_Y19_N6  ; 10      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe4__0_0__g0_i_o4_i                                                                      ; LCCOMB_X56_Y17_N2  ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe4__0_0__g2_i                                                                           ; LCCOMB_X62_Y19_N22 ; 10      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe5__0_0__g0_i_o4_i                                                                      ; LCCOMB_X56_Y17_N12 ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe5__0_0__g2_i                                                                           ; LCCOMB_X62_Y19_N4  ; 10      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe6__0_0__g0_i_o4_i                                                                      ; LCCOMB_X56_Y19_N20 ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe6__0_0__g2_i                                                                           ; LCCOMB_X61_Y19_N12 ; 10      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe7__0_0__g0_i_o4_i                                                                      ; LCCOMB_X56_Y19_N6  ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe7__0_0__g2_i                                                                           ; LCCOMB_X60_Y19_N22 ; 10      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe8__0_0__g0_i_o4_i                                                                      ; LCCOMB_X56_Y19_N26 ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe9__0_0__g0_i_o4_i                                                                      ; LCCOMB_X56_Y19_N24 ; 11      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|overrun_0_0_g0_i_o4_i                                                                      ; LCCOMB_X56_Y20_N2  ; 1       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|reset                                                                                      ; FF_X54_Y20_N1      ; 136     ; Sync. clear                           ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxbrk_1_0_g0_i_o4_i                                                                        ; LCCOMB_X59_Y18_N16 ; 1       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxdiv_1_0_2__g0_i_o4                                                                       ; LCCOMB_X59_Y18_N12 ; 6       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxfrerr_0_0_g0_i_o4                                                                        ; LCCOMB_X57_Y20_N8  ; 1       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxidle_1_0_g0_i_o4_i                                                                       ; LCCOMB_X59_Y18_N14 ; 1       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxlowmark_2_0_7__g0_i_o4                                                                   ; LCCOMB_X55_Y22_N26 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxpar_1_0_g0_i_o4_i                                                                        ; LCCOMB_X59_Y18_N8  ; 1       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxshift_2_0_7__g0_i_o4                                                                     ; LCCOMB_X59_Y18_N26 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_10__g0_i_o4                                                                    ; LCCOMB_X55_Y22_N24 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txlowmark_2_0_7__g0_i_o4                                                                   ; LCCOMB_X55_Y22_N10 ; 8       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txpar_1_0_g0_i_o4                                                                          ; LCCOMB_X61_Y21_N24 ; 1       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txshift_1_0_0__g0_0                                                                        ; LCCOMB_X61_Y21_N28 ; 10      ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txshifting_2_0_g0_i_o4                                                                     ; LCCOMB_X61_Y21_N4  ; 1       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txstate[3]                                                                                 ; FF_X60_Y21_N23     ; 19      ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txstate_srsts_0_3__g0_0                                                                    ; LCCOMB_X60_Y21_N10 ; 7       ; Clock enable                          ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un1_bitcount_1_sqmuxa                                                                      ; LCCOMB_X59_Y18_N24 ; 3       ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un1_icdcount_1_sqmuxa                                                                      ; LCCOMB_X59_Y21_N6  ; 9       ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un2_prevtxclk_2                                                                            ; LCCOMB_X59_Y22_N12 ; 3       ; Sync. load                            ; no     ; --                   ; --               ; --                        ;
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------+--------------------+---------+---------------------------------------+--------+----------------------+------------------+---------------------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------+
; Global & Other Fast Signals                                                                                                                      ;
+----------------+----------+---------+--------------------------------------+----------------------+------------------+---------------------------+
; Name           ; Location ; Fan-Out ; Fan-Out Using Intentional Clock Skew ; Global Resource Used ; Global Line Name ; Enable Signal Source Name ;
+----------------+----------+---------+--------------------------------------+----------------------+------------------+---------------------------+
; CLK_BRD        ; PIN_A14  ; 2355    ; 156                                  ; Global Clock         ; GCLK14           ; --                        ;
; JTAG_NEXUS_TCK ; PIN_Y27  ; 350     ; 30                                   ; Global Clock         ; GCLK9            ; --                        ;
+----------------+----------+---------+--------------------------------------+----------------------+------------------+---------------------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals                                                                                                                                                     ;
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------+---------+
; Name                                                                                                                                                                      ; Fan-Out ;
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------+---------+
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_TakeBranch_1_0_0_g2_0_828_a2_1                                                      ; 784     ;
; TEST_BUTTON~input                                                                                                                                                         ; 327     ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Rt_Data_2_0_0_1_31__g0_i_o4                                                           ; 272     ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|WBWrite~0                                                                                                                             ; 168     ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_2_0_0_1_31__g0_i_o4                                                                ; 163     ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|reset                                                                                      ; 136     ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Rt_Index_Local_0_0_0_0                                                                ; 133     ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_4                                                                        ; 130     ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|ShiftAmountMux:U_ShiftAmountMux|ShiftAmount_0_0_0_1_x_1                               ; 127     ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_3                                                                        ; 125     ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_2_0_0_5__g2_0_7741_i_0                                                              ; 99      ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|shiftdr_r                                                                        ; 99      ;
; ~GND                                                                                                                                                                      ; 96      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|Reg_NegateResult_Z                                                                                            ; 94      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|tapstate_r_i_0_2__Z             ; 87      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtail_0[1]                                                                                ; 86      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_0                                                                        ; 86      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|un1_resetcounter                                                                          ; 85      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|ShiftAmountMux:U_ShiftAmountMux|ShiftAmount_0_0_0_1_x_2                               ; 77      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_1                                                                        ; 77      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|regb_usedatafromma2_NE                                                  ; 76      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|up_ireg_i_0_0__Z                ; 75      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40s                                                                                                                                  ; 72      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|State_2__Z                                                                                                    ; 72      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|ShiftAmountMux:U_ShiftAmountMux|ShiftAmount_0_0_0_1_x_3                               ; 72      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|up_ireg_1__Z                    ; 70      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Rt_Index_Local_0_0_0_1                                                                ; 69      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|PipelineRegister_IMain_2_0_0_1_31__g0_i_o4                                          ; 68      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|ShiftAmountMux:U_ShiftAmountMux|ShiftAmount_0_0_0_1_x_0                               ; 67      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|State_1__Z                                                                                                    ; 66      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|State_4__Z                                                                                                    ; 66      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|UnsignedMultResult_0_o2_x                                                                                     ; 65      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_Segment_Reg_1                                                                  ; 65      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|InRegA_0                                                                                                      ; 64      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_i                                                                                                  ; 64      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_2                                                                        ; 59      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|un1_reg_signa                                                                                                 ; 58      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|DebugState_7                                                              ; 56      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_2_0_0_26__g2_0_8847_a2_4_0                                                     ; 55      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|DebugState_6                                                              ; 55      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|O_Interrupt_i_o2                                                        ; 52      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|un1_resetcounter_4                                                                        ; 52      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtail_0[0]                                                                                ; 51      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Destination_WB_2_0_0_5__g2_0_5881_a2_5                                                ; 51      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|DoRegWrite_WB_1_0_0_g2_0_814_a2_3                                                     ; 51      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_15                                                                                 ; 50      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_1                                                                        ; 47      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2                                                                        ; 46      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_5                                                                        ; 46      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_0                                                                        ; 46      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_3                                                                        ; 45      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_4                                                                        ; 45      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_30                                                               ; 45      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_6                                                                        ; 44      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_7                                                                        ; 44      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txtail_0[1]                                                                                ; 43      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_sn_m2                                                         ; 42      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|regb_usedatafromal2_NE                                                  ; 41      ;
; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|n3s                                                                                                                             ; 40      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|State_5__Z                                                                                                    ; 40      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|DMem_Segment_Reg_1                                                                  ; 40      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|DMem_Segment_Reg_0                                                                  ; 40      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|DebugState_9                                                              ; 40      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|ShiftAmountMux:U_ShiftAmountMux|ShiftAmount_0_0_0_1_x_4                               ; 39      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|PipeReset_0_0_1                                                           ; 39      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|State_3__Z                                                                                                    ; 38      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|PartialProduct_i_a2_0_x                                                                                       ; 38      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Rt_Index_Local_0_0_0_1_3_m6_i                                                         ; 38      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_26                                                               ; 38      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|MDU_EnableControl:U_MDU_EnableControl|Enable_x                                        ; 38      ;
; Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|s_or8:n190|OUT~1                                                                                                ; 37      ;
; Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|s_or8:n190|OUT~0                                                                                                ; 37      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_PC_2_0_0_0__g2_0_2543_a2_4                                                            ; 37      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|rega_usedatafromma3_NE                                                  ; 37      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|PartialProduct_i_a2                                                                                           ; 36      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_2_0_0_13__g2_0_8676_i_0_0                                                      ; 36      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RegA_Abs_i_a2                                                                                                 ; 34      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_0__g2_0_4318_i_2                                                   ; 34      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugSignalController:TSK3000_DebugSignalController|DebugDataReg_Write_Z                        ; 33      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_0_x[0]                                                                                            ; 33      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|CaptureFrom_IO_0                                                                    ; 33      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Rt_Index_Local_0_0_0_1_Z[5]                                                           ; 33      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_45                                                                             ; 33      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_37                                                                             ; 33      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_Segment_Reg_0                                                                  ; 33      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|un12_tdo_0_a2                   ; 33      ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|un5_ins                                                                          ; 33      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RegB_Abs_i_a2_x                                                                                               ; 32      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_11_sn_m2                                                                                           ; 32      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_i_a2                                                                                              ; 32      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_sqmuxa_1                                                                                       ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|un5_reset_i                                                                           ; 32      ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TimeoutCounterlde                                                                                                ; 32      ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|un5_rst_i_x_i                                                                                                    ; 32      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|DataRegister:tsk3000_DebugDataRegister|RegOut                       ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|ExceptionReturnRegister_2_0_0_1_31__g0_i_o4                                           ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|G_9246                                                                                ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|CaptureRegister_DMain_2_0_0_1_31__g0_i_o4                                           ; 32      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|LO_REG_0                                                                                                      ; 32      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|HI_Reg_0                                                                                                      ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_2_0_0_31__g0_0                                     ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptModes_Reg_2_0_0_31__g0_0                                       ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|Write_InterruptClear                                                                  ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|CaptureRegister_IMain_2_0_0_31__g0_0                                                ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|DebugData_Value_2_0_0_1_31__g0_i_o4                                                   ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Rt_Data_2_0_0_26__g2_0_7485_i_1                                                       ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_GP:U_Registers_GP|I_4                                                                                   ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|DataOut_sn_m9_0_o2                                                                    ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|DataOut_sn_m7_0_a2                                                                    ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Result_2_0_0_0__g2_0_1249_a2_7                                                      ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|ALU:U_ALU|DataOut_6_a2_2_0                                                            ; 32      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|Result_i_o4_x[0]                                                                                              ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|ALU:U_ALU|DataOut_6_a2_3_0                                                            ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_33                                                                             ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_32                                                                             ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|ALU:U_ALU|DataOut_6_a2_0                                                              ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|ALU:U_ALU|DataOut_6_a2_1_0                                                            ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Rs_Data_2_0_0_31__g2_0_6970_i_a7_i                                                    ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Rs_Data_2_0_0_31__g2_0_6970_i_o4                                                      ; 32      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|SubstituteRegister:tsk3000_SubstituteRegister|RegOut                ; 32      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|DataRegister:tsk3000_DebugDataRegister|NexusReg_Shift_scalar        ; 32      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|SubstituteRegister:tsk3000_SubstituteRegister|NexusReg_Shift_scalar ; 32      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|un3_tdoenable_0_a2              ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_2_0_0_1_31__g0_i_o4                                                                 ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_38                                                                             ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_2_0_0_31__g2_0_8469_i_o4                                                            ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_2_0_0_0__g2_0_3775_a2_1                                                  ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|regb_usedatafromwb2_NE                                                  ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|rega_usedatafromwb2_NE                                                  ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_27                                                               ; 32      ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_32:RegisterConfiguration|sh_reg_1_0_0__g0_i_o4_i                                   ; 32      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_IsMemWrite                                                                          ; 32      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|un1_reg_signb                                                                                                 ; 31      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|G_70_x                                                                                                        ; 31      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|MainMemoryIsData_0_o2                                                               ; 31      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_PC_PreCalc_2_0_0_1__g2_0_3000_o2                                                      ; 29      ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|DataOut_sn_m4_x                                                                        ; 29      ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_32:RegisterConfiguration|up_reg_1_0_4__g2_i                                        ; 28      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_4                                                                ; 28      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsyncEn:CNT_0|lpm_ff:ff1|dffs[0]                                                                       ; 27      ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|G_85_x                                                                                                        ; 27      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|PC_PreCalc_0_sqmuxa_0_a6                                                      ; 27      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|ALU:U_ALU|DataOut_0_a2_4                                                              ; 26      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Select0_Word                                                                        ; 26      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_rd_0_sqmuxa_1_1_o2                                                      ; 26      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsyncEn:CNT_1|lpm_ff:ff1|dffs[0]                                                                       ; 26      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsyncEn:CNT_2|lpm_ff:ff1|dffs[0]                                                                       ; 26      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsyncEn:CNT_3|lpm_ff:ff1|dffs[0]                                                                       ; 26      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsyncEn:CNT_4|lpm_ff:ff1|dffs[0]                                                                       ; 26      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsyncEn:CNT_5|lpm_ff:ff1|dffs[0]                                                                       ; 26      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsyncEn:CNT_6|lpm_ff:ff1|dffs[0]                                                                       ; 26      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|MIDIKBD__AltSyn_AltiumAlteraDffAsyncEn:CNT_7|lpm_ff:ff1|dffs[0]                                                                       ; 26      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv_2_0_23__g0_i_o4                                                                     ; 25      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_31__g2_0_5125_i_m2                                                 ; 25      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_1                                                                ; 25      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|un7_debugstate_0_a8                                                       ; 25      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|LoadHazard_MA                                                           ; 25      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|G_510_x                                                                                    ; 24      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_22                                                                             ; 24      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_2_0_0_26__g2_0_8847_m2                                                         ; 24      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txtail_0[0]                                                                                ; 23      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_5                                                                ; 23      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Shifter_EnableControl:U_Shifter_EnableControl|Enable_x                                ; 22      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_0                                                                ; 22      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38u~7                                                                                                                                ; 21      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38u~6                                                                                                                                ; 21      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38u~5                                                                                                                                ; 21      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38u~4                                                                                                                                ; 21      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38u~3                                                                                                                                ; 21      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38u~2                                                                                                                                ; 21      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38u~1                                                                                                                                ; 21      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38u~0                                                                                                                                ; 21      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxidle                                                                                     ; 21      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtail_0[3]                                                                                ; 21      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_28                                                               ; 21      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_34                                                                             ; 20      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_2                                                                ; 20      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhead[2]                                                                                  ; 19      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhead[1]                                                                                  ; 19      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxd                                                                                        ; 19      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtail_0[2]                                                                                ; 19      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|StateIO[1]                                                                          ; 19      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|TimeOutCouter_12                                                                    ; 19      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txstate[3]                                                                                 ; 19      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxpar                                                                                      ; 18      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhead[3]                                                                                  ; 18      ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|FillBit_x                                                                              ; 18      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_39                                                                             ; 18      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_40                                                                             ; 18      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_31                                                               ; 18      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_29                                                               ; 18      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un21_prevtxclk                                                                             ; 18      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|ExecuteBusy:U_ExecuteBusy|Busy_EX_x                                                   ; 18      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_2_0_0_15__g2_0_5448_i_a6_0                                                   ; 17      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|un1_pipelinestall_in_i_0_o8                                               ; 17      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38l                                                                                                                                  ; 16      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38k                                                                                                                                  ; 16      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38j                                                                                                                                  ; 16      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38i                                                                                                                                  ; 16      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38h                                                                                                                                  ; 16      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38g                                                                                                                                  ; 16      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38f                                                                                                                                  ; 16      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38d                                                                                                                                  ; 16      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe15__0_5__g2                                                                            ; 16      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe15__0_1__g2                                                                            ; 16      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe15__0_0__g2                                                                            ; 16      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe15__0_3__g2                                                                            ; 16      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxfrerr_2                                                                                  ; 16      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe15__0_4__g2                                                                            ; 16      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe15__0_2__g2                                                                            ; 16      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe15__0_6__g2                                                                            ; 16      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe15__0_8__g2                                                                            ; 16      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe15__0_7__g2                                                                            ; 16      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_2_0_0_0__g2_0_5148_i_o4                                                      ; 16      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_2_0_0_1__g2_0_5168_i_1                                                       ; 16      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|DataOut_sn_m3_0_a2                                                                    ; 16      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_2_0_0_31__g2_0_5784_i_o7                                                     ; 16      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_2_0_0__g2_0_5784_i_a7_1_0                                                    ; 16      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|tapstate_r_i_0_1__Z             ; 16      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_o2_10                                  ; 16      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_IsTrap_1_0_0_g2_0_860_a2_4                                                          ; 16      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_16                                                                       ; 16      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_31                                                      ; 15      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|tapstate_r_i_0_3__Z             ; 15      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|G_9248                                                                                ; 14      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|PC_PreCalc_3_sqmuxa_i                                                         ; 14      ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|DataOut_sn_m3_x                                                                        ; 14      ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|DataOut_sn_m1_x                                                                        ; 14      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_21                                                                             ; 14      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|ControlReset_i_x                                                    ; 14      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4834_m4_0                                                    ; 14      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4892_m4_0                                                    ; 14      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4805_m4_0                                                    ; 14      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4863_m4_0                                                    ; 14      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4921_m4_0                                                    ; 14      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Rd_Index_0                                                                          ; 14      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|StateIO[0]                                                                          ; 14      ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|tapstate_r_i[0]                                                                  ; 14      ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|tapstate_r_i[1]                                                                  ; 14      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|StateMainMem_2                                                                      ; 14      ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|un11_ins                                                                         ; 14      ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|tapstate_r_i[3]                                                                  ; 14      ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|INST_m0_ACK_O~2                                                                                                   ; 13      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|delaylde_0_o2                                                                              ; 13      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxstate_i_0[4]                                                                             ; 13      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|parm[0]                                                                                    ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|un4_reset_i_a2                                                                      ; 13      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txtail_0[2]                                                                                ; 13      ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|tapstate_r_i_0_0__Z             ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4776_m4_0                                                    ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_2__g2_1_5922_i_a6                                                  ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_4__g2_1_5950_i_a6                                                  ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_0                                      ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_5__g2_1_5964_i_a6                                                  ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4510_i_m4_0                                                  ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4666_i_m4_0                                                  ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4588_i_m4_0                                                  ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4614_i_m4_0                                                  ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4640_i_m4_0                                                  ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4692_i_m4_0                                                  ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4536_i_m4_0                                                  ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4562_i_m4_0                                                  ; 13      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Select0_Half                                                                        ; 13      ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|tapstate_r_i[2]                                                                  ; 13      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n1422~1                                                                                                                               ; 12      ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n1x~0                                                                                                             ; 12      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un1_rxhead_NE                                                                              ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_31__g2_0_5125_i_x2                                                 ; 12      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txhead[2]                                                                                  ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemByteLane_2_0_0__g2_0_3669_i_a9_0_0                                               ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|PipeReset_0_0_o8                                                          ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_shiftmode_1_0_a2_2_o2_0                                                 ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|IE_Current_1_0_0_g2_0_798_o2                                                          ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4747_m4_0                                                    ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_1__g2_1_5908_i_a6                                                  ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_17__g2_0_4747_m4                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_3                                      ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0                                        ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_27__g2_0_5025_i_m2                                                 ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_22__g2_0_4892_m4                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_21__g2_0_4863_m4                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_25__g2_0_4975_i_m2                                                 ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_23__g2_0_4921_m4                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_24__g2_0_4950_i_m2                                                 ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_26__g2_0_5000_i_m2                                                 ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_7                                      ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_16__g2_0_4718_m4                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_20__g2_0_4834_m4                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_19__g2_0_4805_m4                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_28__g2_0_5050_i_m2                                                 ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_18__g2_0_4776_m4                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_muxc_ctrl_1_0_0_o2_6_0                                                  ; 12      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txstate[1]                                                                                 ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_12                                                                                  ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_11                                                                                  ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_10                                                                                  ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_9                                                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_8                                                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_7                                                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_6                                                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_5                                                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_4                                                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_3                                                                                   ; 12      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_2                                                                                   ; 12      ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n1y                                                                                                               ; 11      ;
; Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|INST_m0_ACK_O                                                                                                   ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|delaylde_0                                                                                 ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe15__0_0__g0_i_o4_i                                                                     ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe14__0_0__g0_i_o4_i                                                                     ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe12__0_0__g0_i_o4_i                                                                     ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe13__0_0__g0_i_o4_i                                                                     ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe11__0_0__g0_i_o4_i                                                                     ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe10__0_0__g0_i_o4_i                                                                     ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe8__0_0__g0_i_o4_i                                                                      ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe9__0_0__g0_i_o4_i                                                                      ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe3__0_0__g0_i_o4_i                                                                      ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe2__0_0__g0_i_o4_i                                                                      ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe0__0_0__g0_i_o4_i                                                                      ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe1__0_0__g0_i_o4_i                                                                      ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe7__0_0__g0_i_o4_i                                                                      ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe6__0_0__g0_i_o4_i                                                                      ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe4__0_0__g0_i_o4_i                                                                      ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe5__0_0__g0_i_o4_i                                                                      ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|RXCLK                                                                                      ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|parm[1]                                                                                    ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txhead[0]                                                                                  ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txhead[1]                                                                                  ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_2                                                       ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_4                                                       ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_0                                                       ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0__g2_0_4718_m4_0                                                    ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_1                                                       ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_17                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_6                                                       ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_3                                                       ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_7                                                       ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_8                                                       ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_14                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_5                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_11                                     ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_11                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_12                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_8                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_9                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_27                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_22                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_21                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_1_1_0_0                                                       ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_23                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_24                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_26                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_29                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_29__g2_0_5075_i_m2                                                 ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_13                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_15                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_10                                     ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_12                                     ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_6                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_10                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_0_1_0_0                                                       ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_20                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_0_1_0_3                                                       ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_28                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_18                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_30                                                      ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Select1_Half                                                                        ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_2_0_0_2__g2_0_8525_m2                                                          ; 11      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|DebugState_i_0                                                            ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txstate_ns_0_a3_1_0_a2[4]                                                                  ; 11      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|icd_en_0_a2_1_x[0]                                                                         ; 10      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe3__0_0__g2_i                                                                           ; 10      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe2__0_0__g2_i                                                                           ; 10      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe0__0_0__g2_i                                                                           ; 10      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe1__0_0__g2_i                                                                           ; 10      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe7__0_0__g2_i                                                                           ; 10      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe6__0_0__g2_i                                                                           ; 10      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe4__0_0__g2_i                                                                           ; 10      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|muxe5__0_0__g2_i                                                                           ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_muxc_ctrl_1_0_0_a2_0_0                                                  ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_18__g2_0_4776_a2_0                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_0_o2_2                                    ; 10      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txshift_1_0_0__g0_0                                                                        ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_5                                                       ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|DataHazardResolverA:U_DataHazardResolverA|ResolvedA_2_0_0_9                                                       ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_27__g2_1_6252_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_22__g2_1_6187_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_21__g2_1_6174_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_25__g2_1_6226_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_23__g2_1_6200_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_24__g2_1_6213_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_26__g2_1_6239_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_29__g2_1_6278_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_16__g2_1_6109_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_20__g2_1_6161_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_19__g2_1_6148_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_28__g2_1_6265_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_18__g2_1_6135_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_30__g2_0_5100_i_m2                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_30__g2_1_6291_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|StackPointer_2_0_0_31__g2_1_6304_i_a6                                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_a5[14]                                 ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Rd_Index_1                                                                          ; 10      ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Rd_Index_2                                                                          ; 10      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un1_prevtxclk                                                                              ; 10      ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txclkval[23]                                                                               ; 10      ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40b                                                                                                                                  ; 9       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n39y                                                                                                                                  ; 9       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n39v                                                                                                                                  ; 9       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40a                                                                                                                                  ; 9       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n39x                                                                                                                                  ; 9       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n39u                                                                                                                                  ; 9       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n39w                                                                                                                                  ; 9       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n39t                                                                                                                                  ; 9       ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n484                                                                                                              ; 9       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxstate[3]                                                                                 ; 9       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|parm[5]                                                                                    ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|IE_Old_1_0_0_g2_0_782_i_o7                                                            ; 9       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un1_icdcount_1_sqmuxa                                                                      ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_17                                                                             ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_20                                                                             ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_19                                                                             ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_0_o2_0                                    ; 9       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txstate_0_sqmuxa_1                                                                         ; 9       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un2_ack_x                                                                                  ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_14                                     ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Rd_Index_3                                                                          ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|Flush_EX_MA_0                                                             ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_12                                                                       ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_11                                                                       ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_10                                                                       ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_9                                                                        ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_8                                                                        ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_7                                                                        ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_6                                                                        ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_5                                                                        ; 9       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_IsMemRead                                                                           ; 9       ;
; JTAG_NEXUS_TMS~input                                                                                                                                                      ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n539~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n491~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n443~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n395~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n347~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n555~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n507~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n459~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n411~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n363~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n571~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n523~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n475~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n427~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n379~3                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n331~3                                                                                                                                ; 8       ;
; Configurable_KEY_MATRIX:U_MIDIKBD_OB_KEY_MATRIX|n11~1                                                                                                                     ; 8       ;
; Configurable_WB_INTERCON_MEM:U_MIDIKBD_OB_WB_INTERCON_MEM|s_or8:n190|OUT                                                                                                  ; 8       ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n479~0                                                                                                            ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40q                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40n                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40k                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n442~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40h                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n394~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40e                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n346~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n299~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n251~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n203~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40p                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40m                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40j                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40g                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n410~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40d                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n362~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n315~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n267~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n219~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40o                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40l                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40i                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40f                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n426~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n40c                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n378~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n39z                                                                                                                                  ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n330~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n283~0                                                                                                                                ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n235~0                                                                                                                                ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxidle_0                                                                                   ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxshift_2_0_7__g0_i_o4                                                                     ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|awe12_0_a2_1                                                                               ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|awe15_0_a2_2                                                                               ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un16_rxclk                                                                                 ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|intmask_2_0_7__g0_i_o4_x                                                                   ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxsize[0]                                                                                  ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txlowmark_2_0_7__g0_i_o4                                                                   ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|G_508                                                                                      ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_10__g0_i_o4                                                                    ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxlowmark_2_0_7__g0_i_o4                                                                   ; 8       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|INTENABLE_2_0_7__g0_i_o4                                                                                         ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|DAT_O_1_0_7__g0_i_o4                                                                       ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|icd_2_0_7__g0_i_o4                                                                         ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_9__g2_0_4536_i_0                                                   ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemDataOut_2_0_0_15__g2_0_4692_i_o4                                                 ; 8       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|DAT_O_sn_m2                                                                                                      ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|G_9                                                                                        ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|icdcountlde                                                                                ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|icdcount_1_sqmuxa_2_1_a2                                                                   ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|icdcount_3_sqmuxa                                                                          ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txhead_1_sqmuxa_1_0_a2                                                                     ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_18                                                                             ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|DBoot_STB_O                                                                         ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IBoot_STB_O                                                                         ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|InputSynchronizer:U_InputSynchronizer|ResetCounterlde_x                                                                         ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un1_txtail_NE                                                                              ; 8       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_2:RegisterWriteFromInstrument|up_reg_1_0_0__g2_i                                 ; 8       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_TXBUFFER_2_0_7__g0_i_o4_x                                                                                     ; 8       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|un3_wishbone_write_2_x                                                                                           ; 8       ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|ControlRegister:tsk3000_ControlRegister|un1_enable_i                ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Select0_Byte                                                                        ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Select2_Byte                                                                        ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Rd_Index_5                                                                          ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_alumode_1_0_a6_1_0                                                      ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_alumode_1_0_o2_0_0                                                      ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|WishboneStall_Main_0_o2                                                             ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemSelect_2                                                                         ; 8       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|prevtxclk                                                                                  ; 8       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8:control_register|sh_reg_1_0_0__g0_i_o4_i                                         ; 8       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_3:RegisterStatus|sh_reg_1_0_0__g0_i_o4_i                                         ; 8       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_2:RegisterWriteFromInstrument|sh_reg_1_0_0__g0_i_o4_i                            ; 8       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8:control_register|up_reg_1_0_0__g2_i                                              ; 8       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_1:RegisterReadFromInstrument|sh_reg_1_0_0__g0_i_o4_i                             ; 8       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|un19_tapstate_r                                                                  ; 8       ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|tdo_u_0                         ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|StateMainMem_0                                                                      ; 8       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|State_i_8__Z                                                                                                  ; 8       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_26                                                                             ; 8       ;
; Configurable_LEDS:U_MIDIKBD_OB_LEDS|n38b                                                                                                                                  ; 7       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|LoopCounterlde_i_a2                                                                                           ; 7       ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|ControlRegister:tsk3000_ControlRegister|RegOut_6_0_o2[7]            ; 7       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_i_11                                      ; 7       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_i_0                                       ; 7       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txstate_srsts_0_3__g0_0                                                                    ; 7       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txstate_ns_0_0_o2_0[4]                                                                     ; 7       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|un21_local_alumode_0_a2                                                       ; 7       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_19                                                               ; 7       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_a5_0_0_0                               ; 7       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|WaitTo_MDU_0_o2_1                                                                   ; 7       ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugSignalController:TSK3000_DebugSignalController|DebugEnable_Z                               ; 7       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|parm[3]                                                                                    ; 7       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txstate_i[4]                                                                               ; 7       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txdiv[0]                                                                                   ; 7       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txstate[0]                                                                                 ; 7       ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|un1_substituteen_0_a2_0         ; 7       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemSelect_1                                                                         ; 7       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|StateMainMem_i[4]                                                                   ; 7       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|Reg_DoSigned_Z                                                                                                ; 6       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxstate[2]                                                                                 ; 6       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxdiv_1_0_2__g0_i_o4                                                                       ; 6       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxstate[1]                                                                                 ; 6       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|bitcount[0]                                                                                ; 6       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhead[0]                                                                                  ; 6       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|un1_reg_dodivide18_1_1                                                                                        ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_muxc_ctrl_1_0_0_a2_1_0                                                  ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|IE_Current_1_0_0_0_g0_i_o4                                                            ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|un1_enable_if_id                                                          ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|ALU:U_ALU|DataOut_6_a2_4_0                                                            ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|InterruptVector_Enable                                                                ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|RegisterFile:U_RegisterFile|Rt_Index_Local_0_0_0_2                                                                ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemWidth_0                                                                          ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_15                                                      ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_memmode_10_i_o3_9315_tz                                                 ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_branchmode_1_0_a2_0_0                                                   ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_27                                                 ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_i_10                                      ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_0_o2_25                                   ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_22                                                 ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_17                                                 ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_6                                                  ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_9                                                  ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_12                                                 ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_11                                                 ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_15                                                 ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_0_a2_0                                    ; 6       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|G_492                                                                                      ; 6       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|parm[4]                                                                                    ; 6       ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|un1_tapreset_0_a2               ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|Rt_Index_0_iv_0_a2_1_0                                                        ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_muxc_ctrl_1_0_0_a2_0                                                    ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_29                                                                             ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_28                                                                             ; 6       ;
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; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|DebugState_srsts_i_0_a3[10]                                               ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IO_STB_O_1_i                                                                        ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|StateMainMem_ns_0_i_a7_3_1_x[0]                                                     ; 6       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txdiv[1]                                                                                   ; 6       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txstate[2]                                                                                 ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|Main_SEL_O_x_1                                                                      ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|Main_SEL_O_x_2                                                                      ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|Main_SEL_O_x_0                                                                      ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|Main_SEL_O_x_3                                                                      ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_19                                                                       ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_18                                                                       ; 6       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_MemAddress_17                                                                       ; 6       ;
; JTAG_NEXUS_TDI~input                                                                                                                                                      ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|Reg_SignA_Z                                                                                                   ; 5       ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n484~0                                                                                                            ; 5       ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|MIDIKBD__AltSyn_AltiumAlteraDffAsync:Bad_Decode|lpm_ff:ff1|dffs[0]                                                ; 5       ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|up_ireg_2__Z                    ; 5       ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|up_ireg_3__Z                    ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxstate_27                                                                                 ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|bitcount[2]                                                                                ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|bitcount[1]                                                                                ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxhead_1_sqmuxa_0_0                                                                        ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxdiv[0]                                                                                   ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxshift[7]                                                                                 ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxsize[1]                                                                                  ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxsize[4]                                                                                  ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|DAT_O_1_0_5__g2_0_267_i_o8_x                                                               ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|DAT_O_23_sn_m10_i                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|Reg_DoDivide_1_i_a2_0_a2_x                                                                                    ; 5       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_STATUS[7]                                                                                                     ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_0__Z                                                                                           ; 5       ;
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; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_6__Z                                                                                           ; 5       ;
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; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_12__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_13__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_14__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_15__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_16__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_17__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_18__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_19__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_20__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_21__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_22__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_23__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_24__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_25__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_26__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_27__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_28__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_29__Z                                                                                          ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_30__Z                                                                                          ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_GP:U_Registers_GP|ram_1_reg_41                                                                          ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_SP:U_Registers_SP|un3_clk_enable_write_3                                                                ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un1_rst_i_2_i_o2_x                                                                         ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|intmask_en_0_o2_x[0]                                                                       ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|quotientreg4_i_a2                                                                                             ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|State_srsts_i_a2_0[5]                                                                                         ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_0                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_1                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_2                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_3                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_4                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_5                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0                                                       ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_1                                                       ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_2                                                       ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_3                                                       ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_4                                                       ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_5                                                       ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_6                                                       ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_7                                                       ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_8                                                       ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_9                                                       ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_10                                                      ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_11                                                      ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_12                                                      ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_13                                                      ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_14                                                      ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_31                                                                             ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_25                                                                             ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_islink_1_0_a2                                                           ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_rd_1_0_o2_0                                                             ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_alumode_1_0_0_a2_0                                                      ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|un18_local_muxc_ctrl_i_s_2_0_a2_0                                             ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_i_m4_0_0_0_22                             ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_23                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_i_15                                      ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_i_m2_0_0_0_3                              ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_i_m3_0_0_0_0                              ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_16                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_21                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_20                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_19                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_26                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_24                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_4                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_5                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_m2_0_0_0_0                                ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_7                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_m3_0_0_0_5                                ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_m3_0_0_0_8                                ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_m3_0_0_0_7                                ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_m3_0_0_0_11                               ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_8                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_10                                                 ; 5       ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugPort:TSK3000_DebugPort|TapController:tsk3000_TapController|un1_updatedr_0_a2               ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txsize[0]                                                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|DebugState[1]                                                             ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|CalculateEffectiveAddress:U_CalculateEffectiveAddress|un2_address_add30               ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|CalculateEffectiveAddress:U_CalculateEffectiveAddress|un2_address_add29               ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|CalculateEffectiveAddress:U_CalculateEffectiveAddress|un2_address_add28               ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|CalculateEffectiveAddress:U_CalculateEffectiveAddress|un2_address_add27               ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|CalculateEffectiveAddress:U_CalculateEffectiveAddress|un2_address_add26               ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|CalculateEffectiveAddress:U_CalculateEffectiveAddress|un2_address_add24               ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|CalculateEffectiveAddress:U_CalculateEffectiveAddress|un2_address_add0                ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_6                                                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_7                                                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_8                                                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_9                                                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_10                                                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_20                                                               ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_17                                                               ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_12                                                               ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_13                                                               ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_18                                                               ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|ReadSteering:U_ReadSteering|ReadSteering_Mux:U_ReadSteering_Mux|Result_0_0_o2_0                                   ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_30                                                                             ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|un3_debugprog_i_o3_0_x                                                    ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_IsInterrupt                                                                         ; 5       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|ACK_O_x                                                                                                          ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|status[1]                                                                                  ; 5       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txdiv[2]                                                                                   ; 5       ;
; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|MIDIKBD__AltSyn_AltiumAlteraDffAsync:State_state_write_pulse|lpm_ff:ff1|dffs[0]                                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|start_imain                                                                         ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|start_imain_0_x                                                                     ; 5       ;
; TSK3000A_OCDS:U_MIDIKBD_OB_CPU_SubPart_OCDS|JtagDebugUnit:U_JtagDebugUnit|DebugSignalController:TSK3000_DebugSignalController|DebugProg_Z                                 ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_24                                                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_25                                                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_26                                                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_27                                                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_28                                                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_29                                                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_30                                                                                  ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_2                                                                              ; 5       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|StateMainMem[3]                                                                     ; 5       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|up_ireg_2                                                                        ; 5       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_TAPCONTROLLER:TAP1|up_ireg_0                                                                        ; 5       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_1__Z                                                                                           ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_2__Z                                                                                           ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_3__Z                                                                                           ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|State_6__Z                                                                                                    ; 4       ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n2b                                                                                                               ; 4       ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n2f                                                                                                               ; 4       ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n2g                                                                                                               ; 4       ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n2d                                                                                                               ; 4       ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n2c                                                                                                               ; 4       ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n2e                                                                                                               ; 4       ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n2a                                                                                                               ; 4       ;
; Configurable_WB_INTERCON_IO:U_MIDIKBD_OB_WB_INTERCON_IO|n1z                                                                                                               ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_0__Z                                                                                              ; 4       ;
; Configurable_NB_SRAM:U_MIDIKBD_OB_NB_SRAM|State_Next_state_read_ack~1                                                                                                     ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un29_rxclk                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxstate[0]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un1_rxtail_NE                                                                              ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxshift[6]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxdiv[1]                                                                                   ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un11_rxclk                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|overrun_0_0_g2                                                                             ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxsize[2]                                                                                  ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxsize[3]                                                                                  ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_en_0_a2_0[3]                                                                       ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|State_7__Z                                                                                                    ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|DAT_O_1_0_6__g2_0_309_i_a8_0_0_x                                                           ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|DAT_O_1_0_2__g2_0_129_i_a7_1_1_x                                                           ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|DAT_O_1_0_1__g2_0_98_o6                                                                    ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_4__Z                                                                                           ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_5__Z                                                                                           ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_6__Z                                                                                           ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_7__Z                                                                                           ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_8__Z                                                                                           ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_9__Z                                                                                           ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_10__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_11__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_12__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_13__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_14__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_15__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_16__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_17__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_18__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_19__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_20__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_21__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_22__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_23__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_24__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_25__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_26__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_27__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_28__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_29__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_30__Z                                                                                          ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|WorkingReg_0_0_31__Z                                                                                          ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_8__g2_x                                                                        ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_7__g2_x                                                                        ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_10__g2_x                                                                       ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_9__g2_x                                                                        ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_3__g2_x                                                                        ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_4__g2_x                                                                        ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_6__g2_x                                                                        ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|rxtimer_2_0_5__g2_x                                                                        ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|m85_i_o2_8                                                              ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_1__Z                                                                                              ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_2__Z                                                                                              ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_3__Z                                                                                              ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_4__Z                                                                                              ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_5__Z                                                                                              ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_6__Z                                                                                              ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_7__Z                                                                                              ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_8__Z                                                                                              ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_9__Z                                                                                              ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_10__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_11__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_12__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_13__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_14__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_15__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_16__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_17__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_18__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_19__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_20__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_21__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_22__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_23__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_24__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_25__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_26__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_27__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_28__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_29__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|QuotientReg_30__Z                                                                                             ; 4       ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|RemainderReg_0_31__Z                                                                                          ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|parm[2]                                                                                    ; 4       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|GoOnlineFF0                                                                                                      ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_1                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_PC_PreCalc_2_0_0_31__g2_0_3508_o2                                                     ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|ALU:U_ALU|DataOut_6_a2_5_0                                                            ; 4       ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|Shift2R[29]                                                                            ; 4       ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|Shift2L[1]                                                                             ; 4       ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|Shift4R_x[27]                                                                          ; 4       ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|Shift2R[28]                                                                            ; 4       ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|Shift2L[16]                                                                            ; 4       ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|Shift2L_x[0]                                                                           ; 4       ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|Shift2L[4]                                                                             ; 4       ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|Shift2L[12]                                                                            ; 4       ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|Shift2L[8]                                                                             ; 4       ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|Shift1R_x[30]                                                                          ; 4       ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|Shift2L[2]                                                                             ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Select0_Byte_1_0_0_g2_0_1083_a2_3_0                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_6                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_7                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_8                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_9                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_10                                                ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_11                                                ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_12                                                ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_13                                                ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_14                                                ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|Bus_MuxB:U_Bus_MuxB|MuxB_Data_0_0_0_15                                                ; 4       ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|DataOut_1_6_x                                                                          ; 4       ;
; TSK3000A_Shift_Barrel:U_MIDIKBD_OB_CPU_SubPart_Shifter|Shift_Barrel:U_Shift_Barrel|Shift2L[3]                                                                             ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_35                                                                             ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_36                                                                             ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_rs_1_i_o6_0                                                             ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_shiftmode_1_0_a2_0_o2_0_0                                               ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_islink_1_0_a2_1                                                         ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|opcode_primary_1_0_a2_0_a6_0                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|un5_enableflushcount_i_0_0_i                                              ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_alumode_1_0_o2_1                                                        ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_i_m2_0_0_0_4                              ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_30                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_m2_0_0_0_10                               ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_i_m2_0_0_0_2                              ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_i_m3_0_0_0_3                              ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_29                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptEnables_Reg_28                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_i_m2_0_0_0_0                              ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_m2_0_0_0_20                               ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_i_m2_0_0_0_5                              ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|m85_i_o2_6_1_1                                                          ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_m3_0_0_0_0                                ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_i_m4_0_0_0_0                              ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_m2_0_0_0_1                                ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_m2_0_0_0_2                                ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|InterruptController:U_InterruptController|InterruptsPending_Final_0_0_0_m3_0_0_0_6                                ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|mem_txhead[2]                                                                              ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[0]                                                                                  ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[1]                                                                                  ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[2]                                                                                  ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[3]                                                                                  ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[4]                                                                                  ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[5]                                                                                  ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[6]                                                                                  ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[7]                                                                                  ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[8]                                                                                  ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[9]                                                                                  ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[10]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[11]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[12]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[13]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[14]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[15]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[16]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[17]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[18]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[19]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[20]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[21]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[22]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|clkdiv[23]                                                                                 ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txstate_ns_0_0_o2[3]                                                                       ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|ramout_7[9]                                                                                ; 4       ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|un1_reset_23_i_0_o3_x                                                                      ; 4       ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8:control_register|up_reg_7                                                        ; 4       ;
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; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_21                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_22                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_23                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_24                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_25                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_26                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_27                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_28                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_29                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_30                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_31                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_19                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_18                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_17                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_16                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_15                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_14                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_13                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_12                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_11                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_10                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_9                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_8                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_7                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_6                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_5                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_4                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_3                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|DebugState[8]                                                             ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|DebugState_3                                                              ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|DebugState[5]                                                             ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_IF_ID:U_Regs_IF_ID|Reg_PC_2                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|CalculateEffectiveAddress:U_CalculateEffectiveAddress|un2_address_add31               ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Execute:U_Execute|CalculateEffectiveAddress:U_CalculateEffectiveAddress|un2_address_add25               ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_0                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_1                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_2                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_3                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_4                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_5                                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_11                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_12                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_13                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_IR_14                                                                                 ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_15                                                               ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|Rt_Index_0_0_a2_0                                                             ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|Rt_Index_0_iv_0_a2_0_0                                                        ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_14                                                               ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_16                                                               ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|IMem_DataOut_3_0_0_11                                                               ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_TakeBranch_1_0_0_g2_0_828_o6                                                        ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_2                                                                            ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_4                                                                            ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_0                                                                            ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_1                                                                            ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_6                                                                            ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_3                                                                            ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|DMem_DataOut_sn_m1                                                                  ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_5                                                                            ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_EX_MEM:U_Regs_EX_MEM|Reg_Result_7                                                                            ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Select1_Byte                                                                        ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|MemoryManager:U_MemoryManager|DMem_DataOut_24                                                                     ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_DoRegWrite                                                                          ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_MEM_WB:U_Regs_MEM_WB|Reg_Rd_Index_4                                                                          ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeStage_Decode:U_PipeStage_Decode|local_muxc_ctrl_1_0_0_o2_6_0_0                                                ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|PipeLineController:U_PipeLineController|Flush_ID_EX_0_o8                                                          ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLWcst_44                                                                             ; 4       ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_ID_EX:U_Regs_ID_EX|Reg_VLW_0                                                                                 ; 4       ;
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------+---------+


+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter RAM Summary                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                        ;
+----------------------------------------------------------------------------------------------------------------------------------------------------------------+------+------------------+-------------+--------------+--------------+--------------+--------------+------------------------+-------------------------+------------------------+-------------------------+-------+-----------------------------+-----------------------------+-----------------------------+-----------------------------+---------------------+------+--------------------------------------------------------------------------------------------------------------------------------------------------+--------------------------------+
; Name                                                                                                                                                           ; Type ; Mode             ; Clock Mode  ; Port A Depth ; Port A Width ; Port B Depth ; Port B Width ; Port A Input Registers ; Port A Output Registers ; Port B Input Registers ; Port B Output Registers ; Size  ; Implementation Port A Depth ; Implementation Port A Width ; Implementation Port B Depth ; Implementation Port B Width ; Implementation Bits ; M9Ks ; MIF                                                                                                                                              ; Location                       ;
+----------------------------------------------------------------------------------------------------------------------------------------------------------------+------+------------------+-------------+--------------+--------------+--------------+--------------+------------------------+-------------------------+------------------------+-------------------------+-------+-----------------------------+-----------------------------+-----------------------------+-----------------------------+---------------------+------+--------------------------------------------------------------------------------------------------------------------------------------------------+--------------------------------+
; Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u1:Memory_CPU_u1_component|altsyncram:altsyncram_component|altsyncram_10j2:auto_generated|ALTSYNCRAM ; AUTO ; True Dual Port   ; Dual Clocks ; 2048         ; 8            ; 2048         ; 8            ; yes                    ; no                      ; yes                    ; no                      ; 16384 ; 2048                        ; 8                           ; 2048                        ; 8                           ; 16384               ; 2    ; p:/hardware/elektronik-module_und_bausätze/altium nanoboard 3000/nb3000_midi_keyboard/projectoutputs/default - all constraints/Memory_CPU_u1.mif ; M9K_X40_Y26_N0, M9K_X40_Y27_N0 ;
; Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u2:Memory_CPU_u2_component|altsyncram:altsyncram_component|altsyncram_20j2:auto_generated|ALTSYNCRAM ; AUTO ; True Dual Port   ; Dual Clocks ; 2048         ; 8            ; 2048         ; 8            ; yes                    ; no                      ; yes                    ; no                      ; 16384 ; 2048                        ; 8                           ; 2048                        ; 8                           ; 16384               ; 2    ; p:/hardware/elektronik-module_und_bausätze/altium nanoboard 3000/nb3000_midi_keyboard/projectoutputs/default - all constraints/Memory_CPU_u2.mif ; M9K_X40_Y25_N0, M9K_X40_Y33_N0 ;
; Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u3:Memory_CPU_u3_component|altsyncram:altsyncram_component|altsyncram_30j2:auto_generated|ALTSYNCRAM ; AUTO ; True Dual Port   ; Dual Clocks ; 2048         ; 8            ; 2048         ; 8            ; yes                    ; no                      ; yes                    ; no                      ; 16384 ; 2048                        ; 8                           ; 2048                        ; 8                           ; 16384               ; 2    ; p:/hardware/elektronik-module_und_bausätze/altium nanoboard 3000/nb3000_midi_keyboard/projectoutputs/default - all constraints/Memory_CPU_u3.mif ; M9K_X40_Y28_N0, M9K_X40_Y30_N0 ;
; Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u4:Memory_CPU_u4_component|altsyncram:altsyncram_component|altsyncram_40j2:auto_generated|ALTSYNCRAM ; AUTO ; True Dual Port   ; Dual Clocks ; 2048         ; 8            ; 2048         ; 8            ; yes                    ; no                      ; yes                    ; no                      ; 16384 ; 2048                        ; 8                           ; 2048                        ; 8                           ; 16384               ; 2    ; p:/hardware/elektronik-module_und_bausätze/altium nanoboard 3000/nb3000_midi_keyboard/projectoutputs/default - all constraints/Memory_CPU_u4.mif ; M9K_X40_Y29_N0, M9K_X40_Y24_N0 ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_GP:U_Registers_GP|altsyncram:ram_1|altsyncram_j5g1:auto_generated|ALTSYNCRAM                 ; AUTO ; Simple Dual Port ; Dual Clocks ; 32           ; 32           ; 32           ; 32           ; yes                    ; no                      ; yes                    ; no                      ; 1024  ; 32                          ; 32                          ; 32                          ; 32                          ; 1024                ; 1    ; None                                                                                                                                             ; M9K_X40_Y31_N0                 ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Registers_GP:U_Registers_GP|altsyncram:ram|altsyncram_j5g1:auto_generated|ALTSYNCRAM                   ; AUTO ; Simple Dual Port ; Dual Clocks ; 32           ; 32           ; 32           ; 32           ; yes                    ; no                      ; yes                    ; no                      ; 1024  ; 32                          ; 32                          ; 32                          ; 32                          ; 1024                ; 1    ; None                                                                                                                                             ; M9K_X40_Y32_N0                 ;
+----------------------------------------------------------------------------------------------------------------------------------------------------------------+------+------------------+-------------+--------------+--------------+--------------+--------------+------------------------+-------------------------+------------------------+-------------------------+-------+-----------------------------+-----------------------------+-----------------------------+-----------------------------+---------------------+------+--------------------------------------------------------------------------------------------------------------------------------------------------+--------------------------------+
Note: Fitter may spread logical memories into multiple blocks to improve timing. The actual required RAM blocks can be found in the Fitter Resource Usage section.


RAM content values are presented in the following format: (Binary) (Octal) (Decimal) (Hexadecimal) 
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; |MIDIKBD|Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u1:Memory_CPU_u1_component|altsyncram:altsyncram_component|altsyncram_10j2:auto_generated|ALTSYNCRAM                                                                                          ;
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
;   Addr   ;              +0              ;              +1              ;              +2              ;              +3              ;              +4              ;              +5              ;              +6              ;              +7              ;
+----------+------------------------------+------------------------------+------------------------------+------------------------------+------------------------------+------------------------------+------------------------------+------------------------------+
;0;(00010100) (24) (20) (14)    ;(00000000) (0) (0) (00)   ;(11111100) (374) (252) (FC)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000001) (1) (1) (01)   ;(00001100) (14) (12) (0C)   ;(00000000) (0) (0) (00)   ;
;8;(00000001) (1) (1) (01)    ;(01100100) (144) (100) (64)   ;(00001110) (16) (14) (0E)   ;(00001100) (14) (12) (0C)   ;(00000100) (4) (4) (04)   ;(00000000) (0) (0) (00)   ;(00000111) (7) (7) (07)   ;(00111000) (70) (56) (38)   ;
;16;(00000001) (1) (1) (01)    ;(00000100) (4) (4) (04)   ;(10100001) (241) (161) (A1)   ;(00010110) (26) (22) (16)   ;(00011001) (31) (25) (19)   ;(00000000) (0) (0) (00)   ;(00010110) (26) (22) (16)   ;(10011100) (234) (156) (9C)   ;
;24;(00000100) (4) (4) (04)    ;(00001100) (14) (12) (0C)   ;(11101000) (350) (232) (E8)   ;(00011000) (30) (24) (18)   ;(00000000) (0) (0) (00)   ;(00010100) (24) (20) (14)   ;(11000110) (306) (198) (C6)   ;(00001100) (14) (12) (0C)   ;
;32;(00101011) (53) (43) (2B)    ;(00010000) (20) (16) (10)   ;(00001000) (10) (8) (08)   ;(00001100) (14) (12) (0C)   ;(00000001) (1) (1) (01)   ;(01010100) (124) (84) (54)   ;(01101000) (150) (104) (68)   ;(00100101) (45) (37) (25)   ;
;40;(00001000) (10) (8) (08)    ;(00000111) (7) (7) (07)   ;(00111000) (70) (56) (38)   ;(00000001) (1) (1) (01)   ;(00001000) (10) (8) (08)   ;(10100001) (241) (161) (A1)   ;(00010011) (23) (19) (13)   ;(00110100) (64) (52) (34)   ;
;48;(00000000) (0) (0) (00)    ;(00010011) (23) (19) (13)   ;(10011100) (234) (156) (9C)   ;(00001000) (10) (8) (08)   ;(00000000) (0) (0) (00)   ;(00001000) (10) (8) (08)   ;(00000100) (4) (4) (04)   ;(11111100) (374) (252) (FC)   ;
;56;(00000000) (0) (0) (00)    ;(10001111) (217) (143) (8F)   ;(00111000) (70) (56) (38)   ;(00111000) (70) (56) (38)   ;(00000010) (2) (2) (02)   ;(00000000) (0) (0) (00)   ;(10100001) (241) (161) (A1)   ;(00000100) (4) (4) (04)   ;
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;72;(00010100) (24) (20) (14)    ;(00000001) (1) (1) (01)   ;(01010100) (124) (84) (54)   ;(00100101) (45) (37) (25)   ;(10001100) (214) (140) (8C)   ;(00011000) (30) (24) (18)   ;(00110011) (63) (51) (33)   ;(00000000) (0) (0) (00)   ;
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RAM content values are presented in the following format: (Binary) (Octal) (Decimal) (Hexadecimal) 
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+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
;   Addr   ;              +0              ;              +1              ;              +2              ;              +3              ;              +4              ;              +5              ;              +6              ;              +7              ;
+----------+------------------------------+------------------------------+------------------------------+------------------------------+------------------------------+------------------------------+------------------------------+------------------------------+
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RAM content values are presented in the following format: (Binary) (Octal) (Decimal) (Hexadecimal) 
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+----------+------------------------------+------------------------------+------------------------------+------------------------------+------------------------------+------------------------------+------------------------------+------------------------------+
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;2000;(00011010) (32) (26) (1A)    ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;
;2008;(11111111) (377) (255) (FF)    ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(10000000) (200) (128) (80)   ;(00000010) (2) (2) (02)   ;(00000000) (0) (0) (00)   ;
;2016;(11111111) (377) (255) (FF)    ;(00000000) (0) (0) (00)   ;(10001000) (210) (136) (88)   ;(00000000) (0) (0) (00)   ;(00000001) (1) (1) (01)   ;(00000010) (2) (2) (02)   ;(00000111) (7) (7) (07)   ;(00010000) (20) (16) (10)   ;
;2024;(00000010) (2) (2) (02)    ;(00100000) (40) (32) (20)   ;(00100000) (40) (32) (20)   ;(00000010) (2) (2) (02)   ;(00101000) (50) (40) (28)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000001) (1) (1) (01)   ;
;2032;(00000010) (2) (2) (02)    ;(00000111) (7) (7) (07)   ;(11111111) (377) (255) (FF)   ;(00010000) (20) (16) (10)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;
;2040;(00000000) (0) (0) (00)    ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00000000) (0) (0) (00)   ;(00010000) (20) (16) (10)   ;(00000100) (4) (4) (04)   ;




+-----------------------------------------------------------------------------------------------+
; Fitter DSP Block Usage Summary                                                                ;
+---------------------------------------+-------------+---------------------+-------------------+
; Statistic                             ; Number Used ; Available per Block ; Maximum Available ;
+---------------------------------------+-------------+---------------------+-------------------+
; Simple Multipliers (9-bit)            ; 0           ; 2                   ; 252               ;
; Simple Multipliers (18-bit)           ; 2           ; 1                   ; 126               ;
; Embedded Multiplier Blocks            ; 2           ; --                  ; 126               ;
; Embedded Multiplier 9-bit elements    ; 4           ; 2                   ; 252               ;
; Signed Embedded Multipliers           ; 0           ; --                  ; --                ;
; Unsigned Embedded Multipliers         ; 2           ; --                  ; --                ;
; Mixed Sign Embedded Multipliers       ; 0           ; --                  ; --                ;
; Variable Sign Embedded Multipliers    ; 0           ; --                  ; --                ;
; Dedicated Input Shift Register Chains ; 0           ; --                  ; --                ;
+---------------------------------------+-------------+---------------------+-------------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; DSP Block Details                                                                                                                                                                                                                                                                                                                                                                              ;
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+----------------------------+--------------------+---------------------+--------------------------------+-----------------------+-----------------------+-------------------+-----------------+
; Name                                                                                                                                                                                            ; Mode                       ; Location           ; Sign Representation ; Has Input Shift Register Chain ; Data A Input Register ; Data B Input Register ; Pipeline Register ; Output Register ;
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+----------------------------+--------------------+---------------------+--------------------------------+-----------------------+-----------------------+-------------------+-----------------+
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|altmult_add:RegA_Abs_0_muladd_0_31_28__Z|mult_add_rhr3:auto_generated|ded_mult_a851:ded_mult1|ded_mult_cnb1:left_mult|mac_out3      ; Simple Multiplier (18-bit) ; DSPOUT_X31_Y24_N2  ;                     ; No                             ;                       ;                       ;                   ; no              ;
;    TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|altmult_add:RegA_Abs_0_muladd_0_31_28__Z|mult_add_rhr3:auto_generated|ded_mult_a851:ded_mult1|ded_mult_cnb1:left_mult|mac_mult2  ;                            ; DSPMULT_X31_Y24_N0 ; Unsigned            ;                                ; no                    ; yes                   ; no                ;                 ;
; TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|altmult_add:RegA_Abs_0_muladd_0_31_28__Z|mult_add_rhr3:auto_generated|ded_mult_a851:ded_mult1|ded_mult_gnb1:right_mult|mac_out5     ; Simple Multiplier (18-bit) ; DSPOUT_X31_Y25_N2  ;                     ; No                             ;                       ;                       ;                   ; no              ;
;    TSK3000A_MDU:U_MIDIKBD_OB_CPU_SubPart_MDU|MultDiv:U_MultDiv|altmult_add:RegA_Abs_0_muladd_0_31_28__Z|mult_add_rhr3:auto_generated|ded_mult_a851:ded_mult1|ded_mult_gnb1:right_mult|mac_mult4 ;                            ; DSPMULT_X31_Y25_N0 ; Unsigned            ;                                ; no                    ; yes                   ; no                ;                 ;
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+----------------------------+--------------------+---------------------+--------------------------------+-----------------------+-----------------------+-------------------+-----------------+


+-------------------------------------------------------+
; Interconnect Usage Summary                            ;
+----------------------------+--------------------------+
; Interconnect Resource Type ; Usage                    ;
+----------------------------+--------------------------+
; Block interconnects        ; 10,106 / 116,715 ( 9 % ) ;
; C16 interconnects          ; 192 / 3,886 ( 5 % )      ;
; C4 interconnects           ; 5,481 / 73,752 ( 7 % )   ;
; Direct links               ; 1,298 / 116,715 ( 1 % )  ;
; Global clocks              ; 2 / 20 ( 10 % )          ;
; Local interconnects        ; 2,920 / 39,600 ( 7 % )   ;
; R24 interconnects          ; 284 / 3,777 ( 8 % )      ;
; R4 interconnects           ; 6,760 / 99,858 ( 7 % )   ;
+----------------------------+--------------------------+


+-----------------------------------------------------------------------------+
; LAB Logic Elements                                                          ;
+---------------------------------------------+-------------------------------+
; Number of Logic Elements  (Average = 14.01) ; Number of LABs  (Total = 433) ;
+---------------------------------------------+-------------------------------+
; 1                                           ; 7                             ;
; 2                                           ; 6                             ;
; 3                                           ; 2                             ;
; 4                                           ; 3                             ;
; 5                                           ; 8                             ;
; 6                                           ; 9                             ;
; 7                                           ; 6                             ;
; 8                                           ; 4                             ;
; 9                                           ; 7                             ;
; 10                                          ; 4                             ;
; 11                                          ; 15                            ;
; 12                                          ; 12                            ;
; 13                                          ; 18                            ;
; 14                                          ; 34                            ;
; 15                                          ; 27                            ;
; 16                                          ; 271                           ;
+---------------------------------------------+-------------------------------+


+--------------------------------------------------------------------+
; LAB-wide Signals                                                   ;
+------------------------------------+-------------------------------+
; LAB-wide Signals  (Average = 2.29) ; Number of LABs  (Total = 433) ;
+------------------------------------+-------------------------------+
; 1 Async. clear                     ; 4                             ;
; 1 Clock                            ; 356                           ;
; 1 Clock enable                     ; 183                           ;
; 1 Sync. clear                      ; 250                           ;
; 1 Sync. load                       ; 101                           ;
; 2 Clock enables                    ; 84                            ;
; 2 Clocks                           ; 12                            ;
+------------------------------------+-------------------------------+


+------------------------------------------------------------------------------+
; LAB Signals Sourced                                                          ;
+----------------------------------------------+-------------------------------+
; Number of Signals Sourced  (Average = 19.11) ; Number of LABs  (Total = 433) ;
+----------------------------------------------+-------------------------------+
; 0                                            ; 1                             ;
; 1                                            ; 7                             ;
; 2                                            ; 5                             ;
; 3                                            ; 3                             ;
; 4                                            ; 1                             ;
; 5                                            ; 6                             ;
; 6                                            ; 5                             ;
; 7                                            ; 3                             ;
; 8                                            ; 3                             ;
; 9                                            ; 8                             ;
; 10                                           ; 14                            ;
; 11                                           ; 4                             ;
; 12                                           ; 9                             ;
; 13                                           ; 10                            ;
; 14                                           ; 5                             ;
; 15                                           ; 16                            ;
; 16                                           ; 41                            ;
; 17                                           ; 27                            ;
; 18                                           ; 27                            ;
; 19                                           ; 33                            ;
; 20                                           ; 31                            ;
; 21                                           ; 17                            ;
; 22                                           ; 25                            ;
; 23                                           ; 17                            ;
; 24                                           ; 23                            ;
; 25                                           ; 18                            ;
; 26                                           ; 11                            ;
; 27                                           ; 9                             ;
; 28                                           ; 8                             ;
; 29                                           ; 6                             ;
; 30                                           ; 6                             ;
; 31                                           ; 6                             ;
; 32                                           ; 28                            ;
+----------------------------------------------+-------------------------------+


+---------------------------------------------------------------------------------+
; LAB Signals Sourced Out                                                         ;
+-------------------------------------------------+-------------------------------+
; Number of Signals Sourced Out  (Average = 9.86) ; Number of LABs  (Total = 433) ;
+-------------------------------------------------+-------------------------------+
; 0                                               ; 1                             ;
; 1                                               ; 16                            ;
; 2                                               ; 16                            ;
; 3                                               ; 24                            ;
; 4                                               ; 18                            ;
; 5                                               ; 30                            ;
; 6                                               ; 28                            ;
; 7                                               ; 32                            ;
; 8                                               ; 31                            ;
; 9                                               ; 26                            ;
; 10                                              ; 25                            ;
; 11                                              ; 26                            ;
; 12                                              ; 25                            ;
; 13                                              ; 18                            ;
; 14                                              ; 18                            ;
; 15                                              ; 29                            ;
; 16                                              ; 44                            ;
; 17                                              ; 4                             ;
; 18                                              ; 6                             ;
; 19                                              ; 2                             ;
; 20                                              ; 0                             ;
; 21                                              ; 2                             ;
; 22                                              ; 1                             ;
; 23                                              ; 0                             ;
; 24                                              ; 1                             ;
; 25                                              ; 1                             ;
; 26                                              ; 2                             ;
; 27                                              ; 2                             ;
; 28                                              ; 0                             ;
; 29                                              ; 0                             ;
; 30                                              ; 1                             ;
; 31                                              ; 0                             ;
; 32                                              ; 4                             ;
+-------------------------------------------------+-------------------------------+


+------------------------------------------------------------------------------+
; LAB Distinct Inputs                                                          ;
+----------------------------------------------+-------------------------------+
; Number of Distinct Inputs  (Average = 21.56) ; Number of LABs  (Total = 433) ;
+----------------------------------------------+-------------------------------+
; 0                                            ; 0                             ;
; 1                                            ; 1                             ;
; 2                                            ; 2                             ;
; 3                                            ; 6                             ;
; 4                                            ; 13                            ;
; 5                                            ; 7                             ;
; 6                                            ; 3                             ;
; 7                                            ; 8                             ;
; 8                                            ; 10                            ;
; 9                                            ; 3                             ;
; 10                                           ; 7                             ;
; 11                                           ; 7                             ;
; 12                                           ; 14                            ;
; 13                                           ; 12                            ;
; 14                                           ; 9                             ;
; 15                                           ; 14                            ;
; 16                                           ; 9                             ;
; 17                                           ; 12                            ;
; 18                                           ; 10                            ;
; 19                                           ; 9                             ;
; 20                                           ; 20                            ;
; 21                                           ; 17                            ;
; 22                                           ; 18                            ;
; 23                                           ; 22                            ;
; 24                                           ; 16                            ;
; 25                                           ; 10                            ;
; 26                                           ; 25                            ;
; 27                                           ; 11                            ;
; 28                                           ; 17                            ;
; 29                                           ; 12                            ;
; 30                                           ; 12                            ;
; 31                                           ; 20                            ;
; 32                                           ; 28                            ;
; 33                                           ; 42                            ;
; 34                                           ; 1                             ;
; 35                                           ; 3                             ;
; 36                                           ; 2                             ;
+----------------------------------------------+-------------------------------+


+------------------------------------------+
; I/O Rules Summary                        ;
+----------------------------------+-------+
; I/O Rules Statistic              ; Total ;
+----------------------------------+-------+
; Total I/O Rules                  ; 30    ;
; Number of I/O Rules Passed       ; 15    ;
; Number of I/O Rules Failed       ; 0     ;
; Number of I/O Rules Unchecked    ; 0     ;
; Number of I/O Rules Inapplicable ; 15    ;
+----------------------------------+-------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; I/O Rules Details                                                                                                                                                                                                                                                          ;
+--------------+-----------+-----------------------------------+------------------------------------------------------------------------------------------------------+----------+-------------------------------------------------+---------------------+-------------------+
; Status       ; ID        ; Category                          ; Rule Description                                                                                     ; Severity ; Information                                     ; Area                ; Extra Information ;
+--------------+-----------+-----------------------------------+------------------------------------------------------------------------------------------------------+----------+-------------------------------------------------+---------------------+-------------------+
; Pass         ; IO_000001 ; Capacity Checks                   ; Number of pins in an I/O bank should not exceed the number of locations available.                   ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Inapplicable ; IO_000002 ; Capacity Checks                   ; Number of clocks in an I/O bank should not exceed the number of clocks available.                    ; Critical ; No Global Signal assignments found.             ; I/O                 ;                   ;
; Pass         ; IO_000003 ; Capacity Checks                   ; Number of pins in a Vrefgroup should not exceed the number of locations available.                   ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Inapplicable ; IO_000004 ; Voltage Compatibility Checks      ; The I/O bank should support the requested VCCIO.                                                     ; Critical ; No IOBANK_VCCIO assignments found.              ; I/O                 ;                   ;
; Inapplicable ; IO_000005 ; Voltage Compatibility Checks      ; The I/O bank should not have competing VREF values.                                                  ; Critical ; No VREF I/O Standard assignments found.         ; I/O                 ;                   ;
; Pass         ; IO_000006 ; Voltage Compatibility Checks      ; The I/O bank should not have competing VCCIO values.                                                 ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Pass         ; IO_000007 ; Valid Location Checks             ; Checks for unavailable locations.                                                                    ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Inapplicable ; IO_000008 ; Valid Location Checks             ; Checks for reserved locations.                                                                       ; Critical ; No reserved LogicLock region found.             ; I/O                 ;                   ;
; Pass         ; IO_000009 ; I/O Properties Checks for One I/O ; The location should support the requested I/O standard.                                              ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Pass         ; IO_000010 ; I/O Properties Checks for One I/O ; The location should support the requested I/O direction.                                             ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Inapplicable ; IO_000011 ; I/O Properties Checks for One I/O ; The location should support the requested Current Strength.                                          ; Critical ; No Current Strength assignments found.          ; I/O                 ;                   ;
; Pass         ; IO_000012 ; I/O Properties Checks for One I/O ; The location should support the requested On Chip Termination value.                                 ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Inapplicable ; IO_000013 ; I/O Properties Checks for One I/O ; The location should support the requested Bus Hold value.                                            ; Critical ; No Enable Bus-Hold Circuitry assignments found. ; I/O                 ;                   ;
; Pass         ; IO_000014 ; I/O Properties Checks for One I/O ; The location should support the requested Weak Pull Up value.                                        ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Pass         ; IO_000015 ; I/O Properties Checks for One I/O ; The location should support the requested PCI Clamp Diode.                                           ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Inapplicable ; IO_000018 ; I/O Properties Checks for One I/O ; The I/O standard should support the requested Current Strength.                                      ; Critical ; No Current Strength assignments found.          ; I/O                 ;                   ;
; Pass         ; IO_000019 ; I/O Properties Checks for One I/O ; The I/O standard should support the requested On Chip Termination value.                             ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Pass         ; IO_000020 ; I/O Properties Checks for One I/O ; The I/O standard should support the requested PCI Clamp Diode.                                       ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Pass         ; IO_000021 ; I/O Properties Checks for One I/O ; The I/O standard should support the requested Weak Pull Up value.                                    ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Inapplicable ; IO_000022 ; I/O Properties Checks for One I/O ; The I/O standard should support the requested Bus Hold value.                                        ; Critical ; No Enable Bus-Hold Circuitry assignments found. ; I/O                 ;                   ;
; Pass         ; IO_000023 ; I/O Properties Checks for One I/O ; The I/O standard should support the Open Drain value.                                                ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Pass         ; IO_000024 ; I/O Properties Checks for One I/O ; The I/O direction should support the On Chip Termination value.                                      ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Inapplicable ; IO_000026 ; I/O Properties Checks for One I/O ; On Chip Termination and Current Strength should not be used at the same time.                        ; Critical ; No Current Strength assignments found.          ; I/O                 ;                   ;
; Inapplicable ; IO_000027 ; I/O Properties Checks for One I/O ; Weak Pull Up and Bus Hold should not be used at the same time.                                       ; Critical ; No Enable Bus-Hold Circuitry assignments found. ; I/O                 ;                   ;
; Inapplicable ; IO_000045 ; I/O Properties Checks for One I/O ; The I/O standard should support the requested Slew Rate value.                                       ; Critical ; No Slew Rate assignments found.                 ; I/O                 ;                   ;
; Inapplicable ; IO_000046 ; I/O Properties Checks for One I/O ; The location should support the requested Slew Rate value.                                           ; Critical ; No Slew Rate assignments found.                 ; I/O                 ;                   ;
; Inapplicable ; IO_000047 ; I/O Properties Checks for One I/O ; On Chip Termination and Slew Rate should not be used at the same time.                               ; Critical ; No Slew Rate assignments found.                 ; I/O                 ;                   ;
; Pass         ; IO_000033 ; Electromigration Checks           ; Current density for consecutive I/Os should not exceed 240mA for row I/Os and 240mA for column I/Os. ; Critical ; 0 such failures found.                          ; I/O                 ;                   ;
; Inapplicable ; IO_000034 ; SI Related Distance Checks        ; Single-ended outputs should be 5 LAB row(s) away from a differential I/O.                            ; High     ; No Differential I/O Standard assignments found. ; I/O                 ;                   ;
; Inapplicable ; IO_000042 ; SI Related SSO Limit Checks       ; No more than 20 outputs are allowed in a VREF group when VREF is being read from.                    ; High     ; No VREF I/O Standard assignments found.         ; I/O                 ;                   ;
; ----         ; ----      ; Disclaimer                        ; OCT rules are checked but not reported.                                                              ; None     ; ----                                            ; On Chip Termination ;                   ;
+--------------+-----------+-----------------------------------+------------------------------------------------------------------------------------------------------+----------+-------------------------------------------------+---------------------+-------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; I/O Rules Matrix                                                                                                                                                                                                                                                                                                                                                                                                                                                ;
+--------------------+-----------+--------------+-----------+--------------+--------------+-----------+-----------+--------------+-----------+-----------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+-----------+--------------+--------------+
; Pin/Rules          ; IO_000001 ; IO_000002    ; IO_000003 ; IO_000004    ; IO_000005    ; IO_000006 ; IO_000007 ; IO_000008    ; IO_000009 ; IO_000010 ; IO_000011    ; IO_000012    ; IO_000013    ; IO_000014    ; IO_000015    ; IO_000018    ; IO_000019    ; IO_000020    ; IO_000021    ; IO_000022    ; IO_000023    ; IO_000024    ; IO_000026    ; IO_000027    ; IO_000045    ; IO_000046    ; IO_000047    ; IO_000033 ; IO_000034    ; IO_000042    ;
+--------------------+-----------+--------------+-----------+--------------+--------------+-----------+-----------+--------------+-----------+-----------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+-----------+--------------+--------------+
; Total Pass         ; 151       ; 0            ; 151       ; 0            ; 0            ; 151       ; 151       ; 0            ; 151       ; 151       ; 0            ; 140          ; 0            ; 8            ; 79           ; 0            ; 140          ; 79           ; 8            ; 0            ; 28           ; 140          ; 0            ; 0            ; 0            ; 0            ; 0            ; 151       ; 0            ; 0            ;
; Total Unchecked    ; 0         ; 0            ; 0         ; 0            ; 0            ; 0         ; 0         ; 0            ; 0         ; 0         ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0         ; 0            ; 0            ;
; Total Inapplicable ; 0         ; 151          ; 0         ; 151          ; 151          ; 0         ; 0         ; 151          ; 0         ; 0         ; 151          ; 11           ; 151          ; 143          ; 72           ; 151          ; 11           ; 72           ; 143          ; 151          ; 123          ; 11           ; 151          ; 151          ; 151          ; 151          ; 151          ; 0         ; 151          ; 151          ;
; Total Fail         ; 0         ; 0            ; 0         ; 0            ; 0            ; 0         ; 0         ; 0            ; 0         ; 0         ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0         ; 0            ; 0            ;
; JTAG_NEXUS_TDO     ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; LED_B[0]           ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; LED_B[1]           ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; LED_B[2]           ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; LED_B[3]           ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
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; SRAM1_D[5]         ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Pass         ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SRAM1_D[6]         ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Pass         ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SRAM1_D[7]         ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Pass         ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SRAM1_D[8]         ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Pass         ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SRAM1_D[9]         ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Pass         ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SRAM1_D[10]        ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Pass         ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SRAM1_D[11]        ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Pass         ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SRAM1_D[12]        ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Pass         ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SRAM1_D[13]        ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Pass         ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SRAM1_D[14]        ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Pass         ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SRAM1_D[15]        ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Pass         ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; JTAG_NEXUS_TCK     ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; JTAG_NEXUS_TMS     ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; CLK_BRD            ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; TEST_BUTTON        ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; JTAG_NEXUS_TDI     ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SW_USER2           ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SW_USER4           ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SW_USER3           ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SW_USER0           ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SW_USER1           ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; MIDI_RX            ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
+--------------------+-----------+--------------+-----------+--------------+--------------+-----------+-----------+--------------+-----------+-----------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+-----------+--------------+--------------+


+----------------------------------------------------------------------------------------+
; Fitter Device Options                                                                  ;
+------------------------------------------------------------------+---------------------+
; Option                                                           ; Setting             ;
+------------------------------------------------------------------+---------------------+
; Enable user-supplied start-up clock (CLKUSR)                     ; Off                 ;
; Enable device-wide reset (DEV_CLRn)                              ; Off                 ;
; Enable device-wide output enable (DEV_OE)                        ; Off                 ;
; Enable INIT_DONE output                                          ; Off                 ;
; Configuration scheme                                             ; Passive Serial      ;
; Error detection CRC                                              ; Off                 ;
; Enable open drain on CRC_ERROR pin                               ; Off                 ;
; Enable input tri-state on active configuration pins in user mode ; Off                 ;
; Configuration Voltage Level                                      ; Auto                ;
; Force Configuration Voltage Level                                ; Off                 ;
; nCEO                                                             ; Unreserved          ;
; Data[0]                                                          ; As input tri-stated ;
; Data[1]/ASDO                                                     ; As input tri-stated ;
; Data[7..2]                                                       ; Unreserved          ;
; FLASH_nCE/nCSO                                                   ; As input tri-stated ;
; Other Active Parallel pins                                       ; Unreserved          ;
; DCLK                                                             ; As input tri-stated ;
; Base pin-out file on sameframe device                            ; Off                 ;
+------------------------------------------------------------------+---------------------+


+------------------------------------+
; Operating Settings and Conditions  ;
+---------------------------+--------+
; Setting                   ; Value  ;
+---------------------------+--------+
; Nominal Core Voltage      ; 1.20 V ;
; Low Junction Temperature  ; 0 °C   ;
; High Junction Temperature ; 85 °C  ;
+---------------------------+--------+


+------------------------------------------------------------+
; Estimated Delay Added for Hold Timing Summary              ;
+-----------------+----------------------+-------------------+
; Source Clock(s) ; Destination Clock(s) ; Delay Added in ns ;
+-----------------+----------------------+-------------------+
Note: For more information on problematic transfers, consider running the Fitter again with the Optimize hold timing option (Settings Menu) turned off.
This will disable optimization of problematic paths and expose them for further analysis using either the TimeQuest Timing Analyzer or the Classic Timing Analyzer.


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Estimated Delay Added for Hold Timing Details                                                                                                                                                                                                                                                       ;
+-------------------------------------------------------------------------------------------+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+-------------------+
; Source Register                                                                           ; Destination Register                                                                                                                                                                ; Delay Added in ns ;
+-------------------------------------------------------------------------------------------+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+-------------------+
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_12  ; Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u2:Memory_CPU_u2_component|altsyncram:altsyncram_component|altsyncram_20j2:auto_generated|ram_block1a4~porta_address_reg0 ; 0.168             ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_7   ; Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u2:Memory_CPU_u2_component|altsyncram:altsyncram_component|altsyncram_20j2:auto_generated|ram_block1a4~porta_address_reg0 ; 0.152             ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_9   ; Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u2:Memory_CPU_u2_component|altsyncram:altsyncram_component|altsyncram_20j2:auto_generated|ram_block1a4~porta_address_reg0 ; 0.152             ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_10  ; Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u2:Memory_CPU_u2_component|altsyncram:altsyncram_component|altsyncram_20j2:auto_generated|ram_block1a4~porta_address_reg0 ; 0.152             ;
; TSK3000A_MCU:U_MIDIKBD_OB_CPU_SubPart_MCU|MCU_Top:U_MCU|Regs_PC:ProgramCounter|Reg_PC_11  ; Memory_CPU:U_MIDIKBD_OB_CPU_SubPart_BootMemory|Memory_CPU_u2:Memory_CPU_u2_component|altsyncram:altsyncram_component|altsyncram_20j2:auto_generated|ram_block1a4~porta_address_reg0 ; 0.152             ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_STATUS[0]                     ; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_3:RegisterStatus|sh_reg_0                                                                  ; 0.075             ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_STATUS[3]                     ; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_3:RegisterStatus|sh_reg[3]                                                                 ; 0.075             ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_STATUS[1]                     ; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_3:RegisterStatus|sh_reg[1]                                                                 ; 0.075             ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_TXBUFFER[7]                   ; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_1:RegisterReadFromInstrument|sh_reg[7]                                                     ; 0.075             ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_TXBUFFER[6]                   ; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_1:RegisterReadFromInstrument|sh_reg[6]                                                     ; 0.075             ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_TXBUFFER[5]                   ; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_1:RegisterReadFromInstrument|sh_reg[5]                                                     ; 0.075             ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_TXBUFFER[4]                   ; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_1:RegisterReadFromInstrument|sh_reg[4]                                                     ; 0.075             ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_TXBUFFER[3]                   ; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_1:RegisterReadFromInstrument|sh_reg[3]                                                     ; 0.075             ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_TXBUFFER[2]                   ; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_1:RegisterReadFromInstrument|sh_reg[2]                                                     ; 0.075             ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_TXBUFFER[1]                   ; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_1:RegisterReadFromInstrument|sh_reg[1]                                                     ; 0.075             ;
; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|WB_TXBUFFER[0]                   ; TERMINAL:U_MIDIKBD_OB_TERMINAL_1|TERMINALCORE:U_terminal|TERMINALCORE_DATAREG_INOUT_WR_8_1:RegisterReadFromInstrument|sh_reg_0                                                      ; 0.075             ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|overrun    ; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|status[7]                                                                                            ; 0.074             ;
; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|txshifting ; WB_MIDI:U_MIDIKBD_OB_X_MIDI|MIDI:U_midi|WB_UART8_V2:SUB_MIDI|wb_uart:U_WB_UART|status[3]                                                                                            ; 0.068             ;
+-------------------------------------------------------------------------------------------+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+-------------------+


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; Fitter Messages ;
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Info: *******************************************************************
Info: Running Quartus II 32-bit Fitter
    Info: Version 12.0 Build 178 05/31/2012 SJ Web Edition
    Info: Copyright (C) 1991-2012 Altera Corporation. All rights reserved.
    Info: Your use of Altera Corporation's design tools, logic functions 
    Info: and other software and tools, and its AMPP partner logic 
    Info: functions, and any output files from any of the foregoing 
    Info: (including device programming or simulation files), and any 
    Info: associated documentation or information are expressly subject 
    Info: to the terms and conditions of the Altera Program License 
    Info: Subscription Agreement, Altera MegaCore Function License 
    Info: Agreement, or other applicable license agreement, including, 
    Info: without limitation, that your use is for the sole purpose of 
    Info: programming logic devices manufactured by Altera and sold by 
    Info: Altera or its authorized distributors.  Please refer to the 
    Info: applicable agreement for further details.
    Info: Processing started: Sun Dec 30 21:09:26 2012
Info: Command: quartus_fit MIDIKBD
Warning (20028): Parallel compilation is not licensed and has been disabled
Info (119006): Selected device EP3C40F780C8 for design "MIDIKBD"
Info (21076): High junction temperature operating condition is not set. Assuming a default value of '85'.
Info (21076): Low junction temperature operating condition is not set. Assuming a default value of '0'.
Info (171003): Fitter is performing an Auto Fit compilation, which may decrease Fitter effort to reduce compilation time
Warning (292013): Feature LogicLock is only available with a valid subscription license. You can purchase a software subscription to gain full access to this feature.
Info (176444): Device migration not selected. If you intend to use device migration later, you may need to change the pin assignments as they may be incompatible with other devices
    Info (176445): Device EP3C55F780C8 is compatible
    Info (176445): Device EP3C80F780C8 is compatible
    Info (176445): Device EP3C120F780C8 is compatible
Info (169124): Fitter converted 4 user pins into dedicated programming pins
    Info (169125): Pin ~ALTERA_ASDO_DATA1~ is reserved at location F4
    Info (169125): Pin ~ALTERA_FLASH_nCE_nCSO~ is reserved at location E2
    Info (169125): Pin ~ALTERA_DCLK~ is reserved at location P3
    Info (169125): Pin ~ALTERA_DATA0~ is reserved at location N7
Warning (15714): Some pins have incomplete I/O assignments. Refer to the I/O Assignment Warnings report for details
Info (176045): Design uses memory blocks. Violating setup or hold times of memory block address registers for either read or write operations could cause memory contents to be corrupted. Make sure that all memory block address registers meet the setup and hold time requirements.
Info (332104): Reading SDC File: 'MIDIKBD_sta.SDC'
Info (332144): No user constrained base clocks found in the design
Info (332143): No user constrained clock uncertainty found in the design. Calling "derive_clock_uncertainty"
Info (332123): Deriving Clock Uncertainty. Please refer to report_sdc in TimeQuest to see clock uncertainties.
Info (332130): Timing requirements not specified -- quality metrics such as performance may be sacrificed to reduce compilation time.
Info (176353): Automatically promoted node CLK_BRD~input (placed in PIN A14 (CLK10, DIFFCLK_4n))
    Info (176355): Automatically promoted destinations to use location or clock signal Global Clock CLKCTRL_G14
Info (176353): Automatically promoted node JTAG_NEXUS_TCK~input (placed in PIN Y27 (CLK6, DIFFCLK_3p))
    Info (176355): Automatically promoted destinations to use location or clock signal Global Clock CLKCTRL_G9
Info (176233): Starting register packing
Extra Info (176273): Performing register packing on registers with non-logic cell location assignments
Extra Info (176274): Completed register packing on registers with non-logic cell location assignments
Extra Info (176236): Started Fast Input/Output/OE register processing
Extra Info (176237): Finished Fast Input/Output/OE register processing
Extra Info (176248): Moving registers into I/O cells, Multiplier Blocks, and RAM blocks to improve timing and density
Extra Info (176249): Finished moving registers into I/O cells, Multiplier Blocks, and RAM blocks
Info (176235): Finished register packing
    Extra Info (176219): No registers were packed into other blocks
Info (171121): Fitter preparation operations ending: elapsed time is 00:00:12
Info (170189): Fitter placement preparation operations beginning
Info (170190): Fitter placement preparation operations ending: elapsed time is 00:00:06
Info (170191): Fitter placement operations beginning
Info (170137): Fitter placement was successful
Info (170192): Fitter placement operations ending: elapsed time is 00:00:34
Info (170193): Fitter routing operations beginning
Info (170195): Router estimated average interconnect usage is 6% of the available device resources
    Info (170196): Router estimated peak interconnect usage is 48% of the available device resources in the region that extends from location X34_Y22 to location X44_Y32
Info (170194): Fitter routing operations ending: elapsed time is 00:00:29
Info (170199): The Fitter performed an Auto Fit compilation.  Optimizations were skipped to reduce compilation time.
    Info (170201): Optimizations that may affect the design's routability were skipped
Info (334003): Started post-fitting delay annotation
Info (334004): Delay annotation completed successfully
Info (334003): Started post-fitting delay annotation
Info (334004): Delay annotation completed successfully
Warning (169064): Following 36 pins have no output enable or a GND or VCC output enable - later changes to this connectivity may change fitting results
    Info (169065): Pin HA[2] has a permanently enabled output enable
    Info (169065): Pin HA[3] has a permanently enabled output enable
    Info (169065): Pin HA[4] has a permanently enabled output enable
    Info (169065): Pin HA[5] has a permanently enabled output enable
    Info (169065): Pin HA[6] has a permanently enabled output enable
    Info (169065): Pin HA[7] has a permanently enabled output enable
    Info (169065): Pin HA[8] has a permanently enabled output enable
    Info (169065): Pin HA[9] has a permanently enabled output enable
    Info (169065): Pin HA[10] has a permanently enabled output enable
    Info (169065): Pin HA[11] has a permanently enabled output enable
    Info (169065): Pin HA[12] has a permanently enabled output enable
    Info (169065): Pin HA[13] has a permanently enabled output enable
    Info (169065): Pin HA[14] has a permanently enabled output enable
    Info (169065): Pin HA[15] has a permanently enabled output enable
    Info (169065): Pin HA[16] has a permanently enabled output enable
    Info (169065): Pin HA[17] has a permanently enabled output enable
    Info (169065): Pin HA[18] has a permanently enabled output enable
    Info (169065): Pin HA[19] has a permanently enabled output enable
    Info (169065): Pin HB[2] has a permanently enabled output enable
    Info (169065): Pin HB[3] has a permanently enabled output enable
    Info (169065): Pin HB[4] has a permanently enabled output enable
    Info (169065): Pin HB[5] has a permanently enabled output enable
    Info (169065): Pin HB[6] has a permanently enabled output enable
    Info (169065): Pin HB[7] has a permanently enabled output enable
    Info (169065): Pin HB[8] has a permanently enabled output enable
    Info (169065): Pin HB[9] has a permanently enabled output enable
    Info (169065): Pin HB[10] has a permanently enabled output enable
    Info (169065): Pin HB[11] has a permanently enabled output enable
    Info (169065): Pin HB[12] has a permanently enabled output enable
    Info (169065): Pin HB[13] has a permanently enabled output enable
    Info (169065): Pin HB[14] has a permanently enabled output enable
    Info (169065): Pin HB[15] has a permanently enabled output enable
    Info (169065): Pin HB[16] has a permanently enabled output enable
    Info (169065): Pin HB[17] has a permanently enabled output enable
    Info (169065): Pin HB[18] has a permanently enabled output enable
    Info (169065): Pin HB[19] has a permanently enabled output enable
Info: Quartus II 32-bit Fitter was successful. 0 errors, 4 warnings
    Info: Peak virtual memory: 485 megabytes
    Info: Processing ended: Sun Dec 30 21:11:20 2012
    Info: Elapsed time: 00:01:54
    Info: Total CPU time (on all processors): 00:01:32


