Fitter report for URSO180_GlueLogic
Mon Dec 21 19:25:50 2015
Quartus II 64-Bit Version 13.0.1 Build 232 06/12/2013 Service Pack 1 SJ Web Edition


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; Table of Contents ;
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  1. Legal Notice
  2. Fitter Summary
  3. Fitter Settings
  4. Parallel Compilation
  5. Pin-Out File
  6. Fitter Resource Usage Summary
  7. Input Pins
  8. Output Pins
  9. Bidir Pins
 10. All Package Pins
 11. I/O Standard
 12. Dedicated Inputs I/O
 13. Output Pin Default Load For Reported TCO
 14. Fitter Resource Utilization by Entity
 15. Control Signals
 16. Global & Other Fast Signals
 17. Non-Global High Fan-Out Signals
 18. Other Routing Usage Summary
 19. LAB Macrocells
 20. Logic Cell Interconnection
 21. Fitter Device Options
 22. Fitter Messages



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; Legal Notice ;
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Copyright (C) 1991-2013 Altera Corporation
Your use of Altera Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
functions, and any output files from any of the foregoing 
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; Fitter Summary                                                              ;
+---------------------------+-------------------------------------------------+
; Fitter Status             ; Successful - Mon Dec 21 19:25:50 2015           ;
; Quartus II 64-Bit Version ; 13.0.1 Build 232 06/12/2013 SP 1 SJ Web Edition ;
; Revision Name             ; URSO180_GlueLogic                               ;
; Top-level Entity Name     ; URSO180_GlueLogic                               ;
; Family                    ; MAX7000S                                        ;
; Device                    ; EPM7064SLC84-10                                 ;
; Timing Models             ; Final                                           ;
; Total macrocells          ; 29 / 64 ( 45 % )                                ;
; Total pins                ; 34 / 68 ( 50 % )                                ;
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+--------------------------------------------------------------------------------------------------------------+
; Fitter Settings                                                                                              ;
+----------------------------------------------------------------------------+-----------------+---------------+
; Option                                                                     ; Setting         ; Default Value ;
+----------------------------------------------------------------------------+-----------------+---------------+
; Device                                                                     ; EPM7064SLC84-10 ;               ;
; Use smart compilation                                                      ; Off             ; Off           ;
; Enable parallel Assembler and TimeQuest Timing Analyzer during compilation ; On              ; On            ;
; Enable compact report table                                                ; Off             ; Off           ;
; Optimize Multi-Corner Timing                                               ; Off             ; Off           ;
; Optimize Timing for ECOs                                                   ; Off             ; Off           ;
; Regenerate full fit report during ECO compiles                             ; Off             ; Off           ;
; Optimize IOC Register Placement for Timing                                 ; Normal          ; Normal        ;
; Fitter Initial Placement Seed                                              ; 1               ; 1             ;
; Slow Slew Rate                                                             ; Off             ; Off           ;
; Fitter Effort                                                              ; Auto Fit        ; Auto Fit      ;
; Force Fitter to Avoid Periphery Placement Warnings                         ; Off             ; Off           ;
+----------------------------------------------------------------------------+-----------------+---------------+


Parallel compilation was disabled, but you have multiple processors available. Enable parallel compilation to reduce compilation time.
+-------------------------------------+
; Parallel Compilation                ;
+----------------------------+--------+
; Processors                 ; Number ;
+----------------------------+--------+
; Number detected on machine ; 4      ;
; Maximum allowed            ; 1      ;
+----------------------------+--------+


+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in C:/prg/URSO180/Hardware/Glue_Logic/FPGA_Design/output_files/URSO180_GlueLogic.pin.


+-------------------------------------------------+
; Fitter Resource Usage Summary                   ;
+------------------------------+------------------+
; Resource                     ; Usage            ;
+------------------------------+------------------+
; Logic cells                  ; 29 / 64 ( 45 % ) ;
; Registers                    ; 2 / 64 ( 3 % )   ;
; Number of pterms used        ; 5                ;
; I/O pins                     ; 34 / 68 ( 50 % ) ;
;     -- Clock pins            ; 1 / 2 ( 50 % )   ;
;     -- Dedicated input pins  ; 1 / 2 ( 50 % )   ;
;                              ;                  ;
; Global signals               ; 2                ;
; Shareable expanders          ; 0 / 64 ( 0 % )   ;
; Parallel expanders           ; 0 / 60 ( 0 % )   ;
; Cells using turbo bit        ; 29 / 64 ( 45 % ) ;
; Maximum fan-out              ; 3                ;
; Highest non-global fan-out   ; 3                ;
; Total fan-out                ; 49               ;
; Average fan-out              ; 0.78             ;
+------------------------------+------------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins                                                                                                                                      ;
+-----------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; Name      ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; I/O Standard ; Location assigned by ;
+-----------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; clk_40MHz ; 83    ; --       ; --  ; 1                     ; 0                  ; yes    ; no             ; TTL          ; Fitter               ;
; nRESET    ; 1     ; --       ; --  ; 1                     ; 0                  ; yes    ; no             ; TTL          ; Fitter               ;
+-----------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins                                                                                                                                                                                   ;
+-----------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------+----------------------+---------------------+
; Name      ; Pin # ; I/O Bank ; LAB ; Output Register ; Slow Slew Rate ; Open Drain ; TRI Primitive ; I/O Standard ; Location assigned by ; Load  ; Output Enable Source ; Output Enable Group ;
+-----------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------+----------------------+---------------------+
; clk_EXTAL ; 39    ; --       ; 2   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ; 10 pF ; -                    ; -                   ;
; nRAMCS0   ; 74    ; --       ; 4   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; 10 pF ; -                    ; -                   ;
; nRAMCS1   ; 73    ; --       ; 4   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; 10 pF ; -                    ; -                   ;
; nROMCS0   ; 70    ; --       ; 4   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; 10 pF ; -                    ; -                   ;
+-----------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------+----------------------+---------------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Bidir Pins                                                                                                                                                                                                                                       ;
+-------+-------+----------+-----+-----------------------+--------------------+--------+----------------+-----------------+----------------+------------+--------------+----------------------+-------+----------------------+---------------------+
; Name  ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Output Register ; Slow Slew Rate ; Open Drain ; I/O Standard ; Location assigned by ; Load  ; Output Enable Source ; Output Enable Group ;
+-------+-------+----------+-----+-----------------------+--------------------+--------+----------------+-----------------+----------------+------------+--------------+----------------------+-------+----------------------+---------------------+
; A[0]  ; 8     ; --       ; 1   ; 1                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~8 (inverted)    ; -                   ;
; A[10] ; 30    ; --       ; 2   ; 0                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~21 (inverted)   ; -                   ;
; A[11] ; 31    ; --       ; 2   ; 0                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~20 (inverted)   ; -                   ;
; A[12] ; 35    ; --       ; 2   ; 0                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~19 (inverted)   ; -                   ;
; A[13] ; 37    ; --       ; 2   ; 0                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~18 (inverted)   ; -                   ;
; A[14] ; 4     ; --       ; 1   ; 0                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~17 (inverted)   ; -                   ;
; A[15] ; 6     ; --       ; 1   ; 0                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~16 (inverted)   ; -                   ;
; A[16] ; 9     ; --       ; 1   ; 0                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~15 (inverted)   ; -                   ;
; A[17] ; 10    ; --       ; 1   ; 0                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~14 (inverted)   ; -                   ;
; A[18] ; 11    ; --       ; 1   ; 0                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~13 (inverted)   ; -                   ;
; A[19] ; 18    ; --       ; 1   ; 3                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~0 (inverted)    ; -                   ;
; A[1]  ; 12    ; --       ; 1   ; 1                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~7 (inverted)    ; -                   ;
; A[2]  ; 20    ; --       ; 1   ; 1                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~6 (inverted)    ; -                   ;
; A[3]  ; 21    ; --       ; 1   ; 1                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~5 (inverted)    ; -                   ;
; A[4]  ; 22    ; --       ; 1   ; 1                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~4 (inverted)    ; -                   ;
; A[5]  ; 15    ; --       ; 1   ; 1                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~3 (inverted)    ; -                   ;
; A[6]  ; 16    ; --       ; 1   ; 1                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~2 (inverted)    ; -                   ;
; A[7]  ; 17    ; --       ; 1   ; 1                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~1 (inverted)    ; -                   ;
; A[8]  ; 40    ; --       ; 2   ; 0                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~23 (inverted)   ; -                   ;
; A[9]  ; 41    ; --       ; 2   ; 0                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; Fitter               ; 10 pF ; ~VCC~22 (inverted)   ; -                   ;
; D7    ; 5     ; --       ; 1   ; 1                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; User                 ; 10 pF ; ~VCC~11 (inverted)   ; -                   ;
; nIOE  ; 34    ; --       ; 2   ; 1                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; User                 ; 10 pF ; ~VCC~10 (inverted)   ; -                   ;
; nME   ; 33    ; --       ; 2   ; 3                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; User                 ; 10 pF ; ~VCC~12 (inverted)   ; -                   ;
; nWR   ; 36    ; --       ; 2   ; 1                     ; 0                  ; no     ; no             ; no              ; no             ; yes        ; TTL          ; User                 ; 10 pF ; ~VCC~9 (inverted)    ; -                   ;
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; 25       ; 24         ; --       ; RESERVED       ;        ;              ;         ;                 ;
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; 66       ; 65         ; --       ; VCCIO          ; power  ;              ; 5.0V    ;                 ;
; 67       ; 66         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 68       ; 67         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 69       ; 68         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 70       ; 69         ; --       ; nROMCS0        ; output ; TTL          ;         ; Y               ;
; 71       ; 70         ; --       ; TDO            ; output ; TTL          ;         ; N               ;
; 72       ; 71         ; --       ; GND            ; gnd    ;              ;         ;                 ;
; 73       ; 72         ; --       ; nRAMCS1        ; output ; TTL          ;         ; Y               ;
; 74       ; 73         ; --       ; nRAMCS0        ; output ; TTL          ;         ; Y               ;
; 75       ; 74         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 76       ; 75         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 77       ; 76         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 78       ; 77         ; --       ; VCCIO          ; power  ;              ; 5.0V    ;                 ;
; 79       ; 78         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 80       ; 79         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 81       ; 80         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 82       ; 81         ; --       ; GND            ; gnd    ;              ;         ;                 ;
; 83       ; 82         ; --       ; clk_40MHz      ; input  ; TTL          ;         ; N               ;
; 84       ; 83         ; --       ; GND+           ;        ;              ;         ;                 ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
Note: Pin directions (input, output or bidir) are based on device operating in user mode.


+--------------------------------------------------------------------------------------------------+
; I/O Standard                                                                                     ;
+--------------+------------+----------------------+-------------------+-------------------+-------+
; I/O Standard ; Input Vref ; Dedicated Input Pins ; Pins in I/O Bank1 ; Pins in I/O Bank2 ; Total ;
+--------------+------------+----------------------+-------------------+-------------------+-------+
; TTL          ; -          ; 2                    ; 0                 ; 0                 ; 2     ;
+--------------+------------+----------------------+-------------------+-------------------+-------+


+-------------------------------------------------------------------------+
; Dedicated Inputs I/O                                                    ;
+-----------+-------+-------+-------+--------------+------------+---------+
; Name      ; Pin # ; Type  ; VCCIO ; I/O Standard ; Input Vref ; Current ;
+-----------+-------+-------+-------+--------------+------------+---------+
; clk_40MHz ; 83    ; Input ; --    ; TTL          ; -          ; 0 mA    ;
; nRESET    ; 1     ; Input ; --    ; TTL          ; -          ; 0 mA    ;
+-----------+-------+-------+-------+--------------+------------+---------+


+-----------------------------------------------+
; Output Pin Default Load For Reported TCO      ;
+--------------+-------+------------------------+
; I/O Standard ; Load  ; Termination Resistance ;
+--------------+-------+------------------------+
; 3.3-V LVTTL  ; 10 pF ; Not Available          ;
; 3.3-V LVCMOS ; 10 pF ; Not Available          ;
; TTL          ; 10 pF ; Not Available          ;
+--------------+-------+------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.


+-------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity                                               ;
+----------------------------+------------+------+---------------------+--------------+
; Compilation Hierarchy Node ; Macrocells ; Pins ; Full Hierarchy Name ; Library Name ;
+----------------------------+------------+------+---------------------+--------------+
; |URSO180_GlueLogic         ; 29         ; 34   ; |URSO180_GlueLogic  ; work         ;
+----------------------------+------------+------+---------------------+--------------+


+--------------------------------------------------------------------------------------------------+
; Control Signals                                                                                  ;
+-----------+----------+---------+--------------+--------+----------------------+------------------+
; Name      ; Location ; Fan-Out ; Usage        ; Global ; Global Resource Used ; Global Line Name ;
+-----------+----------+---------+--------------+--------+----------------------+------------------+
; A[0]      ; PIN_8    ; 1       ; Clock        ; no     ; --                   ; --               ;
; A[1]      ; PIN_12   ; 1       ; Clock        ; no     ; --                   ; --               ;
; A[2]      ; PIN_20   ; 1       ; Clock        ; no     ; --                   ; --               ;
; A[3]      ; PIN_21   ; 1       ; Clock        ; no     ; --                   ; --               ;
; A[4]      ; PIN_22   ; 1       ; Clock        ; no     ; --                   ; --               ;
; A[5]      ; PIN_15   ; 1       ; Clock        ; no     ; --                   ; --               ;
; A[6]      ; PIN_16   ; 1       ; Clock        ; no     ; --                   ; --               ;
; A[7]      ; PIN_17   ; 1       ; Clock        ; no     ; --                   ; --               ;
; clk_40MHz ; PIN_83   ; 1       ; Clock        ; yes    ; On                   ; --               ;
; nIOE      ; PIN_34   ; 1       ; Clock        ; no     ; --                   ; --               ;
; nRESET    ; PIN_1    ; 1       ; Async. clear ; yes    ; On                   ; --               ;
; nWR       ; PIN_36   ; 1       ; Clock        ; no     ; --                   ; --               ;
+-----------+----------+---------+--------------+--------+----------------------+------------------+


+--------------------------------------------------------------------------+
; Global & Other Fast Signals                                              ;
+-----------+----------+---------+----------------------+------------------+
; Name      ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+-----------+----------+---------+----------------------+------------------+
; clk_40MHz ; PIN_83   ; 1       ; On                   ; --               ;
; nRESET    ; PIN_1    ; 1       ; On                   ; --               ;
+-----------+----------+---------+----------------------+------------------+


+---------------------------------+
; Non-Global High Fan-Out Signals ;
+---------+-----------------------+
; Name    ; Fan-Out               ;
+---------+-----------------------+
; nME~0   ; 3                     ;
; A~0     ; 3                     ;
; inst7   ; 2                     ;
; D7~0    ; 1                     ;
; nIOE~0  ; 1                     ;
; nWR~0   ; 1                     ;
; A~19    ; 1                     ;
; A~18    ; 1                     ;
; A~17    ; 1                     ;
; A~16    ; 1                     ;
; A~15    ; 1                     ;
; A~14    ; 1                     ;
; A~13    ; 1                     ;
; A~12    ; 1                     ;
; ~VCC~23 ; 1                     ;
; ~VCC~22 ; 1                     ;
; ~VCC~21 ; 1                     ;
; ~VCC~20 ; 1                     ;
; ~VCC~19 ; 1                     ;
; ~VCC~18 ; 1                     ;
; ~VCC~17 ; 1                     ;
; ~VCC~16 ; 1                     ;
; ~VCC~15 ; 1                     ;
; ~VCC~14 ; 1                     ;
; ~VCC~13 ; 1                     ;
; ~VCC~12 ; 1                     ;
; ~VCC~11 ; 1                     ;
; ~VCC~10 ; 1                     ;
; ~VCC~9  ; 1                     ;
; ~VCC~8  ; 1                     ;
; ~VCC~7  ; 1                     ;
; ~VCC~6  ; 1                     ;
; ~VCC~5  ; 1                     ;
; ~VCC~4  ; 1                     ;
; ~VCC~3  ; 1                     ;
; ~VCC~2  ; 1                     ;
; ~VCC~1  ; 1                     ;
; ~VCC~0  ; 1                     ;
; inst5~1 ; 1                     ;
; inst3~2 ; 1                     ;
; inst4~1 ; 1                     ;
; inst31  ; 1                     ;
+---------+-----------------------+


+-------------------------------------------------+
; Other Routing Usage Summary                     ;
+-----------------------------+-------------------+
; Other Routing Resource Type ; Usage             ;
+-----------------------------+-------------------+
; Output enables              ; 0 / 6 ( 0 % )     ;
; PIA buffers                 ; 14 / 144 ( 10 % ) ;
+-----------------------------+-------------------+


+----------------------------------------------------------------------+
; LAB Macrocells                                                       ;
+----------------------------------------+-----------------------------+
; Number of Macrocells  (Average = 7.25) ; Number of LABs  (Total = 3) ;
+----------------------------------------+-----------------------------+
; 0                                      ; 1                           ;
; 1                                      ; 0                           ;
; 2                                      ; 0                           ;
; 3                                      ; 1                           ;
; 4                                      ; 0                           ;
; 5                                      ; 0                           ;
; 6                                      ; 0                           ;
; 7                                      ; 0                           ;
; 8                                      ; 0                           ;
; 9                                      ; 0                           ;
; 10                                     ; 1                           ;
; 11                                     ; 0                           ;
; 12                                     ; 0                           ;
; 13                                     ; 0                           ;
; 14                                     ; 0                           ;
; 15                                     ; 0                           ;
; 16                                     ; 1                           ;
+----------------------------------------+-----------------------------+


+-------------------------------------------------------------------------------------------------------------+
; Logic Cell Interconnection                                                                                  ;
+-----+------------+-----------------------------------------------------------------------+------------------+
; LAB ; Logic Cell ; Input                                                                 ; Output           ;
+-----+------------+-----------------------------------------------------------------------+------------------+
;  A  ; LC8        ; nRESET, D7, A[7], A[6], A[5], A[4], A[3], A[2], A[1], A[0], nWR, nIOE ; inst3~2, inst5~1 ;
;  A  ; LC4        ;                                                                       ; A[19]            ;
;  A  ; LC5        ;                                                                       ; A[7]             ;
;  A  ; LC6        ;                                                                       ; A[6]             ;
;  A  ; LC7        ;                                                                       ; A[5]             ;
;  A  ; LC1        ;                                                                       ; A[4]             ;
;  A  ; LC2        ;                                                                       ; A[3]             ;
;  A  ; LC3        ;                                                                       ; A[2]             ;
;  A  ; LC9        ;                                                                       ; A[1]             ;
;  A  ; LC13       ;                                                                       ; A[0]             ;
;  A  ; LC15       ;                                                                       ; D7               ;
;  A  ; LC10       ;                                                                       ; A[18]            ;
;  A  ; LC11       ;                                                                       ; A[17]            ;
;  A  ; LC12       ;                                                                       ; A[16]            ;
;  A  ; LC14       ;                                                                       ; A[15]            ;
;  A  ; LC16       ;                                                                       ; A[14]            ;
;  B  ; LC19       ; clk_40MHz                                                             ; clk_EXTAL        ;
;  B  ; LC21       ;                                                                       ; nWR              ;
;  B  ; LC23       ;                                                                       ; nIOE             ;
;  B  ; LC24       ;                                                                       ; nME              ;
;  B  ; LC20       ;                                                                       ; A[13]            ;
;  B  ; LC22       ;                                                                       ; A[12]            ;
;  B  ; LC25       ;                                                                       ; A[11]            ;
;  B  ; LC26       ;                                                                       ; A[10]            ;
;  B  ; LC17       ;                                                                       ; A[9]             ;
;  B  ; LC18       ;                                                                       ; A[8]             ;
;  D  ; LC57       ; A[19], nME                                                            ; nRAMCS1          ;
;  D  ; LC58       ; inst7, A[19], nME                                                     ; nRAMCS0          ;
;  D  ; LC55       ; inst7, A[19], nME                                                     ; nROMCS0          ;
+-----+------------+-----------------------------------------------------------------------+------------------+


+---------------------------------------------------------------+
; Fitter Device Options                                         ;
+----------------------------------------------+----------------+
; Option                                       ; Setting        ;
+----------------------------------------------+----------------+
; Enable user-supplied start-up clock (CLKUSR) ; Off            ;
; Enable device-wide reset (DEV_CLRn)          ; Off            ;
; Enable device-wide output enable (DEV_OE)    ; Off            ;
; Enable INIT_DONE output                      ; Off            ;
; Configuration scheme                         ; Passive Serial ;
; Security bit                                 ; Off            ;
; Base pin-out file on sameframe device        ; Off            ;
+----------------------------------------------+----------------+


+-----------------+
; Fitter Messages ;
+-----------------+
Warning (20028): Parallel compilation is not licensed and has been disabled
Info (119006): Selected device EPM7064SLC84-10 for design "URSO180_GlueLogic"
Warning (15705): Ignored locations or region assignments to the following nodes
    Warning (15706): Node "A0" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A1" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A10" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A11" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A12" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A13" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A14" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A15" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A16" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A17" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A18" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A19" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A2" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A3" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A4" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A5" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A6" is assigned to location or region, but does not exist in design
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    Warning (15706): Node "A8" is assigned to location or region, but does not exist in design
    Warning (15706): Node "A9" is assigned to location or region, but does not exist in design
    Warning (15706): Node "D0" is assigned to location or region, but does not exist in design
    Warning (15706): Node "D1" is assigned to location or region, but does not exist in design
    Warning (15706): Node "D2" is assigned to location or region, but does not exist in design
    Warning (15706): Node "D3" is assigned to location or region, but does not exist in design
    Warning (15706): Node "D4" is assigned to location or region, but does not exist in design
    Warning (15706): Node "D5" is assigned to location or region, but does not exist in design
    Warning (15706): Node "D6" is assigned to location or region, but does not exist in design
    Warning (15706): Node "nLIR" is assigned to location or region, but does not exist in design
    Warning (15706): Node "nRD" is assigned to location or region, but does not exist in design
    Warning (15706): Node "nROMCS1" is assigned to location or region, but does not exist in design
    Warning (15706): Node "nSTAT" is assigned to location or region, but does not exist in design
Info: Quartus II 64-Bit Fitter was successful. 0 errors, 33 warnings
    Info: Peak virtual memory: 467 megabytes
    Info: Processing ended: Mon Dec 21 19:25:51 2015
    Info: Elapsed time: 00:00:02
    Info: Total CPU time (on all processors): 00:00:01


