Fitter report for Epson
Mon Oct 15 23:32:47 2012
Quartus II 32-bit Version 12.0 Build 178 05/31/2012 SJ Web Edition


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; Table of Contents ;
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  1. Legal Notice
  2. Fitter Summary
  3. Fitter Settings
  4. Parallel Compilation
  5. I/O Assignment Warnings
  6. Fitter Netlist Optimizations
  7. Incremental Compilation Preservation Summary
  8. Incremental Compilation Partition Settings
  9. Incremental Compilation Placement Preservation
 10. Pin-Out File
 11. Fitter Resource Usage Summary
 12. Fitter Partition Statistics
 13. Input Pins
 14. Output Pins
 15. Dual Purpose and Dedicated Pins
 16. I/O Bank Usage
 17. All Package Pins
 18. Fitter Resource Utilization by Entity
 19. Delay Chain Summary
 20. Pad To Core Delay Chain Fanout
 21. Control Signals
 22. Global & Other Fast Signals
 23. Non-Global High Fan-Out Signals
 24. Fitter RAM Summary
 25. Interconnect Usage Summary
 26. LAB Logic Elements
 27. LAB-wide Signals
 28. LAB Signals Sourced
 29. LAB Signals Sourced Out
 30. LAB Distinct Inputs
 31. I/O Rules Summary
 32. I/O Rules Details
 33. I/O Rules Matrix
 34. Fitter Device Options
 35. Operating Settings and Conditions
 36. Estimated Delay Added for Hold Timing Summary
 37. Estimated Delay Added for Hold Timing Details
 38. Fitter Messages



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; Legal Notice ;
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Copyright (C) 1991-2012 Altera Corporation
Your use of Altera Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
functions, and any output files from any of the foregoing 
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; Fitter Summary                                                                ;
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; Fitter Status                      ; Successful - Mon Oct 15 23:32:47 2012    ;
; Quartus II 32-bit Version          ; 12.0 Build 178 05/31/2012 SJ Web Edition ;
; Revision Name                      ; Epson                                    ;
; Top-level Entity Name              ; Epson                                    ;
; Family                             ; Cyclone III                              ;
; Device                             ; EP3C40F780C8                             ;
; Timing Models                      ; Final                                    ;
; Total logic elements               ; 847 / 39,600 ( 2 % )                     ;
;     Total combinational functions  ; 644 / 39,600 ( 2 % )                     ;
;     Dedicated logic registers      ; 461 / 39,600 ( 1 % )                     ;
; Total registers                    ; 461                                      ;
; Total pins                         ; 82 / 536 ( 15 % )                        ;
; Total virtual pins                 ; 0                                        ;
; Total memory bits                  ; 32,768 / 1,161,216 ( 3 % )               ;
; Embedded Multiplier 9-bit elements ; 0 / 252 ( 0 % )                          ;
; Total PLLs                         ; 0 / 4 ( 0 % )                            ;
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; Fitter Settings                                                                                                                                            ;
+----------------------------------------------------------------------------+---------------------------------------+---------------------------------------+
; Option                                                                     ; Setting                               ; Default Value                         ;
+----------------------------------------------------------------------------+---------------------------------------+---------------------------------------+
; Device                                                                     ; EP3C40F780C8                          ;                                       ;
; Fit Attempts to Skip                                                       ; 0                                     ; 0.0                                   ;
; Use smart compilation                                                      ; Off                                   ; Off                                   ;
; Enable parallel Assembler and TimeQuest Timing Analyzer during compilation ; On                                    ; On                                    ;
; Enable compact report table                                                ; Off                                   ; Off                                   ;
; Auto Merge PLLs                                                            ; On                                    ; On                                    ;
; Router Timing Optimization Level                                           ; Normal                                ; Normal                                ;
; Perform Clocking Topology Analysis During Routing                          ; Off                                   ; Off                                   ;
; Placement Effort Multiplier                                                ; 1.0                                   ; 1.0                                   ;
; Router Effort Multiplier                                                   ; 1.0                                   ; 1.0                                   ;
; Optimize Hold Timing                                                       ; All Paths                             ; All Paths                             ;
; Optimize Multi-Corner Timing                                               ; On                                    ; On                                    ;
; PowerPlay Power Optimization                                               ; Normal compilation                    ; Normal compilation                    ;
; SSN Optimization                                                           ; Off                                   ; Off                                   ;
; Optimize Timing                                                            ; Normal compilation                    ; Normal compilation                    ;
; Optimize Timing for ECOs                                                   ; Off                                   ; Off                                   ;
; Regenerate full fit report during ECO compiles                             ; Off                                   ; Off                                   ;
; Optimize IOC Register Placement for Timing                                 ; Normal                                ; Normal                                ;
; Limit to One Fitting Attempt                                               ; Off                                   ; Off                                   ;
; Final Placement Optimizations                                              ; Automatically                         ; Automatically                         ;
; Fitter Aggressive Routability Optimizations                                ; Automatically                         ; Automatically                         ;
; Fitter Initial Placement Seed                                              ; 1                                     ; 1                                     ;
; PCI I/O                                                                    ; Off                                   ; Off                                   ;
; Weak Pull-Up Resistor                                                      ; Off                                   ; Off                                   ;
; Enable Bus-Hold Circuitry                                                  ; Off                                   ; Off                                   ;
; Auto Packed Registers                                                      ; Auto                                  ; Auto                                  ;
; Auto Delay Chains                                                          ; On                                    ; On                                    ;
; Allow Single-ended Buffer for Differential-XSTL Input                      ; Off                                   ; Off                                   ;
; Treat Bidirectional Pin as Output Pin                                      ; Off                                   ; Off                                   ;
; Perform Physical Synthesis for Combinational Logic for Fitting             ; Off                                   ; Off                                   ;
; Perform Physical Synthesis for Combinational Logic for Performance         ; Off                                   ; Off                                   ;
; Perform Register Duplication for Performance                               ; Off                                   ; Off                                   ;
; Perform Logic to Memory Mapping for Fitting                                ; Off                                   ; Off                                   ;
; Perform Register Retiming for Performance                                  ; Off                                   ; Off                                   ;
; Perform Asynchronous Signal Pipelining                                     ; Off                                   ; Off                                   ;
; Fitter Effort                                                              ; Auto Fit                              ; Auto Fit                              ;
; Physical Synthesis Effort Level                                            ; Normal                                ; Normal                                ;
; Logic Cell Insertion - Logic Duplication                                   ; Auto                                  ; Auto                                  ;
; Auto Register Duplication                                                  ; Auto                                  ; Auto                                  ;
; Auto Global Clock                                                          ; On                                    ; On                                    ;
; Auto Global Register Control Signals                                       ; On                                    ; On                                    ;
; Reserve all unused pins                                                    ; As input tri-stated with weak pull-up ; As input tri-stated with weak pull-up ;
; Synchronizer Identification                                                ; Off                                   ; Off                                   ;
; Enable Beneficial Skew Optimization                                        ; On                                    ; On                                    ;
; Optimize Design for Metastability                                          ; On                                    ; On                                    ;
; Force Fitter to Avoid Periphery Placement Warnings                         ; Off                                   ; Off                                   ;
; RAM Bit Reservation (Cyclone III)                                          ; Off                                   ; Off                                   ;
; Enable input tri-state on active configuration pins in user mode           ; Off                                   ; Off                                   ;
+----------------------------------------------------------------------------+---------------------------------------+---------------------------------------+


Parallel compilation was disabled, but you have multiple processors available. Enable parallel compilation to reduce compilation time.
+-------------------------------------+
; Parallel Compilation                ;
+----------------------------+--------+
; Processors                 ; Number ;
+----------------------------+--------+
; Number detected on machine ; 4      ;
; Maximum allowed            ; 1      ;
+----------------------------+--------+


+------------------------------------------------+
; I/O Assignment Warnings                        ;
+----------------+-------------------------------+
; Pin Name       ; Reason                        ;
+----------------+-------------------------------+
; HA[2]          ; Incomplete set of assignments ;
; HA[3]          ; Incomplete set of assignments ;
; HA[4]          ; Incomplete set of assignments ;
; HA[5]          ; Incomplete set of assignments ;
; HA[6]          ; Incomplete set of assignments ;
; HA[7]          ; Incomplete set of assignments ;
; HA[8]          ; Incomplete set of assignments ;
; HA[9]          ; Incomplete set of assignments ;
; HA[10]         ; Incomplete set of assignments ;
; HA[11]         ; Incomplete set of assignments ;
; HB[2]          ; Incomplete set of assignments ;
; HB[3]          ; Incomplete set of assignments ;
; HB[4]          ; Incomplete set of assignments ;
; HB[5]          ; Incomplete set of assignments ;
; HB[6]          ; Incomplete set of assignments ;
; HB[7]          ; Incomplete set of assignments ;
; HB[8]          ; Incomplete set of assignments ;
; HB[9]          ; Incomplete set of assignments ;
; HB[10]         ; Incomplete set of assignments ;
; HB[11]         ; Incomplete set of assignments ;
; HB[12]         ; Incomplete set of assignments ;
; HB[13]         ; Incomplete set of assignments ;
; HB[14]         ; Incomplete set of assignments ;
; HB[15]         ; Incomplete set of assignments ;
; HB[16]         ; Incomplete set of assignments ;
; HB[17]         ; Incomplete set of assignments ;
; HB[18]         ; Incomplete set of assignments ;
; HB[19]         ; Incomplete set of assignments ;
; JTAG_NEXUS_TDO ; Incomplete set of assignments ;
; LED_B[0]       ; Incomplete set of assignments ;
; LED_B[1]       ; Incomplete set of assignments ;
; LED_B[2]       ; Incomplete set of assignments ;
; LED_B[3]       ; Incomplete set of assignments ;
; LED_B[4]       ; Incomplete set of assignments ;
; LED_B[5]       ; Incomplete set of assignments ;
; LED_B[6]       ; Incomplete set of assignments ;
; LED_B[7]       ; Incomplete set of assignments ;
; LED_G[0]       ; Incomplete set of assignments ;
; LED_G[1]       ; Incomplete set of assignments ;
; LED_G[2]       ; Incomplete set of assignments ;
; LED_G[3]       ; Incomplete set of assignments ;
; LED_G[4]       ; Incomplete set of assignments ;
; LED_G[5]       ; Incomplete set of assignments ;
; LED_G[6]       ; Incomplete set of assignments ;
; LED_G[7]       ; Incomplete set of assignments ;
; LED_R[0]       ; Incomplete set of assignments ;
; LED_R[1]       ; Incomplete set of assignments ;
; LED_R[2]       ; Incomplete set of assignments ;
; LED_R[3]       ; Incomplete set of assignments ;
; LED_R[4]       ; Incomplete set of assignments ;
; LED_R[5]       ; Incomplete set of assignments ;
; LED_R[6]       ; Incomplete set of assignments ;
; LED_R[7]       ; Incomplete set of assignments ;
; RELAY[0]       ; Incomplete set of assignments ;
; RELAY[1]       ; Incomplete set of assignments ;
; RELAY[2]       ; Incomplete set of assignments ;
; RELAY[3]       ; Incomplete set of assignments ;
; SW_USER4       ; Incomplete set of assignments ;
; SW_USER3       ; Incomplete set of assignments ;
; HA[12]         ; Incomplete set of assignments ;
; HA[13]         ; Incomplete set of assignments ;
; HA[14]         ; Incomplete set of assignments ;
; HA[15]         ; Incomplete set of assignments ;
; HA[16]         ; Incomplete set of assignments ;
; HA[17]         ; Incomplete set of assignments ;
; HA[18]         ; Incomplete set of assignments ;
; HA[19]         ; Incomplete set of assignments ;
; JTAG_NEXUS_TCK ; Incomplete set of assignments ;
; JTAG_NEXUS_TMS ; Incomplete set of assignments ;
; JTAG_NEXUS_TDI ; Incomplete set of assignments ;
; SW[0]          ; Incomplete set of assignments ;
; SW_USER0       ; Incomplete set of assignments ;
; SW[1]          ; Incomplete set of assignments ;
; SW[2]          ; Incomplete set of assignments ;
; SW[3]          ; Incomplete set of assignments ;
; SW[4]          ; Incomplete set of assignments ;
; SW[5]          ; Incomplete set of assignments ;
; SW[6]          ; Incomplete set of assignments ;
; SW[7]          ; Incomplete set of assignments ;
; CLK_BRD        ; Incomplete set of assignments ;
; SW_USER1       ; Incomplete set of assignments ;
; SW_USER2       ; Incomplete set of assignments ;
+----------------+-------------------------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Netlist Optimizations                                                                                                                                ;
+---------------+---------+------------------+---------------------+-----------+----------------+------------------+------------------+-----------------------+
; Node          ; Action  ; Operation        ; Reason              ; Node Port ; Node Port Name ; Destination Node ; Destination Port ; Destination Port Name ;
+---------------+---------+------------------+---------------------+-----------+----------------+------------------+------------------+-----------------------+
; INV8B:U7|O[0] ; Deleted ; Register Packing ; Timing optimization ; COMBOUT   ;                ;                  ;                  ;                       ;
; INV8B:U7|O[1] ; Deleted ; Register Packing ; Timing optimization ; COMBOUT   ;                ;                  ;                  ;                       ;
; INV8B:U7|O[2] ; Deleted ; Register Packing ; Timing optimization ; COMBOUT   ;                ;                  ;                  ;                       ;
; INV8B:U7|O[3] ; Deleted ; Register Packing ; Timing optimization ; COMBOUT   ;                ;                  ;                  ;                       ;
; INV8B:U7|O[4] ; Deleted ; Register Packing ; Timing optimization ; COMBOUT   ;                ;                  ;                  ;                       ;
; INV8B:U7|O[5] ; Deleted ; Register Packing ; Timing optimization ; COMBOUT   ;                ;                  ;                  ;                       ;
; INV8B:U7|O[6] ; Deleted ; Register Packing ; Timing optimization ; COMBOUT   ;                ;                  ;                  ;                       ;
; INV8B:U7|O[7] ; Deleted ; Register Packing ; Timing optimization ; COMBOUT   ;                ;                  ;                  ;                       ;
+---------------+---------+------------------+---------------------+-----------+----------------+------------------+------------------+-----------------------+


+----------------------------------------------+
; Incremental Compilation Preservation Summary ;
+---------------------+------------------------+
; Type                ; Value                  ;
+---------------------+------------------------+
; Placement (by node) ;                        ;
;     -- Requested    ; 0 / 1301 ( 0.00 % )    ;
;     -- Achieved     ; 0 / 1301 ( 0.00 % )    ;
;                     ;                        ;
; Routing (by net)    ;                        ;
;     -- Requested    ; 0 / 0 ( 0.00 % )       ;
;     -- Achieved     ; 0 / 0 ( 0.00 % )       ;
+---------------------+------------------------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Incremental Compilation Partition Settings                                                                                                                                             ;
+--------------------------------+----------------+-------------------+-------------------------+------------------------+------------------------------+--------------------------------+
; Partition Name                 ; Partition Type ; Netlist Type Used ; Preservation Level Used ; Netlist Type Requested ; Preservation Level Requested ; Contents                       ;
+--------------------------------+----------------+-------------------+-------------------------+------------------------+------------------------------+--------------------------------+
; Top                            ; User-created   ; Source File       ; N/A                     ; Source File            ; N/A                          ;                                ;
; hard_block:auto_generated_inst ; Auto-generated ; Source File       ; N/A                     ; Source File            ; N/A                          ; hard_block:auto_generated_inst ;
+--------------------------------+----------------+-------------------+-------------------------+------------------------+------------------------------+--------------------------------+


+------------------------------------------------------------------------------------------------------------+
; Incremental Compilation Placement Preservation                                                             ;
+--------------------------------+---------+-------------------+-------------------------+-------------------+
; Partition Name                 ; # Nodes ; # Preserved Nodes ; Preservation Level Used ; Netlist Type Used ;
+--------------------------------+---------+-------------------+-------------------------+-------------------+
; Top                            ; 1293    ; 0                 ; N/A                     ; Source File       ;
; hard_block:auto_generated_inst ; 8       ; 0                 ; N/A                     ; Source File       ;
+--------------------------------+---------+-------------------+-------------------------+-------------------+


+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in P:/users/Wolfgang/Projekte/Altium Nanoboard/EPSON Printer Module/ProjectOutputs/Default - All Constraints/Epson.pin.


+-------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Usage Summary                                                                                                                         ;
+---------------------------------------------+---------------------------------------------------------------------------------------------------------+
; Resource                                    ; Usage                                                                                                   ;
+---------------------------------------------+---------------------------------------------------------------------------------------------------------+
; Total logic elements                        ; 847 / 39,600 ( 2 % )                                                                                    ;
;     -- Combinational with no register       ; 386                                                                                                     ;
;     -- Register only                        ; 203                                                                                                     ;
;     -- Combinational with a register        ; 258                                                                                                     ;
;                                             ;                                                                                                         ;
; Logic element usage by number of LUT inputs ;                                                                                                         ;
;     -- 4 input functions                    ; 214                                                                                                     ;
;     -- 3 input functions                    ; 239                                                                                                     ;
;     -- <=2 input functions                  ; 191                                                                                                     ;
;     -- Register only                        ; 203                                                                                                     ;
;                                             ;                                                                                                         ;
; Logic elements by mode                      ;                                                                                                         ;
;     -- normal mode                          ; 486                                                                                                     ;
;     -- arithmetic mode                      ; 158                                                                                                     ;
;                                             ;                                                                                                         ;
; Total registers*                            ; 461 / 42,205 ( 1 % )                                                                                    ;
;     -- Dedicated logic registers            ; 461 / 39,600 ( 1 % )                                                                                    ;
;     -- I/O registers                        ; 0 / 2,605 ( 0 % )                                                                                       ;
;                                             ;                                                                                                         ;
; Total LABs:  partially or completely used   ; 81 / 2,475 ( 3 % )                                                                                      ;
; User inserted logic elements                ; 0                                                                                                       ;
; Virtual pins                                ; 0                                                                                                       ;
; I/O pins                                    ; 82 / 536 ( 15 % )                                                                                       ;
;     -- Clock pins                           ; 2 / 8 ( 25 % )                                                                                          ;
;     -- Dedicated input pins                 ; 0 / 9 ( 0 % )                                                                                           ;
;                                             ;                                                                                                         ;
; Global signals                              ; 6                                                                                                       ;
; M9Ks                                        ; 4 / 126 ( 3 % )                                                                                         ;
; Total block memory bits                     ; 32,768 / 1,161,216 ( 3 % )                                                                              ;
; Total block memory implementation bits      ; 36,864 / 1,161,216 ( 3 % )                                                                              ;
; Embedded Multiplier 9-bit elements          ; 0 / 252 ( 0 % )                                                                                         ;
; PLLs                                        ; 0 / 4 ( 0 % )                                                                                           ;
; Global clocks                               ; 6 / 20 ( 30 % )                                                                                         ;
; JTAGs                                       ; 0 / 1 ( 0 % )                                                                                           ;
; CRC blocks                                  ; 0 / 1 ( 0 % )                                                                                           ;
; ASMI blocks                                 ; 0 / 1 ( 0 % )                                                                                           ;
; Impedance control blocks                    ; 0 / 4 ( 0 % )                                                                                           ;
; Average interconnect usage (total/H/V)      ; 1% / 0% / 1%                                                                                            ;
; Peak interconnect usage (total/H/V)         ; 6% / 6% / 7%                                                                                            ;
; Maximum fan-out node                        ; JTAG_NEXUS_TCK~inputclkctrl                                                                             ;
; Maximum fan-out                             ; 250                                                                                                     ;
; Highest non-global fan-out signal           ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|up_ireg_3__Z ;
; Highest non-global fan-out                  ; 151                                                                                                     ;
; Total fan-out                               ; 4139                                                                                                    ;
; Average fan-out                             ; 2.92                                                                                                    ;
+---------------------------------------------+---------------------------------------------------------------------------------------------------------+
*  Register count does not include registers inside RAM blocks or DSP blocks.



+----------------------------------------------------------------------------------------------------+
; Fitter Partition Statistics                                                                        ;
+---------------------------------------------+---------------------+--------------------------------+
; Statistic                                   ; Top                 ; hard_block:auto_generated_inst ;
+---------------------------------------------+---------------------+--------------------------------+
; Difficulty Clustering Region                ; Low                 ; Low                            ;
;                                             ;                     ;                                ;
; Total logic elements                        ; 847 / 39600 ( 2 % ) ; 0 / 39600 ( 0 % )              ;
;     -- Combinational with no register       ; 386                 ; 0                              ;
;     -- Register only                        ; 203                 ; 0                              ;
;     -- Combinational with a register        ; 258                 ; 0                              ;
;                                             ;                     ;                                ;
; Logic element usage by number of LUT inputs ;                     ;                                ;
;     -- 4 input functions                    ; 214                 ; 0                              ;
;     -- 3 input functions                    ; 239                 ; 0                              ;
;     -- <=2 input functions                  ; 191                 ; 0                              ;
;     -- Register only                        ; 203                 ; 0                              ;
;                                             ;                     ;                                ;
; Logic elements by mode                      ;                     ;                                ;
;     -- normal mode                          ; 486                 ; 0                              ;
;     -- arithmetic mode                      ; 158                 ; 0                              ;
;                                             ;                     ;                                ;
; Total registers                             ; 461                 ; 0                              ;
;     -- Dedicated logic registers            ; 461 / 39600 ( 1 % ) ; 0 / 39600 ( 0 % )              ;
;     -- I/O registers                        ; 0                   ; 0                              ;
;                                             ;                     ;                                ;
; Total LABs:  partially or completely used   ; 81 / 2475 ( 3 % )   ; 0 / 2475 ( 0 % )               ;
;                                             ;                     ;                                ;
; Virtual pins                                ; 0                   ; 0                              ;
; I/O pins                                    ; 82                  ; 0                              ;
; Embedded Multiplier 9-bit elements          ; 0 / 252 ( 0 % )     ; 0 / 252 ( 0 % )                ;
; Total memory bits                           ; 32768               ; 0                              ;
; Total RAM block bits                        ; 36864               ; 0                              ;
; M9K                                         ; 4 / 126 ( 3 % )     ; 0 / 126 ( 0 % )                ;
; Clock control block                         ; 6 / 24 ( 25 % )     ; 0 / 24 ( 0 % )                 ;
;                                             ;                     ;                                ;
; Connections                                 ;                     ;                                ;
;     -- Input Connections                    ; 0                   ; 0                              ;
;     -- Registered Input Connections         ; 0                   ; 0                              ;
;     -- Output Connections                   ; 0                   ; 0                              ;
;     -- Registered Output Connections        ; 0                   ; 0                              ;
;                                             ;                     ;                                ;
; Internal Connections                        ;                     ;                                ;
;     -- Total Connections                    ; 4137                ; 4                              ;
;     -- Registered Connections               ; 1819                ; 0                              ;
;                                             ;                     ;                                ;
; External Connections                        ;                     ;                                ;
;     -- Top                                  ; 0                   ; 0                              ;
;     -- hard_block:auto_generated_inst       ; 0                   ; 0                              ;
;                                             ;                     ;                                ;
; Partition Interface                         ;                     ;                                ;
;     -- Input Ports                          ; 35                  ; 0                              ;
;     -- Output Ports                         ; 47                  ; 0                              ;
;     -- Bidir Ports                          ; 0                   ; 0                              ;
;                                             ;                     ;                                ;
; Registered Ports                            ;                     ;                                ;
;     -- Registered Input Ports               ; 0                   ; 0                              ;
;     -- Registered Output Ports              ; 0                   ; 0                              ;
;                                             ;                     ;                                ;
; Port Connectivity                           ;                     ;                                ;
;     -- Input Ports driven by GND            ; 0                   ; 0                              ;
;     -- Output Ports driven by GND           ; 0                   ; 0                              ;
;     -- Input Ports driven by VCC            ; 0                   ; 0                              ;
;     -- Output Ports driven by VCC           ; 0                   ; 0                              ;
;     -- Input Ports with no Source           ; 0                   ; 0                              ;
;     -- Output Ports with no Source          ; 0                   ; 0                              ;
;     -- Input Ports with no Fanout           ; 0                   ; 0                              ;
;     -- Output Ports with no Fanout          ; 0                   ; 0                              ;
+---------------------------------------------+---------------------+--------------------------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins                                                                                                                                                                                                                                                                          ;
+----------------+-------+----------+--------------+--------------+--------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+---------------------------+----------------------+
; Name           ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Z coordinate ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination Control Block ; Location assigned by ;
+----------------+-------+----------+--------------+--------------+--------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+---------------------------+----------------------+
; CLK_BRD        ; A14   ; 8        ; 34           ; 43           ; 14           ; 31                    ; 0                  ; yes    ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[10]         ; M5    ; 1        ; 0            ; 28           ; 7            ; 0                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[11]         ; T9    ; 2        ; 0            ; 11           ; 21           ; 0                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[12]         ; L8    ; 1        ; 0            ; 34           ; 21           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[13]         ; M7    ; 1        ; 0            ; 33           ; 14           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[14]         ; L1    ; 1        ; 0            ; 28           ; 0            ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[15]         ; M1    ; 1        ; 0            ; 28           ; 21           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[16]         ; L4    ; 1        ; 0            ; 33           ; 21           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[17]         ; M9    ; 1        ; 0            ; 41           ; 14           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[18]         ; L5    ; 1        ; 0            ; 37           ; 14           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[19]         ; M2    ; 1        ; 0            ; 28           ; 14           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[2]          ; N4    ; 1        ; 0            ; 30           ; 21           ; 0                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[3]          ; R6    ; 2        ; 0            ; 19           ; 7            ; 0                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[4]          ; M8    ; 1        ; 0            ; 33           ; 7            ; 0                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[5]          ; R4    ; 2        ; 0            ; 19           ; 14           ; 0                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[6]          ; M4    ; 1        ; 0            ; 29           ; 7            ; 0                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[7]          ; N3    ; 1        ; 0            ; 29           ; 0            ; 0                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[8]          ; L7    ; 1        ; 0            ; 33           ; 0            ; 0                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; HA[9]          ; R5    ; 2        ; 0            ; 17           ; 0            ; 0                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; JTAG_NEXUS_TCK ; Y27   ; 5        ; 67           ; 22           ; 14           ; 251                   ; 0                  ; yes    ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; JTAG_NEXUS_TDI ; AD21  ; 4        ; 59           ; 0            ; 21           ; 13                    ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; JTAG_NEXUS_TMS ; AE22  ; 4        ; 65           ; 0            ; 21           ; 4                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW[0]          ; AC7   ; 2        ; 0            ; 8            ; 21           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW[1]          ; AC8   ; 3        ; 16           ; 0            ; 0            ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW[2]          ; AE8   ; 3        ; 5            ; 0            ; 21           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW[3]          ; AG8   ; 3        ; 18           ; 0            ; 7            ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW[4]          ; AF10  ; 3        ; 27           ; 0            ; 7            ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW[5]          ; AE10  ; 3        ; 20           ; 0            ; 14           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW[6]          ; AC11  ; 3        ; 1            ; 0            ; 28           ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW[7]          ; AF11  ; 3        ; 27           ; 0            ; 0            ; 1                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW_USER0       ; M3    ; 1        ; 0            ; 30           ; 7            ; 8                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW_USER1       ; W1    ; 2        ; 0            ; 15           ; 21           ; 8                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW_USER2       ; AB1   ; 2        ; 0            ; 15           ; 0            ; 8                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW_USER3       ; AB6   ; 2        ; 0            ; 6            ; 7            ; 9                     ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
; SW_USER4       ; AA3   ; 2        ; 0            ; 6            ; 21           ; 13                    ; 0                  ; no     ; no             ; no            ; yes             ; no       ; Off          ; 2.5 V        ; --                        ; User                 ;
+----------------+-------+----------+--------------+--------------+--------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+---------------------------+----------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins                                                                                                                                                                                                                                                                                                                                                                                                                                                     ;
+----------------+-------+----------+--------------+--------------+--------------+-----------------+------------------------+---------------+-----------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-----------------------------------+---------------------------+----------------------------+-----------------------------+----------------------+----------------------+---------------------+
; Name           ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Z coordinate ; Output Register ; Output Enable Register ; Power Up High ; Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination                       ; Termination Control Block ; Output Buffer Pre-emphasis ; Voltage Output Differential ; Location assigned by ; Output Enable Source ; Output Enable Group ;
+----------------+-------+----------+--------------+--------------+--------------+-----------------+------------------------+---------------+-----------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-----------------------------------+---------------------------+----------------------------+-----------------------------+----------------------+----------------------+---------------------+
; HB[10]         ; R7    ; 2        ; 0            ; 19           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[11]         ; K2    ; 1        ; 0            ; 29           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[12]         ; U6    ; 2        ; 0            ; 13           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[13]         ; P1    ; 1        ; 0            ; 27           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[14]         ; U4    ; 2        ; 0            ; 18           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[15]         ; R1    ; 2        ; 0            ; 20           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[16]         ; V9    ; 2        ; 0            ; 16           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[17]         ; U5    ; 2        ; 0            ; 14           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[18]         ; V5    ; 2        ; 0            ; 13           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[19]         ; AA8   ; 2        ; 0            ; 12           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[2]          ; J4    ; 1        ; 0            ; 32           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[3]          ; L2    ; 1        ; 0            ; 29           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[4]          ; J7    ; 1        ; 0            ; 35           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[5]          ; K7    ; 1        ; 0            ; 34           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[6]          ; J6    ; 1        ; 0            ; 36           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[7]          ; L6    ; 1        ; 0            ; 34           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[8]          ; H4    ; 1        ; 0            ; 39           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; HB[9]          ; K4    ; 1        ; 0            ; 35           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; JTAG_NEXUS_TDO ; AC21  ; 4        ; 59           ; 0            ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[0]       ; AD27  ; 5        ; 67           ; 7            ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[1]       ; AA25  ; 5        ; 67           ; 13           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[2]       ; AB20  ; 4        ; 61           ; 0            ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[3]       ; AB23  ; 5        ; 67           ; 3            ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[4]       ; AD11  ; 3        ; 1            ; 0            ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[5]       ; AD10  ; 3        ; 14           ; 0            ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[6]       ; V4    ; 2        ; 0            ; 17           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_B[7]       ; R3    ; 2        ; 0            ; 19           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[0]       ; AC28  ; 5        ; 67           ; 8            ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[1]       ; AA23  ; 5        ; 67           ; 7            ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[2]       ; AA24  ; 5        ; 67           ; 5            ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[3]       ; AD26  ; 5        ; 67           ; 6            ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[4]       ; AC12  ; 3        ; 9            ; 0            ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[5]       ; AG11  ; 3        ; 29           ; 0            ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[6]       ; T3    ; 2        ; 0            ; 18           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_G[7]       ; U1    ; 2        ; 0            ; 17           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[0]       ; Y22   ; 5        ; 67           ; 5            ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[1]       ; W26   ; 5        ; 67           ; 12           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[2]       ; AB25  ; 5        ; 67           ; 13           ; 21           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[3]       ; AB24  ; 5        ; 67           ; 2            ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[4]       ; Y13   ; 3        ; 16           ; 0            ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[5]       ; AC10  ; 3        ; 11           ; 0            ; 28           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[6]       ; W9    ; 2        ; 0            ; 8            ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; LED_R[7]       ; R2    ; 2        ; 0            ; 20           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; RELAY[0]       ; C7    ; 8        ; 5            ; 43           ; 0            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; RELAY[1]       ; C11   ; 8        ; 9            ; 43           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; RELAY[2]       ; B12   ; 8        ; 29           ; 43           ; 14           ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
; RELAY[3]       ; A12   ; 8        ; 29           ; 43           ; 7            ; no              ; no                     ; no            ; 2         ; no              ; no         ; no            ; no       ; Off          ; 2.5 V        ; Default          ; Series 50 Ohm without Calibration ; --                        ; no                         ; no                          ; User                 ; -                    ; -                   ;
+----------------+-------+----------+--------------+--------------+--------------+-----------------+------------------------+---------------+-----------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-----------------------------------+---------------------------+----------------------------+-----------------------------+----------------------+----------------------+---------------------+


+---------------------------------------------------------------------------------------------------------------------+
; Dual Purpose and Dedicated Pins                                                                                     ;
+----------+------------------------------+---------------------+-------------------------+---------------------------+
; Location ; Pin Name                     ; Reserved As         ; User Signal Name        ; Pin Type                  ;
+----------+------------------------------+---------------------+-------------------------+---------------------------+
; F4       ; DIFFIO_L8n, DATA1, ASDO      ; As input tri-stated ; ~ALTERA_ASDO_DATA1~     ; Dual Purpose Pin          ;
; E2       ; DIFFIO_L10p, FLASH_nCE, nCSO ; As input tri-stated ; ~ALTERA_FLASH_nCE_nCSO~ ; Dual Purpose Pin          ;
; M6       ; nSTATUS                      ; -                   ; -                       ; Dedicated Programming Pin ;
; P3       ; DCLK                         ; As input tri-stated ; ~ALTERA_DCLK~           ; Dual Purpose Pin          ;
; N7       ; DATA0                        ; As input tri-stated ; ~ALTERA_DATA0~          ; Dual Purpose Pin          ;
; P4       ; nCONFIG                      ; -                   ; -                       ; Dedicated Programming Pin ;
; R8       ; nCE                          ; -                   ; -                       ; Dedicated Programming Pin ;
; P24      ; CONF_DONE                    ; -                   ; -                       ; Dedicated Programming Pin ;
; N22      ; MSEL0                        ; -                   ; -                       ; Dedicated Programming Pin ;
; P23      ; MSEL1                        ; -                   ; -                       ; Dedicated Programming Pin ;
; M22      ; MSEL2                        ; -                   ; -                       ; Dedicated Programming Pin ;
; P22      ; MSEL3                        ; -                   ; -                       ; Dedicated Programming Pin ;
; C11      ; DIFFIO_T7n, DATA7            ; Use as regular IO   ; RELAY[1]                ; Dual Purpose Pin          ;
; C7       ; DIFFIO_T4n, DATA10           ; Use as regular IO   ; RELAY[0]                ; Dual Purpose Pin          ;
+----------+------------------------------+---------------------+-------------------------+---------------------------+


+------------------------------------------------------------+
; I/O Bank Usage                                             ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage            ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1        ; 29 / 61 ( 48 % ) ; 2.5V          ; --           ;
; 2        ; 23 / 73 ( 32 % ) ; 2.5V          ; --           ;
; 3        ; 13 / 65 ( 20 % ) ; 2.5V          ; --           ;
; 4        ; 4 / 67 ( 6 % )   ; 2.5V          ; --           ;
; 5        ; 12 / 71 ( 17 % ) ; 2.5V          ; --           ;
; 6        ; 0 / 65 ( 0 % )   ; 2.5V          ; --           ;
; 7        ; 0 / 67 ( 0 % )   ; 2.5V          ; --           ;
; 8        ; 5 / 67 ( 7 % )   ; 2.5V          ; --           ;
+----------+------------------+---------------+--------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins                                                                                                                                                       ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage                           ; Dir.   ; I/O Standard ; Voltage ; I/O Type   ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; A2       ;            ; 8        ; VCCIO8                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; A3       ; 540        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A4       ; 538        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A5       ;            ; 8        ; VCCIO8                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; A6       ; 524        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A7       ; 515        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A8       ; 531        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; A9       ;            ; 8        ; VCCIO8                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; A10      ; 499        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; AB15     ; 208        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AB16     ; 220        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AB17     ; 253        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AB18     ; 246        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AB19     ; 251        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AB20     ; 261        ; 4        ; LED_B[2]                                 ; output ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
; AB21     ; 270        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AB22     ; 274        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AB23     ; 278        ; 5        ; LED_B[3]                                 ; output ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
; AB24     ; 275        ; 5        ; LED_R[3]                                 ; output ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
; AB25     ; 313        ; 5        ; LED_R[2]                                 ; output ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
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; AB28     ; 305        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
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; AC3      ; 113        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AC4      ; 131        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AC5      ; 137        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AC6      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; AC7      ; 120        ; 2        ; SW[0]                                    ; input  ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
; AC8      ; 173        ; 3        ; SW[1]                                    ; input  ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
; AC9      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; AC10     ; 162        ; 3        ; LED_R[5]                                 ; output ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
; AC11     ; 141        ; 3        ; SW[6]                                    ; input  ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
; AC12     ; 160        ; 3        ; LED_G[4]                                 ; output ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
; AC13     ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; AC14     ; 199        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AC15     ; 209        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AC16     ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; AC17     ; 231        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AC18     ; 245        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AC19     ; 250        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AC20     ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; AC21     ; 257        ; 4        ; JTAG_NEXUS_TDO                           ; output ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
; AC22     ; 271        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AC23     ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; AC24     ; 276        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AC25     ; 286        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AC26     ; 293        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AC27     ; 298        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AC28     ; 296        ; 5        ; LED_G[0]                                 ; output ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
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; AD2      ; 114        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AD3      ; 132        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AD4      ; 133        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; AD5      ; 138        ; 2        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
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; AD7      ; 152        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; AD13     ;            ; 3        ; VCCIO3                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
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; AD15     ; 210        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; AF23     ; 267        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AF24     ; 238        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AF25     ; 240        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AF26     ; 258        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; AG1      ;            ; 2        ; VCCIO2                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
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; AG3      ; 149        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; AG4      ; 148        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; AG10     ; 192        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; AG17     ; 215        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; AG21     ; 230        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; K13      ; 492        ; 8        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
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; K15      ; 472        ; 7        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; K16      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; K17      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; K18      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
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; M13      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; M14      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
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; P1       ; 57         ; 1        ; HB[13]                                   ; output ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
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; P7       ; 61         ; 1        ; #TDI                                     ; input  ;              ;         ; --         ;                 ; --       ; --           ;
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; P13      ;            ;          ; VCCINT                                   ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
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; Y10      ; 147        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; Y11      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; Y12      ; 153        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; Y13      ; 171        ; 3        ; LED_R[4]                                 ; output ; 2.5 V        ;         ; Column I/O ; Y               ; no       ; Off          ;
; Y14      ; 175        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; Y15      ; 177        ; 3        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; Y16      ;            ; 4        ; VCCIO4                                   ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; Y17      ; 229        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; Y18      ;            ;          ; GND                                      ; gnd    ;              ;         ; --         ;                 ; --       ; --           ;
; Y19      ; 243        ; 4        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Column I/O ;                 ; no       ; On           ;
; Y20      ;            ;          ; VCCD_PLL4                                ; power  ;              ; 1.2V    ; --         ;                 ; --       ; --           ;
; Y21      ;            ; --       ; VCCA4                                    ; power  ;              ; 2.5V    ; --         ;                 ; --       ; --           ;
; Y22      ; 283        ; 5        ; LED_R[0]                                 ; output ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
; Y23      ; 291        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y24      ; 294        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y25      ; 325        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y26      ; 308        ; 5        ; RESERVED_INPUT_WITH_WEAK_PULLUP          ;        ;              ;         ; Row I/O    ;                 ; no       ; On           ;
; Y27      ; 343        ; 5        ; JTAG_NEXUS_TCK                           ; input  ; 2.5 V        ;         ; Row I/O    ; Y               ; no       ; Off          ;
; Y28      ; 342        ; 5        ; GND+                                     ;        ;              ;         ; Row I/O    ;                 ; --       ; --           ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
Note: Pin directions (input, output or bidir) are based on device operating in user mode.


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity                                                                                                                                                                                                                                                                                                                                                                          ;
+--------------------------------------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+----------------------------------------------------------------------------------------------------------------------------------------+--------------+
; Compilation Hierarchy Node                             ; Logic Cells ; Dedicated Logic Registers ; I/O Registers ; Memory Bits ; M9Ks ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Full Hierarchy Name                                                                                                                    ; Library Name ;
+--------------------------------------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+----------------------------------------------------------------------------------------------------------------------------------------+--------------+
; |Epson                                                 ; 847 (20)    ; 461 (0)                   ; 0 (0)         ; 32768       ; 4    ; 0            ; 0       ; 0         ; 82   ; 0            ; 386 (20)     ; 203 (0)           ; 258 (2)          ; |Epson                                                                                                                                 ;              ;
;    |AND2S:Deb01_U4|                                    ; 1 (1)       ; 0 (0)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 1 (1)        ; 0 (0)             ; 0 (0)            ; |Epson|AND2S:Deb01_U4                                                                                                                  ;              ;
;    |AND2S:Deb02_U4|                                    ; 1 (1)       ; 0 (0)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 1 (1)        ; 0 (0)             ; 0 (0)            ; |Epson|AND2S:Deb02_U4                                                                                                                  ;              ;
;    |ClkDiv500:U902|                                    ; 24 (10)     ; 14 (0)                    ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 10 (10)      ; 0 (0)             ; 14 (1)           ; |Epson|ClkDiv500:U902                                                                                                                  ;              ;
;       |Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT| ; 1 (0)       ; 1 (0)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (0)            ; |Epson|ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT                                                                   ;              ;
;          |lpm_ff:ff1|                                  ; 1 (1)       ; 1 (1)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (1)            ; |Epson|ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1                                                        ;              ;
;       |Epson__AltSyn_AltiumAlteraDffAsync:cnt_0|       ; 1 (0)       ; 1 (0)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (0)            ; |Epson|ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_0                                                                         ;              ;
;          |lpm_ff:ff1|                                  ; 1 (1)       ; 1 (1)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (1)            ; |Epson|ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_0|lpm_ff:ff1                                                              ;              ;
;       |Epson__AltSyn_AltiumAlteraDffAsync:cnt_10|      ; 1 (0)       ; 1 (0)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (0)            ; |Epson|ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_10                                                                        ;              ;
;          |lpm_ff:ff1|                                  ; 1 (1)       ; 1 (1)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (1)            ; |Epson|ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_10|lpm_ff:ff1                                                             ;              ;
;       |Epson__AltSyn_AltiumAlteraDffAsync:cnt_11|      ; 1 (0)       ; 1 (0)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (0)            ; |Epson|ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_11                                                                        ;              ;
;          |lpm_ff:ff1|                                  ; 1 (1)       ; 1 (1)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 1 (1)            ; |Epson|ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_11|lpm_ff:ff1                                                             ;              ;
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;          |LAX_CFG8_DUMP:U_DUMP|                        ; 54 (54)     ; 23 (23)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 30 (30)      ; 9 (9)             ; 15 (15)          ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP                                                                           ;              ;
;          |LAX_CFG8_FSM:U_FSM|                          ; 334 (334)   ; 111 (111)                 ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 187 (187)    ; 17 (17)           ; 130 (130)        ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM                                                                             ;              ;
;          |LAX_CFG8_LA16PORT:U_LA16PORT|                ; 307 (2)     ; 250 (1)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 57 (0)       ; 174 (0)           ; 76 (2)           ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT                                                                   ;              ;
;             |LAX_CFG8_BUFFREG:U_BUFFREG|               ; 9 (9)       ; 8 (8)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 1 (1)        ; 8 (8)             ; 0 (0)            ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_BUFFREG:U_BUFFREG                                        ;              ;
;             |LAX_CFG8_NXMODULE:U_NX_MODULE|            ; 237 (40)    ; 193 (16)                  ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 43 (23)      ; 134 (0)           ; 60 (17)          ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE                                     ;              ;
;                |LAX_CFG8_CFGREG:U_CFGREG|              ; 18 (18)     ; 16 (16)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 2 (2)        ; 16 (16)           ; 0 (0)            ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CFGREG:U_CFGREG            ;              ;
;                |LAX_CFG8_CTRLREG:U_CTRLREG|            ; 7 (7)       ; 5 (5)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 2 (2)        ; 5 (5)             ; 0 (0)            ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CTRLREG:U_CTRLREG          ;              ;
;                |LAX_CFG8_NXCTRLFSM:U_NEXUS_CTRL_FSM|   ; 5 (5)       ; 2 (2)                     ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 3 (3)        ; 0 (0)             ; 2 (2)            ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXCTRLFSM:U_NEXUS_CTRL_FSM ;              ;
;                |LAX_CFG8_NXREGZ0:U_MAGNITREG|          ; 34 (34)     ; 32 (32)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 2 (2)        ; 21 (21)           ; 11 (11)          ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ0:U_MAGNITREG        ;              ;
;                |LAX_CFG8_NXREGZ1:U_CURSORREG|          ; 44 (44)     ; 42 (42)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 2 (2)        ; 29 (29)           ; 13 (13)          ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG        ;              ;
;                |LAX_CFG8_NXREGZ2:U_TRWORDREG|          ; 18 (18)     ; 16 (16)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 1 (1)        ; 11 (11)           ; 6 (6)            ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2:U_TRWORDREG        ;              ;
;                |LAX_CFG8_NXREGZ2_1:U_TRWORD2REG|       ; 18 (18)     ; 16 (16)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 2 (2)        ; 10 (10)           ; 6 (6)            ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_1:U_TRWORD2REG     ;              ;
;                |LAX_CFG8_NXREGZ2_2:U_TRMASKREG|        ; 18 (18)     ; 16 (16)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 2 (2)        ; 16 (16)           ; 0 (0)            ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_2:U_TRMASKREG      ;              ;
;                |LAX_CFG8_NXREGZ2_3:U_ECNTREG|          ; 18 (18)     ; 16 (16)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 2 (2)        ; 14 (14)           ; 2 (2)            ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_3:U_ECNTREG        ;              ;
;                |LAX_CFG8_NXREGZ2_4:U_SELREG|           ; 18 (18)     ; 16 (16)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 2 (2)        ; 12 (12)           ; 4 (4)            ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_4:U_SELREG         ;              ;
;             |LAX_CFG8_TAPCONTROLLER:U_TAP|             ; 61 (29)     ; 48 (16)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 13 (13)      ; 32 (1)            ; 16 (15)          ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP                                      ;              ;
;                |LAX_CFG8_DRNOOUT:id_reg_unit|          ; 32 (32)     ; 32 (32)                   ; 0 (0)         ; 0           ; 0    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 31 (31)           ; 1 (1)            ; |Epson|LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|LAX_CFG8_DRNOOUT:id_reg_unit         ;              ;
;    |memory_u10:U10_U2|                                 ; 0 (0)       ; 0 (0)                     ; 0 (0)         ; 32768       ; 4    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 0 (0)            ; |Epson|memory_u10:U10_U2                                                                                                               ;              ;
;       |altsyncram:altsyncram_component|                ; 0 (0)       ; 0 (0)                     ; 0 (0)         ; 32768       ; 4    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 0 (0)            ; |Epson|memory_u10:U10_U2|altsyncram:altsyncram_component                                                                               ;              ;
;          |altsyncram_h681:auto_generated|              ; 0 (0)       ; 0 (0)                     ; 0 (0)         ; 32768       ; 4    ; 0            ; 0       ; 0         ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 0 (0)            ; |Epson|memory_u10:U10_U2|altsyncram:altsyncram_component|altsyncram_h681:auto_generated                                                ;              ;
+--------------------------------------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+----------------------------------------------------------------------------------------------------------------------------------------+--------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.


+------------------------------------------------------------------------------------------------+
; Delay Chain Summary                                                                            ;
+----------------+----------+---------------+---------------+-----------------------+-----+------+
; Name           ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ; TCOE ;
+----------------+----------+---------------+---------------+-----------------------+-----+------+
; HA[2]          ; Input    ; --            ; --            ; --                    ; --  ; --   ;
; HA[3]          ; Input    ; --            ; --            ; --                    ; --  ; --   ;
; HA[4]          ; Input    ; --            ; --            ; --                    ; --  ; --   ;
; HA[5]          ; Input    ; --            ; --            ; --                    ; --  ; --   ;
; HA[6]          ; Input    ; --            ; --            ; --                    ; --  ; --   ;
; HA[7]          ; Input    ; --            ; --            ; --                    ; --  ; --   ;
; HA[8]          ; Input    ; --            ; --            ; --                    ; --  ; --   ;
; HA[9]          ; Input    ; --            ; --            ; --                    ; --  ; --   ;
; HA[10]         ; Input    ; --            ; --            ; --                    ; --  ; --   ;
; HA[11]         ; Input    ; --            ; --            ; --                    ; --  ; --   ;
; HB[2]          ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[3]          ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[4]          ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[5]          ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[6]          ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[7]          ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[8]          ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[9]          ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[10]         ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[11]         ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[12]         ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[13]         ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[14]         ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[15]         ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[16]         ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[17]         ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[18]         ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; HB[19]         ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; JTAG_NEXUS_TDO ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[0]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[1]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[2]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[3]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[4]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[5]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[6]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_B[7]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[0]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[1]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[2]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[3]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[4]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[5]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[6]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_G[7]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[0]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[1]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[2]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[3]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[4]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[5]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[6]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; LED_R[7]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; RELAY[0]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; RELAY[1]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; RELAY[2]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; RELAY[3]       ; Output   ; --            ; --            ; --                    ; --  ; --   ;
; SW_USER4       ; Input    ; (0) 0 ps      ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SW_USER3       ; Input    ; (0) 0 ps      ; (3) 742 ps    ; --                    ; --  ; --   ;
; HA[12]         ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; HA[13]         ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; HA[14]         ; Input    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; HA[15]         ; Input    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; HA[16]         ; Input    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; HA[17]         ; Input    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; HA[18]         ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; HA[19]         ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; JTAG_NEXUS_TCK ; Input    ; (0) 0 ps      ; --            ; --                    ; --  ; --   ;
; JTAG_NEXUS_TMS ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; JTAG_NEXUS_TDI ; Input    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SW[0]          ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SW_USER0       ; Input    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SW[1]          ; Input    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SW[2]          ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SW[3]          ; Input    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SW[4]          ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SW[5]          ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SW[6]          ; Input    ; --            ; (6) 1314 ps   ; --                    ; --  ; --   ;
; SW[7]          ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; CLK_BRD        ; Input    ; (0) 0 ps      ; --            ; --                    ; --  ; --   ;
; SW_USER1       ; Input    ; (6) 1314 ps   ; --            ; --                    ; --  ; --   ;
; SW_USER2       ; Input    ; --            ; (0) 0 ps      ; --                    ; --  ; --   ;
+----------------+----------+---------------+---------------+-----------------------+-----+------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Pad To Core Delay Chain Fanout                                                                                                                                               ;
+------------------------------------------------------------------------------------------------------------------------------------------------+-------------------+---------+
; Source Pin / Fanout                                                                                                                            ; Pad To Core Index ; Setting ;
+------------------------------------------------------------------------------------------------------------------------------------------------+-------------------+---------+
; HA[2]                                                                                                                                          ;                   ;         ;
; HA[3]                                                                                                                                          ;                   ;         ;
; HA[4]                                                                                                                                          ;                   ;         ;
; HA[5]                                                                                                                                          ;                   ;         ;
; HA[6]                                                                                                                                          ;                   ;         ;
; HA[7]                                                                                                                                          ;                   ;         ;
; HA[8]                                                                                                                                          ;                   ;         ;
; HA[9]                                                                                                                                          ;                   ;         ;
; HA[10]                                                                                                                                         ;                   ;         ;
; HA[11]                                                                                                                                         ;                   ;         ;
; SW_USER4                                                                                                                                       ;                   ;         ;
;      - AND2S:Deb01_U4|O_x                                                                                                                      ; 0                 ; 0       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|state_nxt_2_sqmuxa_1_1_cZ                                                           ; 0                 ; 0       ;
;      - Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                                               ; 0                 ; 0       ;
;      - Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_1|lpm_ff:ff1|dffs[0]                                               ; 0                 ; 0       ;
;      - Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_2|lpm_ff:ff1|dffs[0]                                               ; 0                 ; 0       ;
;      - Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_3|lpm_ff:ff1|dffs[0]                                               ; 0                 ; 0       ;
;      - Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_4|lpm_ff:ff1|dffs[0]                                               ; 0                 ; 0       ;
;      - Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_5|lpm_ff:ff1|dffs[0]                                               ; 0                 ; 0       ;
;      - Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]                                               ; 0                 ; 0       ;
;      - LED_B_4                                                                                                                                 ; 1                 ; 6       ;
;      - Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]                                               ; 0                 ; 0       ;
;      - SW_USER4~_wirecell                                                                                                                      ; 0                 ; 0       ;
;      - HB[2]~output                                                                                                                            ; 1                 ; 6       ;
; SW_USER3                                                                                                                                       ;                   ;         ;
;      - AND2S:Deb02_U4|O_x                                                                                                                      ; 1                 ; 3       ;
;      - Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                                               ; 0                 ; 0       ;
;      - Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_1|lpm_ff:ff1|dffs[0]                                               ; 1                 ; 3       ;
;      - Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_2|lpm_ff:ff1|dffs[0]                                               ; 1                 ; 3       ;
;      - Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_3|lpm_ff:ff1|dffs[0]                                               ; 1                 ; 3       ;
;      - Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_4|lpm_ff:ff1|dffs[0]                                               ; 1                 ; 3       ;
;      - Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_5|lpm_ff:ff1|dffs[0]                                               ; 1                 ; 3       ;
;      - Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]                                               ; 1                 ; 3       ;
;      - Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]                                               ; 1                 ; 3       ;
; HA[12]                                                                                                                                         ;                   ;         ;
;      - LED_G_0                                                                                                                                 ; 0                 ; 6       ;
; HA[13]                                                                                                                                         ;                   ;         ;
;      - LED_G_1                                                                                                                                 ; 0                 ; 6       ;
; HA[14]                                                                                                                                         ;                   ;         ;
;      - LED_G_2                                                                                                                                 ; 1                 ; 6       ;
; HA[15]                                                                                                                                         ;                   ;         ;
;      - LED_G_3                                                                                                                                 ; 1                 ; 6       ;
; HA[16]                                                                                                                                         ;                   ;         ;
;      - LED_G_4                                                                                                                                 ; 1                 ; 6       ;
; HA[17]                                                                                                                                         ;                   ;         ;
;      - LED_G_5                                                                                                                                 ; 1                 ; 6       ;
; HA[18]                                                                                                                                         ;                   ;         ;
;      - LED_G_6                                                                                                                                 ; 0                 ; 6       ;
; HA[19]                                                                                                                                         ;                   ;         ;
;      - LED_G_7                                                                                                                                 ; 0                 ; 6       ;
; JTAG_NEXUS_TCK                                                                                                                                 ;                   ;         ;
; JTAG_NEXUS_TMS                                                                                                                                 ;                   ;         ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|tapstate_r_i_3__Z                            ; 0                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|tapstate_r_i_2__Z                            ; 0                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|tapstate_r_i_1__Z                            ; 0                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|tapstate_r_i_0__Z                            ; 0                 ; 6       ;
; JTAG_NEXUS_TDI                                                                                                                                 ;                   ;         ;
;      - LAX_CFG8:U10_U1|N_1774_a2_x_cZ                                                                                                          ; 1                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|G_27_x_cZ                                   ; 1                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|ir_shift_process_sh_ireg_3_x_3_              ; 1                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_BUFFREG:U_BUFFREG|sh_reg_7__Z                                    ; 1                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_4:U_SELREG|sh_reg_7__Z     ; 1                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ0:U_MAGNITREG|sh_reg_15__Z   ; 1                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_3:U_ECNTREG|sh_reg_7__Z    ; 1                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|sh_reg_20__Z   ; 1                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_2:U_TRMASKREG|sh_reg_7__Z  ; 1                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_1:U_TRWORD2REG|sh_reg_7__Z ; 1                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2:U_TRWORDREG|sh_reg_7__Z    ; 1                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CTRLREG:U_CTRLREG|sh_reg_2__Z      ; 1                 ; 6       ;
;      - LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CFGREG:U_CFGREG|sh_reg_7__Z        ; 1                 ; 6       ;
; SW[0]                                                                                                                                          ;                   ;         ;
;      - INV8B:U6|I_1_x                                                                                                                          ; 0                 ; 6       ;
; SW_USER0                                                                                                                                       ;                   ;         ;
;      - Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]                                                     ; 1                 ; 6       ;
;      - Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_1|lpm_ff:ff1|dffs[0]                                                     ; 1                 ; 6       ;
;      - Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_2|lpm_ff:ff1|dffs[0]                                                     ; 1                 ; 6       ;
;      - Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_3|lpm_ff:ff1|dffs[0]                                                     ; 1                 ; 6       ;
;      - Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_4|lpm_ff:ff1|dffs[0]                                                     ; 1                 ; 6       ;
;      - Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_5|lpm_ff:ff1|dffs[0]                                                     ; 1                 ; 6       ;
;      - Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]                                                     ; 1                 ; 6       ;
;      - Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                                                     ; 1                 ; 6       ;
; SW[1]                                                                                                                                          ;                   ;         ;
;      - INV8B:U6|I_2_x                                                                                                                          ; 1                 ; 6       ;
; SW[2]                                                                                                                                          ;                   ;         ;
;      - INV8B:U6|I_3_x                                                                                                                          ; 0                 ; 6       ;
; SW[3]                                                                                                                                          ;                   ;         ;
;      - INV8B:U6|I_4_x                                                                                                                          ; 1                 ; 6       ;
; SW[4]                                                                                                                                          ;                   ;         ;
;      - INV8B:U6|I_5_x                                                                                                                          ; 0                 ; 6       ;
; SW[5]                                                                                                                                          ;                   ;         ;
;      - INV8B:U6|I_6_x                                                                                                                          ; 0                 ; 6       ;
; SW[6]                                                                                                                                          ;                   ;         ;
;      - INV8B:U6|I_7_x                                                                                                                          ; 1                 ; 6       ;
; SW[7]                                                                                                                                          ;                   ;         ;
;      - INV8B:U6|I_8_x                                                                                                                          ; 0                 ; 6       ;
; CLK_BRD                                                                                                                                        ;                   ;         ;
; SW_USER1                                                                                                                                       ;                   ;         ;
;      - Configurable_U12:LED_Brightness_U12|n2r~0                                                                                               ; 0                 ; 6       ;
;      - Configurable_U12:LED_Brightness_U12|n2i~0                                                                                               ; 0                 ; 6       ;
;      - Configurable_U12:LED_Brightness_U12|n2o~0                                                                                               ; 0                 ; 6       ;
;      - Configurable_U12:LED_Brightness_U12|n3d                                                                                                 ; 0                 ; 6       ;
;      - Configurable_U12:LED_Brightness_U12|Q_7_in~0                                                                                            ; 0                 ; 6       ;
;      - Configurable_U12:LED_Brightness_U12|n3a~0                                                                                               ; 0                 ; 6       ;
;      - Configurable_U12:LED_Brightness_U12|n2x~0                                                                                               ; 0                 ; 6       ;
;      - Configurable_U12:LED_Brightness_U12|n2u~0                                                                                               ; 0                 ; 6       ;
; SW_USER2                                                                                                                                       ;                   ;         ;
;      - Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]                                    ; 1                 ; 0       ;
;      - Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_1|lpm_ff:ff1|dffs[0]                                    ; 1                 ; 0       ;
;      - Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_2|lpm_ff:ff1|dffs[0]                                    ; 1                 ; 0       ;
;      - Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_3|lpm_ff:ff1|dffs[0]                                    ; 1                 ; 0       ;
;      - Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_4|lpm_ff:ff1|dffs[0]                                    ; 1                 ; 0       ;
;      - Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_5|lpm_ff:ff1|dffs[0]                                    ; 1                 ; 0       ;
;      - Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]                                    ; 1                 ; 0       ;
;      - Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                                    ; 1                 ; 0       ;
+------------------------------------------------------------------------------------------------------------------------------------------------+-------------------+---------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Control Signals                                                                                                                                                                                                                                                                     ;
+-------------------------------------------------------------------------------------------------------------------------------------------+--------------------+---------+---------------------------+--------+----------------------+------------------+---------------------------+
; Name                                                                                                                                      ; Location           ; Fan-Out ; Usage                     ; Global ; Global Resource Used ; Global Line Name ; Enable Signal Source Name ;
+-------------------------------------------------------------------------------------------------------------------------------------------+--------------------+---------+---------------------------+--------+----------------------+------------------+---------------------------+
; AND2S:Deb01_U4|O                                                                                                                          ; LCCOMB_X25_Y23_N28 ; 12      ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; AND2S:Deb01_U4|O                                                                                                                          ; LCCOMB_X25_Y23_N28 ; 8       ; Clock                     ; yes    ; Global Clock         ; GCLK1            ; --                        ;
; AND2S:Deb02_U4|O                                                                                                                          ; LCCOMB_X1_Y6_N0    ; 18      ; Clock enable, Sync. load  ; no     ; --                   ; --               ; --                        ;
; AND2S:Deb02_U4|O                                                                                                                          ; LCCOMB_X1_Y6_N0    ; 9       ; Clock                     ; yes    ; Global Clock         ; GCLK3            ; --                        ;
; CLK_BRD                                                                                                                                   ; PIN_A14            ; 31      ; Clock                     ; yes    ; Global Clock         ; GCLK14           ; --                        ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0]                                                          ; FF_X18_Y35_N5      ; 143     ; Clock                     ; yes    ; Global Clock         ; GCLK11           ; --                        ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0]                                                             ; FF_X25_Y23_N25     ; 14      ; Clock                     ; yes    ; Global Clock         ; GCLK2            ; --                        ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0]                                                             ; FF_X25_Y23_N25     ; 4       ; Clock                     ; no     ; --                   ; --               ; --                        ;
; Configurable_U11:LED_Brightness_U11|n47                                                                                                   ; LCCOMB_X3_Y15_N12  ; 7       ; Sync. clear               ; no     ; --                   ; --               ; --                        ;
; Configurable_U2:Deb01_U2|s_or8:n1l|OUT                                                                                                    ; LCCOMB_X26_Y23_N20 ; 7       ; Sync. clear               ; no     ; --                   ; --               ; --                        ;
; Configurable_U2:Deb02_U2|s_or8:n1l|OUT                                                                                                    ; LCCOMB_X2_Y6_N24   ; 7       ; Sync. clear               ; no     ; --                   ; --               ; --                        ;
; JTAG_NEXUS_TCK                                                                                                                            ; PIN_Y27            ; 250     ; Clock                     ; yes    ; Global Clock         ; GCLK9            ; --                        ;
; JTAG_NEXUS_TMS                                                                                                                            ; PIN_AE22           ; 4       ; Sync. load                ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrdaddr_scalar                                                                    ; LCCOMB_X39_Y20_N8  ; 12      ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrw_x                                                                             ; LCCOMB_X37_Y22_N6  ; 4       ; Write enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|startcap_s_1_i_a3                                                                   ; LCCOMB_X38_Y20_N22 ; 11      ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|bf_2_sqmuxa                                                                           ; LCCOMB_X38_Y20_N26 ; 1       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|capturecnt_scalar                                                                     ; LCCOMB_X37_Y21_N26 ; 21      ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|channels_shadow2_scalar                                                               ; LCCOMB_X36_Y24_N18 ; 4       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_1_sqmuxa                                                                 ; LCCOMB_X39_Y23_N2  ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_2_sqmuxa                                                                      ; LCCOMB_X37_Y24_N28 ; 42      ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memdata_2_sqmuxa                                                                      ; LCCOMB_X38_Y25_N14 ; 4       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|rst_Z                                                                                 ; FF_X39_Y24_N29     ; 100     ; Clock enable, Sync. clear ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1                                                                            ; LCCOMB_X38_Y25_N30 ; 12      ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|state_nxt_2_sqmuxa_2                                                                  ; LCCOMB_X38_Y23_N0  ; 2       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|tmp_2                                                                                 ; LCCOMB_X39_Y24_N30 ; 1       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_rst_1                                                                             ; LCCOMB_X39_Y24_N18 ; 24      ; Sync. clear               ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_BUFFREG:U_BUFFREG|sh_reg_scalar                                    ; LCCOMB_X38_Y22_N2  ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CFGREG:U_CFGREG|un1_update           ; LCCOMB_X35_Y18_N26 ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CFGREG:U_CFGREG|un2_enable           ; LCCOMB_X36_Y18_N8  ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2:U_TRWORDREG|sh_reg_scalar    ; LCCOMB_X34_Y21_N28 ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2:U_TRWORDREG|up_reg           ; LCCOMB_X34_Y24_N30 ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_1:U_TRWORD2REG|sh_reg_scalar ; LCCOMB_X35_Y21_N24 ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_1:U_TRWORD2REG|up_reg        ; LCCOMB_X34_Y24_N0  ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_2:U_TRMASKREG|sh_reg_scalar  ; LCCOMB_X33_Y23_N12 ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_2:U_TRMASKREG|up_reg         ; LCCOMB_X33_Y23_N2  ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_3:U_ECNTREG|sh_reg_scalar    ; LCCOMB_X34_Y22_N6  ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_3:U_ECNTREG|up_reg           ; LCCOMB_X34_Y22_N24 ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_4:U_SELREG|sh_reg_scalar     ; LCCOMB_X38_Y25_N24 ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_4:U_SELREG|up_reg            ; LCCOMB_X36_Y23_N30 ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|sh_reg_r                                      ; LCCOMB_X34_Y21_N12 ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|up_reg_r_scalar                               ; LCCOMB_X33_Y22_N2  ; 8       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|reset_r_Z                                      ; FF_X36_Y22_N7      ; 4       ; Async. clear              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|shiftdr_r_Z                                    ; FF_X36_Y22_N27     ; 136     ; Sync. clear, Sync. load   ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|un19_tapstate_r                                ; LCCOMB_X36_Y22_N10 ; 12      ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|un26_tms                                       ; LCCOMB_X36_Y22_N2  ; 4       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|un2_ins                                        ; LCCOMB_X36_Y22_N30 ; 33      ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|un31_tapstate_r                                ; LCCOMB_X36_Y22_N16 ; 4       ; Clock enable              ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|up_ireg_3__Z                                   ; FF_X37_Y22_N13     ; 151     ; Sync. clear               ; no     ; --                   ; --               ; --                        ;
; LAX_CFG8:U10_U1|N_1231_i_a4_0                                                                                                             ; LCCOMB_X37_Y22_N0  ; 103     ; Async. clear, Sync. clear ; no     ; --                   ; --               ; --                        ;
; SW_USER0                                                                                                                                  ; PIN_M3             ; 8       ; Async. clear              ; no     ; --                   ; --               ; --                        ;
; SW_USER2                                                                                                                                  ; PIN_AB1            ; 8       ; Clock                     ; no     ; --                   ; --               ; --                        ;
; SW_USER3                                                                                                                                  ; PIN_AB6            ; 9       ; Async. clear              ; no     ; --                   ; --               ; --                        ;
; SW_USER4                                                                                                                                  ; PIN_AA3            ; 13      ; Async. clear              ; no     ; --                   ; --               ; --                        ;
+-------------------------------------------------------------------------------------------------------------------------------------------+--------------------+---------+---------------------------+--------+----------------------+------------------+---------------------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Global & Other Fast Signals                                                                                                                                                                                                  ;
+----------------------------------------------------------------------------------+--------------------+---------+--------------------------------------+----------------------+------------------+---------------------------+
; Name                                                                             ; Location           ; Fan-Out ; Fan-Out Using Intentional Clock Skew ; Global Resource Used ; Global Line Name ; Enable Signal Source Name ;
+----------------------------------------------------------------------------------+--------------------+---------+--------------------------------------+----------------------+------------------+---------------------------+
; AND2S:Deb01_U4|O                                                                 ; LCCOMB_X25_Y23_N28 ; 8       ; 0                                    ; Global Clock         ; GCLK1            ; --                        ;
; AND2S:Deb02_U4|O                                                                 ; LCCOMB_X1_Y6_N0    ; 9       ; 0                                    ; Global Clock         ; GCLK3            ; --                        ;
; CLK_BRD                                                                          ; PIN_A14            ; 31      ; 2                                    ; Global Clock         ; GCLK14           ; --                        ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0] ; FF_X18_Y35_N5      ; 143     ; 0                                    ; Global Clock         ; GCLK11           ; --                        ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0]    ; FF_X25_Y23_N25     ; 14      ; 0                                    ; Global Clock         ; GCLK2            ; --                        ;
; JTAG_NEXUS_TCK                                                                   ; PIN_Y27            ; 250     ; 16                                   ; Global Clock         ; GCLK9            ; --                        ;
+----------------------------------------------------------------------------------+--------------------+---------+--------------------------------------+----------------------+------------------+---------------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals                                                                                                                                 ;
+-------------------------------------------------------------------------------------------------------------------------------------------------------+---------+
; Name                                                                                                                                                  ; Fan-Out ;
+-------------------------------------------------------------------------------------------------------------------------------------------------------+---------+
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|up_ireg_3__Z                                               ; 151     ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|shiftdr_r_Z                                                ; 136     ;
; LAX_CFG8:U10_U1|N_1231_i_a4_0                                                                                                                         ; 103     ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|rst_Z                                                                                             ; 100     ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_2_sqmuxa                                                                                  ; 42      ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|dstate_1__Z                                                                                     ; 39      ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|un2_ins                                                    ; 33      ;
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; Configurable_U11:LED_Brightness_U11|n47                                                                                                               ; 7       ;
; Configurable_U12:LED_Brightness_U12|n12~1                                                                                                             ; 7       ;
; Configurable_U12:LED_Brightness_U12|n12~0                                                                                                             ; 7       ;
; Configurable_U9:U9|s_or8:n1l|OUT~1                                                                                                                    ; 7       ;
; Configurable_U9:U9|s_or8:n1l|OUT~0                                                                                                                    ; 7       ;
; Configurable_U2:Deb02_U2|s_or8:n1l|OUT                                                                                                                ; 7       ;
; Configurable_U2:Deb01_U2|s_or8:n1l|OUT                                                                                                                ; 7       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|G_15                                                                                              ; 7       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ0:U_MAGNITREG|up_reg_3__Z                  ; 7       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ0:U_MAGNITREG|up_reg_7__Z                  ; 7       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ0:U_MAGNITREG|up_reg_9__Z                  ; 7       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2:U_TRWORDREG|up_reg_3__Z                  ; 7       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|startcap_s_Z                                                                                    ; 7       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2:U_TRWORDREG|up_reg_2__Z                  ; 7       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2:U_TRWORDREG|up_reg_0__Z                  ; 7       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|state_nxt_1__Z                                                                                    ; 6       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CFGREG:U_CFGREG|up_reg_0__Z                      ; 6       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|up_reg_r_2__Z                                             ; 6       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m3                                                                                                ; 6       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_0__Z                                                                                      ; 6       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|up_reg_0__Z                  ; 6       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|G_23                                                      ; 6       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|G_22                                                      ; 6       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|cursormask_0__Z                                                                                   ; 5       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|state_nxt_0__Z                                                                                    ; 5       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|state_nxt36                                                                                       ; 5       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|up_reg_2__Z                  ; 5       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_10__Z                                                                                     ; 5       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4__Z                                                                                      ; 5       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_3__Z                                                                                      ; 5       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_2__Z                                                                                      ; 5       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_1__Z                                                                                      ; 5       ;
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; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_12|lpm_ff:ff1|dffs[0]                                                                           ; 5       ;
; Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]                                                                   ; 5       ;
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; JTAG_NEXUS_TMS~input                                                                                                                                  ; 4       ;
; ~GND                                                                                                                                                  ; 4       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrdaddr_0__Z                                                                                  ; 4       ;
; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:I_0|lpm_ff:ff1|dffs[0]                                                         ; 4       ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_4|lpm_ff:ff1|dffs[0]                                                  ; 4       ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_5|lpm_ff:ff1|dffs[0]                                                  ; 4       ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]                                                  ; 4       ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                                                  ; 4       ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_1|lpm_ff:ff1|dffs[0]                                                  ; 4       ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_2|lpm_ff:ff1|dffs[0]                                                  ; 4       ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_3|lpm_ff:ff1|dffs[0]                                                  ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|reset_r_Z                                                  ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|shiftir_r_Z                                                ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXCTRLFSM:U_NEXUS_CTRL_FSM|nxcfsm_r_0__Z         ; 4       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m2                                                                                                ; 4       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startcap_ff1_3                                                                                    ; 4       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|cursormask_6__Z                                                                                   ; 4       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|cursormask_11__Z                                                                                  ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|up_reg_11__Z                 ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|up_reg_18__Z                 ; 4       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memaddr_x_10                                                                                    ; 4       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memaddr_x_7                                                                                     ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memaddr_x_6                                                                                     ; 4       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memaddr_x_3                                                                                     ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memaddr_x_2                                                                                     ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memaddr_x_1                                                                                     ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memaddr_x_0                                                                                     ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrw_x                                                                                         ; 4       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_10|lpm_ff:ff1|dffs[0]                                                                           ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|up_reg_1__Z                  ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|G_24                                                      ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|G_8                                                       ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|G_7                                                       ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|G_4                                                        ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|un26_tms                                                   ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|un31_tapstate_r                                            ; 4       ;
; Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_3|lpm_ff:ff1|dffs[0]                                                                   ; 4       ;
; Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_2|lpm_ff:ff1|dffs[0]                                                                   ; 4       ;
; Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_1|lpm_ff:ff1|dffs[0]                                                                   ; 4       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CTRLREG:U_CTRLREG|up_reg_0__Z                    ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrdaddr_10__Z                                                                                 ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrdaddr_9__Z                                                                                  ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrdaddr_8__Z                                                                                  ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrdaddr_7__Z                                                                                  ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrdaddr_6__Z                                                                                  ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrdaddr_5__Z                                                                                  ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrdaddr_4__Z                                                                                  ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrdaddr_3__Z                                                                                  ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrdaddr_2__Z                                                                                  ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrdaddr_1__Z                                                                                  ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|clken_ff_Z                                                                                                           ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|tck2_Z                                                                                                               ; 3       ;
; Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]                                                             ; 3       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0]                                                                      ; 3       ;
; Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]                                                             ; 3       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0]                                                                         ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|condtrue_magnit_sel2_3_5                                                                          ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m14                                                                                               ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|condtrue_magnit_sel1_ee_3_7                                                                       ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_1:U_TRWORD2REG|up_reg_3__Z               ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ0:U_MAGNITREG|up_reg_6__Z                  ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_2:U_TRMASKREG|up_reg_4__Z                ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_2:U_TRMASKREG|up_reg_5__Z                ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_2:U_TRMASKREG|up_reg_6__Z                ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_2:U_TRMASKREG|up_reg_7__Z                ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_2:U_TRMASKREG|up_reg_3__Z                ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un11_every_edge                                                                                   ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|up_reg_20__Z                 ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un36_curevcnt_nxt                                                                                 ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|up_reg_19__Z                 ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|up_reg_17__Z                 ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|up_reg_15__Z                 ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_2:U_TRMASKREG|up_reg_2__Z                ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_1:U_TRWORD2REG|up_reg_2__Z               ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_11__Z                                                                                     ; 3       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_6|lpm_ff:ff1|dffs[0]                                                                            ; 3       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_8|lpm_ff:ff1|dffs[0]                                                                            ; 3       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_7|lpm_ff:ff1|dffs[0]                                                                            ; 3       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_5|lpm_ff:ff1|dffs[0]                                                                            ; 3       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_4|lpm_ff:ff1|dffs[0]                                                                            ; 3       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_3|lpm_ff:ff1|dffs[0]                                                                            ; 3       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_9|lpm_ff:ff1|dffs[0]                                                                            ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_2:U_TRMASKREG|up_reg_1__Z                ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_1:U_TRWORD2REG|up_reg_1__Z               ; 3       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_14|lpm_ff:ff1|dffs[0]                                                                              ; 3       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_13|lpm_ff:ff1|dffs[0]                                                                              ; 3       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_12|lpm_ff:ff1|dffs[0]                                                                              ; 3       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_11|lpm_ff:ff1|dffs[0]                                                                              ; 3       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_10|lpm_ff:ff1|dffs[0]                                                                              ; 3       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_9|lpm_ff:ff1|dffs[0]                                                                               ; 3       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_5|lpm_ff:ff1|dffs[0]                                                                               ; 3       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_4|lpm_ff:ff1|dffs[0]                                                                               ; 3       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_6|lpm_ff:ff1|dffs[0]                                                                               ; 3       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_8|lpm_ff:ff1|dffs[0]                                                                               ; 3       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_7|lpm_ff:ff1|dffs[0]                                                                               ; 3       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_15|lpm_ff:ff1|dffs[0]                                                                              ; 3       ;
; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:I_1|lpm_ff:ff1|dffs[0]                                                         ; 3       ;
; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:I_2|lpm_ff:ff1|dffs[0]                                                         ; 3       ;
; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:I_3|lpm_ff:ff1|dffs[0]                                                         ; 3       ;
; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:I_4|lpm_ff:ff1|dffs[0]                                                         ; 3       ;
; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:I_5|lpm_ff:ff1|dffs[0]                                                         ; 3       ;
; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:I_6|lpm_ff:ff1|dffs[0]                                                         ; 3       ;
; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:I_7|lpm_ff:ff1|dffs[0]                                                         ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CTRLREG:U_CTRLREG|un2_enable                     ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_2:U_TRMASKREG|up_reg_0__Z                ; 3       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_1:U_TRWORD2REG|up_reg_0__Z               ; 3       ;
; Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                                                                   ; 3       ;
; Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]                                                                   ; 3       ;
; Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_5|lpm_ff:ff1|dffs[0]                                                                   ; 3       ;
; Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_4|lpm_ff:ff1|dffs[0]                                                                   ; 3       ;
; Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                                                             ; 3       ;
; Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                                                             ; 3       ;
; ClkDiv500:U902|n32~1                                                                                                                                  ; 2       ;
; ClkDiv500:U902|n2a~4                                                                                                                                  ; 2       ;
; ClkDiv500:U902|n2a~3                                                                                                                                  ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_1__Z                                                                                 ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_0__Z                                                                                 ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_3__Z                                                                                 ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_2__Z                                                                                 ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_4__Z                                                                                 ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_5__Z                                                                                 ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_7__Z                                                                                 ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_6__Z                                                                                 ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|bf_Z                                                                                              ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|memrdaddr_11__Z                                                                                 ; 2       ;
; ClkDiv:U901|n38                                                                                                                                       ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|clken_ff1_Z                                                                                                          ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|tck3_Z                                                                                                               ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|sh_reg_r_4__Z                                             ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|sh_reg_r_7__Z                                             ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|sh_reg_r_6__Z                                             ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|sh_reg_r_5__Z                                             ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|sh_reg_r_1__Z                                             ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|sh_reg_r_3__Z                                             ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|sh_reg_r_2__Z                                             ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|sh_ireg_3__Z                                               ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|sh_ireg_2__Z                                               ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|sh_ireg_1__Z                                               ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|sh_reg_r_0__Z                                             ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|up_reg_r_4__Z                                             ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|up_reg_r_7__Z                                             ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|up_reg_r_6__Z                                             ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|up_reg_r_5__Z                                             ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|sh_ireg_0__Z                                               ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_1:U_TRWORD2REG|sh_reg_7__Z               ; 2       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|channels_shadow2_3__Z                                                                             ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ0:U_MAGNITREG|sh_reg_15__Z                 ; 2       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_1:U_TRWORD2REG|sh_reg_6__Z               ; 2       ;
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; SW_USER4~_wirecell                                                                                                                                    ; 1       ;
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; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_0|lpm_ff:ff1|dffs[0]~0                                                                             ; 1       ;
; Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]~0                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|rst_Z~0                                                                                           ; 1       ;
; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:I_0|lpm_ff:ff1|dffs[0]~0                                                       ; 1       ;
; Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]~0                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|up_ireg_i_0__Z~0                                           ; 1       ;
; ClkDiv500:U902|n2a~5                                                                                                                                  ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|LAX_CFG8_DRNOOUT:id_reg_unit|sh_reg_31__Z                  ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startcap_ff1_Z                                                                                    ; 1       ;
; ClkDiv500:U902|n31~0                                                                                                                                  ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_0|lpm_ff:ff1|dffs[0]                                                                            ; 1       ;
; ClkDiv500:U902|n2a~2                                                                                                                                  ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|tck1_Z                                                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memrw_i_Z                                                                                         ; 1       ;
; ClkDiv:U901|n37                                                                                                                                       ; 1       ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:cnt_0|lpm_ff:ff1|dffs[0]                                                                               ; 1       ;
; ClkDiv:U901|n2b~1                                                                                                                                     ; 1       ;
; ClkDiv:U901|n2b~0                                                                                                                                     ; 1       ;
; ClkDiv:U901|n2k~0                                                                                                                                     ; 1       ;
; ClkDiv500:U902|n4~3                                                                                                                                   ; 1       ;
; ClkDiv500:U902|n4~2                                                                                                                                   ; 1       ;
; ClkDiv500:U902|n4~1                                                                                                                                   ; 1       ;
; ClkDiv500:U902|n4~0                                                                                                                                   ; 1       ;
; Configurable_U11:LED_Brightness_U11|n47~1                                                                                                             ; 1       ;
; Configurable_U11:LED_Brightness_U11|n47~0                                                                                                             ; 1       ;
; Configurable_U12:LED_Brightness_U12|n2u~0                                                                                                             ; 1       ;
; Configurable_U12:LED_Brightness_U12|n2x~0                                                                                                             ; 1       ;
; Configurable_U12:LED_Brightness_U12|n3a~0                                                                                                             ; 1       ;
; Configurable_U12:LED_Brightness_U12|Q_7_in~0                                                                                                          ; 1       ;
; Configurable_U12:LED_Brightness_U12|n3d                                                                                                               ; 1       ;
; Configurable_U12:LED_Brightness_U12|n2o~0                                                                                                             ; 1       ;
; Configurable_U12:LED_Brightness_U12|n2i~0                                                                                                             ; 1       ;
; Configurable_U12:LED_Brightness_U12|n2r~0                                                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|up_reg_r_0__Z                                             ; 1       ;
; ClkDiv:U901|n4                                                                                                                                        ; 1       ;
; ClkDiv:U901|n2e~2                                                                                                                                     ; 1       ;
; ClkDiv:U901|n2e~1                                                                                                                                     ; 1       ;
; ClkDiv:U901|n2e~0                                                                                                                                     ; 1       ;
; Configurable_U9:U9|LPM_ADD_7:i126|lpm_add_sub:lpm_add_sub_inst|add_sub_a8b:auto_generated|op_1~20                                                     ; 1       ;
; Configurable_U9:U9|LPM_ADD_7:i126|lpm_add_sub:lpm_add_sub_inst|add_sub_a8b:auto_generated|op_1~17                                                     ; 1       ;
; Configurable_U9:U9|LPM_ADD_7:i126|lpm_add_sub:lpm_add_sub_inst|add_sub_a8b:auto_generated|op_1~14                                                     ; 1       ;
; Configurable_U9:U9|LPM_ADD_7:i126|lpm_add_sub:lpm_add_sub_inst|add_sub_a8b:auto_generated|op_1~11                                                     ; 1       ;
; Configurable_U9:U9|LPM_ADD_7:i126|lpm_add_sub:lpm_add_sub_inst|add_sub_a8b:auto_generated|op_1~8                                                      ; 1       ;
; Configurable_U9:U9|LPM_ADD_7:i126|lpm_add_sub:lpm_add_sub_inst|add_sub_a8b:auto_generated|op_1~5                                                      ; 1       ;
; Configurable_U9:U9|LPM_ADD_7:i126|lpm_add_sub:lpm_add_sub_inst|add_sub_a8b:auto_generated|op_1~2                                                      ; 1       ;
; Configurable_U2:Deb02_U2|s_or8:n1l|OUT~1                                                                                                              ; 1       ;
; Configurable_U2:Deb02_U2|s_or8:n1l|OUT~0                                                                                                              ; 1       ;
; Configurable_U11:LED_Brightness_U11|PWM_in                                                                                                            ; 1       ;
; Configurable_U11:LED_Brightness_U11|s_or8:n2h|OUT~1                                                                                                   ; 1       ;
; Configurable_U11:LED_Brightness_U11|s_or8:n2h|OUT~0                                                                                                   ; 1       ;
; Configurable_U2:Deb01_U2|s_or8:n1l|OUT~1                                                                                                              ; 1       ;
; Configurable_U2:Deb01_U2|s_or8:n1l|OUT~0                                                                                                              ; 1       ;
; LED_R_7                                                                                                                                               ; 1       ;
; LED_R_6                                                                                                                                               ; 1       ;
; LED_R_5                                                                                                                                               ; 1       ;
; LED_R_4                                                                                                                                               ; 1       ;
; LED_R_3                                                                                                                                               ; 1       ;
; LED_R_2                                                                                                                                               ; 1       ;
; LED_R_1                                                                                                                                               ; 1       ;
; LED_R_0                                                                                                                                               ; 1       ;
; LED_G_7                                                                                                                                               ; 1       ;
; LED_G_6                                                                                                                                               ; 1       ;
; LED_G_5                                                                                                                                               ; 1       ;
; LED_G_4                                                                                                                                               ; 1       ;
; LED_G_3                                                                                                                                               ; 1       ;
; LED_G_2                                                                                                                                               ; 1       ;
; LED_G_1                                                                                                                                               ; 1       ;
; LED_G_0                                                                                                                                               ; 1       ;
; LED_B_7                                                                                                                                               ; 1       ;
; LED_B_6                                                                                                                                               ; 1       ;
; LED_B_5                                                                                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|la_status_Z                                                                                       ; 1       ;
; LED_B_4                                                                                                                                               ; 1       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_0_cout[8]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_0[8]                                                                                 ; 1       ;
; LAX_CFG8:U10_U1|N_1275_a2_0                                                                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_carry_6                                                                              ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_add6                                                                                 ; 1       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_0[7]                                                                                 ; 1       ;
; LAX_CFG8:U10_U1|N_1273_a2_0                                                                                                                           ; 1       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_add5                                                                                 ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_0_cout[6]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_0[6]                                                                                 ; 1       ;
; LAX_CFG8:U10_U1|N_1271_a2_0                                                                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_carry_4                                                                              ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_add4                                                                                 ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_0_cout[5]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_0[5]                                                                                 ; 1       ;
; LAX_CFG8:U10_U1|N_1269_a2_0                                                                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_carry_3                                                                              ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_add3                                                                                 ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_0_cout[4]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_0[4]                                                                                 ; 1       ;
; LAX_CFG8:U10_U1|N_1267_a2_0                                                                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_carry_2                                                                              ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_add2                                                                                 ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_0_cout[3]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_0[3]                                                                                 ; 1       ;
; LAX_CFG8:U10_U1|N_1265_a2_0                                                                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_carry_1                                                                              ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_add1                                                                                 ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_0_cout[2]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_0[2]                                                                                 ; 1       ;
; LAX_CFG8:U10_U1|N_1263_a2_0                                                                                                                           ; 1       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un5_startpos_add0                                                                                 ; 1       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|lt_2_4                                                                                            ; 1       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_condtrue_less_than_c_lower_2_1                                                                ; 1       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_2__Z                                                                                     ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_curevcnt_combout[4]                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_3__Z                                                                                     ; 1       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_4__Z                                                                                     ; 1       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_6__Z                                                                                     ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add20                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_19                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add19                                                                            ; 1       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add18                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_17                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add17                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_16                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add16                                                                            ; 1       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[1]                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[0]                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_state_nxt                                                                                     ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_15                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add15                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_14                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add14                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_13                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add13                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_12                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add12                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_11                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add11                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_10                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add10                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_9                                                                          ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add9                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_8                                                                          ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add8                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_7                                                                          ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add7                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_6                                                                          ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add6                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_5                                                                          ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add5                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_4                                                                          ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add4                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_3                                                                          ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add3                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_2                                                                          ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add2                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_1                                                                          ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add1                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_carry_0                                                                          ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_1_add0                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[20]                                                                        ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[19]                                                                        ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[18]                                                                        ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[17]                                                                        ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[16]                                                                        ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[15]                                                                        ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[14]                                                                        ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[13]                                                                        ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|cursor2end[7]                                                                                     ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[12]                                                                        ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[11]                                                                        ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|cursor2end[9]                                                                                     ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[10]                                                                        ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[9]                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[8]                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|cursor2end[12]                                                                                    ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[7]                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|cursor2end[13]                                                                                    ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[6]                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|cursor2end[14]                                                                                    ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un2_cursor2end_combout[5]                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m19                                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m7                                                                                                ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m7_0                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m9                                                                                                ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m17                                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m13                                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m13_0                                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m10                                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m12                                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m12_0                                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m20                                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m20_0                                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m11                                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m16                                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m16_0                                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m8                                                                                                ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|m5_e                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|bf_2_sqmuxa                                                                                       ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|bf_1_sqmuxa_1                                                                                     ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un43_state_nxt                                                                                    ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_4:U_SELREG|up_reg_3__Z                   ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_BUFFREG:U_BUFFREG|sh_reg_4__Z                                                  ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|buffregout_3__Z                                                                                 ; 1       ;
; memory_u10:U10_U2|altsyncram:altsyncram_component|altsyncram_h681:auto_generated|q_a[3]                                                               ; 1       ;
; memory_u10:U10_U2|altsyncram:altsyncram_component|altsyncram_h681:auto_generated|q_a[2]                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memdata_1__Z                                                                                      ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4_0[11]                                                                                   ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_combout[11]                                                                           ; 1       ;
; LAX_CFG8:U10_U1|N_1175_i                                                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|N_1175_i_0                                                                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_combout_10                                                                        ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_11__Z                                                                                  ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4_0[10]                                                                                   ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_combout[10]                                                                           ; 1       ;
; LAX_CFG8:U10_U1|N_1168_i                                                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|N_1168_i_0                                                                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_combout_9                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_10__Z                                                                                  ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4_0[9]                                                                                    ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_cout[9]                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_combout[9]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|N_1161_i                                                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|N_1161_i_0                                                                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_cout[9]                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_combout_8                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_9__Z                                                                                   ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4_0[8]                                                                                    ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_cout[8]                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_combout[8]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|N_1154_i                                                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|N_1154_i_0                                                                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_cout[8]                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_combout_7                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_8__Z                                                                                   ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4_0[7]                                                                                    ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_cout[7]                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_combout[7]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|N_1147_i                                                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|N_1147_i_0                                                                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_cout[7]                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_combout_6                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_7__Z                                                                                   ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4_0[6]                                                                                    ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_cout[6]                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_combout[6]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|N_1140_i                                                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|N_1140_i_0                                                                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_cout[6]                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_combout_5                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_6__Z                                                                                   ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4_0[5]                                                                                    ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_cout[5]                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_combout[5]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|N_1133_i                                                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|N_1133_i_0                                                                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_cout[5]                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_combout_4                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_5__Z                                                                                   ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4_0[4]                                                                                    ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_cout[4]                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_combout[4]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|N_1126_i                                                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|N_1126_i_0                                                                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_cout[4]                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_combout_3                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_4__Z                                                                                   ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4_0[3]                                                                                    ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_cout[3]                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_combout[3]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|N_1119_i                                                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|N_1119_i_0                                                                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_cout[3]                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_combout_2                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_3__Z                                                                                   ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4_0[2]                                                                                    ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_cout[2]                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_combout[2]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_cout[0]                                                                               ; 1       ;
; LAX_CFG8:U10_U1|N_1112_i                                                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|N_1112_i_0                                                                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_cout[2]                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_combout_1                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_cout[0]                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_2__Z                                                                                   ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4_0[1]                                                                                    ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_cout[1]                                                                               ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|un1_memaddr_combout[1]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|N_1105_i                                                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|N_1105_i_0                                                                                                                            ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_cout[1]                                                                           ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|un5_memrdaddr_combout_0                                                                         ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_1__Z                                                                                   ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4_0[0]                                                                                    ; 1       ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_DUMP:U_DUMP|dstate_ns_i_a4_x[1]                                                                             ; 1       ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_TAPCONTROLLER:U_TAP|LAX_CFG8_DRNOOUT:id_reg_unit|sh_reg_4__Z                   ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_12|lpm_ff:ff1|dffs[0]~1                                                                         ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_11|lpm_ff:ff1|dffs[0]~2                                                                         ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_11|lpm_ff:ff1|dffs[0]~1                                                                         ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_10|lpm_ff:ff1|dffs[0]~2                                                                         ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_10|lpm_ff:ff1|dffs[0]~1                                                                         ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_9|lpm_ff:ff1|dffs[0]~2                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_9|lpm_ff:ff1|dffs[0]~1                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_8|lpm_ff:ff1|dffs[0]~2                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_8|lpm_ff:ff1|dffs[0]~1                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_7|lpm_ff:ff1|dffs[0]~2                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_7|lpm_ff:ff1|dffs[0]~1                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_6|lpm_ff:ff1|dffs[0]~2                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_6|lpm_ff:ff1|dffs[0]~1                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_5|lpm_ff:ff1|dffs[0]~2                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_5|lpm_ff:ff1|dffs[0]~1                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_4|lpm_ff:ff1|dffs[0]~2                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_4|lpm_ff:ff1|dffs[0]~1                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_3|lpm_ff:ff1|dffs[0]~2                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_3|lpm_ff:ff1|dffs[0]~1                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_2|lpm_ff:ff1|dffs[0]~2                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_2|lpm_ff:ff1|dffs[0]~1                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_1|lpm_ff:ff1|dffs[0]~2                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_1|lpm_ff:ff1|dffs[0]~1                                                                          ; 1       ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:cnt_1|lpm_ff:ff1|dffs[0]                                                                            ; 1       ;
; LAX_CFG8:U10_U1|N_1243_i                                                                                                                              ; 1       ;
; LAX_CFG8:U10_U1|N_1243_i_m5                                                                                                                           ; 1       ;
+-------------------------------------------------------------------------------------------------------------------------------------------------------+---------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter RAM Summary                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                     ;
+---------------------------------------------------------------------------------------------+------+-------------+--------------+--------------+--------------+--------------+--------------+------------------------+-------------------------+------------------------+-------------------------+-------+-----------------------------+-----------------------------+-----------------------------+-----------------------------+---------------------+------+------+----------------------------------------------------------------+
; Name                                                                                        ; Type ; Mode        ; Clock Mode   ; Port A Depth ; Port A Width ; Port B Depth ; Port B Width ; Port A Input Registers ; Port A Output Registers ; Port B Input Registers ; Port B Output Registers ; Size  ; Implementation Port A Depth ; Implementation Port A Width ; Implementation Port B Depth ; Implementation Port B Width ; Implementation Bits ; M9Ks ; MIF  ; Location                                                       ;
+---------------------------------------------------------------------------------------------+------+-------------+--------------+--------------+--------------+--------------+--------------+------------------------+-------------------------+------------------------+-------------------------+-------+-----------------------------+-----------------------------+-----------------------------+-----------------------------+---------------------+------+------+----------------------------------------------------------------+
; memory_u10:U10_U2|altsyncram:altsyncram_component|altsyncram_h681:auto_generated|ALTSYNCRAM ; AUTO ; Single Port ; Single Clock ; 4096         ; 8            ; --           ; --           ; yes                    ; no                      ; --                     ; --                      ; 32768 ; 4096                        ; 8                           ; --                          ; --                          ; 32768               ; 4    ; None ; M9K_X40_Y20_N0, M9K_X40_Y21_N0, M9K_X40_Y23_N0, M9K_X40_Y22_N0 ;
+---------------------------------------------------------------------------------------------+------+-------------+--------------+--------------+--------------+--------------+--------------+------------------------+-------------------------+------------------------+-------------------------+-------+-----------------------------+-----------------------------+-----------------------------+-----------------------------+---------------------+------+------+----------------------------------------------------------------+
Note: Fitter may spread logical memories into multiple blocks to improve timing. The actual required RAM blocks can be found in the Fitter Resource Usage section.


+------------------------------------------------------+
; Interconnect Usage Summary                           ;
+----------------------------+-------------------------+
; Interconnect Resource Type ; Usage                   ;
+----------------------------+-------------------------+
; Block interconnects        ; 1,356 / 116,715 ( 1 % ) ;
; C16 interconnects          ; 70 / 3,886 ( 2 % )      ;
; C4 interconnects           ; 661 / 73,752 ( < 1 % )  ;
; Direct links               ; 351 / 116,715 ( < 1 % ) ;
; Global clocks              ; 6 / 20 ( 30 % )         ;
; Local interconnects        ; 419 / 39,600 ( 1 % )    ;
; R24 interconnects          ; 59 / 3,777 ( 2 % )      ;
; R4 interconnects           ; 747 / 99,858 ( < 1 % )  ;
+----------------------------+-------------------------+


+----------------------------------------------------------------------------+
; LAB Logic Elements                                                         ;
+---------------------------------------------+------------------------------+
; Number of Logic Elements  (Average = 10.47) ; Number of LABs  (Total = 81) ;
+---------------------------------------------+------------------------------+
; 1                                           ; 12                           ;
; 2                                           ; 5                            ;
; 3                                           ; 2                            ;
; 4                                           ; 0                            ;
; 5                                           ; 4                            ;
; 6                                           ; 1                            ;
; 7                                           ; 2                            ;
; 8                                           ; 4                            ;
; 9                                           ; 1                            ;
; 10                                          ; 4                            ;
; 11                                          ; 3                            ;
; 12                                          ; 2                            ;
; 13                                          ; 1                            ;
; 14                                          ; 3                            ;
; 15                                          ; 5                            ;
; 16                                          ; 32                           ;
+---------------------------------------------+------------------------------+


+-------------------------------------------------------------------+
; LAB-wide Signals                                                  ;
+------------------------------------+------------------------------+
; LAB-wide Signals  (Average = 2.22) ; Number of LABs  (Total = 81) ;
+------------------------------------+------------------------------+
; 1 Async. clear                     ; 15                           ;
; 1 Clock                            ; 63                           ;
; 1 Clock enable                     ; 36                           ;
; 1 Sync. clear                      ; 41                           ;
; 1 Sync. load                       ; 15                           ;
; 2 Clock enables                    ; 7                            ;
; 2 Clocks                           ; 3                            ;
+------------------------------------+------------------------------+


+-----------------------------------------------------------------------------+
; LAB Signals Sourced                                                         ;
+----------------------------------------------+------------------------------+
; Number of Signals Sourced  (Average = 14.96) ; Number of LABs  (Total = 81) ;
+----------------------------------------------+------------------------------+
; 0                                            ; 0                            ;
; 1                                            ; 10                           ;
; 2                                            ; 7                            ;
; 3                                            ; 0                            ;
; 4                                            ; 1                            ;
; 5                                            ; 4                            ;
; 6                                            ; 1                            ;
; 7                                            ; 1                            ;
; 8                                            ; 4                            ;
; 9                                            ; 0                            ;
; 10                                           ; 2                            ;
; 11                                           ; 1                            ;
; 12                                           ; 1                            ;
; 13                                           ; 0                            ;
; 14                                           ; 0                            ;
; 15                                           ; 2                            ;
; 16                                           ; 2                            ;
; 17                                           ; 4                            ;
; 18                                           ; 7                            ;
; 19                                           ; 3                            ;
; 20                                           ; 7                            ;
; 21                                           ; 1                            ;
; 22                                           ; 3                            ;
; 23                                           ; 2                            ;
; 24                                           ; 4                            ;
; 25                                           ; 2                            ;
; 26                                           ; 2                            ;
; 27                                           ; 2                            ;
; 28                                           ; 3                            ;
; 29                                           ; 0                            ;
; 30                                           ; 2                            ;
; 31                                           ; 2                            ;
; 32                                           ; 1                            ;
+----------------------------------------------+------------------------------+


+--------------------------------------------------------------------------------+
; LAB Signals Sourced Out                                                        ;
+-------------------------------------------------+------------------------------+
; Number of Signals Sourced Out  (Average = 8.07) ; Number of LABs  (Total = 81) ;
+-------------------------------------------------+------------------------------+
; 0                                               ; 0                            ;
; 1                                               ; 12                           ;
; 2                                               ; 8                            ;
; 3                                               ; 3                            ;
; 4                                               ; 2                            ;
; 5                                               ; 4                            ;
; 6                                               ; 2                            ;
; 7                                               ; 6                            ;
; 8                                               ; 6                            ;
; 9                                               ; 3                            ;
; 10                                              ; 6                            ;
; 11                                              ; 7                            ;
; 12                                              ; 3                            ;
; 13                                              ; 5                            ;
; 14                                              ; 3                            ;
; 15                                              ; 5                            ;
; 16                                              ; 3                            ;
; 17                                              ; 1                            ;
; 18                                              ; 0                            ;
; 19                                              ; 0                            ;
; 20                                              ; 2                            ;
+-------------------------------------------------+------------------------------+


+-----------------------------------------------------------------------------+
; LAB Distinct Inputs                                                         ;
+----------------------------------------------+------------------------------+
; Number of Distinct Inputs  (Average = 14.35) ; Number of LABs  (Total = 81) ;
+----------------------------------------------+------------------------------+
; 0                                            ; 0                            ;
; 1                                            ; 4                            ;
; 2                                            ; 5                            ;
; 3                                            ; 5                            ;
; 4                                            ; 8                            ;
; 5                                            ; 3                            ;
; 6                                            ; 1                            ;
; 7                                            ; 1                            ;
; 8                                            ; 1                            ;
; 9                                            ; 1                            ;
; 10                                           ; 2                            ;
; 11                                           ; 1                            ;
; 12                                           ; 5                            ;
; 13                                           ; 0                            ;
; 14                                           ; 2                            ;
; 15                                           ; 5                            ;
; 16                                           ; 3                            ;
; 17                                           ; 4                            ;
; 18                                           ; 1                            ;
; 19                                           ; 2                            ;
; 20                                           ; 2                            ;
; 21                                           ; 3                            ;
; 22                                           ; 4                            ;
; 23                                           ; 1                            ;
; 24                                           ; 5                            ;
; 25                                           ; 1                            ;
; 26                                           ; 0                            ;
; 27                                           ; 0                            ;
; 28                                           ; 3                            ;
; 29                                           ; 2                            ;
; 30                                           ; 3                            ;
; 31                                           ; 0                            ;
; 32                                           ; 0                            ;
; 33                                           ; 3                            ;
+----------------------------------------------+------------------------------+


+------------------------------------------+
; I/O Rules Summary                        ;
+----------------------------------+-------+
; I/O Rules Statistic              ; Total ;
+----------------------------------+-------+
; Total I/O Rules                  ; 30    ;
; Number of I/O Rules Passed       ; 12    ;
; Number of I/O Rules Failed       ; 0     ;
; Number of I/O Rules Unchecked    ; 0     ;
; Number of I/O Rules Inapplicable ; 18    ;
+----------------------------------+-------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; I/O Rules Details                                                                                                                                                                                                                                                                                   ;
+--------------+-----------+-----------------------------------+------------------------------------------------------------------------------------------------------+----------+--------------------------------------------------------------------------+---------------------+-------------------+
; Status       ; ID        ; Category                          ; Rule Description                                                                                     ; Severity ; Information                                                              ; Area                ; Extra Information ;
+--------------+-----------+-----------------------------------+------------------------------------------------------------------------------------------------------+----------+--------------------------------------------------------------------------+---------------------+-------------------+
; Pass         ; IO_000001 ; Capacity Checks                   ; Number of pins in an I/O bank should not exceed the number of locations available.                   ; Critical ; 0 such failures found.                                                   ; I/O                 ;                   ;
; Inapplicable ; IO_000002 ; Capacity Checks                   ; Number of clocks in an I/O bank should not exceed the number of clocks available.                    ; Critical ; No Global Signal assignments found.                                      ; I/O                 ;                   ;
; Pass         ; IO_000003 ; Capacity Checks                   ; Number of pins in a Vrefgroup should not exceed the number of locations available.                   ; Critical ; 0 such failures found.                                                   ; I/O                 ;                   ;
; Inapplicable ; IO_000004 ; Voltage Compatibility Checks      ; The I/O bank should support the requested VCCIO.                                                     ; Critical ; No IOBANK_VCCIO assignments found.                                       ; I/O                 ;                   ;
; Inapplicable ; IO_000005 ; Voltage Compatibility Checks      ; The I/O bank should not have competing VREF values.                                                  ; Critical ; No VREF I/O Standard assignments found.                                  ; I/O                 ;                   ;
; Pass         ; IO_000006 ; Voltage Compatibility Checks      ; The I/O bank should not have competing VCCIO values.                                                 ; Critical ; 0 such failures found.                                                   ; I/O                 ;                   ;
; Pass         ; IO_000007 ; Valid Location Checks             ; Checks for unavailable locations.                                                                    ; Critical ; 0 such failures found.                                                   ; I/O                 ;                   ;
; Inapplicable ; IO_000008 ; Valid Location Checks             ; Checks for reserved locations.                                                                       ; Critical ; No reserved LogicLock region found.                                      ; I/O                 ;                   ;
; Pass         ; IO_000009 ; I/O Properties Checks for One I/O ; The location should support the requested I/O standard.                                              ; Critical ; 0 such failures found.                                                   ; I/O                 ;                   ;
; Pass         ; IO_000010 ; I/O Properties Checks for One I/O ; The location should support the requested I/O direction.                                             ; Critical ; 0 such failures found.                                                   ; I/O                 ;                   ;
; Inapplicable ; IO_000011 ; I/O Properties Checks for One I/O ; The location should support the requested Current Strength.                                          ; Critical ; No Current Strength assignments found.                                   ; I/O                 ;                   ;
; Pass         ; IO_000012 ; I/O Properties Checks for One I/O ; The location should support the requested On Chip Termination value.                                 ; Critical ; 0 such failures found.                                                   ; I/O                 ;                   ;
; Inapplicable ; IO_000013 ; I/O Properties Checks for One I/O ; The location should support the requested Bus Hold value.                                            ; Critical ; No Enable Bus-Hold Circuitry assignments found.                          ; I/O                 ;                   ;
; Inapplicable ; IO_000014 ; I/O Properties Checks for One I/O ; The location should support the requested Weak Pull Up value.                                        ; Critical ; No Weak Pull-Up Resistor assignments found.                              ; I/O                 ;                   ;
; Pass         ; IO_000015 ; I/O Properties Checks for One I/O ; The location should support the requested PCI Clamp Diode.                                           ; Critical ; 0 such failures found.                                                   ; I/O                 ;                   ;
; Inapplicable ; IO_000018 ; I/O Properties Checks for One I/O ; The I/O standard should support the requested Current Strength.                                      ; Critical ; No Current Strength assignments found.                                   ; I/O                 ;                   ;
; Pass         ; IO_000019 ; I/O Properties Checks for One I/O ; The I/O standard should support the requested On Chip Termination value.                             ; Critical ; 0 such failures found.                                                   ; I/O                 ;                   ;
; Pass         ; IO_000020 ; I/O Properties Checks for One I/O ; The I/O standard should support the requested PCI Clamp Diode.                                       ; Critical ; 0 such failures found.                                                   ; I/O                 ;                   ;
; Inapplicable ; IO_000021 ; I/O Properties Checks for One I/O ; The I/O standard should support the requested Weak Pull Up value.                                    ; Critical ; No Weak Pull-Up Resistor assignments found.                              ; I/O                 ;                   ;
; Inapplicable ; IO_000022 ; I/O Properties Checks for One I/O ; The I/O standard should support the requested Bus Hold value.                                        ; Critical ; No Enable Bus-Hold Circuitry assignments found.                          ; I/O                 ;                   ;
; Inapplicable ; IO_000023 ; I/O Properties Checks for One I/O ; The I/O standard should support the Open Drain value.                                                ; Critical ; No open drain assignments found.                                         ; I/O                 ;                   ;
; Pass         ; IO_000024 ; I/O Properties Checks for One I/O ; The I/O direction should support the On Chip Termination value.                                      ; Critical ; 0 such failures found.                                                   ; I/O                 ;                   ;
; Inapplicable ; IO_000026 ; I/O Properties Checks for One I/O ; On Chip Termination and Current Strength should not be used at the same time.                        ; Critical ; No Current Strength assignments found.                                   ; I/O                 ;                   ;
; Inapplicable ; IO_000027 ; I/O Properties Checks for One I/O ; Weak Pull Up and Bus Hold should not be used at the same time.                                       ; Critical ; No Enable Bus-Hold Circuitry or Weak Pull-Up Resistor assignments found. ; I/O                 ;                   ;
; Inapplicable ; IO_000045 ; I/O Properties Checks for One I/O ; The I/O standard should support the requested Slew Rate value.                                       ; Critical ; No Slew Rate assignments found.                                          ; I/O                 ;                   ;
; Inapplicable ; IO_000046 ; I/O Properties Checks for One I/O ; The location should support the requested Slew Rate value.                                           ; Critical ; No Slew Rate assignments found.                                          ; I/O                 ;                   ;
; Inapplicable ; IO_000047 ; I/O Properties Checks for One I/O ; On Chip Termination and Slew Rate should not be used at the same time.                               ; Critical ; No Slew Rate assignments found.                                          ; I/O                 ;                   ;
; Pass         ; IO_000033 ; Electromigration Checks           ; Current density for consecutive I/Os should not exceed 240mA for row I/Os and 240mA for column I/Os. ; Critical ; 0 such failures found.                                                   ; I/O                 ;                   ;
; Inapplicable ; IO_000034 ; SI Related Distance Checks        ; Single-ended outputs should be 5 LAB row(s) away from a differential I/O.                            ; High     ; No Differential I/O Standard assignments found.                          ; I/O                 ;                   ;
; Inapplicable ; IO_000042 ; SI Related SSO Limit Checks       ; No more than 20 outputs are allowed in a VREF group when VREF is being read from.                    ; High     ; No VREF I/O Standard assignments found.                                  ; I/O                 ;                   ;
; ----         ; ----      ; Disclaimer                        ; OCT rules are checked but not reported.                                                              ; None     ; ----                                                                     ; On Chip Termination ;                   ;
+--------------+-----------+-----------------------------------+------------------------------------------------------------------------------------------------------+----------+--------------------------------------------------------------------------+---------------------+-------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; I/O Rules Matrix                                                                                                                                                                                                                                                                                                                                                                                                                                                ;
+--------------------+-----------+--------------+-----------+--------------+--------------+-----------+-----------+--------------+-----------+-----------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+-----------+--------------+--------------+
; Pin/Rules          ; IO_000001 ; IO_000002    ; IO_000003 ; IO_000004    ; IO_000005    ; IO_000006 ; IO_000007 ; IO_000008    ; IO_000009 ; IO_000010 ; IO_000011    ; IO_000012    ; IO_000013    ; IO_000014    ; IO_000015    ; IO_000018    ; IO_000019    ; IO_000020    ; IO_000021    ; IO_000022    ; IO_000023    ; IO_000024    ; IO_000026    ; IO_000027    ; IO_000045    ; IO_000046    ; IO_000047    ; IO_000033 ; IO_000034    ; IO_000042    ;
+--------------------+-----------+--------------+-----------+--------------+--------------+-----------+-----------+--------------+-----------+-----------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+-----------+--------------+--------------+
; Total Pass         ; 82        ; 0            ; 82        ; 0            ; 0            ; 82        ; 82        ; 0            ; 82        ; 82        ; 0            ; 47           ; 0            ; 0            ; 35           ; 0            ; 47           ; 35           ; 0            ; 0            ; 0            ; 47           ; 0            ; 0            ; 0            ; 0            ; 0            ; 82        ; 0            ; 0            ;
; Total Unchecked    ; 0         ; 0            ; 0         ; 0            ; 0            ; 0         ; 0         ; 0            ; 0         ; 0         ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0         ; 0            ; 0            ;
; Total Inapplicable ; 0         ; 82           ; 0         ; 82           ; 82           ; 0         ; 0         ; 82           ; 0         ; 0         ; 82           ; 35           ; 82           ; 82           ; 47           ; 82           ; 35           ; 47           ; 82           ; 82           ; 82           ; 35           ; 82           ; 82           ; 82           ; 82           ; 82           ; 0         ; 82           ; 82           ;
; Total Fail         ; 0         ; 0            ; 0         ; 0            ; 0            ; 0         ; 0         ; 0            ; 0         ; 0         ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0            ; 0         ; 0            ; 0            ;
; HA[2]              ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
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; SW[7]              ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; CLK_BRD            ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SW_USER1           ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
; SW_USER2           ; Pass      ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Pass      ; Pass      ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Pass         ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Inapplicable ; Pass      ; Inapplicable ; Inapplicable ;
+--------------------+-----------+--------------+-----------+--------------+--------------+-----------+-----------+--------------+-----------+-----------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+--------------+-----------+--------------+--------------+


+----------------------------------------------------------------------------------------+
; Fitter Device Options                                                                  ;
+------------------------------------------------------------------+---------------------+
; Option                                                           ; Setting             ;
+------------------------------------------------------------------+---------------------+
; Enable user-supplied start-up clock (CLKUSR)                     ; Off                 ;
; Enable device-wide reset (DEV_CLRn)                              ; Off                 ;
; Enable device-wide output enable (DEV_OE)                        ; Off                 ;
; Enable INIT_DONE output                                          ; Off                 ;
; Configuration scheme                                             ; Passive Serial      ;
; Error detection CRC                                              ; Off                 ;
; Enable open drain on CRC_ERROR pin                               ; Off                 ;
; Enable input tri-state on active configuration pins in user mode ; Off                 ;
; Configuration Voltage Level                                      ; Auto                ;
; Force Configuration Voltage Level                                ; Off                 ;
; nCEO                                                             ; Unreserved          ;
; Data[0]                                                          ; As input tri-stated ;
; Data[1]/ASDO                                                     ; As input tri-stated ;
; Data[7..2]                                                       ; Unreserved          ;
; FLASH_nCE/nCSO                                                   ; As input tri-stated ;
; Other Active Parallel pins                                       ; Unreserved          ;
; DCLK                                                             ; As input tri-stated ;
; Base pin-out file on sameframe device                            ; Off                 ;
+------------------------------------------------------------------+---------------------+


+------------------------------------+
; Operating Settings and Conditions  ;
+---------------------------+--------+
; Setting                   ; Value  ;
+---------------------------+--------+
; Nominal Core Voltage      ; 1.20 V ;
; Low Junction Temperature  ; 0 °C   ;
; High Junction Temperature ; 85 °C  ;
+---------------------------+--------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Estimated Delay Added for Hold Timing Summary                                                                                                                                              ;
+-------------------------------------------------------------------------------+----------------------------------------------------------------------------------------+-------------------+
; Source Clock(s)                                                               ; Destination Clock(s)                                                                   ; Delay Added in ns ;
+-------------------------------------------------------------------------------+----------------------------------------------------------------------------------------+-------------------+
; SW_USER2                                                                      ; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0],SW_USER3 ; 20.6              ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0] ; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0]          ; 3.8               ;
; JTAG_NEXUS_TCK                                                                ; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0]       ; 2.3               ;
+-------------------------------------------------------------------------------+----------------------------------------------------------------------------------------+-------------------+
Note: For more information on problematic transfers, consider running the Fitter again with the Optimize hold timing option (Settings Menu) turned off.
This will disable optimization of problematic paths and expose them for further analysis using either the TimeQuest Timing Analyzer or the Classic Timing Analyzer.


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Estimated Delay Added for Hold Timing Details                                                                                                                                                                                                                                ;
+---------------------------------------------------------------------------------------------------------------------------------------+------------------------------------------------------------------------------------------------------------------+-------------------+
; Source Register                                                                                                                       ; Destination Register                                                                                             ; Delay Added in ns ;
+---------------------------------------------------------------------------------------------------------------------------------------+------------------------------------------------------------------------------------------------------------------+-------------------+
; JTAG_NEXUS_TCK                                                                                                                        ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|tck1_Z                                                                          ; 2.511             ;
; ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0]                                                         ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|channels_shadow0_cap_2__Z                                    ; 2.492             ;
; Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                                             ; Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]                        ; 2.392             ;
; SW_USER4                                                                                                                              ; Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]                        ; 2.392             ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                                  ; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:INST_PWM|lpm_ff:ff1|dffs[0]               ; 2.197             ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0]                                                      ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|clken_ff_Z                                                                      ; 1.885             ;
; ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0]                                                      ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|channels_shadow0_trig_3__Z                                   ; 1.861             ;
; SW_USER4                                                                                                                              ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|channels_shadow0_cap_0__Z                                    ; 1.550             ;
; SW_USER4                                                                                                                              ; Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]                        ; 1.474             ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_5|lpm_ff:ff1|dffs[0]                                  ; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:INST_PWM|lpm_ff:ff1|dffs[0]               ; 1.292             ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]                                  ; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:INST_PWM|lpm_ff:ff1|dffs[0]               ; 1.207             ;
; SW_USER3                                                                                                                              ; Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]                        ; 1.180             ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_3|lpm_ff:ff1|dffs[0]                                  ; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:INST_PWM|lpm_ff:ff1|dffs[0]               ; 1.146             ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_4|lpm_ff:ff1|dffs[0]                                  ; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:INST_PWM|lpm_ff:ff1|dffs[0]               ; 1.056             ;
; Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                                             ; Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]                        ; 1.023             ;
; SW_USER3                                                                                                                              ; Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]                        ; 1.023             ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_2|lpm_ff:ff1|dffs[0]                                  ; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:INST_PWM|lpm_ff:ff1|dffs[0]               ; 0.955             ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_1|lpm_ff:ff1|dffs[0]                                  ; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:INST_PWM|lpm_ff:ff1|dffs[0]               ; 0.950             ;
; Configurable_U12:LED_Brightness_U12|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]                                  ; Configurable_U11:LED_Brightness_U11|Epson__AltSyn_AltiumAlteraDffAsync:INST_PWM|lpm_ff:ff1|dffs[0]               ; 0.755             ;
; Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                                             ; Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]                              ; 0.557             ;
; SW_USER3                                                                                                                              ; Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]                              ; 0.557             ;
; SW_USER3                                                                                                                              ; Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                        ; 0.553             ;
; Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]                                             ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|channels_shadow0_cap_1__Z                                    ; 0.488             ;
; SW_USER4                                                                                                                              ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|channels_shadow0_cap_1__Z                                    ; 0.488             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_3:U_ECNTREG|up_reg_0__Z  ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_1__Z                                            ; 0.483             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_3:U_ECNTREG|up_reg_0__Z  ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_0__Z                                            ; 0.483             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_3:U_ECNTREG|up_reg_0__Z  ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_3__Z                                            ; 0.483             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_3:U_ECNTREG|up_reg_0__Z  ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_2__Z                                            ; 0.483             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_3:U_ECNTREG|up_reg_0__Z  ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_4__Z                                            ; 0.483             ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_3:U_ECNTREG|up_reg_0__Z  ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_7__Z                                            ; 0.483             ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CFGREG:U_CFGREG|up_reg_3__Z      ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|cursormask_18__Z                                             ; 0.047             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CFGREG:U_CFGREG|up_reg_3__Z      ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|cursormask_9__Z                                              ; 0.046             ;
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; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CFGREG:U_CFGREG|up_reg_4__Z      ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|cursormask_8__Z                                              ; 0.045             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|state_0__Z                                                                        ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_7__Z                                            ; 0.044             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|state_1__Z                                                                        ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_7__Z                                            ; 0.044             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ2_3:U_ECNTREG|up_reg_7__Z  ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_7__Z                                            ; 0.044             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_7__Z                                                                     ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|curevcnt_nxt_7__Z                                            ; 0.044             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CFGREG:U_CFGREG|up_reg_2__Z      ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|cursormask_10__Z                                             ; 0.041             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_CFGREG:U_CFGREG|up_reg_2__Z      ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|cursormask_9__Z                                              ; 0.041             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|up_reg_0__Z  ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_4__Z                                              ; 0.036             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|up_reg_3__Z  ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_4__Z                                              ; 0.036             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|up_reg_2__Z  ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_4__Z                                              ; 0.036             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_LA16PORT:U_LA16PORT|LAX_CFG8_NXMODULE:U_NX_MODULE|LAX_CFG8_NXREGZ1:U_CURSORREG|up_reg_1__Z  ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_4__Z                                              ; 0.036             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_1__Z                                                                      ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_4__Z                                              ; 0.036             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_0__Z                                                                      ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_4__Z                                              ; 0.036             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_3__Z                                                                      ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_4__Z                                              ; 0.036             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_2__Z                                                                      ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_4__Z                                              ; 0.036             ;
; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|memaddr_4__Z                                                                      ; LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|startpos_1_4__Z                                              ; 0.036             ;
+---------------------------------------------------------------------------------------------------------------------------------------+------------------------------------------------------------------------------------------------------------------+-------------------+


+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II 32-bit Fitter
    Info: Version 12.0 Build 178 05/31/2012 SJ Web Edition
    Info: Copyright (C) 1991-2012 Altera Corporation. All rights reserved.
    Info: Your use of Altera Corporation's design tools, logic functions 
    Info: and other software and tools, and its AMPP partner logic 
    Info: functions, and any output files from any of the foregoing 
    Info: (including device programming or simulation files), and any 
    Info: associated documentation or information are expressly subject 
    Info: to the terms and conditions of the Altera Program License 
    Info: Subscription Agreement, Altera MegaCore Function License 
    Info: Agreement, or other applicable license agreement, including, 
    Info: without limitation, that your use is for the sole purpose of 
    Info: programming logic devices manufactured by Altera and sold by 
    Info: Altera or its authorized distributors.  Please refer to the 
    Info: applicable agreement for further details.
    Info: Processing started: Mon Oct 15 23:32:07 2012
Info: Command: quartus_fit Epson
Warning (20028): Parallel compilation is not licensed and has been disabled
Info (119006): Selected device EP3C40F780C8 for design "Epson"
Info (21076): High junction temperature operating condition is not set. Assuming a default value of '85'.
Info (21076): Low junction temperature operating condition is not set. Assuming a default value of '0'.
Info (171003): Fitter is performing an Auto Fit compilation, which may decrease Fitter effort to reduce compilation time
Warning (292013): Feature LogicLock is only available with a valid subscription license. You can purchase a software subscription to gain full access to this feature.
Info (176444): Device migration not selected. If you intend to use device migration later, you may need to change the pin assignments as they may be incompatible with other devices
    Info (176445): Device EP3C55F780C8 is compatible
    Info (176445): Device EP3C80F780C8 is compatible
    Info (176445): Device EP3C120F780C8 is compatible
Info (169124): Fitter converted 4 user pins into dedicated programming pins
    Info (169125): Pin ~ALTERA_ASDO_DATA1~ is reserved at location F4
    Info (169125): Pin ~ALTERA_FLASH_nCE_nCSO~ is reserved at location E2
    Info (169125): Pin ~ALTERA_DCLK~ is reserved at location P3
    Info (169125): Pin ~ALTERA_DATA0~ is reserved at location N7
Warning (15714): Some pins have incomplete I/O assignments. Refer to the I/O Assignment Warnings report for details
Info (176045): Design uses memory blocks. Violating setup or hold times of memory block address registers for either read or write operations could cause memory contents to be corrupted. Make sure that all memory block address registers meet the setup and hold time requirements.
Info (332104): Reading SDC File: 'Epson_sta.SDC'
Info (332144): No user constrained base clocks found in the design
Info (332143): No user constrained clock uncertainty found in the design. Calling "derive_clock_uncertainty"
Info (332123): Deriving Clock Uncertainty. Please refer to report_sdc in TimeQuest to see clock uncertainties.
Info (332130): Timing requirements not specified -- quality metrics such as performance may be sacrificed to reduce compilation time.
Info (176353): Automatically promoted node ClkDiv500:U902|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0] 
    Info (176355): Automatically promoted destinations to use location or clock signal Global Clock
    Info (176356): Following destination nodes may be non-global or may not use global or regional clocks
        Info (176357): Destination node LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|clken_ff_0_x_cZ
        Info (176357): Destination node LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|state_nxt_1_sqmuxa_2_cZ
        Info (176357): Destination node LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|channels_shadow0_trig_3__Z
Info (176353): Automatically promoted node JTAG_NEXUS_TCK~input (placed in PIN Y27 (CLK6, DIFFCLK_3p))
    Info (176355): Automatically promoted destinations to use location or clock signal Global Clock CLKCTRL_G9
    Info (176356): Following destination nodes may be non-global or may not use global or regional clocks
        Info (176357): Destination node LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|tck1_Z
Info (176353): Automatically promoted node CLK_BRD~input (placed in PIN A14 (CLK10, DIFFCLK_4n))
    Info (176355): Automatically promoted destinations to use location or clock signal Global Clock CLKCTRL_G14
Info (176353): Automatically promoted node ClkDiv:U901|Epson__AltSyn_AltiumAlteraDffAsync:INST_CLKOUT|lpm_ff:ff1|dffs[0] 
    Info (176355): Automatically promoted destinations to use location or clock signal Global Clock
    Info (176356): Following destination nodes may be non-global or may not use global or regional clocks
        Info (176357): Destination node LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|channels_shadow0_cap_2__Z
        Info (176357): Destination node Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]
Info (176353): Automatically promoted node AND2S:Deb02_U4|O 
    Info (176355): Automatically promoted destinations to use location or clock signal Global Clock
    Info (176356): Following destination nodes may be non-global or may not use global or regional clocks
        Info (176357): Destination node Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_1|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_2|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_3|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_4|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_5|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U9:U9|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U2:Deb02_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]
        Info (176358): Non-global destination nodes limited to 10 nodes
Info (176353): Automatically promoted node AND2S:Deb01_U4|O 
    Info (176355): Automatically promoted destinations to use location or clock signal Global Clock
    Info (176356): Following destination nodes may be non-global or may not use global or regional clocks
        Info (176357): Destination node Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_7|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_6|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_5|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_4|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_3|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_2|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_1|lpm_ff:ff1|dffs[0]
        Info (176357): Destination node LAX_CFG8:U10_U1|LAX_CFG8_LA16:U1|LAX_CFG8_FSM:U_FSM|channels_shadow0_cap_1__Z
        Info (176357): Destination node LED_B_7
        Info (176357): Destination node Configurable_U2:Deb01_U2|Epson__AltSyn_AltiumAlteraDffAsyncEn:INST_Q_0|lpm_ff:ff1|dffs[0]
        Info (176358): Non-global destination nodes limited to 10 nodes
Info (176233): Starting register packing
Extra Info (176273): Performing register packing on registers with non-logic cell location assignments
Extra Info (176274): Completed register packing on registers with non-logic cell location assignments
Extra Info (176236): Started Fast Input/Output/OE register processing
Extra Info (176237): Finished Fast Input/Output/OE register processing
Extra Info (176248): Moving registers into I/O cells, Multiplier Blocks, and RAM blocks to improve timing and density
Extra Info (176249): Finished moving registers into I/O cells, Multiplier Blocks, and RAM blocks
Info (176235): Finished register packing
    Extra Info (176219): No registers were packed into other blocks
Info (171121): Fitter preparation operations ending: elapsed time is 00:00:07
Info (170189): Fitter placement preparation operations beginning
Info (170190): Fitter placement preparation operations ending: elapsed time is 00:00:01
Info (170191): Fitter placement operations beginning
Info (170137): Fitter placement was successful
Info (170192): Fitter placement operations ending: elapsed time is 00:00:04
Info (170193): Fitter routing operations beginning
Info (170195): Router estimated average interconnect usage is 0% of the available device resources
    Info (170196): Router estimated peak interconnect usage is 4% of the available device resources in the region that extends from location X34_Y11 to location X44_Y21
Info (170194): Fitter routing operations ending: elapsed time is 00:00:05
Info (170199): The Fitter performed an Auto Fit compilation.  Optimizations were skipped to reduce compilation time.
    Info (170201): Optimizations that may affect the design's routability were skipped
Info (334003): Started post-fitting delay annotation
Info (334004): Delay annotation completed successfully
Info (334003): Started post-fitting delay annotation
Info (334004): Delay annotation completed successfully
Info: Quartus II 32-bit Fitter was successful. 0 errors, 3 warnings
    Info: Peak virtual memory: 432 megabytes
    Info: Processing ended: Mon Oct 15 23:32:51 2012
    Info: Elapsed time: 00:00:44
    Info: Total CPU time (on all processors): 00:00:29


